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JPH0425549B2 - - Google Patents
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JPH0425549B2 - - Google Patents

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JPH0425549B2
JPH0425549B2 JP20952182A JP20952182A JPH0425549B2 JP H0425549 B2 JPH0425549 B2 JP H0425549B2 JP 20952182 A JP20952182 A JP 20952182A JP 20952182 A JP20952182 A JP 20952182A JP H0425549 B2 JPH0425549 B2 JP H0425549B2
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JP
Japan
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display
address
data
logic processing
display elements
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Application number
JP20952182A
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Japanese (ja)
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JPS59100496A (en
Inventor
Masaki Nohayashi
Yoichi Isobe
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Panasonic Electric Works Co Ltd
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Matsushita Electric Works Ltd
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Publication date
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  • Digital Computer Display Output (AREA)
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Description

【発明の詳細な説明】 本発明は、集中操作盤から制御される多数の表
示素子を平面的に列設した表示装置に関するもの
である。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a display device in which a large number of display elements controlled from a central operation panel are arranged in a plane.

従来、この種の表示装置Aとして第1図に示す
ように、ランプの前面に番号表示板を配設した多
数の表示素子11,12……を平面的に列設し、集
中操作盤からのスイツチ操作にて表示素子11
2……を点灯あるいは消灯するようにしたもの
があつた。しかしながら、この従来例において
は、各表示素子11,12……と集中操作盤のスイ
ツチとを直接対応(1:1対応)させるように配
線しており、表示素子11,12……の数が増える
と配線数も増加する上、スイツチ数も増加するの
で表示素子11,12……の増設が容易にできない
という問題があつた。本発明は上記の点に鑑みて
為されたものであり、その目的とするところは、
表示素子の増設が容易にでき、しかも各表示素子
に対応する個有アドレスを設定するアドレス設定
部の構成が簡単でかつアドレス設定操作が簡便な
表示装置を提供することにある。
Conventionally, as shown in FIG. 1, this type of display device A has a large number of display elements 1 1 , 1 2 . Display element 1 1 by switch operation from
1 2 There was something that turned on or off... However, in this conventional example, each display element 1 1 , 1 2 . . . and the switch on the central operation panel are wired in direct correspondence ( 1 : 1 correspondence). As the number of... increases, the number of wiring also increases, and the number of switches also increases, so there is a problem that it is not easy to add display elements 1 1 , 1 2 , etc. The present invention has been made in view of the above points, and its purpose is to:
To provide a display device in which display elements can be easily added, an address setting section for setting a unique address corresponding to each display element has a simple configuration, and address setting operation is simple.

以下、実施例について図を用いて説明する。第
2図乃至第4図は本発明の基本構成を示すもの
で、集中操作盤B1,B2と表示装置Aとが商用電
源ACの電源線lを介して接続され、集中操作盤
B1,B2と表示装置Aとの間のデータの送受信は
高周波信号を商用電源ACの重畳して伝送する電
力線搬送方式にて行なわれる。第3図は表示装置
Aの基本ユニツトを示すもので、10は信号処理
部であり、集中操作盤B1,B2から電源線lを介
して送られる伝送信号VSを受信して復調すると
ともに集中操作盤B1,B2に返送するデータにて
搬送波を変調して返送信号VBを形成する変復調
回路11と、商用電源ACのゼロクロス点に同期
したゼロクロス信号VZを出力する同期信号発生
回路12とで構成されている。13は論理処理部
であり、受信された伝送信号VSにて伝送された
アドレスデータADがアドレス設定部14′にて
予め設定された個有アドレスと一致したときその
アドレスデータADに続いて伝送される表示制御
データCDを取込んで表示素子1の表示モードを
制御する連続点灯信号VCあるいは点滅点灯信号
VFを形成して表示ドライブ部15に送るととも
に、集中操作盤B1,B2に送るべきデータを作成
して変復調回路12に送るようになつている。表
示ドライブ部15はゼロクロス信号VZをカウン
トして点滅クロツクVCLを発生するクロツク発生
器CLとアンド回路ANDと逆流阻止用ダイオード
D1,D2とスイツチングトランジスタQとで形成
され、連続点灯信号VCが入力されたとき表示素
子1を連続点灯し、点滅点灯信号VFが入力され
たとき点滅クロツクVCLの周期で表示素子1を点
滅し、両信号VC,VFが共に入力されなかつたと
き表示素子1を消灯するようになつている。第4
図は集中操作盤B1,B2を示すもので、ケース3
0の上面に設けられたキーボード31によつて表
示モードを変更させる表示素子11,12……の番
号および表示モード(点灯、点滅、消灯)を入力
するようになつており、入力されたデータは直ち
に表示装置Aに電力線搬送にて送られ、表示装置
Aでは対応する表示素子11,12……の表示モー
ドが変更される。図中32はキー入力データ表示
部、33は各表示素子11,12……に対応する発
光ダイオードよりなる確認ランプ331,332
…よりなる動作表示部である。
Examples will be described below using figures. Figures 2 to 4 show the basic configuration of the present invention, in which centralized operation panels B 1 and B 2 and display device A are connected via a power line l of a commercial power source AC.
Transmission and reception of data between B 1 and B 2 and display device A is performed using a power line carrier method in which high frequency signals are transmitted by superimposing commercial power supply AC. Figure 3 shows the basic unit of the display device A, where 10 is a signal processing section that receives and demodulates the transmission signal V S sent from the central operation panels B 1 and B 2 via the power line l. and a modulation/demodulation circuit 11 that modulates a carrier wave with data sent back to the central operation panels B 1 and B 2 to form a return signal V B , and a synchronization signal that outputs a zero cross signal V Z synchronized with the zero cross point of the commercial power supply AC. It is composed of a generating circuit 12. 13 is a logic processing unit which, when the address data AD transmitted by the received transmission signal V S matches the unique address preset by the address setting unit 14', transmits the address data AD following that address data AD. A continuous lighting signal V C or a blinking lighting signal that takes in the display control data CD to control the display mode of the display element 1.
V F is formed and sent to the display drive unit 15, and data to be sent to the central operation panels B 1 and B 2 is created and sent to the modulation/demodulation circuit 12. The display drive section 15 includes a clock generator CL that counts the zero cross signal VZ and generates a blinking clock VCL , an AND circuit AND, and a backflow blocking diode.
It is formed by D 1 , D 2 and a switching transistor Q, and when the continuous lighting signal V C is input, the display element 1 is lit continuously, and when the blinking lighting signal V F is input, it lights up the display element 1 at the cycle of the blinking clock V CL . The display element 1 is turned on and off, and when both signals V C and V F are not input, the display element 1 is turned off. Fourth
The figure shows centralized operation panels B 1 and B 2 , and Case 3
The number of the display elements 1 1 , 1 2 . . . whose display mode is to be changed and the display mode (on, blinking, off) are input using the keyboard 31 provided on the top surface of the 0. The data is immediately sent to display device A via power line transport, and in display device A, the display mode of the corresponding display elements 1 1 , 1 2 . . . is changed. In the figure, 32 is a key input data display section, and 33 is a confirmation lamp 33 1 , 33 2 . . . consisting of a light emitting diode corresponding to each display element 1 1 , 1 2 .
This is an operation display section consisting of...

第5図は伝送信号VSの一例を示すもので、商
用電源ACの半サイクル区間Hを4分割し、各分
割区間h1〜h4に高周波信号が重畳されているか否
かでサブビツトSB1〜SB4の「1」「0」を伝送
し、半サイクルHの4個のサブビツトSB1〜SB4
にて制御信号を形成している。すなわち、制御信
号が(0,1,0,1)の場合をスタートデータ
SD,(0,1,1,1)の場合を伝送データ
“1”、(0,1,0,0)の場合を伝送データ
“0”、(0,1,1,0)の場合をエンドデータ
EDとしており、例えばスタートデータSDと、8
ビツトの伝送データよりなる端末器呼出用のアド
レスデータADと、2ビツトの伝送データよりな
る表示制御データCDと、エンドデータEDとで伝
送信号VSが形成される。
FIG. 5 shows an example of the transmission signal V S. The half cycle section H of the commercial power supply AC is divided into four, and the sub-bit SB 1 is determined depending on whether or not a high frequency signal is superimposed on each divided section h 1 to h 4 . ~Transmits "1" and "0" of SB 4 , and 4 sub-bits of half cycle H SB 1 ~ SB 4
The control signal is generated by In other words, the start data is when the control signal is (0, 1, 0, 1).
SD, (0, 1, 1, 1) is the transmission data "1", (0, 1, 0, 0) is the transmission data "0", (0, 1, 1, 0) is the transmission data end data
For example, start data SD and 8
A transmission signal VS is formed by address data AD for terminal calling consisting of bit transmission data, display control data CD consisting of 2 bit transmission data, and end data ED .

以下、上述の表示装置Aの使用例および動作に
ついて説明する。この種の表示システムは例えば
デパートのギフトコーナなどにおいて使用され、
ギフトコーナの受付け用として集中操作盤B1
配置するとともに、商品の包装現場に集中操作盤
B2を配置し、表示装置Aを客が良く見えるよう
に配置する。いま、受付けで客の商品を受付ける
と、番号札を客に渡し、集中操作盤B1のキーボ
ード31にて番号札の番号に対応する数字(この
数字は表示素子11,12……の番号に1:1対応
する)を入力するとともに、受付けを示すフアン
クシヨンキーを押して表示素子11,12……を連
続点灯モードにするためのデータを入力する。表
示装置Aでは集中操作盤B1からの伝送信号VS
よつて当該表示素子11,12……を連続点灯させ
る。この点灯と同時に表示装置Aから返送信号
VBが送信され、この返送信号VBは各集中操作盤
B1,B2で受信されて、対応する確認ランプ33
,332……を点灯する。次に、包装現場で商品
の包装が完了すると、現場に設置している集中操
作盤B2のキーボード31にて商品に対応する番
号に対応する数字を入力するとともに、包装完了
を示すフアンクシヨンキーを押して表示素子11
2……を点滅点灯モードにするためのデータを
入力する。すると、集中操作盤B2から表示装置
Aに伝送信号VSが送信され、表示装置Aでは当
該表示素子11,12……を点滅点灯させる。同時
に返送信号VBを送信して各集中操作盤B1,B2
点滅せる表示素子11,12……に対応する確認ラ
ンプ331,332……を点滅点灯させる。次に、
受付けでは表示装置Aの表示素子11,12……の
点滅点灯によつて客に商品の包装が終了したこと
を知らせ、同時に集中操作盤B1の確認ランプ3
1,332……の点滅で当該番号の商品の包装が
終了したことを受付けの店員が知ることになる。
次に、客が番号札と商品とを交換すると、受付け
では集中操作盤B1のキーボード31にて当該番
号に対応する数字を入力するとともに、終了のフ
アンクシヨンサーを押して表示素子11,12……
を消灯させるデータを入力する。このことによ
り、表示素子11,12……を消灯させるための伝
送信号VSが送信され、表示装置Aではこの伝送
信号VSを受信して表示素子11,12……を消灯さ
せるとともに、返送信号VBを送信して集中操作
盤B1,B2の消灯した表示素子11,12……に対
応する確認ランプ331,332……を消灯するよ
うになつている。
Hereinafter, an example of use and operation of the above-mentioned display device A will be described. This type of display system is used, for example, in gift corners of department stores.
A central operation panel B1 will be installed for reception at the gift corner, and a central operation panel will be installed at the product packaging site.
B 2 is placed, and the display device A is placed so that the customer can see it clearly. Now, when a customer's product is accepted at the reception desk, a number tag is given to the customer, and the number corresponding to the number on the number tag (this number is displayed on the display elements 1 1 , 1 2 , etc.) is entered using the keyboard 31 of the central operation panel B 1 . (corresponding 1:1 with the number) and press the function key indicating acceptance to input data for setting the display elements 1 1 , 1 2 . . . to continuous lighting mode. In the display device A, the display elements 1 1 , 1 2 . . . are continuously lit by the transmission signal V S from the central operation panel B 1 . At the same time as this lighting, a return signal is sent from display device A.
V B is transmitted, and this return signal V B is sent to each centralized control panel.
Received by B 1 and B 2 and the corresponding confirmation lamp 33
1 , 33 2 ... lights up. Next, when the packaging of the product is completed at the packaging site, the number corresponding to the number corresponding to the product is entered on the keyboard 31 of the central operation panel B2 installed at the site, and the function key indicating packaging completion is input. Press display element 1 1 ,
1 2 Input the data to set ... to blinking lighting mode. Then, a transmission signal V S is transmitted from the central operation panel B 2 to the display device A, and the display device A causes the display elements 1 1 , 1 2 . . . to flash on and off. At the same time, a return signal V B is transmitted to blink and light up the confirmation lamps 33 1 , 33 2 . . . corresponding to the blinking display elements 1 1 , 1 2 . next,
At the reception desk, the display elements 1 1 , 1 2 .
When 3 1 , 33 2 . . . flashes, the clerk at the reception desk will know that the packaging for the product with that number has been completed.
Next, when the customer exchanges the number plate and the product, at the reception desk, he inputs the number corresponding to the number on the keyboard 31 of the central operation panel B 1 , presses the end function, and displays the display element 1 1 , 1 2 ...
Enter the data to turn off the light. As a result, a transmission signal VS for turning off the display elements 1 1 , 1 2 . . . is transmitted, and the display device A receives this transmission signal VS and turns off the display elements 1 1 , 1 2 . At the same time, a return signal V B is sent to turn off the confirmation lamps 33 1 , 33 2 . . . corresponding to the extinguished display elements 1 1 , 1 2 . There is.

以上のように構成された基本例において、表示
素子11,12……を増設する場合、論理処理部1
3を増設するだけで良く、集中操作盤B1,B2
表示装置Aとの間の配線数を増加する必要が全く
ないので、表示素子11,12……の増設が容易に
できるという利点をもつている。しかしながら、
このような基本例において、近接して配設される
表示素子11,12……に対応する論理処理部13
に予め設定される個有アドレスの上位ビツトが同
一であるにも拘らず、アドレス設定部14′のス
イツチS1〜S8によつて個有アドレスの全ビツトを
各別に設定するようになつており、アドレス設定
部14′のスイツチ数が多くなり、コストアツプ
になるとともに操作が面倒であるという不都合が
あつた。
In the basic example configured as above, when adding display elements 1 1 , 1 2 . . . , logic processing unit 1
3, and there is no need to increase the number of wires between the central operation panels B 1 and B 2 and the display device A, so it is easy to add display elements 1 1 , 1 2 . . . It has the advantage of however,
In such a basic example, the logic processing units 13 corresponding to the display elements 1 1 , 1 2 . . .
Even though the upper bits of the unique addresses set in advance are the same, all the bits of the unique addresses are set individually by switches S1 to S8 of the address setting section 14'. This increases the number of switches in the address setting section 14', resulting in increased costs and troublesome operations.

第6図乃至第8図は上記の点に鑑みて為された
本発明の一実施例を示すもので、概略構成は第3
図基本例と、略同一である。すなわち、実施例
は、第7図のように8個の表示素子11〜18……
にて表示ユニツト31〜315を形成し、表示ユニ
ツト31〜315を横5列、縦3列に配列して120個
の表示素子11,12……をマトリクス状に配設し
たものであり、各表示ユニツト31〜315内には
第3図と同様の基本ユニツトを8個設けてある。
但し、表示ドライブ部15のクロツク発生器CL
は共通化されており、各表示素子11,12……は
点滅周期が同一で、同期がとれた状態で点滅され
るようになつている。ところで、実施例におい
て、表示ユニツト31の上列の表示素子11〜14
にそれぞれ対応する論理処理部131〜134のア
ドレス設定部14は各論理処理部131〜134
個有アドレスの下位2ビツトを各別に設定するス
イツチS1,S2よりなる下位アドレス設定部14a
と、各論理処理部131〜134の個有アドレスの
上位6ビツトを共通に設定する6個のスイツチS3
〜S8よりなる上位アドレス設定部14bとで構成
されている。一方、表示ユニツト31の下列の表
示素子15〜18にそれぞれ対応する論理処理部13
〜138のアドレス設定部14も同様に構成され
ている。
6 to 8 show one embodiment of the present invention made in view of the above points, and the schematic configuration is the third embodiment.
It is almost the same as the basic example in the figure. That is, in the embodiment, eight display elements 1 1 to 1 8 . . . as shown in FIG.
The display units 3 1 to 3 15 are formed by arranging the display units 3 1 to 3 15 in 5 rows horizontally and 3 columns vertically, and 120 display elements 1 1 , 1 2 . . . are arranged in a matrix. Eight basic units similar to those shown in FIG. 3 are provided in each display unit 31 to 315 .
However, the clock generator CL of the display drive section 15
are standardized, and each display element 1 1 , 1 2 . . . has the same blinking cycle and blinks in synchronization. By the way, in the embodiment, the display elements 1 1 to 1 4 in the upper row of the display unit 3 1
The address setting unit 14 of the logic processing units 13 1 to 13 4 corresponding to each of the logic processing units 13 1 to 13 4 is a lower address consisting of switches S 1 and S 2 that individually set the lower two bits of the unique address of each logic processing unit 13 1 to 13 4. Setting section 14a
and six switches S3 that commonly set the upper six bits of the unique addresses of each logic processing unit 131 to 134 .
.about.S8 and an upper address setting section 14b. On the other hand, the logic processing units 13 respectively corresponding to the display elements 15 to 18 in the lower row of the display unit 31
The address setting sections 14 of 5 to 138 are similarly configured.

以下、表示ユニツト31〜315の各表示素子1
,18に対応する個有アドレスの設定操作につい
て具体的に説明すると、いま上列の表示素子11
〜14に対応する論理処理部131,132,13
,134の下位アドレス設定部14aに設定する
データ値はそれぞれ(0,0)、(0,1)、(1,
0)、(1,1)であり、下列の表示素子15,18
……に対応する論理処理部135,136,137
138の下位アドレス設定部14aに設定するデ
ータ値も上列と同様(0,0)、(0,1)、(1,
0)、(1,1)に設定され、各表示ユニツト31
〜315の下位アドレス設定部14aのデータ値は
常に上述のように固定的に設定される。次に、上
下各列の上位アドレス設定部14bに設定される
データ値は表示ユニツト31〜315の配設位置に
応じて設定されるようになつており、例えば左上
隅に配置される表示ユニツト31の上列の表示素
子11〜14に対応する上位アドレス設定部14b
に設定されるべきデータ値は(0,0,0,0,
0,0)となり、下列の表示素子11〜14に対応
する上位アドレス設定部14bに設定されるべき
データ値は(0,0,0,1,0,1)となる。
同様にして各表示ユニツト32〜315の上位アド
レス設定部14bに所定のデータをセツトすれば
良く、この場合、下位アドレス設定部14aは表
示ユニツト31〜315の配列位置に全く関係ない
ので、固定化しておいても良い。したがつて、個
有アドレスの設定操作が大巾に簡略化されること
になり、多数の表示素子11,12……を配設する
場合における施工が容易になる。
Below, each display element 1 of display units 3 1 to 3 15
To specifically explain the operation for setting the unique addresses corresponding to 1 and 1 8 , the display elements 1 1 in the upper row
Logic processing units 13 1 , 13 2 , 13 corresponding to ~1 4
The data values set in the lower address setting section 14a of 3 , 13 and 4 are (0, 0), (0, 1), (1,
0), (1, 1), and the lower row display elements 1 5 , 1 8
Logic processing units 13 5 , 13 6 , 13 7 , corresponding to ...
The data values set in the lower address setting section 14a of 138 are also (0,0), (0,1), (1,
0), (1, 1), and each display unit 3 1
The data values of the lower address setting section 14a of 315 to 315 are always fixedly set as described above. Next, the data values set in the upper address setting sections 14b in the upper and lower columns are set according to the arrangement positions of the display units 31 to 315. For example, the data values set in the upper address setting sections 14b of the upper and lower columns are Upper address setting section 14b corresponding to display elements 1 1 to 1 4 in the upper row of unit 3 1
The data value to be set to (0, 0, 0, 0,
0, 0), and the data values to be set in the upper address setting section 14b corresponding to the display elements 1 1 to 1 4 in the lower row are (0, 0, 0, 1, 0, 1).
Predetermined data may be set in the upper address setting section 14b of each display unit 32 to 315 in the same way; in this case, the lower address setting section 14a has no relation to the arrangement position of the display units 31 to 315 . Therefore, it may be fixed. Therefore, the operation for setting a unique address is greatly simplified, and construction becomes easier when a large number of display elements 1 1 , 1 2 . . . are arranged.

本発明は上述のように、多数の表示素子を平面
的に列記し、集中操作盤から商用電源線を介して
送られる伝送信号を受信して上記伝送信号にて伝
送されたアドレスデータが予め設定された個有ア
ドレスと一致したときアドレスデータに続いて伝
送される表示制御データを取込んで表示素子の表
示モードを制御する論理処理部を各表示素子に対
応して設けたものであるので、信号線を増加する
ことなく表示素子の増設ができ、また、近接して
配設される適数個の表示素子に対応する論理処理
部の下位ビツトを各別に設定する下位アドレス設
定部を上記論理処理部にそれぞれ設け、上記各論
理処理部の個有アドレスの上位ビツトを共通に設
定する上位アドレス設定部を設けたので、各表示
素子に対応する個有アドレスを設定するアドレス
設定部の構成が簡単で、かつアドレス設定操作が
簡便な表示装置を提供することができるという利
点がある。
As described above, the present invention arranges a large number of display elements in a two-dimensional array, receives a transmission signal sent from a central operation panel via a commercial power line, and sets the address data transmitted in the transmission signal in advance. A logic processing section is provided corresponding to each display element, which takes in the display control data transmitted following the address data and controls the display mode of the display element when the address data matches the unique address given. The number of display elements can be increased without increasing the number of signal lines, and the lower address setting section that individually sets the lower bits of the logic processing section corresponding to an appropriate number of display elements arranged in close proximity can be added to the above logic. Since an upper address setting section is provided in each processing section and commonly sets the upper bits of the unique address of each logic processing section, the structure of the address setting section that sets the unique address corresponding to each display element can be changed. This has the advantage that it is possible to provide a display device that is simple and allows easy address setting operations.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明に係る表示装置の正面図、第2
図は表示システムの一例を示す図、第3図は基本
例のブロツク回路図、第4図は集中操作盤の上面
図、第5図は伝送信号の構成を示す図、第6図は
本発明一実施例の正面図、第7図は同上の要部斜
視図、第8図は同上のブロツク回路図である。 1,11,12……は表示素子、13,131
138は論理処理部、14aは下位アドレス設定
部、14bは上位アドレス設定部である。
Fig. 1 is a front view of a display device according to the present invention, Fig. 2 is a front view of a display device according to the present invention;
The figure shows an example of a display system, Fig. 3 is a block circuit diagram of a basic example, Fig. 4 is a top view of a central operation panel, Fig. 5 is a diagram showing the structure of a transmission signal, and Fig. 6 is a diagram of the present invention. FIG. 7 is a front view of one embodiment, FIG. 7 is a perspective view of essential parts of the same, and FIG. 8 is a block circuit diagram of the same. 1, 1 1 , 1 2 ... are display elements, 13, 13 1 -
138 is a logic processing section, 14a is a lower address setting section, and 14b is an upper address setting section.

Claims (1)

【特許請求の範囲】[Claims] 1 多数の表示素子を平面的に列設し、集中操作
盤から商用電源の電源線を介して送られる伝送信
号を受信して上記伝送信号にて伝送されたアドレ
スデータが予め設定された個有アドレスと一致し
たときアドレスデータに続いて伝送される表示制
御データを取込んで表示素子の表示モードを制御
する論理処理部を各表示素子に対応して設けた表
示装置において、近接して配設される適数個の表
示素子に対応する論理処理部の下位ビツトを各別
に設定する下位アドレス設定部を上記各論理処理
部にそれぞれ設け、上記各論理処理部の個有アド
レスの上位ビツトを共通に設定する上位アドレス
設定部を設けたことを特徴とする表示装置。
1 A large number of display elements are arranged in a two-dimensional array, and a transmission signal sent from a central operation panel via a commercial power supply line is received, and the address data transmitted in the transmission signal is preset to a unique address. In a display device in which a logic processing unit is provided corresponding to each display element, which takes in display control data that is transmitted following the address data and controls the display mode of the display element when the address data matches, Each logic processing section is provided with a lower address setting section that separately sets the lower bits of the logic processing section corresponding to an appropriate number of display elements to be displayed, and the upper bits of the unique address of each logic processing section are shared. 1. A display device comprising an upper address setting section for setting an upper address.
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