JPH0452717B2 - - Google Patents
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- JPH0452717B2 JPH0452717B2 JP58044663A JP4466383A JPH0452717B2 JP H0452717 B2 JPH0452717 B2 JP H0452717B2 JP 58044663 A JP58044663 A JP 58044663A JP 4466383 A JP4466383 A JP 4466383A JP H0452717 B2 JPH0452717 B2 JP H0452717B2
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Description
【発明の詳細な説明】
この発明は、サイリスタモータの制御装置に関
する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a control device for a thyristor motor.
第1図に、自然転流式インバータによつて駆動
される従来のサイリスタモータの制御装置を示
す。図において、100は電源変圧器であつて、
出力が30度の位相差を持つ2次巻線10H,10
Lを具えている。11H,11Lは3相ブリツジ
のコンバータであつて、それぞれ2次巻線10
H,10Lから交流電力を受け、両者で12相整流
回路を構成している。12H,12Lは直流リア
クトル、13H,13Lは3相ブリツジ自然転流
式のインバータであつて、互いに30度の位相差を
持つ交流電力を送出し、それぞれ直流リアクトル
12H,12Lを介してコンバータ11H,11
Lに接続されている。14H,14Lはサイリス
タスイツチであつて、それぞれコンバータ11H
とコンバータ11L、インバータ13Hと13L
間に挿入されている。15H,15Lは電流検出
器であつて、それぞれコンバータ11H,11L
の交流入力を検出して該交流入力に対応した直流
信号(電流検出信号)を送出する。101は同期
電動機であつて、2組の巻線を有し、その回転軸
には回転子位置を検出する位置検出器102と速
度検出器103が軸結されている。104は速度
制御器であつて、速度検出器103の出力信号は
速度フイードバツク信号として受け、これと速度
基準信号の偏差に対応した出力を送出する。10
5H,105Lは電流基準器であつて、速度制御
器104の出力信号と論理回路装置109が出力
する低速制御パルス信号P1,P2を受けて電流
基準信号を出力する。論理回路装置109は、位
置検出器102の出力、速度制御器104の出力
を受けてインバータ13H,13Lの導通信号を
送出すると共に速度比較器108の出力する低速
判定信号を受けてサイリスタスイツチ14H,1
4Lの交互導通信号と該交互導通信号に同期する
上記低速制御パルス信号P1,P2を送出する。
速度比較器108は同期電動機101の速度が所
定速度以下に降下すると上記低速判定信号を発生
する。106H,106Lはそれぞれ電流制御器
であつて、それぞれ電流検出器15Hと電流基準
器105Hの出力の偏差、電流検出器15Lと電
流基準器105Lの出力の偏差に対応する出力信
号を送出する。107H,107Lはゲートパル
ス発生器であつて、電流制御器106H,106
Lの出力信号を受けてそれぞれコンバータ11
H、コンバータ11Lに導通信号を送出する。 FIG. 1 shows a conventional control device for a thyristor motor driven by a naturally commutated inverter. In the figure, 100 is a power transformer,
Secondary winding 10H, 10 whose output has a phase difference of 30 degrees
It has an L. 11H and 11L are three-phase bridge converters, each with a secondary winding of 10
It receives AC power from H and 10L, and together they form a 12-phase rectifier circuit. 12H and 12L are DC reactors, and 13H and 13L are three-phase bridge natural commutation type inverters, which send out AC power with a phase difference of 30 degrees to the converters 11H and 11H, respectively, through the DC reactors 12H and 12L. 11
Connected to L. 14H and 14L are thyristor switches, each of which is a converter 11H.
and converter 11L, inverters 13H and 13L
inserted in between. 15H and 15L are current detectors, and converters 11H and 11L respectively.
detects an AC input and sends a DC signal (current detection signal) corresponding to the AC input. A synchronous motor 101 has two sets of windings, and a position detector 102 and a speed detector 103 for detecting the rotor position are connected to its rotating shaft. 104 is a speed controller which receives the output signal of the speed detector 103 as a speed feedback signal and sends out an output corresponding to the deviation between this and the speed reference signal. 10
Reference numerals 5H and 105L are current reference devices that receive the output signal of the speed controller 104 and the low speed control pulse signals P1 and P2 output from the logic circuit device 109 and output a current reference signal. The logic circuit device 109 receives the output of the position detector 102 and the output of the speed controller 104 and sends out a conduction signal for the inverters 13H and 13L, and also receives the low speed determination signal output from the speed comparator 108 and switches the thyristor switches 14H and 13L. 1
The 4L alternating conduction signal and the low-speed control pulse signals P1 and P2 synchronized with the alternating conduction signal are sent out.
The speed comparator 108 generates the low speed determination signal when the speed of the synchronous motor 101 falls below a predetermined speed. Reference numerals 106H and 106L are current controllers, respectively, and output signals corresponding to the deviation between the outputs of the current detector 15H and the current reference device 105H, and the deviation between the outputs of the current detector 15L and the current reference device 105L, respectively. 107H, 107L are gate pulse generators, and current controllers 106H, 106
Converter 11 receives the output signal of L.
H, sends a conduction signal to converter 11L.
この構成においては、インバータ13H,13
Lが同期電動機101の誘起電圧で転流可能該同
期電動機の速度領域(負荷転流領域)では、サイ
リスタスイツチ14H,14Lは共に導通せず、
コンバータ11H,11L群とインバータ13
H,13L群とは直流リアクトル12H,12L
を介してコンバータとインバータとが交互且つ順
番に直列接続されて閉ループを形成する。 In this configuration, inverters 13H, 13
In the speed range (load commutation range) of the synchronous motor where L can be commutated by the induced voltage of the synchronous motor 101, the thyristor switches 14H and 14L are not conductive.
Converter 11H, 11L group and inverter 13
H, 13L group is DC reactor 12H, 12L
Converters and inverters are alternately and sequentially connected in series to form a closed loop.
しかし、同期電動機101の速度が低速度に降
下し、同期電動機101の誘起電圧ではインバー
タ13H,13Lが良好に転流し得なくなると、
速度比較器108が出力して論理回路装置109
からサイリスタスイツチ14H,14Lに交互に
導通信号を供給すると共に該導通信号に同期して
電流基準器105H,105Lに第2図に示す如
き低速制御パルス信号P1,P2を入力する。こ
の低速制御パルス信号P1,P2は同時に且つ逆
極性にインバータ13H,13Lの転流のタイミ
ングと一致して、同期電動機101の周波数ベー
スで30度毎に発生するようになつており、この低
速制御パルス信号、P1,P2が電流基準器10
5H、電流基準器105Lに入力されている間、
電流基準器105H,105Lが出力する電流基
準信号は零レベルもしくは、2倍レベルに制御さ
れる。 However, when the speed of the synchronous motor 101 drops to a low speed and the induced voltage of the synchronous motor 101 is no longer able to commutate the inverters 13H and 13L well,
The speed comparator 108 outputs and the logic circuit device 109
A conduction signal is alternately supplied from the thyristor switches 14H and 14L to the thyristor switches 14H and 14L, and low-speed control pulse signals P1 and P2 as shown in FIG. 2 are inputted to the current reference devices 105H and 105L in synchronization with the conduction signal. These low-speed control pulse signals P1 and P2 are generated simultaneously and with opposite polarities at intervals of 30 degrees based on the frequency of the synchronous motor 101, coinciding with the commutation timing of the inverters 13H and 13L. Pulse signals, P1 and P2 are current reference device 10
5H, while being input to the current reference device 105L,
The current reference signals output by the current reference devices 105H and 105L are controlled to zero level or double level.
例えば、時刻t1で低速制御パルス信号P1,P
2が図示極性に電流基準器105H,105Lに
入力された場合、電流基準器105Hの電流基準
信号は零レベル、電流基準器105Lの電流基準
信号は2倍レベルになつて、サイリスタスイツチ
14Lが導通し、該サイリスタスイツチ、コンバ
ータ11L、直流リアクトル12L及びインバー
タ13Lの閉ループが形成され、該閉ループに時
刻t1以前より倍加した電流が送り出される。この
間、電流基準器105Hの電流基準信号が零であ
ることによりインバータ13Hに流入する電流が
無くなるまで、転流が可能となる。時刻t1より30
度遅れた時刻t2では、上記とは逆にサイリスタス
イツチ14Hが導通して該サイリスタスイツチ、
コンバータ11H、インバータ13H、直流リア
クトル12Hからなる閉ループが形成され、この
間に、インバータ13Lの転流が行われる。 For example, at time t1 , the low speed control pulse signals P1, P
2 is input to the current reference devices 105H and 105L with the illustrated polarity, the current reference signal of the current reference device 105H becomes zero level, the current reference signal of the current reference device 105L becomes twice the level, and the thyristor switch 14L becomes conductive. However, a closed loop is formed of the thyristor switch, converter 11L, DC reactor 12L, and inverter 13L, and a current doubled from before time t1 is sent to the closed loop. During this time, since the current reference signal of the current reference device 105H is zero, commutation is possible until no current flows into the inverter 13H. 30 from time t 1
At time t2 , which is delayed by 1.5 degrees, the thyristor switch 14H becomes conductive, contrary to the above, and the thyristor switch 14H becomes conductive.
A closed loop consisting of converter 11H, inverter 13H, and DC reactor 12H is formed, during which commutation of inverter 13L is performed.
このように、従来の制御装置では、2台の電流
制御器、2台の電流基準器を必要とするので、そ
れだけ高価になるだけでなく、負荷転流領域では
両コンバータの直流電流を等しくする必要がある
が、両電流制御器の出力を平衡させることは容易
ではないと云う問題があつた。 In this way, conventional control devices require two current controllers and two current standards, which not only increases the cost, but also makes it difficult to equalize the DC currents of both converters in the load commutation region. However, there was a problem in that it was not easy to balance the outputs of both current controllers.
この発明は、上記問題点に鑑みてなされたもの
で、電流基準信号を受けて各コンバータのゲート
パルス発生器を制御する電流制御器を共通にする
と共に該電流制御器に上記各コンバータの電流を
個別に検出する電流検出器の出力総和を電流フイ
ードバツク信号として与え、該電流制御器の出力
を、低速制御パルス信号に同期して一方コンバー
タのゲートパルス発生器の入力を低減し他方コン
バータのゲートパルス発生器の入力を増大させる
入力装置を通して各ゲートパルス発生器に供給す
る構成とすることにより、従来に比して安価にす
ることができ、制御特性を向上することができる
サイリスタモータの制御装置を提供することを目
的とする。 This invention has been made in view of the above problems, and includes a common current controller that receives a current reference signal to control the gate pulse generator of each converter, and also allows the current controller to control the current of each converter. The sum of the outputs of the individually detected current detectors is given as a current feedback signal, and the output of the current controller is synchronized with the low-speed control pulse signal to reduce the input of the gate pulse generator of one converter and generate the gate pulse of the other converter. The present invention provides a thyristor motor control device that can be made cheaper than conventional ones and has improved control characteristics by having a configuration in which the input is supplied to each gate pulse generator through an input device that increases the input of the generator. The purpose is to provide.
以下、この発明の一実施例を図について説明す
る。 An embodiment of the present invention will be described below with reference to the drawings.
第3図において、206は電流制御器であつ
て、速度制御器104の出力信号Vsに対する電
流検出器15Hの出力信号ihと電流検出器15L
の出力信号ilとの和の偏差に対応する電流制御信
号Isを出力する。210H,210Lは極性変換
器であつて、前者は、電流制御信号Isの極性を交
換してゲートパルス発生器107Hに入力すると
共にスイツチ211Hを介して極性変換器210
Lの出力が入力される。後者は、電流制御信号Is
の極性を反転してゲートパルス発生器107Lに
入力すると共にスイツチ211Lを介して極性変
換器210Hの出力が入力される。スイツチ21
1H,211Lは論理回路装置109が出力する
後述の低速制御パルス信号p1,p2を受けてオ
ン・オフ制御される。極性変換器210H,21
0L、スイツチ211H,211Lはゲートパル
ス発生器の入力装置を構成している。なお、ゲー
トパルス発生器107H,107Lは出力するゲ
ートパルスの出力位相が入力零時に約180°で該入
力の正方向増大に対応してこの約180°位相から進
む位相特性を有している。 In FIG. 3, 206 is a current controller, and the output signal ih of the current detector 15H and the current detector 15L correspond to the output signal Vs of the speed controller 104.
outputs a current control signal Is corresponding to the deviation of the sum from the output signal il. 210H and 210L are polarity converters, and the former exchanges the polarity of the current control signal Is and inputs it to the gate pulse generator 107H, and also inputs it to the polarity converter 210 via a switch 211H.
The output of L is input. The latter is the current control signal Is
The polarity of the signal is inverted and inputted to the gate pulse generator 107L, and at the same time, the output of the polarity converter 210H is inputted via the switch 211L. switch 21
1H and 211L are turned on and off in response to low-speed control pulse signals p1 and p2, which will be described later, output from the logic circuit device 109. Polarity converter 210H, 21
0L, switches 211H, and 211L constitute an input device for the gate pulse generator. Note that the gate pulse generators 107H and 107L have a phase characteristic in which the output phase of the gate pulse to be output is approximately 180° when the input is zero, and advances from this approximately 180° phase as the input increases in the positive direction.
この構成において、前記した負荷転流領域では
低速制御パルス信号p1,p2が論理回路装置1
09から出力されない為、論理スイツチ211
H,211L及びサイリスタスイツチ14H,1
4Lは開路しており、コンバータ11H,11L
群とインバータ13H,13L群とは直流リアク
トル12H,12Lを介してコンバータとインバ
ータとが交互且つ順番に直列接続されて閉ループ
を形成する。 In this configuration, in the load commutation region described above, the low speed control pulse signals p1 and p2 are applied to the logic circuit device 1.
Since there is no output from 09, logic switch 211
H, 211L and thyristor switch 14H, 1
4L is open, converters 11H and 11L
The converters and the inverters 13H, 13L are connected in series alternately and sequentially via the DC reactors 12H, 12L to form a closed loop.
同期電動機101の速度が前記所定速度以下に
降下すると、論理回路装置109から第4図に示
す低速制御パルス信号p1,p2が出力される。
この低速制御パルス信号p1,p2はインバータ
13H,13Lの転流のタイミングと一致して、
同期電動機101の周波数ベースで30度毎に発生
し、交互に且つサイリスタスイツチ14L,14
Hの導通信号に同期してスイツチ211H,21
1Lに供給される。 When the speed of the synchronous motor 101 falls below the predetermined speed, the logic circuit device 109 outputs low speed control pulse signals p1 and p2 shown in FIG.
These low-speed control pulse signals p1 and p2 coincide with the commutation timing of the inverters 13H and 13L,
Occurs every 30 degrees based on the frequency of the synchronous motor 101, and alternately and when the thyristor switches 14L, 14
Switches 211H and 21 are activated in synchronization with the H conduction signal.
1L is supplied.
今、時刻t1において、スイツチ211Lが低速
制御パルス信号p2を受けて閉路したものとする
と、極性変換器210Lの入力には、電流制御信
号Isとこれを極性変換した極性変換器210Hの
出力とが与えられる為、該極性変換器210Lの
出力は零レベルに減少する。この時、同時にサイ
リスタスイツチ14Hにも導通信号が与えられ
る。この為、コンバータ11Lは位相制御角約
180°で制御されるようになつて、出力電流レベル
が零レベルに向かつて減少する一方、これに対応
して電流検出器15Lの出力が減少するので、電
流制御器206の出力レベルが増大して、コンバ
ータ11Lの出力電流が零になると、コンバータ
11H、直流リアクトル12H、インバータ13
H、サイリスタスイツチ14Hの直流閉ループを
流れる電流のレベルが時刻t1以前のレベルより倍
加する。このように、低速制御パルス信号p2の
発生中、コンバータ11Lの出力が零に低下する
のでインバータ13Lの転流が行える。時刻t2に
なると、今度は、サイリスタ14Lが導通して該
サイリスタスイツチ14L、コンバータ11L、
インバータ13L、直流リアクトル12Lからな
る直流閉ループが形成され、極性変換器210H
の出力が零レベル以下になり、コンバータ11H
の出力が零に低減し、コンバータ11Lの出力が
倍加する。 Now, at time t1 , if the switch 211L receives the low-speed control pulse signal p2 and closes the circuit, the input of the polarity converter 210L receives the current control signal Is and the output of the polarity converter 210H which converted the polarity of the current control signal Is. is given, the output of the polarity converter 210L decreases to zero level. At this time, a conduction signal is also given to the thyristor switch 14H at the same time. For this reason, the converter 11L has a phase control angle of approximately
As the current is controlled at 180°, the output current level decreases toward the zero level, and the output of the current detector 15L decreases accordingly, so the output level of the current controller 206 increases. When the output current of converter 11L becomes zero, converter 11H, DC reactor 12H, and inverter 13
H, the level of the current flowing through the DC closed loop of the thyristor switch 14H doubles from the level before time t1 . In this way, while the low-speed control pulse signal p2 is being generated, the output of the converter 11L is reduced to zero, so that commutation of the inverter 13L can be performed. At time t2 , the thyristor 14L becomes conductive and the thyristor switch 14L, converter 11L,
A DC closed loop consisting of an inverter 13L and a DC reactor 12L is formed, and a polarity converter 210H
The output of converter 11H becomes below zero level.
The output of converter 11L is reduced to zero, and the output of converter 11L is doubled.
なお、上記実施例では、12相整流回路を構成す
るコンバータ、インバータの場合について説明し
たが、更に、多相の整流回路構成を取る場合につ
いても、この発明を実施して同様の効果を得るこ
とができる。アナログ構成のものを示したがマイ
クロプロセツサーを用いて容易にデジタル構成と
することができる。 In the above embodiment, the case of a converter and an inverter constituting a 12-phase rectifier circuit has been described, but the present invention can also be practiced to obtain the same effect even in the case of a multi-phase rectifier circuit configuration. Can be done. Although an analog configuration is shown, it can be easily converted to a digital configuration using a microprocessor.
又、上記実施例では、同期電動機の低速時に一
方コンバータの直流電流を2倍に制御している
が、電流基準や電流フイードバツクのゲインを調
整して1〜2倍の間に調整するようにしてもよ
い。又電流フイードバツク信号としてはコンバー
タの直流電流を検出して与えるようにしてもよ
い。又直流リアクトルは互いに結合を持たせたも
のでもよい。 Furthermore, in the above embodiment, the DC current of one converter is controlled to double when the synchronous motor runs at low speed, but the current reference and current feedback gain are adjusted to adjust the current between 1 and 2 times. Good too. Alternatively, the DC current of the converter may be detected and provided as the current feedback signal. Further, the DC reactors may be coupled to each other.
以上の如く、この発明によれば、複数のコンバ
ータのゲートパルス発生器を1台の電流制御器で
制御することができるので、従来に比して、装置
価格を安価にすることができる上、負荷転流領域
では複数のコンバータの出力が容易に平衡するの
で、制御特性を良好にすることができる。 As described above, according to the present invention, the gate pulse generators of a plurality of converters can be controlled by one current controller, so the cost of the device can be reduced compared to the conventional one, and In the load commutation region, the outputs of the plurality of converters are easily balanced, so that control characteristics can be improved.
第1図は従来のサイリスタモータの制御装置の
ブロツク構成図、第2図は上記制御装置の動作を
説明する為の動作波形図、第3図はこの発明によ
るサイリスタモータの制御装置の実施例のブロツ
ク構成図、第4図は上記実施例の動作を説明する
為の動作波形図である。
11H,11L……コンバータ、13H,13
L……インバータ、14H,14L……サイリス
タスイツチ、15H,15L……電流検出器、1
02……位置検出器、103……速度検出器、1
07H,107L……ゲートパルス発生器、10
8……速度比較器、109……論理回路装置、2
06……電流制御器、210H,210L……極
性変換器、211H,211L……スイツチ。な
お、図中、同一符号は同一または相当部分を示
す。
Fig. 1 is a block diagram of a conventional thyristor motor control device, Fig. 2 is an operation waveform diagram for explaining the operation of the above control device, and Fig. 3 is an embodiment of the thyristor motor control device according to the present invention. The block diagram and FIG. 4 are operational waveform diagrams for explaining the operation of the above embodiment. 11H, 11L...Converter, 13H, 13
L...Inverter, 14H, 14L...Thyristor switch, 15H, 15L...Current detector, 1
02...Position detector, 103...Speed detector, 1
07H, 107L...Gate pulse generator, 10
8...Speed comparator, 109...Logic circuit device, 2
06... Current controller, 210H, 210L... Polarity converter, 211H, 211L... Switch. In addition, in the figures, the same reference numerals indicate the same or corresponding parts.
Claims (1)
直列接続し閉ループ回路に構成された多相整流回
路の該インバータ交流出力により駆動される同期
電動機を備え、コンバータ相互間、インバータ相
互間にサイリスタスイツチを有するサイリスタモ
ータの制御装置であつて、電流基準信号と電流フ
イードバツク信号に基づいて上記コンバータの出
力を制御し、上記同期電動機の速度が所定速度以
下に降下した時に低速制御パルス信号を発生せし
めて、該低速制御パルス信号に対応して上記サイ
リスタスイツチを交互に導通するとともに、該導
通したサイリスタスイツチを通して電力の授受を
行う一方コンバータとインバータの該コンバータ
出力を増大させ他方のコンバータの出力を減少せ
しめて該他方コンバータと電力の授受を行うイン
バータを自然転流させるものにおいて、電流基準
信号を受けて上記各コンバータのゲートパルス発
生器を制御する電流制御器を共通にして上記各コ
ンバータの電流の総和の信号を電流フイードバツ
ク信号として与えるとともに、上記低速制御パル
ス信号に同期して上記電流制御器の出力と上記一
方コンバータのゲートパルス発生器への入力との
差を上記他方コンバータのゲートパルス発生器へ
入力する入力装置を通して、上記電流制御器の出
力を上記各ゲートパルス発生器に分配供給するこ
とを特徴とするサイリスタモータの制御装置。 2 入力装置が、ゲートパルス発生器のそれぞれ
に対応する極性変換器を有し、これら極性変換器
はスイツチを介して相手極性変換器の出力を受
け、これらスイツチが低速制御パルス信号に同期
して交互に開閉制御されることを特徴とする特許
請求の範囲第1項記載のサイリスタモータの制御
装置。[Scope of Claims] 1. A synchronous motor driven by the AC output of the inverter of a polyphase rectifier circuit configured by connecting two converters and inverters in series alternately to form a closed loop circuit, A control device for a thyristor motor having a thyristor switch in between, which controls the output of the converter based on a current reference signal and a current feedback signal, and generates a low speed control pulse signal when the speed of the synchronous motor drops below a predetermined speed. The thyristor switches are alternately turned on in response to the low-speed control pulse signal, and power is transferred through the turned on thyristor switches. In a device that naturally commutates an inverter that reduces the output and transfers power to and from the other converter, each of the converters has a common current controller that receives a current reference signal and controls the gate pulse generator of each of the converters. A signal representing the sum of the currents is given as a current feedback signal, and the difference between the output of the current controller and the input to the gate pulse generator of the one converter is applied to the gate of the other converter in synchronization with the low-speed control pulse signal. A control device for a thyristor motor, characterized in that the output of the current controller is distributed and supplied to each of the gate pulse generators through an input device that inputs input to the pulse generator. 2. The input device has a polarity converter corresponding to each of the gate pulse generators, and these polarity converters receive the output of the other polarity converter via a switch, and these switches synchronize with the low-speed control pulse signal. 2. The thyristor motor control device according to claim 1, wherein the thyristor motor is controlled to open and close alternately.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58044663A JPS59169379A (en) | 1983-03-16 | 1983-03-16 | Controller of thyristor motor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58044663A JPS59169379A (en) | 1983-03-16 | 1983-03-16 | Controller of thyristor motor |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59169379A JPS59169379A (en) | 1984-09-25 |
| JPH0452717B2 true JPH0452717B2 (en) | 1992-08-24 |
Family
ID=12697683
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58044663A Granted JPS59169379A (en) | 1983-03-16 | 1983-03-16 | Controller of thyristor motor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59169379A (en) |
-
1983
- 1983-03-16 JP JP58044663A patent/JPS59169379A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59169379A (en) | 1984-09-25 |
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