JPH0454456B2 - - Google Patents
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- JPH0454456B2 JPH0454456B2 JP59051320A JP5132084A JPH0454456B2 JP H0454456 B2 JPH0454456 B2 JP H0454456B2 JP 59051320 A JP59051320 A JP 59051320A JP 5132084 A JP5132084 A JP 5132084A JP H0454456 B2 JPH0454456 B2 JP H0454456B2
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Landscapes
- Analysing Materials By The Use Of Radiation (AREA)
- Apparatus For Radiation Diagnosis (AREA)
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
本発明は、主として電子医療機器の分野で使用
される計算機トモグラフイ装置に関する。特に、
フアンビーム放射線または電磁波により透視像デ
ータの収集を行い、逆投影方法により被検体の断
面部分に関する放射線または電磁波の応答の分布
画像を再構成するように構成された計算機トモグ
ラフイ装置の改良に関する。DETAILED DESCRIPTION OF THE INVENTION [Technical Field to Which the Invention Pertains] The present invention relates to a computer tomography apparatus used primarily in the field of electronic medical equipment. especially,
The present invention relates to an improvement in a computer tomography apparatus configured to collect fluoroscopic image data using Fan beam radiation or electromagnetic waves and reconstruct a distribution image of the response of radiation or electromagnetic waves regarding a cross-sectional portion of a subject by a back projection method.
従来装置は、再構成領域の形状が正方形または
長方形であり、任意の形状(例えば、頭部に使用
する楕円型)のまま高速処理することができない
欠点がある。
Conventional devices have a disadvantage that the shape of the reconstruction area is square or rectangular, and high-speed processing cannot be performed with an arbitrary shape (for example, an ellipse used for the head).
従来例装置の文献としては、米国特許公報
4135247(1979年1月16日)に公示されたシーメン
ス(simens)社「Tomography Singnal
Processing system」の逆投影装置がある。 Documents regarding conventional devices include U.S. Patent Publication
4135247 (January 16, 1979)
There is a back projection device for "Processing system".
また、従来装置は大容量の記憶装置を安価な低
速メモリに代えて高価な高速メモリにしないと高
速処理が行えない。 Furthermore, conventional devices cannot perform high-speed processing unless the large-capacity storage device is replaced with an inexpensive low-speed memory by an expensive high-speed memory.
本発明は、前述の欠点を除去するもので、各種
のアプリケーシヨンに柔軟に対応でき、かつ高速
の連続逆投影制御を可能にする経済的な計算機ト
モグラフイ装置を提供することを目的とする。
The present invention eliminates the above-mentioned drawbacks and aims to provide an economical computer tomography apparatus that can be flexibly adapted to various applications and that enables high-speed continuous backprojection control.
さらに本発明は、楕円形を含む任意の形状の再
構成領域を設定することができる計算機トモグラ
フイ装置を提供することを目的とする。 A further object of the present invention is to provide a computer tomography apparatus that can set a reconstruction region of any shape including an ellipse.
本発明は、フアンビーム状の放射線または電磁
波を発生させこの放射線または電磁波を被検体の
断面部分に透過させその断面部分に関してこの放
射線または電磁波の応答であるそれぞれ多数個の
サンプリングデータとして得られるビユーデータ
を多数の角度方向に収集する第一の手段と、この
第一の手段によつて得られた多数のビユーデータ
より上記断面部分に関する上記応答の分布画像を
逆投影法により再構成する第二の手段と、この第
2の手段により得られた上記分布画像を画面に表
示する第三の手段とを備えた計算機トモグラフイ
装置において、前記第二の手段は、再構成領域を
x軸、y軸からなるxy座標で表し、このx軸、
y軸にそれぞれ平行な直線で前記再構成領域を格
子状に区切り、この格子状の各交点をそれぞれ再
構成画像を構成するピクセルとするとき、前記x
軸に平行な各直線上のピクセルの総数、前記y軸
に平行な各直線上のピクセルの総数、前記再構成
領域を前記y軸に平行な直線で二分しこの二分さ
れた第一の部分又は第二の部分の前記x軸に平行
な各直線上のピクセル数、前記再構成領域を前記
x軸に平行な直線で二分しこの二分された第一の
部分又は第二の部分の前記y軸に平行な各直線上
のピクセル数、前記x軸に平行な直線の総数、前
記y軸に平行な直線の総数、前記再構成領域を前
記x軸に平行な一個以上の直線で複数の部分に分
けその各部分のx軸に平行な直線の総数、および
前記再構成領域を前記y軸に平行な一個以上の直
線で複数の部分に分けその各部分のy軸に平行な
直線の総数を前記再構成領域の形状に関する制御
パラメータとしてその一部又は全部を記憶する手
段と、前記再構成領域の内部または外部に存在す
る単数または複数の特定点における逆投影制御パ
ラメータを記憶する手段と、演算手段とを備え、
前記演算手段は、前記再構成領域の形状に関する
前記制御パラメータと前記特定点の逆投影制御パ
ラメータとから、各ピクセルにおける逆投影制御
パラメータを逐次演算により生成する手段を含む
ことを特徴とする。
The present invention generates radiation or electromagnetic waves in the form of a fan beam, transmits the radiation or electromagnetic waves to a cross-sectional area of a subject, and obtains view data as a response to the radiation or electromagnetic waves with respect to the cross-sectional area as a large number of sampling data. a first means for collecting data in a large number of angular directions, and a second method for reconstructing a distribution image of the response regarding the cross-sectional area by a back projection method from a large number of view data obtained by the first means. and a third means for displaying the distribution image obtained by the second means on a screen, wherein the second means moves the reconstruction region from the x-axis and the y-axis. Expressed in xy coordinates, this x axis,
When the reconstruction area is divided into a lattice shape by straight lines parallel to the y-axis, and each intersection of the lattice shape is defined as a pixel constituting the reconstructed image, the x
the total number of pixels on each straight line parallel to the y-axis, the total number of pixels on each straight line parallel to the y-axis, dividing the reconstruction area into two by the straight line parallel to the y-axis, and dividing the first part of the two halves, or the number of pixels on each straight line parallel to the x-axis of the second portion, the number of pixels on each straight line parallel to the x-axis of the second portion; the number of pixels on each straight line parallel to the x axis, the total number of straight lines parallel to the x axis, the total number of straight lines parallel to the y axis; The total number of straight lines parallel to the x-axis of each part, and the total number of straight lines parallel to the y-axis of each part divided into a plurality of parts by one or more straight lines parallel to the y-axis. means for storing part or all of the control parameters regarding the shape of the reconstruction region; means for storing backprojection control parameters at one or more specific points existing inside or outside the reconstruction region; and a calculation means. and
The calculation means is characterized in that it includes means for generating backprojection control parameters for each pixel by sequential calculation from the control parameters regarding the shape of the reconstruction area and the backprojection control parameters of the specific point.
また、第二の手段には、各ピクセルについて各
ビユー毎の乗算(重みつきデータ)とその結果の
加算を多数のビユーについて繰り返し実行し、大
容量の各ピクセル・メモリに中間結果または最終
結果を蓄積する逆投影積分手段を含み、この逆投
影積分手段は、複数のビユーについて各ビユー毎
の重みつきデータを加算し結果を対応するピクセ
ルのデータに加算して蓄積するように構成し、各
ピクセルメモリに対する読出し書込み回数すなわ
ち各ピクセル・メモリのアクセス軽減し、ピクセ
ル・メモリを低速アクセスメモリとするように構
成されてもよい。 The second method involves repeatedly performing multiplication (weighted data) for each view of each pixel and adding the results for a large number of views, and storing intermediate or final results in a large capacity memory for each pixel. The backprojection integration means is configured to add weighted data for each view for a plurality of views, add the result to the data of the corresponding pixel, and store the result. It may be configured to reduce the number of reads and writes to the memory, ie, accesses of each pixel memory, making the pixel memory a slow access memory.
また、逆投影積分手段には、縦続接続された乗
算器および加算器を含み、この加算器の入力回路
に、同一のタイミングで別のアドレスにデータの
読出しおよび書込みを実行することができるバツ
フア回路を備えてもよい。 Further, the back projection integration means includes a cascade-connected multiplier and an adder, and the input circuit of the adder is a buffer circuit that can read and write data to different addresses at the same timing. may be provided.
なお、第一の手段として各磁気共鳴吸収現象に
よりデータ収集を行つてもよい。 Note that as a first means, data may be collected by each magnetic resonance absorption phenomenon.
本発明に関する逆投影の原理を第1図に基づき
説明する。第1図で、Xkはフアンビーム・エツ
クス線発生源であり、中央部領域PAは画像再構
成領域である。中央部領域PAは、x,y各軸に
平行な直線y=y1,y2,…、y2oおよびx=x1,
x2,…,X2nで分割され、これらの直線の交点す
なわちピクセル点に対して画像の再構成を行う。
この再構成には逆投影が含まれる。y=y1,…,
y2oの線分の間隔は等間隔のΔyであり、また、x
=x1,…,x2nの線分の間隔は等間隔のΔxであ
り、また、xn+1=0.5・Δx、yn=0.5・Δy(ただ
し、Δx、Δy>0)である。
The principle of back projection related to the present invention will be explained based on FIG. In FIG. 1, X k is the fan beam X-ray source, and the central area PA is the image reconstruction area. The central area PA is defined by straight lines y=y 1 , y 2 ,..., y 2o and x=x 1 , parallel to the x and y axes.
The image is divided by x 2 , ..., X 2n , and the image is reconstructed at the intersections of these straight lines, that is, pixel points.
This reconstruction includes back projection. y=y 1 ,...,
The intervals between the line segments of y 2o are equally spaced Δy, and x
The intervals between the line segments = x 1 , ..., x 2n are equally spaced Δx, and x n+1 = 0.5·Δx, yn = 0.5·Δy (where Δx, Δy>0).
中央部領域PA内の任意の点Q(x,y)から直
線XkOまたはその延長線上に下ろした垂線の足
を点Q′とする。ただし、点Oは中央部領域PAの
中心であり、かつフアンビーム・エツクス線発生
源Xkの回転中心である。ここで、QQ′=p,Xk
Q′=h,XkO=Lとし、点Q(x,y)とX線焦
点(X線源)Xkとを結ぶ直線の長さをL0とし、
逆投影における重み係数となるwをw=1/
(L0 2)とするとき、
h=L−x・cosθk−y・sinθk …(1)
p=x・sinθk−y・cosθk …(2)
w=1/(h2+p2) …(3)
α=tan-1(p/h) …(4)
y=yj上で、xがΔxだけ変化したときのpお
よびhの変化をそれぞれΔpおよびΔhとすると、
Δp=Δx・sinθk …(5)
Δh=−Δx・cosθk …(6)
また、x=xi上で、yが−Δyだけ変化したと
きのpおよびhの変化をそれぞれΔp′および
Δh′とすると、
Δp′=Δy・cosθk …(7)
Δh′=Δy・sinθk …(8)
また、
yj=(n−j+0.5)・Δy …(9)
ただし、j=1,2,…,2n
また、直線y=yj上のy軸の左側にある交点の
数すなわちピクセル数をljとし、点Rjの座標を
(xn+1,yj)とし、直線y=yj上の左端点をSjと
すると、点Sjの座標は((0.5−lj)・Δx,(n−j
+0.5)・Δy)となる。 The foot of a perpendicular line drawn from an arbitrary point Q(x,y) in the central area PA to the straight line X k O or its extension is defined as a point Q'. However, point O is the center of the central area PA and the rotation center of the fan beam X-ray source Xk . Here, QQ′=p,X k
Let Q' = h, X k O = L, and let the length of the straight line connecting point Q (x, y) and X - ray focus (X-ray source)
Let w, which is the weighting coefficient in back projection, be w=1/
(L 0 2 ), h=L−x・cosθ k −y・sinθ k …(1) p=x・sinθ k −y・cosθ k …(2) w=1/(h 2 +p 2 ) ...(3) α=tan -1 (p/h) ...(4) y=y On j , if x changes by Δx, the changes in p and h are respectively Δp and Δh, then Δp=Δx・sinθ k …(5) Δh=−Δx・cosθ k …(6) Also, on x=x i , if y changes by −Δy, the changes in p and h are Δp′ and Δh′, respectively. , Δp′=Δy・cosθ k …(7) Δh′=Δy・sinθ k …(8) Also, y j =(n−j+0.5)・Δy …(9) However, j=1, 2,… , 2n Also, let l j be the number of intersections on the left side of the y-axis on the straight line y = y j , let the coordinates of point R j be (x n+1 , y j ), and let the straight line y = y j If the upper left end point is S j , the coordinates of point S j are ((0.5−l j )・Δx, (n−j
+0.5)・Δy).
ここで点Rjのhおよびpの値をそれぞれh0(j)お
よびp0(j)とすると、点Sjのhおよびpの値h1(j)お
よびp1(j)は、
p1(j)=p0(j)−lj・Δp …(10)
h1(j)=h0(j)−lj・Δh …(11)
p0(j+1)=p0(j)+Δp′ …(12)
h0(j+1)=h0(j)+Δh′ …(13)
また、直線y=yj上の点Qi(j)のpおよびhの値
をpi(j)およびhi(j)とし、また、その右隣点Qi+1(j)
のpおよびhの値をpi+1(j)およびhi+1(j)すると、
pi+1(j)=pi(j)+Δp …(14)
hi+1(j)=hi(j)+Δh …(15)
ここで、p0,h0,;p1,h1はjとθkの関数であ
り、また、Δp,Δh;Δp′,Δh′はθkの関数である
ので次のように表現する。 Here, if the values of h and p at point R j are h 0 (j) and p 0 (j), respectively, then the values h 1 (j) and p 1 (j) of h and p at point S j are p 1 (j)=p 0 (j)−l j・Δp …(10) h 1 (j)=h 0 (j)−l j・Δh …(11) p 0 (j+1)=p 0 (j) +Δp′ …(12) h 0 (j+1)=h 0 (j)+Δh′ …(13) Also, the values of p and h of point Qi(j) on the straight line y=y j are expressed as p i (j) and h i (j), and its right neighbor point Q i+1 (j)
If the values of p and h are p i+1 (j) and h i+1 (j), then p i+1 (j)=p i (j)+Δp …(14) h i+1 (j)= h i (j) + Δh …(15) Here, p 0 , h 0 , ;p 1 , h 1 are functions of j and θ k , and Δp, Δh; Δp′, Δh′ are functions of θ k Since it is a function, it can be expressed as follows.
Δp≡Δp(k)=Δx・sinθk …(5′)
Δh≡Δh(k)=−Δx・conθk …(6′)
Δp′≡Δp(k)′=Δy・cosθk …(7′)
Δh′≡Δh(k)′=Δy・sinθk …(8′)
p1(j,k)=p0(j,k)−lj・Δp(k)…(10′)
h1(j,k)=h0(j,k)−li・Δh(k)…(11′)
p0(j+1,k)=p0(j,k)+Δp(k)′…(12′
)
h0(j+1,k)=h0(j,k)+Δh(k)′…(13′
)
p(i+1,j,k)=p(i,j,k)+Δp(k)
…(14′)
h(i+1,j,k)=h(i,j,k)+Δh(k)
…(15′)
w(i,j,k)={(p(i,j,k))2
+(h(i,j,k))2}-1 …(3′)
CH(i,j,k)=CCH(k)+a・α(i,j,
k) …(4′)
ここで、CH(i,j,k)は、ピクセル点
(i,j);θ=θkにおける逆投影データの格納ア
ドレスを示し、CCH(k)は、θ=θkにおけるα=
0に対応する中心データ格納アドレスを示す。 Δp≡Δp(k)=Δx・sinθ k …(5′) Δh≡Δh(k)=−Δx・conθ k …(6′) Δp′≡Δp(k)′=Δy・cosθ k …(7′ ) Δh′≡Δh(k)′=Δy・sinθ k …(8′) p 1 (j, k)=p 0 (j, k)−l j・Δp(k)…(10′) h 1 ( j, k)=h 0 (j, k)−l i・Δh(k)…(11′) p 0 (j+1, k)=p 0 (j, k)+Δp(k)′…(12′
) h 0 (j+1,k)=h 0 (j,k)+Δh(k)′…(13′
) p(i+1,j,k)=p(i,j,k)+Δp(k)
...(14') h(i+1,j,k)=h(i,j,k)+Δh(k)
…(15′) w(i, j, k) = {(p(i, j, k)) 2 + (h(i, j, k)) 2 } -1 …(3′) CH(i, j, k)=CCH(k)+a・α(i, j,
k) ...(4') Here, CH(i, j, k) indicates the storage address of the back projection data at the pixel point (i, j); θ=θ k , and CCH(k) indicates the storage address of the back projection data at the pixel point (i, j); θ=θ α= at θ k
Indicates the central data storage address corresponding to 0.
ただし、aは比例定数である。 However, a is a proportionality constant.
また、点(i,j)の逆投影は、次式で示され
る。 Further, the back projection of the point (i, j) is expressed by the following equation.
μ(i,j)=bVn
〓k=1
w(i,j,k)×D(CH(i,j,k)) …(16)
ここで、D(CH(i,j,k))は、θ=θk、点
(i,j)におけるデータ格納アドレスCH(i,
j,k)における逆投影データであり、bは比例
定数である。 μ(i,j)=b Vn 〓 k=1 w(i,j,k)×D(CH(i,j,k)) …(16) Here, D(CH(i,j,k) ) is θ=θ k , data storage address CH(i, j) at point (i, j)
j, k), and b is a proportionality constant.
このように、一つ点R1(m+1,1)に対応す
るp0(1,k)、h0(1,k)、Δp(k)、Δh(k)、Δp
(k)′、Δh(k)′あるいは二つの点R1、Ro+1に対応す
るものと、画像再構成領域形状に対応するljとに
より、全ての点(i,j,k)の逆投影制御パラ
メータp(i,j,k)、h(i,j,k)を漸化
式で求めることができる。 In this way, p 0 (1, k), h 0 (1, k), Δp(k), Δh(k), Δp corresponding to one point R 1 (m+1,1)
(k)′, Δh(k)′ or those corresponding to the two points R 1 and R o+1 , and l j corresponding to the shape of the image reconstruction area, all points (i, j, k) The backprojection control parameters p(i, j, k) and h(i, j, k) can be obtained using recurrence formulas.
以下、本発明実施例の逆投影装置を図面に基づ
いて説明する。第2図は、この実施例装置の構成
を示すブロツク構成図である。
Hereinafter, a back projection apparatus according to an embodiment of the present invention will be explained based on the drawings. FIG. 2 is a block configuration diagram showing the configuration of the apparatus of this embodiment.
まず、この実施例装置の構成を第2図に基づき
説明する。この実施例装置は、第一のメモリ群1
と、第二のメモリ群2と、第三のメモリ群3と、
演算装置4と、第一のレジスタメモリ群5と、第
二のレジスタメモリ群6と、第一のテーブル7
と、第二テーブル8と、高速アクセス・メモリ9
と、乗算器10と、バツフアレジスタ群11と、
低速アクセス・メモリ12と、セレクタ13と、
加算器14と、制御装置15とで構成される。 First, the configuration of this embodiment device will be explained based on FIG. 2. This embodiment device has a first memory group 1
, a second memory group 2, a third memory group 3,
Arithmetic unit 4, first register memory group 5, second register memory group 6, and first table 7
, a second table 8 and a fast access memory 9
, a multiplier 10, a buffer register group 11,
a low-speed access memory 12, a selector 13,
It is composed of an adder 14 and a control device 15.
第一のメモリ群1の第一の入力と、第二のメモ
リ群2の第一の入力と、第三のメモリ群3の第一
の入力とは、データライン20に接続され、第一
のメモリ群1の出力と第二のメモリ群2の出力
と、第三のメモリ群3の出力のそれぞれは、演算
装置4の第一の入力と、演算装置4の第二の入力
と、演算装置4の第三の入力とのそれぞれに接続
される。 A first input of the first memory group 1, a first input of the second memory group 2 and a first input of the third memory group 3 are connected to a data line 20, The output of the memory group 1, the output of the second memory group 2, and the output of the third memory group 3 are respectively connected to the first input of the arithmetic device 4, the second input of the arithmetic device 4, and the arithmetic device. 4 and a third input, respectively.
演算装置4の第一の出力は、第一のメモリ群1
の第二の入力に接続され、演算装置4の第二の出
力は、第一のレジスタメモリ群5の第一の入力に
接続され、演算装置4の第三の出力は、第二のレ
ジスタメモリ群6の第一の入力に接続され、第一
のレジスタメモリ群5の出力は、第一のレジスタ
メモリ群5の第一の入力、第一のテーブル7の第
一の入力および第二のテーブル8の第一の入力と
に接続され、第二のレジスタメモリ6の出力は、
第二のレジスタメモリ6の第一入力、第一のテー
ブル7の第二の入力および第二のテーブル8の第
二の入力とに接続される。 The first output of the arithmetic unit 4 is the first output of the first memory group 1
The second output of the arithmetic unit 4 is connected to the first input of the first register memory group 5, and the third output of the arithmetic unit 4 is connected to the second register memory group 5. connected to the first input of the group 6, the output of the first register memory group 5 is connected to the first input of the first register memory group 5, the first input of the first table 7 and the second table 8 and the output of the second register memory 6 is
It is connected to a first input of the second register memory 6 , a second input of the first table 7 and a second input of the second table 8 .
高速アクセス・メモリ9の第一の入力は、デー
タライン20に接続され、第一のテーブル7の出
力は、高速アクセス・メモリ9の第二の入力に接
続され、第二のテーブル8の出力は、乗算器10
の第二の入力に接続され、高速アクセス・メモリ
9の出力は、乗算器10の第一の入力に接続さ
れ、乗算器10の出力は、バツフアレジスタ群1
1の第一の入力に接続され、バツフアレジスタ群
11の出力は、加算器14の第二の入力に接続さ
れる。 The first input of the fast access memory 9 is connected to the data line 20, the output of the first table 7 is connected to the second input of the fast access memory 9, and the output of the second table 8 is connected to the data line 20. , multiplier 10
The output of the fast access memory 9 is connected to the first input of the multiplier 10, the output of the multiplier 10 is connected to the buffer register group 1.
The output of buffer register group 11 is connected to the second input of adder 14 .
加算器14の出力は、低速アクセス・メモリ1
2の第一の入力およびセレクタ13の第一の入力
に接続され、低速アクセス・メモリ12の出力
は、データライン20およびセレクタ13の第二
の入力に接続され、セレクタ13の出力は、加算
器14の第一の入力に接続される。 The output of adder 14 is connected to slow access memory 1
2 and a first input of a selector 13, the output of the slow access memory 12 is connected to a data line 20 and a second input of the selector 13, and the output of the selector 13 is connected to a first input of the adder 13. 14 first inputs.
制御装置15は、制御ライン25に接続され
る。制御装置15のと各装置1,2,3,…,1
4とは各々ラインで接続され、制御信号、データ
等の授受が行われる。 Control device 15 is connected to control line 25 . The control device 15 and each device 1, 2, 3,..., 1
4 are connected by lines, and control signals, data, etc. are exchanged.
次に、この実施例装置の動作を図に基づいて説
明する。この説明では、第1図のほかに、第3図
および第4図が用いられる。第3図は、逆投影の
動作手順を示す流れ図であり、第4図は、この実
施例装置の動作タイミングを示すタイミング・チ
ヤートであり、直線y=yj上のピクセル点(i,
j)の近傍における各部の動作、処理、演算およ
び入力データと出力データの詳細と相互関係など
が示される。ただし、この図では、8ビユー一括
の逆投影の場合が示されている。 Next, the operation of this embodiment device will be explained based on the drawings. In this explanation, FIGS. 3 and 4 are used in addition to FIG. 1. FIG. 3 is a flowchart showing the operation procedure of backprojection, and FIG. 4 is a timing chart showing the operation timing of this embodiment device. The pixel point ( i ,
The details and interrelationships of the operations, processing, calculations, and input data and output data of each part in the vicinity of j) are shown. However, this figure shows the case of back projection of 8 views at once.
まず、この実施例装置を構成するブロツク回路
の動作を第2図に基づき説明する。 First, the operation of the block circuit constituting the apparatus of this embodiment will be explained based on FIG.
第一のメモリ群1では、p0(1,k)およびh0
(1,k)(ただし、k=1,2,…,Vmとす
る。)の初期値と、その更新された値p0(j,k)
およびh0(j,k)(ただし、j=1,2,…,2n
とする。)が格納される。また、第二のメモリ群
2では、Δp(k)とΔh(k)、およびΔp(k)′とΔh(k)′の
値、またはΔxとΔy、sinθkとcosθkなどの値が格
納される。また、第三のメモリ群3では、直線y
=yj上のy軸の左側のピクセル数lj(ただし、j=
1,2,…,2nとする。)、直線y=yj上のピクセ
ル数mj、直線yの総数Nおよびビユー総数Vmな
どが格納される。 In the first memory group 1, p 0 (1,k) and h 0
The initial value of (1, k) (k = 1, 2, ..., Vm) and its updated value p 0 (j, k)
and h 0 (j, k) (where j=1, 2,..., 2n
shall be. ) is stored. In addition, the second memory group 2 stores the values of Δp(k) and Δh(k), Δp(k)' and Δh(k)', or values such as Δx and Δy, sinθ k and cosθ k , etc. be done. In addition, in the third memory group 3, the straight line y
= Number of pixels to the left of the y-axis on y j (where j =
Let 1, 2, ..., 2n. ), the number m j of pixels on the straight line y=y j , the total number N of straight lines y, the total number of views Vm, etc. are stored.
演算装置4では、第一のメモリ群1、第二のメ
モリ群2および第三のメモリ群3の出力が入力さ
れ、前述の式(10′)、(11′)、(12′)および(13
′)
の演算が行われて、演算結果が第一のレジスタメ
モリ群5、第二のレジスタメモリ群6および第一
のメモリ群1に出力される。 In the arithmetic unit 4, the outputs of the first memory group 1, the second memory group 2, and the third memory group 3 are input, and the above-mentioned equations (10'), (11'), (12') and ( 13
′)
The calculation results are output to the first register memory group 5, the second register memory group 6, and the first memory group 1.
第一のレジスタメモリ5および第二のレジスタ
メモリ6には演算器が内蔵され、第一のレジスタ
メモリ5では、h1(j,k)およびΔhを、また、
第二のレジスタメモリ6では、p1(j,k)およ
びΔpを演算装置4から初期設定され、この設定
値が、第一のテーブル7および第二のテーブル8
のそれぞれに出力されるとともに、前述の式
(14′)および(15′)によるによつて逆投影制御
パラメータp(i+1,j,k)、h(i+1,j,
k)の演算が行われ、その結果により記憶内容が
更新される。 The first register memory 5 and the second register memory 6 have built-in arithmetic units, and the first register memory 5 calculates h 1 (j, k) and Δh, and
In the second register memory 6, p 1 (j, k) and Δp are initialized by the arithmetic unit 4, and these set values are used in the first table 7 and the second table 8.
The back projection control parameters p(i+1,j,k), h(i+1,j,
The calculation k) is performed, and the stored contents are updated based on the result.
第一のテーブル7および第二のテーブル8には
演算器が内蔵され、それぞれのテーブルでは、前
述の式(4′)および(3′)に対応する演算が行わ
れる。 The first table 7 and the second table 8 have built-in arithmetic units, and in each table, calculations corresponding to the above-mentioned equations (4') and (3') are performed.
高速アクセス・メモリ9では、最小サイクルで
の連続読出し動作と、初期設定または適当なビユ
ー数のデータ・ブロツク単位での書込み動作が行
われる。高速アクセスメモリ9には、逆投影デー
タ群が格納され、第一のテーブル7の出力を格納
アドレスとしてそれに対応する逆投影データ読出
され、乗算器10に出力される。 The high-speed access memory 9 performs continuous read operations in minimum cycles and write operations in units of initial setting or data blocks of an appropriate number of views. A group of back projection data is stored in the high speed access memory 9, and the back projection data corresponding thereto is read out using the output of the first table 7 as a storage address, and is output to the multiplier 10.
低速アクセス・メモリ12では、イメージ・デ
ータまたはその中間結果μ(i,j)が格納され
る。 In the slow access memory 12, image data or its intermediate result μ(i,j) is stored.
このメモリに対する読出しと書込みは、適当な
ビユー数単位で実行される。また、連続逆投影動
作での読出しと書込みは、シーケンシヤル・アク
セスで行うことができる。また、イメージ・デー
タの配置は、直線y1上の点(1,1)、(2,1)、
…(m1,1)、直線y2上の点(1,2)、(2,
2),…、(m2,2)…、直線yj上の点(1,
j)、(2,j)、…、(mj,j)、…の順で選ぶこ
とが可能でありアドレシングが容易にできる。 Reading and writing to this memory is performed in units of an appropriate number of views. Furthermore, reading and writing in continuous backprojection operations can be performed by sequential access. Also, the arrangement of the image data is points (1, 1), (2, 1), on the straight line y 1 ,
...(m 1 , 1), point (1, 2) on straight line y 2 , (2,
2),..., (m 2 , 2)..., point (1,
j), (2, j), . . . , (m j , j), . . . can be selected in this order, making addressing easy.
乗算器10では、高速アクセス・メモリ9の出
力と、第二のテーブル8の出力とが入力され、こ
の二つの入力の乗算演算が行われ、その演算結果
がバツフアレジスタ群11に出力される。 The multiplier 10 receives the output of the high-speed access memory 9 and the output of the second table 8, performs a multiplication operation on these two inputs, and outputs the result to the buffer register group 11. .
セレクタ13では、低速アクセス・メモリ12
の出力、加算器14の出力、値Oのデータの何れ
かが選択される。 In the selector 13, the low speed access memory 12
The output of the adder 14, the output of the adder 14, and the data of value O are selected.
加算器14では、バツフアレジスタ群11の出
力と、セレクタ13の出力とが入力され、この二
つの入力の加算演算が行われ、その演算結果が低
速アクセス・メモリ12およびセレクタ13に出
力される。 The adder 14 receives the output of the buffer register group 11 and the output of the selector 13, performs an addition operation on these two inputs, and outputs the result to the low-speed access memory 12 and the selector 13. .
バツフアレジスタ11では、乗算器10の出力
が一時的に格納され、必要に応じて読出されて加
算器14に与えられる。また、バツフアレジスタ
11は、同一のタイミングで、必ずしも等しくな
いアドレスからのデータ読出しと書込みが同時に
行えるように構成されている。このバツフアレジ
スタ群により、各装置間の不均一な応答時間の遅
れが吸収されて、加算器14が最高速で、すなわ
ち、本装置が最高速で使用される。 In the buffer register 11, the output of the multiplier 10 is temporarily stored, read out as necessary, and provided to the adder 14. Further, the buffer register 11 is configured so that data can be simultaneously read and written from addresses that are not necessarily the same, at the same timing. This group of buffer registers absorbs delays in non-uniform response times between devices, allowing the adder 14 to be used at maximum speed, that is, the present device to be used at maximum speed.
制御装置15は、各装置の動作、相互のタイミ
ング、および外部装置とのデータの授受などを統
一的に制御する信号を生成する。 The control device 15 generates signals that uniformly control the operations of each device, mutual timing, data exchange with external devices, and the like.
次に、この実施例装置にかかわる逆投影の動作
手順を説明する。この動作手順は、第3図に示さ
れているが、ここで、この動作手順の基本を説明
する。 Next, an explanation will be given of the back projection operation procedure related to this embodiment apparatus. This operating procedure is shown in FIG. 3, and the basics of this operating procedure will now be explained.
() Kビユー分を一まとめにした逆投影が行わ
れる。() Back projection of the K views is performed.
() 直線y=y1の最左のピクセル点から逆投影
が開始され、順次右隣に移行する。() Back projection starts from the leftmost pixel point of the straight line y=y 1 and moves sequentially to the right neighbor.
() 直線y=yjの逆投影が全部終了後に、直線
y=yj+1について()と同様の逆投影が行わ
れる。() After the back projection of the straight line y=y j is completed, the same back projection as in () is performed for the straight line y=y j+1 .
() すべての直線、すなわち、すべてのピクセ
ル点の逆投影が終了後に、次のKビユーについ
て()〜()の動作手順が繰返される。() After the back projection of all straight lines, that is, all pixel points, is completed, the operating procedure of () to () is repeated for the next K view.
次に、この実施例装置の各部の動作タイミング
を説明する。この動作タイミングは、第4図に示
されているが、ここで、この動作タイミングの基
本を説明すると、
() 第一のレジスタメモリ群5、第二レジスタ
メモリ群6、およびバツフアレジスタ群11な
どでは、読出しおよび書込み動作が、基本クロ
ツクの1サイクル内で完了する。 Next, the operation timing of each part of this embodiment device will be explained. This operation timing is shown in FIG. 4. Here, the basics of this operation timing will be explained as follows: () First register memory group 5, second register memory group 6, and buffer register group 11 etc., read and write operations are completed within one cycle of the basic clock.
() 第一のテーブル7と第二のテーブル8、高
速アクセス・メモリ9と低速アクセス・メモリ
12、および乗算器10と加算器14では、入
力が与えられてから出力が得られるまで、また
は、装置を始動してから動作が完了するまで
に、図に示すように、それぞれ時間遅れτcと
τw、τhとτnnおよびτnとτaが生ずるので、演算、
処理および制御などでこの時間遅れを考慮した
制御がなされる。() In the first table 7 and the second table 8, the fast access memory 9 and the slow access memory 12, and the multiplier 10 and adder 14, from the time an input is given until the output is obtained, or As shown in the figure, time delays τ c and τ w , τ h and τ nn , and τ n and τ a occur from the time the device is started until the operation is completed.
Control is performed in consideration of this time delay in processing and control.
() 加算器14では、ピクセル点(i,j)の
処理と同時に、ピクセル点(i−1,j)およ
び(i+1,j)の処理がなされている。各装
置相互間でも、類似の並列動作が行われる。() In the adder 14, pixel points (i-1, j) and (i+1, j) are processed simultaneously with the processing of pixel point (i, j). Similar parallel operations are performed between each device.
() 各装置は、始点および終点などでのオーバ
ヘツド部を除き、完全な並列処理が実行される
ように制御される。() Each device is controlled so that complete parallel processing is executed, except for overhead at the start and end points.
以上、実施例装置について説明したが、下記の
ように構成しても、本発明を実施することができ
る。 Although the embodiment apparatus has been described above, the present invention can also be implemented with the following configuration.
() 第一のメモリ群1と、第二のメモリ群2
と、第三のメモリ群3とを、一個または複数組
のメモリで構成する、
() 演算装置4を、加算器、乗算器およびレジ
スタなどで構成する、
() 第一のレジスタメモリ群5を、h用とΔh用
の二組のレジスタ群と加算器などで構成する、
() 第二のレジスタメモリ群6を、p用とΔp用
の二組のレジスタ群と加算器などで構成する、
() 第一のテーブル7を、演算器とテーブル群
またはメモリ群などで構成する、
() 第二のテーブル8を、演算器とテーブル群
またはメモリ群などで構成する、
() セレクタ13と加算器14を一体化して構
成する、
() バツフアレジスタ群11を、複数のレジス
タ群で構成する、
() 高速アクセス・メモリ9および低速アクセ
ス・メモリ12を複数個に分割する、
() 制御装置15を、マイクロ・プログラム・
メモリ、デコーダ、制御装置などで構成する、
(xi) データ・ラインおよび制御ライン20を、
統一または分離して構成する(バスの共通化な
ど)、
(xii) 複数装置を合体して、または、一つの装置
を複数に分離して構成する。() First memory group 1 and second memory group 2
and the third memory group 3 are composed of one or more sets of memories; () the arithmetic unit 4 is composed of an adder, a multiplier, a register, etc.; () the first register memory group 5 is composed of one or more sets of memories; , consists of two sets of register groups for h and Δh, an adder, etc. () The second register memory group 6 is composed of two sets of registers for p and Δp, an adder, etc. () The first table 7 is composed of an arithmetic unit and a table group or a memory group, etc. () The second table 8 is composed of an arithmetic unit and a table group or a memory group, etc. () The selector 13 and addition () The buffer register group 11 is configured by a plurality of register groups. () The high-speed access memory 9 and the low-speed access memory 12 are divided into a plurality of pieces. () The control device 15 as a micro program.
(xi) data and control lines 20, consisting of memory, decoders, control devices, etc.;
(xii) Configure multiple devices by combining them or by separating one device into multiple devices.
また、直線y=yjに沿つて、右端から左端へ行
う逆投影の動作手順、直線x=xiに沿つて上端か
ら下端へ行う動作手順、また、直線x=xiに沿つ
て、下端から上端へ行う動作手順でも、本発明を
実施することができる。 In addition, the back projection operation procedure is performed from the right end to the left end along the straight line y = y j , the operation procedure is performed from the upper end to the lower end along the straight line x = x i , and the operation procedure is performed from the upper end to the lower end along the straight line x = x i . The present invention can also be implemented in an operating procedure from the top to the top.
また、一括処理ビユー数を常に一定数に保たな
くても、本発明を実施することができる。 Further, the present invention can be implemented even if the number of batch-processed views is not always kept constant.
さらに、式(16)を次式(16′)に変更しても、本
発明を実施することができる。 Furthermore, the present invention can be practiced even if the equation (16) is changed to the following equation (16').
μ(i,j)=Vn
〓
〓k=1
bk・w(i,j,k)×D(CH(i,j,k))…
(16′)
〔発明の効果〕
本発明は、以上説明したように、次に列挙する
効果がある。 μ (i, j) = Vn 〓 〓 k=1 b k・w (i, j, k) × D (CH (i, j, k))...
(16') [Effects of the Invention] As explained above, the present invention has the following effects.
(1) フアンビーム用の逆投影を高速化し高能率化
する。(1) Faster and more efficient back projection for fan beams.
(2) 楕円形を含む任意の形状の再構成領域にたい
しての逆投影を高速化する。(2) Speed up backprojection for reconstruction regions of arbitrary shapes, including ellipses.
(3) イメージデータへのアクセス頻度を軽減する
ことにより、大量のイメージ・データが安価な
低速メモリに置かれ、高価な高速メモリの使用
が逆投影データのみに限定できるので、装置を
安価で経済的に設計でき、コストパーホーマン
スを高めることができる。(3) By reducing the frequency of access to image data, large amounts of image data can be placed in cheap, low-speed memory, and the use of expensive, high-speed memory can be limited to backprojection data, making the device cheaper and more economical. It can be designed in a practical manner, and cost performance can be improved.
(4) スキヤン・データが期待したビユーの方向か
ら外れたり、また、ばらついたりする場合で
も、逆投影制御データを実際のそれぞれのθkの
値に合わせて、動的な演算または選択により変
更させることにより、画質を高品質に維持し、
かつ逆投影の処理時間を高速に維持する。(4) Even if the scan data deviates from the expected viewing direction or varies, the back projection control data can be changed by dynamic calculation or selection to match the actual value of each θ k . By doing this, you can maintain high image quality,
In addition, the back projection processing time is maintained at high speed.
(5) シンプルで汎用性の高い設計思想に基づいた
制御構造なのでフイールドオブビユー(Field
of View)の種類と形状等に無関係に、再構成
領域の中心がX線源の回転中心(Iso Center)
と一致しない場合(拡大再構成等)にも逆投影
のフアームウエアを同一にしうる。(5) Because the control structure is based on a simple and highly versatile design concept, field-of-view (field-of-view)
The center of the reconstruction area is the rotation center (Iso Center) of the X-ray source, regardless of the type and shape of the
Even if they do not match (enlarged reconstruction, etc.), the back projection firmware can be made the same.
(6) 逆投影の制御データが極小であるので、制御
データの高速プロセツサへのデータ転送が極小
になり、したがつて、総合的な逆投影処理およ
び再構成処理を、高速化し高能率化する。(6) Since the control data for backprojection is extremely small, the data transfer of the control data to the high-speed processor becomes extremely small, thus speeding up the overall backprojection processing and reconstruction processing and making it highly efficient. .
第1図は本発明にかかわる逆投影の原理を説明
する模式図。第2図は本発明にかかわる逆投影の
実施例装置の構成を示すブロツク構成図。第3図
は本発明にかかわる逆投影の実施例装置の逆投影
の動作手順を示す流れ図。第4図は実施例装置の
動作タイミングを示すタイミング・チヤート。
1,2,3……メモリ群、4……演算装置、
5,6……レジスタメモリ群、7,8……テーブ
ル、9……高速アクセス・メモリ、10……乗算
器、11……バツフアレジスタ部、12……低速
アクセス・メモリ、13……セレクタ、14……
加算器、15……制御装置、20……データライ
ン、25……制御ライン。
FIG. 1 is a schematic diagram explaining the principle of back projection related to the present invention. FIG. 2 is a block diagram showing the configuration of an embodiment of a back projection apparatus according to the present invention. FIG. 3 is a flowchart showing the backprojection operation procedure of the embodiment of the backprojection apparatus according to the present invention. FIG. 4 is a timing chart showing the operation timing of the embodiment device. 1, 2, 3...Memory group, 4...Arithmetic unit,
5, 6... Register memory group, 7, 8... Table, 9... High speed access memory, 10... Multiplier, 11... Buffer register section, 12... Low speed access memory, 13... Selector , 14...
Adder, 15...control device, 20...data line, 25...control line.
Claims (1)
たは電磁波を被検体の断面部分に透過させその断
面部分に関してこの放射線または電磁波の応答で
あるそれぞれ多数個のサンプリングデータとして
得られるビユーデータを多数の角度方向に走査収
集する第一の手段と、 この第一の手段によつて得られた多数のビユー
データより前記断面部分に関する前記応答の分布
画像を逆投影法により再構成する第二の手段と、 この第二の手段で得られた前記分布画像を画面
に表示する第三の手段と を備えた計算機トモグラフイ装置において、 前記第二の手段は、 再構成領域をx軸、y軸からなるxy座標で表
し、このx軸、y軸にそれぞれ平行な直線で前記
再構成領域を格子状に区切り、この格子状の各交
点をそれぞれ再構成画像を構成するピクセルとす
るとき、 前記x軸に平行な各直線上のピクセルの総数、
前記y軸に平行な各直線上のピクセルの総数、前
記再構成領域を前記y軸に平行な直線で二分しこ
の二分された第一の部分又は第二の部分の前記x
軸に平行な各直線上のピクセル数(lj)、前記再
構成領域を前記x軸に平行な直線で二分しこの二
分された第一の部分又は第二の部分の前記y軸に
平行な各直線上のピクセル数(li)、前記x軸に平
行な直線の総数(2n)、前記y軸に平行な直線の
総数(2m)、前記再構成領域を前記x軸に平行な
一個以上の直線で複数の部分に分けその各部分の
x軸に平行な直線の総数、および前記再構成領域
を前記y軸に平行な一個以上の直線で複数の部分
に分けその各部分のy軸に平行な直線の総数を前
記構成領域の形状に関する制御パラメータとして
その一部又は全部を記憶する手段と、 前記再構成領域の内部または外部に存在する単
数または複数の特定点における逆投影制御パラメ
ータ(p0(1,k)、h0(1,k)、Δp(k)、Δh(k)、
Δp(k)′、Δh(k)′またはΔx、sinθk、cosθk、L、
x、y)を記憶する手段と、 演算手段と を備え、 前記演算手段は、前記再構成領域の形状に関す
る前記制御パラメータと前記特定点の逆投影制御
パラメータとから、各ピクセルにおける逆投影制
御パラメータ(p(i,j,k)、h(i,j,
k))を逐次演算により生成する手段を含む ことを特徴とする計算機トモグラフイ装置。 2 第二の手段には、各ピクセルについて、各ビ
ユー毎の乗算(重み付きデータ)とその結果の加
算を多数のビユーについえ繰り返し実行し、大容
量の各ピクセル・メモリに中間結果または最終結
果を蓄積する逆投影積分手段を含み、 この逆投影積分手段は、複数のビユーについて
各ビユー毎の重みつきデータを加算した結果を対
応するピクセルのデータに加算して蓄積するよう
に構成し、各ピクセル・メモリに対する読出し書
込みの回数すなわち各ピクセル・メモリへのアク
セスを軽減し、ピクセル・メモリを低速アクセス
メモリで構成する特許請求の範囲第1項に記載の
計算機トモグラフイ装置。 3 逆投影積分手段には、縦続接続された乗算器
および加算器を含み、この加算器の入力回路に、
同一のタイミングで別のアドレスにデータの読出
しおよび書込みを実行することができるバツフア
回路を備えた特許請求の範囲第2項に記載の計算
機トモグラフイ装置。 4 第一の手段として核磁気共鳴吸収現象により
データ収集を行う特許請求の範囲第1項に記載の
計算機トモグラフイ装置。[Claims] 1. Radiation or electromagnetic waves are generated, the radiation or electromagnetic waves are transmitted through a cross section of a subject, and view data obtained as a plurality of sampling data, each of which is a response to the radiation or electromagnetic waves, for the cross section is obtained. a first means for scanning and collecting data in a large number of angular directions; and a second means for reconstructing a distribution image of the response regarding the cross-sectional area by a back projection method from a large number of view data obtained by the first means. and a third means for displaying the distribution image obtained by the second means on a screen, the second means comprising: When the reconstruction area is divided into a grid by straight lines parallel to the x-axis and y-axis, and each intersection of the grid is defined as a pixel constituting the reconstructed image, the x-axis The total number of pixels on each line parallel to ,
The total number of pixels on each straight line parallel to the y-axis, the reconstruction area divided into two by a straight line parallel to the y-axis, and the x of this bisected first part or second part
The number of pixels (l j ) on each straight line parallel to the axis, bisect the reconstruction area by a straight line parallel to the x-axis, and the number of pixels parallel to the y-axis of the first or second bisected part. The number of pixels on each straight line (l i ), the total number of straight lines parallel to the x-axis (2n), the total number of straight lines parallel to the y-axis (2m), the reconstruction area to one or more parallel to the x-axis The reconstruction area is divided into a plurality of parts by one or more straight lines parallel to the y-axis, and the total number of straight lines parallel to the x-axis of each part is divided into a plurality of parts, and the reconstruction area is divided into a plurality of parts by one or more straight lines parallel to the y-axis. means for storing part or all of the total number of parallel straight lines as a control parameter regarding the shape of the configuration region; and means for storing a back projection control parameter (p 0 (1, k), h 0 (1, k), Δp(k), Δh(k),
Δp(k)′, Δh(k)′ or Δx, sinθ k , cosθ k , L,
x, y); and a calculation device, the calculation device calculating a backprojection control parameter for each pixel from the control parameter regarding the shape of the reconstruction area and the backprojection control parameter of the specific point. (p(i, j, k), h(i, j,
A computer tomography apparatus characterized by comprising means for generating k)) by sequential calculation. 2 The second method involves repeatedly performing multiplication (weighted data) for each view and addition of the results for each pixel over a large number of views, and storing the intermediate or final results in a large capacity memory for each pixel. The back projection integrating means is configured to add and accumulate the result of adding weighted data for each view for a plurality of views to the data of the corresponding pixel. 2. The computer tomography apparatus according to claim 1, wherein the number of reads and writes to the pixel memory, that is, the number of accesses to each pixel memory is reduced, and the pixel memory is configured with a low-speed access memory. 3. The backprojection integration means includes a cascaded multiplier and an adder, and the input circuit of the adder includes:
The computer tomography apparatus according to claim 2, comprising a buffer circuit that can read and write data to different addresses at the same timing. 4. The computer tomography apparatus according to claim 1, which collects data by a nuclear magnetic resonance absorption phenomenon as a first means.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59051320A JPS60194939A (en) | 1984-03-16 | 1984-03-16 | Calculator tomography apparatus |
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| JP59051320A JPS60194939A (en) | 1984-03-16 | 1984-03-16 | Calculator tomography apparatus |
Publications (2)
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|---|---|
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| US7769126B2 (en) * | 2007-09-25 | 2010-08-03 | Canon Kabushiki Kaisha | Computed tomography system |
-
1984
- 1984-03-16 JP JP59051320A patent/JPS60194939A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60194939A (en) | 1985-10-03 |
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