JPH0532962B2 - - Google Patents
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- JPH0532962B2 JPH0532962B2 JP58030808A JP3080883A JPH0532962B2 JP H0532962 B2 JPH0532962 B2 JP H0532962B2 JP 58030808 A JP58030808 A JP 58030808A JP 3080883 A JP3080883 A JP 3080883A JP H0532962 B2 JPH0532962 B2 JP H0532962B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- output
- speed limit
- frequency
- brake command
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B60—VEHICLES IN GENERAL
- B60L—PROPULSION OF ELECTRICALLY-PROPELLED VEHICLES; SUPPLYING ELECTRIC POWER FOR AUXILIARY EQUIPMENT OF ELECTRICALLY-PROPELLED VEHICLES; ELECTRODYNAMIC BRAKE SYSTEMS FOR VEHICLES IN GENERAL; MAGNETIC SUSPENSION OR LEVITATION FOR VEHICLES; MONITORING OPERATING VARIABLES OF ELECTRICALLY-PROPELLED VEHICLES; ELECTRIC SAFETY DEVICES FOR ELECTRICALLY-PROPELLED VEHICLES
- B60L3/00—Electric devices on electrically-propelled vehicles for safety purposes; Monitoring operating variables, e.g. speed, deceleration or energy consumption
- B60L3/08—Means for preventing excessive speed of the vehicle
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B60—VEHICLES IN GENERAL
- B60L—PROPULSION OF ELECTRICALLY-PROPELLED VEHICLES; SUPPLYING ELECTRIC POWER FOR AUXILIARY EQUIPMENT OF ELECTRICALLY-PROPELLED VEHICLES; ELECTRODYNAMIC BRAKE SYSTEMS FOR VEHICLES IN GENERAL; MAGNETIC SUSPENSION OR LEVITATION FOR VEHICLES; MONITORING OPERATING VARIABLES OF ELECTRICALLY-PROPELLED VEHICLES; ELECTRIC SAFETY DEVICES FOR ELECTRICALLY-PROPELLED VEHICLES
- B60L2200/00—Type of vehicles
- B60L2200/26—Rail vehicles
Landscapes
- Engineering & Computer Science (AREA)
- Life Sciences & Earth Sciences (AREA)
- Sustainable Development (AREA)
- Sustainable Energy (AREA)
- Power Engineering (AREA)
- Transportation (AREA)
- Mechanical Engineering (AREA)
- Electric Propulsion And Braking For Vehicles (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は制限速度に対応して外部より指令され
る速度制御信号である周波数信号によつて実列車
速度制御を行なう車両用自動列車制御装置に関す
る。
る速度制御信号である周波数信号によつて実列車
速度制御を行なう車両用自動列車制御装置に関す
る。
従来の車両用自動列車制御装置は第１図に示す
如き構成を有している。すなわち、外部より信号
を受信するアンテナ１にはバンドパスフイルタ２
が接続されており、このバンドパスフイルタ２に
は検波器３が接続されている。この検波器３には
ローパスフイルタ４を介しててい倍回路７と変調
器３１が接続されている。このバンドパスフイル
タ２と検波器３とローパスフイルタ４とによつて
復調部５を形成している。このてい倍回路７には
バンドパスフイルタ８を介して検波器９と、スキ
ヤンロジツク部２１とが接続されている。検波器
９には複数のAND回路１２1〜１２oが接続され
ており、この複数のAND回路１２1〜１２oのそ
れぞれの他の入力端子には、スキヤンロジツク部
２１から出力される信号が入力するように構成さ
れている。このてい倍回路７とバンドパスフイル
タ８と検波器９とによつててい倍部１０が形成さ
れている。また、複数のAND回路１２1〜１２o
のそれぞれの出力端子には、メモリ１３1〜１３o
が接続されている。このAND回路１２1〜１２o
とメモリ１３1〜１３oによつて並直変換メモリ部
１４が構成されている。この複数のメモリ１３1
〜１３oの出力端には、低位優先回路１６と、プ
ログラマブルオシレータ１８が接続されている。
この低位優先回路１６から低位優先され制御部４
１へ出力される。また、プログラマブルオシレー
タ１８からは、変調器３１に信号が出力されるよ
うに構成されている。この変調器３１にはバンド
パスフイルタ３２を介して低位優先回路１６が接
続されている。
如き構成を有している。すなわち、外部より信号
を受信するアンテナ１にはバンドパスフイルタ２
が接続されており、このバンドパスフイルタ２に
は検波器３が接続されている。この検波器３には
ローパスフイルタ４を介しててい倍回路７と変調
器３１が接続されている。このバンドパスフイル
タ２と検波器３とローパスフイルタ４とによつて
復調部５を形成している。このてい倍回路７には
バンドパスフイルタ８を介して検波器９と、スキ
ヤンロジツク部２１とが接続されている。検波器
９には複数のAND回路１２1〜１２oが接続され
ており、この複数のAND回路１２1〜１２oのそ
れぞれの他の入力端子には、スキヤンロジツク部
２１から出力される信号が入力するように構成さ
れている。このてい倍回路７とバンドパスフイル
タ８と検波器９とによつててい倍部１０が形成さ
れている。また、複数のAND回路１２1〜１２o
のそれぞれの出力端子には、メモリ１３1〜１３o
が接続されている。このAND回路１２1〜１２o
とメモリ１３1〜１３oによつて並直変換メモリ部
１４が構成されている。この複数のメモリ１３1
〜１３oの出力端には、低位優先回路１６と、プ
ログラマブルオシレータ１８が接続されている。
この低位優先回路１６から低位優先され制御部４
１へ出力される。また、プログラマブルオシレー
タ１８からは、変調器３１に信号が出力されるよ
うに構成されている。この変調器３１にはバンド
パスフイルタ３２を介して低位優先回路１６が接
続されている。
このアンテナ１と、復調部５と、てい倍部１０
と、並直変換メモリ部１４と、低位優先回路１６
と、プログラマブルオシレータ１８と、スキヤン
ロジツク部２１と、変調器３１と、バンドパスフ
イルタ３２とによつて受信部３４が構成されてい
る。
と、並直変換メモリ部１４と、低位優先回路１６
と、プログラマブルオシレータ１８と、スキヤン
ロジツク部２１と、変調器３１と、バンドパスフ
イルタ３２とによつて受信部３４が構成されてい
る。
この受信部３４の低位優先回路１６からの出力
は、第２図に示す如き制御部４１に出力される。
すなわち、出力信号１７1〜１７oは、AND回路
４２1〜４２oに入力され、このAND回路４２1〜
４２oの他方の入力端子にはメモリ４９からの出
力信号が入力されるように構成されている。ま
た、このAND回路４２1〜４２oの出力端子には、
OR回路を介して制限速度信号発生部４３が接続
されている。この制限速度信号発生部４３には比
較部４７が接続されている。この比較部４７の他
方には、変換部４４を介して速度発電機５１が接
続されている。この比較部４７からの出力がブレ
ーキ指令となる。
は、第２図に示す如き制御部４１に出力される。
すなわち、出力信号１７1〜１７oは、AND回路
４２1〜４２oに入力され、このAND回路４２1〜
４２oの他方の入力端子にはメモリ４９からの出
力信号が入力されるように構成されている。ま
た、このAND回路４２1〜４２oの出力端子には、
OR回路を介して制限速度信号発生部４３が接続
されている。この制限速度信号発生部４３には比
較部４７が接続されている。この比較部４７の他
方には、変換部４４を介して速度発電機５１が接
続されている。この比較部４７からの出力がブレ
ーキ指令となる。
このように構成されるものであるから、車上の
アンテナ１にて地上の軌道回路に流れる振幅変調
された速度段信号を受信し、この信号のキヤリア
成分をバンドパスフイルタ２に取り込み、さらに
検波器３とローパスフイルタ４によつて変調周波
数信号６を取り出す。さらにてい倍回路７にてこ
の変調周波数信号６をてい倍し、バンドパスフイ
ルター８、および検波器９にて信号１１を出力す
る。このときのてい倍部のてい倍度はスキヤンロ
ジツク部２１によつて制御され、てい倍度が順次
変えられてゆき、変調周波数６をてい倍した周波
数が、バンドパスフイルター８の中心周波数と合
つた場合にのみ、信号１１が出力される。一方ス
キヤンロジツク部２１より出力される信号G1〜
Goはてい倍部７のてい倍度のスキヤンに合わせ
順次加圧されてゆくようになつており、検波器９
より出力される信号１１と、スキヤンロツク部２
１より出力される信号G1〜GoのAND回路１２1
〜１２oにより、いずれかのAND回路出力が１と
なる。このAND回路出力により、メモリ１３1〜
１３oのうち、変調周波数６に対応したものが、
動作するようになつており、信号１５1〜１５oと
して出力される。さらにこの信号は低位優先回路
１６にて低位優先がとられ最終的な出力信号１７
１〜１７oが得られる。
アンテナ１にて地上の軌道回路に流れる振幅変調
された速度段信号を受信し、この信号のキヤリア
成分をバンドパスフイルタ２に取り込み、さらに
検波器３とローパスフイルタ４によつて変調周波
数信号６を取り出す。さらにてい倍回路７にてこ
の変調周波数信号６をてい倍し、バンドパスフイ
ルター８、および検波器９にて信号１１を出力す
る。このときのてい倍部のてい倍度はスキヤンロ
ジツク部２１によつて制御され、てい倍度が順次
変えられてゆき、変調周波数６をてい倍した周波
数が、バンドパスフイルター８の中心周波数と合
つた場合にのみ、信号１１が出力される。一方ス
キヤンロジツク部２１より出力される信号G1〜
Goはてい倍部７のてい倍度のスキヤンに合わせ
順次加圧されてゆくようになつており、検波器９
より出力される信号１１と、スキヤンロツク部２
１より出力される信号G1〜GoのAND回路１２1
〜１２oにより、いずれかのAND回路出力が１と
なる。このAND回路出力により、メモリ１３1〜
１３oのうち、変調周波数６に対応したものが、
動作するようになつており、信号１５1〜１５oと
して出力される。さらにこの信号は低位優先回路
１６にて低位優先がとられ最終的な出力信号１７
１〜１７oが得られる。
一方、この装置の動作のセルフチエツクのため
並直変換メモリ部１４から出力される出力信号１
５1〜１５oにより、プログラマブルオシレータ１
８より、各速度信号段に対応する周波数信号１９
を発生させている。この信号１９は変調器３１に
より復調部５から出力される信号６と変調され、
すなわち信号１９の周波数19と信信号６の周波
数6との間の変調により（19＋6）の周波数信
号が発生される。この（19＋6）の周波数信号
はバンドパスフイルタ３２に入力され、バンドパ
スフイルタ３２の中心周波数32に一致したとき、
すなわち32＝l19＋6の場合にのみ、出力３３が
でるようになつている。
並直変換メモリ部１４から出力される出力信号１
５1〜１５oにより、プログラマブルオシレータ１
８より、各速度信号段に対応する周波数信号１９
を発生させている。この信号１９は変調器３１に
より復調部５から出力される信号６と変調され、
すなわち信号１９の周波数19と信信号６の周波
数6との間の変調により（19＋6）の周波数信
号が発生される。この（19＋6）の周波数信号
はバンドパスフイルタ３２に入力され、バンドパ
スフイルタ３２の中心周波数32に一致したとき、
すなわち32＝l19＋6の場合にのみ、出力３３が
でるようになつている。
もし、このとき、32＝19＋6の関係が常に成
立するような19をプログラマブルオシレータ１
８で発生させるようにしておけば、並直変換メモ
リ部１４における周波数の判定結果１５1〜１５o
が正しいかどうかのチエツクができる。
立するような19をプログラマブルオシレータ１
８で発生させるようにしておけば、並直変換メモ
リ部１４における周波数の判定結果１５1〜１５o
が正しいかどうかのチエツクができる。
すなわち、入力周波数6に対する判定結果が正
しければバンドパスフイルタ３２から信号３３が
出力される。この信号３３が、万一出力されなく
なつた場合には、低位優先回路１６の出力を制御
し１７1〜１７oまでのいずれの信号も出さないよ
うにしておくことにより、装置の安全性を高める
ことができる。
しければバンドパスフイルタ３２から信号３３が
出力される。この信号３３が、万一出力されなく
なつた場合には、低位優先回路１６の出力を制御
し１７1〜１７oまでのいずれの信号も出さないよ
うにしておくことにより、装置の安全性を高める
ことができる。
さて、ここで判別された低位優先回路１６から
出力される信号１７1〜１７oは制御部４１に入力
される。この制御部４１は、信号１７1〜１７oに
対応した制限速度と、速度発電機５１などから与
えられる実列車速度とを比較し後者が前者を上回
つた場合ブレーキを出力する機能を持つものであ
る。
出力される信号１７1〜１７oは制御部４１に入力
される。この制御部４１は、信号１７1〜１７oに
対応した制限速度と、速度発電機５１などから与
えられる実列車速度とを比較し後者が前者を上回
つた場合ブレーキを出力する機能を持つものであ
る。
制御部４１内のメモリ４９には各制限速度に対
応したデータが記憶されており、信号１７1〜１
７oに応じて、AND回路４２1〜４２oにより適当
なデータが制限速度信号発生部４３に入力され
る。一方速度発電機５１などにより、検知された
速度情報は、適当な変換部４４により、演算に適
した実速度信号４６に変換される。その後、制限
速度信号４５と実速度信号４６が比較部４７によ
り比較され、後者が前者を上回つたときにブレー
キ指令６１が出力されるようになつている。
応したデータが記憶されており、信号１７1〜１
７oに応じて、AND回路４２1〜４２oにより適当
なデータが制限速度信号発生部４３に入力され
る。一方速度発電機５１などにより、検知された
速度情報は、適当な変換部４４により、演算に適
した実速度信号４６に変換される。その後、制限
速度信号４５と実速度信号４６が比較部４７によ
り比較され、後者が前者を上回つたときにブレー
キ指令６１が出力されるようになつている。
このように、従来の車両用自動列車制御装置に
あつては、受信部と制御部の間の情報伝達が並列
となつており、信号線数が制限速度の段数分必要
となり、また、信号がレベル信号であるために、
リレーなどを用いずにIC回路などでインターフ
エイスをとる場合には一重系ではフエイルセーフ
がとりにくいといつた欠点を有していた。
あつては、受信部と制御部の間の情報伝達が並列
となつており、信号線数が制限速度の段数分必要
となり、また、信号がレベル信号であるために、
リレーなどを用いずにIC回路などでインターフ
エイスをとる場合には一重系ではフエイルセーフ
がとりにくいといつた欠点を有していた。
なお、特開昭57−177205号公報には受信部と制
御部の間の情報伝達を一重系で行うようにしたも
のが示されているが、この公知例では鋸歯状波を
用いてスイツチドキヤパシタフイルタの中心周波
数を変化させているため、制限速度信号がキヤツ
チされるまでの間、スイツチドキヤパシタフイル
タの出力が零になつてとぎれてしまう。一般に、
制御部はフエイルセーフに設計されているため、
スイツチドキヤパシタフイルタからの出力がとぎ
れると停止側に動作するようになつており、上記
公知例では制限速度信号が切換わる度にブレーキ
指令が送出され、不必要なブレーキが掛かつてし
まうという欠点があつた。
御部の間の情報伝達を一重系で行うようにしたも
のが示されているが、この公知例では鋸歯状波を
用いてスイツチドキヤパシタフイルタの中心周波
数を変化させているため、制限速度信号がキヤツ
チされるまでの間、スイツチドキヤパシタフイル
タの出力が零になつてとぎれてしまう。一般に、
制御部はフエイルセーフに設計されているため、
スイツチドキヤパシタフイルタからの出力がとぎ
れると停止側に動作するようになつており、上記
公知例では制限速度信号が切換わる度にブレーキ
指令が送出され、不必要なブレーキが掛かつてし
まうという欠点があつた。
本発明の目的は、情報伝達のフエイルセーフ性
を構築するために制御部との間の信号線を一重系
にしても、受信部から制御部への信号がとぎれる
という事態を防止することができる自動列車制御
装置を提供することである。
を構築するために制御部との間の信号線を一重系
にしても、受信部から制御部への信号がとぎれる
という事態を防止することができる自動列車制御
装置を提供することである。
上記目的を達成するために、本発明は、列車の
制限速度信号を受信する受信手段と、前記制限速
度信号の周波数を判別する判別手段と、この判別
結果を記憶する記憶手段と、この記憶手段の出力
に応じた周波数の交番信号を単一の信号線に送出
する発振手段とを有する受信部と、前記信号線を
介して前記交番信号を入力し、該交番信号の周波
数に基づく列車制限速度信号と実列車速度または
相当信号とを比較する比較手段と、その比較の結
果、前記実列車速度または相当信号が前記列車制
限速度信号より大きい場合にブレーキ指令を送出
するブレーキ指令送出手段とを有する制御部と、 を備えたことを特徴としている。
制限速度信号を受信する受信手段と、前記制限速
度信号の周波数を判別する判別手段と、この判別
結果を記憶する記憶手段と、この記憶手段の出力
に応じた周波数の交番信号を単一の信号線に送出
する発振手段とを有する受信部と、前記信号線を
介して前記交番信号を入力し、該交番信号の周波
数に基づく列車制限速度信号と実列車速度または
相当信号とを比較する比較手段と、その比較の結
果、前記実列車速度または相当信号が前記列車制
限速度信号より大きい場合にブレーキ指令を送出
するブレーキ指令送出手段とを有する制御部と、 を備えたことを特徴としている。
また、本発明は、列車の制限速度信号を受信す
る受信手段と、前記制限速度信号の周波数を判別
する判別手段と、この判別結果を記憶する記憶手
段と、この記憶手段の出力に応じた周波数の交番
信号を単一の信号線に送出する発振手段とを有す
る受信部と、前記信号線を介して前記交番信号を
入力し、該交番信号の周波数に基づく列車制限速
度信号と実列車速度または相当信号とを比較する
比較手段と、その比較の結果、前記実列車速度ま
たは相当信号が前記列車制限速度信号より大きい
場合にブレーキ指令を送出するブレーキ指令送出
手段とを有する制御部と、前記発振手段の出力で
ある交番信号と、前記制限速度信号とを入力し照
合する照合手段と、その照合結果が正しいとき所
定の信号を出力する出力手段と、この所定の信号
がない場合にブレーキ指令を出力するブレーキ指
令出力手段とを有するチエツク部と、を備えたこ
とを特徴としている。
る受信手段と、前記制限速度信号の周波数を判別
する判別手段と、この判別結果を記憶する記憶手
段と、この記憶手段の出力に応じた周波数の交番
信号を単一の信号線に送出する発振手段とを有す
る受信部と、前記信号線を介して前記交番信号を
入力し、該交番信号の周波数に基づく列車制限速
度信号と実列車速度または相当信号とを比較する
比較手段と、その比較の結果、前記実列車速度ま
たは相当信号が前記列車制限速度信号より大きい
場合にブレーキ指令を送出するブレーキ指令送出
手段とを有する制御部と、前記発振手段の出力で
ある交番信号と、前記制限速度信号とを入力し照
合する照合手段と、その照合結果が正しいとき所
定の信号を出力する出力手段と、この所定の信号
がない場合にブレーキ指令を出力するブレーキ指
令出力手段とを有するチエツク部と、を備えたこ
とを特徴としている。
上記構成によれば、受信部から制御部への情報
伝達を、制限速度信号の判別結果に応じた発振手
段からの交番信号で行うことができ、受信部と制
御部との間を単一の信号線で結ぶことができる。
伝達を、制限速度信号の判別結果に応じた発振手
段からの交番信号で行うことができ、受信部と制
御部との間を単一の信号線で結ぶことができる。
また、制限速度信号の判別結果を記憶する記憶
手段と、この記憶手段の出力に応じた周波数の交
番信号を発生する発振手段の出力を用いて、後段
で速度照査を行うので、この速度照査を行う際に
制限速度信号がとぎれることがなく、制限速度信
号がとぎれた場合は、判別手段、記憶手段、発振
手段または信号線のいずれかに故障が起きている
と判断できる。
手段と、この記憶手段の出力に応じた周波数の交
番信号を発生する発振手段の出力を用いて、後段
で速度照査を行うので、この速度照査を行う際に
制限速度信号がとぎれることがなく、制限速度信
号がとぎれた場合は、判別手段、記憶手段、発振
手段または信号線のいずれかに故障が起きている
と判断できる。
以下、本発明の実施例について説明する。
第３図には、本発明の一実施例が示されてい
る。
る。
図において、本実施例が第２図図示従来例と異
る点は次の如くである。すなわち、受信部３４に
おいては、低位優先回路１６を取り除き、プログ
ラマブルオシレータ１８の出力を制御部４０に出
力する点である。また、制御部４０においては、
AND回路４２1〜４２oとOR回路とメモリ４９に
よつて構成される回路に代えて、デジタル周波数
判別部４８を挿入接続し、受信部３４のプログラ
マブルオシレータ１８からの出力を入力し、周波
数判別して信号を出力させる。他は第２図図示従
来例と同様である。
る点は次の如くである。すなわち、受信部３４に
おいては、低位優先回路１６を取り除き、プログ
ラマブルオシレータ１８の出力を制御部４０に出
力する点である。また、制御部４０においては、
AND回路４２1〜４２oとOR回路とメモリ４９に
よつて構成される回路に代えて、デジタル周波数
判別部４８を挿入接続し、受信部３４のプログラ
マブルオシレータ１８からの出力を入力し、周波
数判別して信号を出力させる。他は第２図図示従
来例と同様である。
このように構成されるものであるから、従来の
方式と同様、周波数判定の結果として信号１５1
〜１５oのうちいずれかが出力される。そして、
それに応じて周波数信号１９がプログラマブルオ
シレータ１８により発生される。この信号１９を
制御部４０へ出力する。信号１９はデイジタル信
号であり、また、その周波数は、制限速度情報を
与えるものである。制御部４０ではこの信号をデ
イジタル周波数判別部４８により周波数判別し、
その結果により、その周波数情報に対応する制限
速度信号を制限速度信号発生部４３により発生す
る。そして実速度信号４６と制限速度信号４５と
を比較し、前者が後者より大であれば、ブレーキ
指令を出力する。
方式と同様、周波数判定の結果として信号１５1
〜１５oのうちいずれかが出力される。そして、
それに応じて周波数信号１９がプログラマブルオ
シレータ１８により発生される。この信号１９を
制御部４０へ出力する。信号１９はデイジタル信
号であり、また、その周波数は、制限速度情報を
与えるものである。制御部４０ではこの信号をデ
イジタル周波数判別部４８により周波数判別し、
その結果により、その周波数情報に対応する制限
速度信号を制限速度信号発生部４３により発生す
る。そして実速度信号４６と制限速度信号４５と
を比較し、前者が後者より大であれば、ブレーキ
指令を出力する。
したがつて、本実施例によれば、信号１９は、
正常時であれば常にある周波数をもつた交番信号
であり、万一ICなどが故障したり、信号線の断
線などが起つた場合、信号１９はＯHzとなる。こ
の場合には、デイジタル周波数判別部でＯHz検出
により無条件にブレーキを出力するようすること
で、フエイルセーフなインターフエイスが可能と
なる。
正常時であれば常にある周波数をもつた交番信号
であり、万一ICなどが故障したり、信号線の断
線などが起つた場合、信号１９はＯHzとなる。こ
の場合には、デイジタル周波数判別部でＯHz検出
により無条件にブレーキを出力するようすること
で、フエイルセーフなインターフエイスが可能と
なる。
第４図には、本発明の他の実施例が示されてい
る。
る。
本実施例が、第３図図示実施例と異る点は、ブ
レーキ指令チエツク部６２を設け、バンドパスフ
イルタ３２からの出力と、比較部４７からの出力
によつてブレーキ指令を出すようにしている点で
ある。すなわち、受信部のセルフチエツクのため
のバンドパスフイルタ３２の出力とブレーキ指令
出力６１を入力とするブレーキ指令チエツク部６
２を設け、このブレーキ指令チエツク部６２によ
つて、速度比較部からブレーキ指令が出ているか
または、セルフチエツク信号３３が出ていない場
合の少なくともいずれかの事象が生じるとブレー
キ指令を外部に出力する。
レーキ指令チエツク部６２を設け、バンドパスフ
イルタ３２からの出力と、比較部４７からの出力
によつてブレーキ指令を出すようにしている点で
ある。すなわち、受信部のセルフチエツクのため
のバンドパスフイルタ３２の出力とブレーキ指令
出力６１を入力とするブレーキ指令チエツク部６
２を設け、このブレーキ指令チエツク部６２によ
つて、速度比較部からブレーキ指令が出ているか
または、セルフチエツク信号３３が出ていない場
合の少なくともいずれかの事象が生じるとブレー
キ指令を外部に出力する。
したがつて、本実施例によれば、自動列車制御
装置の安置性を更に向上することができる。
装置の安置性を更に向上することができる。
以上説明したように、本発明によれば、判別結
果を記憶して、これに応じた交番信号を単一の信
号線を介して制御部に送出することができるの
で、信号段数の増設が容易となるとともに、信号
のとぎれがなくなり、整つた波形で任意の周波数
の交番信号を送ることが可能となる。
果を記憶して、これに応じた交番信号を単一の信
号線を介して制御部に送出することができるの
で、信号段数の増設が容易となるとともに、信号
のとぎれがなくなり、整つた波形で任意の周波数
の交番信号を送ることが可能となる。
第１図は従来の受信部の構成図、第２図は従来
の自動列車制御装置の全体構成図、第３図は本発
明の実施例を示す図、第４図は本発明の他の実施
例を示す図である。 １…アンテナ、５…復調部、１０…てい倍部、
１４…並直変換メモリ部、２１…スキヤンロジツ
ク部、１８…プログラマブルオシレータ、３４…
受信部、４０，４１…制御部。
の自動列車制御装置の全体構成図、第３図は本発
明の実施例を示す図、第４図は本発明の他の実施
例を示す図である。 １…アンテナ、５…復調部、１０…てい倍部、
１４…並直変換メモリ部、２１…スキヤンロジツ
ク部、１８…プログラマブルオシレータ、３４…
受信部、４０，４１…制御部。
Claims (1)
- 【特許請求の範囲】 １ 列車の制限速度信号を受信する受信手段と、
前記制限速度信号の周波数を判別する判別手段
と、この判別結果を記憶する記憶手段と、この記
憶手段の出力に応じた周波数の交番信号を単一の
信号線に送出する発振手段とを有する受信部と、 前記信号線を介して前記交番信号を入力し、該
交番信号の周波数に基づく列車制限速度信号と実
列車速度または相当信号とを比較する比較手段
と、その比較の結果、前記実列車速度または相当
信号が前記列車制限速度信号より大きい場合にブ
レーキ指令を送出するブレーキ指令送出手段とを
有する制御部と、 を備えた自動列車制御装置。 ２ 列車の制限速度信号を受信する受信手段と、
前記制限速度信号の周波数を判別する判別手段
と、この判別結果を記憶する記憶手段と、この記
憶手段の出力に応じた周波数の交番信号を単一の
信号線に送出する発振手段とを有する受信部と、 前記信号線を介して前記交番信号を入力し、該
交番信号の周波数に基づく列車制限速度信号と実
列車速度または相当信号とを比較する比較手段
と、その比較の結果、前記実列車速度または相当
信号が前記列車制限速度信号より大きい場合にブ
レーキ指令を送出するブレーキ指令送出手段とを
有する制御部と、 前記発振手段の出力である交番信号と、前記制
限速度信号とを入力し照合する照合手段と、その
照合結果が正しいとき所定の信号を出力する出力
手段と、この所定の信号がない場合にブレーキ指
令を出力するブレーキ指令出力手段とを有するチ
エツク部と、 を備えた自動列車制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3080883A JPS59159601A (ja) | 1983-02-28 | 1983-02-28 | 自動列車制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3080883A JPS59159601A (ja) | 1983-02-28 | 1983-02-28 | 自動列車制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59159601A JPS59159601A (ja) | 1984-09-10 |
| JPH0532962B2 true JPH0532962B2 (ja) | 1993-05-18 |
Family
ID=12313981
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3080883A Granted JPS59159601A (ja) | 1983-02-28 | 1983-02-28 | 自動列車制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59159601A (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5593069A (en) * | 1978-12-30 | 1980-07-15 | Nippon Signal Co Ltd:The | Frequency decision circuit |
| JPS57177205A (en) * | 1981-04-22 | 1982-10-30 | Hitachi Ltd | Frequency signal selecting circuit for atc |
-
1983
- 1983-02-28 JP JP3080883A patent/JPS59159601A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59159601A (ja) | 1984-09-10 |
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