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JPH0550164B2 - - Google Patents
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JPH0550164B2 - - Google Patents

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JPH0550164B2
JPH0550164B2 JP58243477A JP24347783A JPH0550164B2 JP H0550164 B2 JPH0550164 B2 JP H0550164B2 JP 58243477 A JP58243477 A JP 58243477A JP 24347783 A JP24347783 A JP 24347783A JP H0550164 B2 JPH0550164 B2 JP H0550164B2
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JP
Japan
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transistor
collector
base
resistor
circuit
Prior art date
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JP58243477A
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Japanese (ja)
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JPS60134612A (en
Inventor
Yoshiaki Sano
Haranobu Yamashita
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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Description

【発明の詳細な説明】 発明の技術分野 本発明は、電源電圧変動の影響の少ない定電流
回路に関し、小型のトランジスタでこれを実現し
ようとするものである。
DETAILED DESCRIPTION OF THE INVENTION Technical Field of the Invention The present invention relates to a constant current circuit that is less affected by fluctuations in power supply voltage, and is intended to realize this using small transistors.

従来技術と問題点 定電流回路には第1図に示す回路がある。この
図でQ1〜Q4はトランジスタ、R1,R2は抵抗
であり、Vccは電源電圧、I1は抵抗R1を流れる電
流である。I2はトランジスタQ4のコレクタ電流
であり、本回路の出力電流でもある。トランジス
タQ3は他のトランジスタに比べて大きく、エミ
ツタ面積はn倍である。既知のようにトランジス
タのベースエミツタ間電圧VBEは、飽和電流をIS
エミツタ電流をIE、kはボルツマン常数、Tは絶
対温度、qは電荷として VBE=KT/qlnIE/IS ……(1) で表わされる。トランジスタのhFEは充分大きい
とするとベース電流は無視でき、エミツタ電流は
コレクタ電流に等しい。そして第1図の点Pの電
位は、電源VccよりトランジスタQ1とQ4の
VBEだけ下つた電位、または抵抗R2の電圧降下と
トランジスタQ3,Q2のVBEだけ下つた電位で
あるから次式が成立する。
Prior Art and Problems There is a constant current circuit shown in FIG. In this figure, Q1 to Q4 are transistors, R1 and R2 are resistors, Vcc is a power supply voltage, and I1 is a current flowing through resistor R1 . I 2 is the collector current of transistor Q4 and is also the output current of this circuit. Transistor Q3 is larger than other transistors, and has an emitter area n times larger. As is known, the base-emitter voltage V BE of a transistor is the saturation current I S ,
The emitter current is I E , k is the Boltzmann constant, T is the absolute temperature, and q is the electric charge, and it is expressed as V BE =KT/qlnI E /I S (1). If the h FE of the transistor is large enough, the base current can be ignored and the emitter current is equal to the collector current. The potential at point P in FIG.
Since the potential is lowered by V BE or the voltage drop of the resistor R 2 and the potential lowered by V BE of the transistors Q3 and Q2, the following equation holds true.

R2I2+KT/qlnI2/nIs+KT/qlnI1/Ims =KT/qlnI2/Is+KT/qlnI1/Is ……(2) この式の左辺第2項、第3項、右辺第1項、第
2項はトランジスタQ3,Q2,Q4,Q1の
VBEを示す。この(2)式から(3)式が成立する。
R 2 I 2 +KT/qlnI 2 /nIs+KT/qlnI 1 /Ims =KT/qlnI 2 /Is+KT/qlnI 1 /Is...(2) The second term, third term, the first term, and the third term on the left side of this equation The second term is for transistors Q3, Q2, Q4, and Q1.
V indicates BE . From this equation (2), equation (3) is established.

I2=1/R2・KT/qlon ……(3) この(3)式でR2、k、q、nは定数であるから
(R2の温度依存性はこゝでは考えない)電流I2
これらの定数により定まり、電源電圧Vccには依
存しない。こうして本回路により、電源電圧に依
存しない、そして温度Tには比例する定電流源が
提供される。
I 2 = 1/R 2・KT/ql o n ...(3) In this equation (3), R 2 , k, q, and n are constants (temperature dependence of R 2 is not considered here) ) The current I 2 is determined by these constants and does not depend on the power supply voltage Vcc. The circuit thus provides a constant current source that is independent of the supply voltage and proportional to the temperature T.

しかしながら本回路ではトランジスタQ3は他
のトランジスタよりエミツタがn倍の面積を持つ
必要があり、nが小さいと出力電流I2が小さくな
つてしまう。出力電流I2を大にするには大面積ト
ランジスタQ3が必要であるが、これでは集積回
路などに用いる場合集積度が下がつてしまう。前
記(2)式はI2R2=VBE1−VBE2即ち抵抗R2を2つのト
ランジスタのVBE(これを上記では添字1、2で
示す)の差に規制することを示しており、かゝる
条件が満足されるなら他の手段でも定電流回路を
実現できる。
However, in this circuit, the emitter of the transistor Q3 must have an area n times larger than that of the other transistors, and if n is small, the output current I 2 will be small. In order to increase the output current I 2 , a large-area transistor Q3 is required, but this reduces the degree of integration when used in an integrated circuit or the like. The above formula (2) indicates that I 2 R 2 = V BE1 −V BE2 , that is, the resistance R 2 is limited to the difference between the V BE (indicated by subscripts 1 and 2 in the above) of the two transistors, If these conditions are satisfied, a constant current circuit can be realized by other means.

発明の目的 本発明はかゝる点に鑑みてなされたもので、占
有面積が少なくて済む、電源電圧変動の影響が少
ない定電流回路を提供しようとするものである。
OBJECTS OF THE INVENTION The present invention has been made in view of the above points, and it is an object of the present invention to provide a constant current circuit that occupies a small area and is less affected by fluctuations in power supply voltage.

発明の構成 本発明は、電源に第1の抵抗R2、第1のトラ
ンジスタQ3、および第2のトランジスタQ4を
順次直列に接続しそして他端を出力端としてなる
第1の回路と、電源に第3のトランジスタQ1、
第4のトランジスタQ2、及び第2の抵抗R1
順次直列に接続する第2の回路を備え、第1のト
ランジスタQ3のベースを第3のトランジスタQ
1のコレクタに接続し、第3のトランジスタQ1
のベースを第1のトランジスタQ3のコレクタに
接続し、第4のトランジスタQ2のコレクタとベ
ースを第2のトランジスタQ4のベースに接続す
ることにより前記第1の抵抗R2に生じる電圧降
下が2つのトランジスタQ1,Q3のベース・エ
ミツタ間電圧の差に等しくなるように制御する第
2の回路とで構成される定電流回路において、前
記第2の回路の第3のトランジスタQ1をマルチ
コレクタ型としてコレクタ電流比が1:n(ここ
でn>1)になるようにし、n倍側のコレクタは
前記第2の抵抗R1へ、1倍側のコレクタは前記
第4のトランジスタQ2へ接続したことを特徴と
するが(参照符号は第2図に対応する)、次に実
施例を参照しながらこれを説明する。
Structure of the Invention The present invention includes a first circuit in which a first resistor R 2 , a first transistor Q3, and a second transistor Q4 are sequentially connected in series to a power supply, and the other end is an output terminal; third transistor Q1,
A second circuit connects a fourth transistor Q2 and a second resistor R1 in series, and connects the base of the first transistor Q3 to the third transistor Q.
1 and the third transistor Q1
By connecting the base of R2 to the collector of the first transistor Q3, and connecting the collector and base of the fourth transistor Q2 to the base of the second transistor Q4, the voltage drop across the first resistor R2 becomes two and a second circuit that controls the voltage difference between the base and emitter of the transistors Q1 and Q3 to be equal to the difference between the base and emitter voltages of the transistors Q1 and Q3, wherein the third transistor Q1 of the second circuit is of a multi-collector type and the collector The current ratio is set to 1:n (here n>1), and the collector on the n-times side is connected to the second resistor R1 , and the collector on the 1-times side is connected to the fourth transistor Q2. This feature (reference numerals correspond to FIG. 2) will now be described with reference to embodiments.

発明の実施例 第2図は本発明の実施例を示し、第1図と同様
にQ1〜Q4はトランジスタ、R1,R2は抵抗で
ある。本発明ではトランジスタQ3は他のトラン
ジスタと同じ大きさとし、代つてトランジスタQ
1をマルチコレクタ型(コレクタを2つ有する)
としてその面積を1:nに選ぶ。この回路では、
やはり点PとVcc間の電圧はR2、Q3のベース・
エミツタ、Q2のベースエミツタの経路でも、ま
たQ1のベース・エミツタ、Q4のベース・エミ
ツタの経路でも等しいので下式が成立する。
Embodiment of the Invention FIG. 2 shows an embodiment of the present invention, in which Q1 to Q4 are transistors and R 1 and R 2 are resistors as in FIG. 1. In the present invention, transistor Q3 is the same size as the other transistors, and transistor Q3 is replaced by transistor Q3.
1 is multi-collector type (has two collectors)
The area is chosen as 1:n. In this circuit,
Again, the voltage between point P and Vcc is R 2 , the base of Q3.
The path between the emitter and the base emitter of Q2 is the same, as is the path between the base emitter of Q1 and the base emitter of Q4, so the following formula holds true.

R2I2+kT/qlnI2/Is+kT/qlnI1/Is =kT/qln(1+n)I1/Is+kT/qlnI2/Is……(4
) この式の左辺第2項、第3項、右辺第1項、第
2項はトランジスタQ3,Q2,Q1,Q4の
VBEを示す。この(4)式から下式が成立する。
R 2 I 2 +kT/qlnI 2 / Is +kT/qlnI 1 /Is =kT/qln(1+n)I 1 /Is+kT/qlnI 2 /Is……(4
) The second and third terms on the left side and the first and second terms on the right side of this equation are
V indicates BE . From this equation (4), the following equation is established.

I2=1/R2・kT/qln(1+n) ……(5) この(5)式から明らかなように第2図の回路も、
電源電圧Vccの影響を受けない定電流I2を出力す
ることができる。しかもトランジスタQ1は2コ
レクタ型で、その比が1:nであればよく、大型
であることを必要としない。従つて集積度を向上
できる。
I 2 = 1/R 2・kT/qln (1+n) ...(5) As is clear from equation (5), the circuit in Figure 2 also
It is possible to output a constant current I2 that is not affected by the power supply voltage Vcc. Furthermore, the transistor Q1 is of a two-collector type, as long as the ratio thereof is 1:n, and does not need to be large. Therefore, the degree of integration can be improved.

トランジスタQ1〜Q4はpnp型であるが、こ
の型のトランジスタはラテラル形式で作られるの
が普通である。第3図a,bにその概略平面図お
よび断面を示し、Eはエミツタ領域、Cは環状の
コレクタ領域である。これらはエピタキシヤル成
長層EPの表面部に形成される。エピ層EPはアイ
ソレーシヨン領域ISで区画され、この区画内がベ
ース領域となる。Bはベースコンタクト領域であ
る。各部のサイズには必要な値があるので、第1
図のトランジスタQ3のようにn倍(エミツタ領
域がn倍)のサイズが必要であると第4図の如く
なり、エミツタ領域の増大に伴なつてベース、コ
レクタ各部も増大し、トランジスタ全体の大きさ
が大になつてしまう。第4図はn=4の例を示
す。第5図は本発明のトランジスタQ1を示し、
この場合はコレクタ領域を1:nに区切ればよ
い。従つてトランジスタ全体の寸法に対しては全
く、又は殆んど影響しない。
Transistors Q1-Q4 are of the pnp type, but transistors of this type are usually made in lateral form. FIGS. 3a and 3b show a schematic plan view and a cross section thereof, where E is an emitter region and C is an annular collector region. These are formed on the surface of the epitaxial growth layer EP. The epitaxial layer EP is divided into isolation regions IS, and the inside of this division becomes a base region. B is the base contact region. The size of each part has a required value, so the first
If the size of the transistor Q3 in the figure needs to be n times larger (the emitter area is n times larger), the result will be as shown in Figure 4, and as the emitter area increases, the base and collector parts will also increase, resulting in the overall size of the transistor. It gets bigger. FIG. 4 shows an example where n=4. FIG. 5 shows a transistor Q1 of the present invention,
In this case, the collector area may be divided into 1:n ratios. Therefore, it has no or little effect on the overall dimensions of the transistor.

なお第2図では抵抗R1に流れる電流は(1+
n)I1としたので第1図の抵抗R1に流れる電流よ
り大きい印象を与えるが、これは表記上の問題
で、勿論そのようなことはない。即ち出力電流は
トランジスタQ3,Q4を流れる電流I2であり、
トランジスタQ1,Q2は抵抗R1は、トランジ
スタQ3,Q4のベース電流を扱うだけであるか
ら第1図と変らない。第2図ではトランジスタQ
1の大面積コレクタ側に流れる電流をI1、小面積
コレクタ側に流れる電流をI1/nと表現してもよ
く、このとき抵抗R1に流れる電流は(1+1/n) I1となり、第1図と余り変らないことが式の上か
らも印象ずけられよう。
In addition, in Figure 2, the current flowing through resistor R 1 is (1+
n) I 1 gives the impression that the current is larger than the current flowing through the resistor R 1 in Figure 1, but this is just a problem with the notation and, of course, is not the case. That is, the output current is the current I 2 flowing through transistors Q3 and Q4,
The transistors Q1 and Q2 are the same as in FIG. 1 because the resistor R1 only handles the base current of the transistors Q3 and Q4. In Figure 2, transistor Q
The current flowing to the large-area collector side of R1 may be expressed as I 1 and the current flowing to the small-area collector side may be expressed as I 1 /n. In this case, the current flowing to the resistor R 1 is (1+1/n) I 1 , You can get the impression from the equation that it is not much different from Figure 1.

前記(3)式、(5)式から明らかなように、そして前
述したように、出力電流I2を大にするにはnを大
にする必要があり、第3図、第4図から明らかな
ようにnが大なる程本発明はトランジスタの小面
積比に有効である。
As is clear from equations (3) and (5) above, and as mentioned above, in order to increase the output current I 2 , it is necessary to increase n, which is clear from Figures 3 and 4. As described above, the larger n is, the more effective the present invention is in reducing the area ratio of the transistor.

発明の効果 以上説明したように本発明によれば電源電圧の
影響を受けず、そして温度で変わる定電流回路
を、小面積トランジスタで構成できるという利点
が得られる。
Effects of the Invention As explained above, according to the present invention, there is an advantage that a constant current circuit that is not affected by the power supply voltage and that changes depending on the temperature can be constructed using small-area transistors.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来例を示す回路図、第2図は本発明
の実施例を示す回路図、第3図〜第5図はトラン
ジスタの所要サイズを対比説明する図である。 図面でVccは電源電圧、R2は第1の抵抗、Q
3,Q4は第1、第2のトランジスタ、Q1,Q
2は第3、第4のトランジスタ、R1は第2の抵
抗である。
FIG. 1 is a circuit diagram showing a conventional example, FIG. 2 is a circuit diagram showing an embodiment of the present invention, and FIGS. 3 to 5 are diagrams for comparing and explaining required sizes of transistors. In the drawing, Vcc is the power supply voltage, R2 is the first resistor, and Q
3, Q4 are the first and second transistors, Q1, Q
2 is the third and fourth transistors, and R 1 is the second resistor.

Claims (1)

【特許請求の範囲】 1 電源に第1の抵抗、第1のトランジスタ、及
び第2のトランジスタを順次直列に接続しそして
他端を出力端としてなる第1の回路と、電源に第
3のトランジスタ、第4のトランジスタ、及び第
2の抵抗を順次直列に接続する第2の回路を備
え、第1のトランジスタのベースを第3のトラン
ジスタのコレクタに接続し、第3のトランジスタ
のベースを第1のトランジスタのコレクタに接続
し、第4のトランジスタのコレクタとベースを第
2のトランジスタのベースにに接続することによ
り前記第1の抵抗に生じる電圧降下が2つのトラ
ンジスタのベース・エミツタ間電圧の差に等しく
なるように制御する第2の回路とで構成される定
電流回路において、 前記第2の回路の第3のトランジスタをマルチ
コレクタ型としてコレクタ電流比が1:n(ここ
でn>1)になるようにし、n倍側のコレクタは
前記第2の抵抗へ、1倍側のコレクタは前記第4
のトランジスタへ接続したことを特徴とする定電
流回路。
[Claims] 1. A first circuit including a first resistor, a first transistor, and a second transistor sequentially connected in series to a power source, with the other end serving as an output terminal, and a third transistor to the power source. , a fourth transistor, and a second resistor connected in series in sequence, the base of the first transistor is connected to the collector of the third transistor, and the base of the third transistor is connected to the collector of the third transistor. By connecting the collector and base of the fourth transistor to the base of the second transistor, the voltage drop generated across the first resistor is equal to the difference in the base-emitter voltage of the two transistors. and a second circuit that controls the current to be equal to the voltage, the third transistor of the second circuit is a multi-collector type, and the collector current ratio is 1:n (where n>1). The collector on the n-times side is connected to the second resistor, and the collector on the 1-times side is connected to the fourth resistor.
A constant current circuit characterized by being connected to a transistor.
JP58243477A 1983-12-23 1983-12-23 Constant current circuit Granted JPS60134612A (en)

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