JPH0623644B2 - Edge position detector - Google Patents
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- JPH0623644B2 JPH0623644B2 JP60158424A JP15842485A JPH0623644B2 JP H0623644 B2 JPH0623644 B2 JP H0623644B2 JP 60158424 A JP60158424 A JP 60158424A JP 15842485 A JP15842485 A JP 15842485A JP H0623644 B2 JPH0623644 B2 JP H0623644B2
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Description
【発明の詳細な説明】 (産業上の利用分野) 本発明は物体のエッジ(端縁部)の正確な位置を光学的
に検出する装置に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a device for optically detecting an accurate position of an edge of an object.
(従来の技術) 一般に、物体の光学的撮像からそのエッジの位置を知る
要求が高く、多くの技術分野で組立工程、あるいは作業
の自動化などに利用されている。(Prior Art) Generally, there is a strong demand for knowing the position of an edge of an object from optical imaging, and it is used in many technical fields for an assembly process or automation of work.
第3図はそのような光学的なエッジ検出装置の従来の構
成を示す図である。1はエッジを検出しようとする被測
定物で、光源から照射された光を被測定物が反射する
と、その反射光はCCDなどのラインセンサ2によって
感知,撮像されて、その出力はマルチプレクサ(以下、
MPXという)3によりマルチプレクスされた上、サン
プルホールド(以下、S/Hという)回路4によりサン
プルホールドされて、アナログデジタル(以下、A/D
という)変換回路5に加えられ、ラインセンサ2の出力
がデジタル変換される。すなわち、被測定物1のエッジ
の検出情報を含むラインセンサ2の出力は、デジタル信
号として取り出される。以下、このデジタル信号をライ
ンセンサ2の出力(またはデジタル出力)という。FIG. 3 is a diagram showing a conventional configuration of such an optical edge detecting device. Reference numeral 1 denotes an object to be detected whose edge is to be detected. When the object to be measured reflects light emitted from a light source, the reflected light is sensed and imaged by a line sensor 2 such as a CCD, and its output is a multiplexer (hereinafter ,
After being multiplexed by an MPX 3 and sample-held by a sample-hold (hereinafter referred to as S / H) circuit 4, analog-digital (hereinafter referred to as A / D)
The output of the line sensor 2 is digitally converted. That is, the output of the line sensor 2 including the detection information of the edge of the DUT 1 is taken out as a digital signal. Hereinafter, this digital signal is referred to as the output (or digital output) of the line sensor 2.
さて、ラインセンサ2のデジタル出力は、減算器6に印
加されるとともに、第1のメモリ7に1フレームごとに
記憶される。8は第2のメモリで、これには被測定物1
が存在しないときのラインセンサ2の出力(バックグラ
ンド信号という)が予め記憶されており、その出力が減
算器6に印加されて、ラインセンサ2のデジタル信号か
ら減算される。したがって、減算器6の出力は被測定物
1のバックグランド信号が差し引された被測定物1のみ
の完全なエッジ情報を含む信号で、それは第3のメモリ
9に記憶される。10は平均化回路で、1フレーム分のラ
インセンサ2の総デジタル出力を、1フレーム分のビッ
ト数で除算して平均値を算出する。11は演算器で、ある
一定値を平均化回路10の出力に加減乗除して、エッジ検
出のためのしきい値を演算している。12は比較器で、第
3のメモリ9の出力信号と演算器11のしきい値出力とを
比較し、その出力を用いてラインセンサ2のデジタル出
力と走査位置を対応させて、エッジ位置の検出を行って
いる。13はマイクロコンピュータ(以下、CPUとい
う)で、比較器12の出力から被測定物1のエッジの位置
を算出している。14はデータバスである。The digital output of the line sensor 2 is applied to the subtractor 6 and stored in the first memory 7 for each frame. 8 is a second memory, in which the DUT 1
The output of the line sensor 2 (referred to as a background signal) when there is no signal is stored in advance, and the output is applied to the subtractor 6 and subtracted from the digital signal of the line sensor 2. Therefore, the output of the subtractor 6 is a signal containing the complete edge information of only the DUT 1 from which the background signal of the DUT 1 has been subtracted, which is stored in the third memory 9. An averaging circuit 10 divides the total digital output of the line sensor 2 for one frame by the number of bits for one frame to calculate an average value. Reference numeral 11 denotes an arithmetic unit that calculates a threshold value for edge detection by adding, subtracting, multiplying, and dividing a certain fixed value to the output of the averaging circuit 10. Reference numeral 12 denotes a comparator, which compares the output signal of the third memory 9 with the threshold output of the arithmetic unit 11, and uses the output to associate the digital output of the line sensor 2 with the scanning position to determine the edge position. It is detecting. Reference numeral 13 denotes a microcomputer (hereinafter referred to as CPU), which calculates the position of the edge of the DUT 1 from the output of the comparator 12. 14 is a data bus.
第4図は上述した第3図の構成によるエッジ検出の結果
を示すもので、aは減算器6の出力で、バックグランド
信号を差し引いたラインセンサ2の出力である。bは演
算器11の出力のしきい値である。したがって、被測定物
1の検出したエッジ位置は、出力がしきい値bを超えた
ビット位置m1になる。FIG. 4 shows the result of edge detection by the configuration of FIG. 3 described above, where a is the output of the subtracter 6, which is the output of the line sensor 2 after subtracting the background signal. b is a threshold value of the output of the calculator 11. Therefore, the edge position detected by the DUT 1 becomes the bit position m 1 at which the output exceeds the threshold value b.
(発明が解決しようとする問題点) しかしながら、従来の光学的エッジ検出装置では、一定
のしきい値を超えたか否かでエッジ位置を判断するた
め、被測定物1のエッジの断面が湾曲した球面のような
ものである場合には、検出したエッジ位置が正確さを欠
くという問題点を有していた。すなわち、第5図に示す
ように正しいエッジ位置がビット位置m3であるにもかか
わらず、エッジの断面が緩やかに変化するため、デジタ
ル出力が緩やかに増加し、しきい値bを超えるビット位
置m2をエッジ位置として検出することとなる。(Problems to be Solved by the Invention) However, in the conventional optical edge detection device, since the edge position is determined by whether or not a certain threshold is exceeded, the cross section of the edge of the DUT 1 is curved. In the case of a spherical surface, there is a problem that the detected edge position lacks accuracy. That is, as shown in FIG. 5, although the correct edge position is the bit position m 3 , the cross section of the edge changes gently, so that the digital output gradually increases and exceeds the threshold value b. m 2 is detected as the edge position.
本発明は、このような従来装置の問題点を排除した優れ
た光学的エッジ位置検出装置の提供を目的としたもので
ある。The present invention aims to provide an excellent optical edge position detecting device which eliminates the problems of the conventional device.
(問題点を解決するための手段) 本発明は上記の目的を達成するために、第3図の構成に
加え、微分器及び積分器を備えたものであり、この微分
器によりラインセンサのデジタル出力の隣合うビットの
差分をとり、その差分の正負を判断し、この差分が正の
値をとるとき、積分器によりその差分値を積分し、一時
的にそのビット位置Pを記憶し、負の値をとるとき、積
分器において一定値を差し引いて積分し、この積分値が
一定の第1のしきい値に達したか否かを判断し、第1の
しきい値に達していない場合には、記憶を解除し、第1
のしきい値に達した場合には、さらにビット位置を変え
て積分を行い、この積分値が第1のしきい値より大きい
第2のしきい値に達した場合に、ビット位置Pをエッジ
位置と決定するものである。(Means for Solving the Problems) In order to achieve the above-mentioned object, the present invention is provided with a differentiator and an integrator in addition to the configuration of FIG. The difference between the adjacent bits of the output is taken, and whether the difference is positive or negative is judged. When this difference takes a positive value, the difference value is integrated by an integrator, the bit position P is temporarily stored, and a negative value is stored. When taking the value of, the integrator subtracts a constant value for integration, determines whether this integrated value has reached a constant first threshold value, and if it has not reached the first threshold value. To release the memory, first
When the threshold value is reached, the bit position is further changed and integration is performed. When the integrated value reaches a second threshold value which is larger than the first threshold value, the bit position P is set to the edge. The position is determined.
(作用) 本発明によれば、隣合うビットのデジタル出力の差分を
とり、このデジタル出力が増加したと判断した場合に
は、これをエッジ位置として検出することができ、ま
た、デジタル出力が一定値を超えた後は、一時的にデジ
タル出力が急減した場合であっても、前記検出したビッ
ト位置をエッジ位置として判断する。(Operation) According to the present invention, when the difference between the digital outputs of adjacent bits is taken and it is determined that this digital output has increased, this can be detected as an edge position, and the digital output is constant. After the value is exceeded, the detected bit position is determined as the edge position even if the digital output suddenly decreases suddenly.
(実施例) 以下、本発明の実施例を、図面を参照しながら、詳細に
詳細に説明する。(Example) Hereinafter, the Example of this invention is described in detail, referring drawings.
第1図は本発明の一実施例の構成を示す図で、第3図の
参照符号と同一符号のものは同一部分を示している。FIG. 1 is a diagram showing the configuration of an embodiment of the present invention, and the same reference numerals as those in FIG. 3 denote the same parts.
1はエッジを検出しようとする被測定物で、光源から照
射された光を被測定物が反射すると、その反射光はCC
Dなどのラインセンサ2によって感知,撮像されて、そ
の出力はMPX3によりマルチプレクスされた上、S/
H回路4によってサンプルホールドされて、A/D変換
回路5によりデジタル変換される。すなわち、被測定物
1のエッジの検出情報を含むラインセンサ2の出力は、
デジタル信号化されて、減算器6に印加されるととも
に、第1のメモリ7に記憶される。この第1のメモリ7
は、ラインセンサ2のデジタル出力を1フレームごとに
記憶する。減算器6においては、第2のメモリ8に予め
記憶されている被測定物1のバックグランド信号をA/
D変換回路5の出力から減算した上、被測定物1のみの
エッジ情報信号を出力して、第3のメモリ9に記憶させ
る。15は微分器で、これにより第3のメモリ9の内容の
データがCPU13により制御されて、ラインセンサ2の
デジタル出力の隣合うビットごとに差分が順次検出さ
れ、その差分値は積分器16により積分される。このとき
の積分は、差分値が正のときはそのまま積分し、負のと
きは一定値を減算して行われる。こうして積分した値は
比較器17及び18によって、それぞれ第4のメモリ19及び
第5のメモリ20の値と比較される。この第4のメモリ19
及び第5のメモリ20には、エッジの判定のためのしきい
値1及びそれより高いしきい値2が記憶されており、デ
ータバス14,メモリ9の制御及びデータの演算などを行
うCPU13によって第2図で示すアルゴリズム制御を行
い、エッジが検出される。Reference numeral 1 is an object to be detected whose edge is to be detected. When the object to be measured reflects the light emitted from the light source, the reflected light is CC
It is sensed and imaged by the line sensor 2 such as D, and the output is multiplexed by the MPX3 and S /
It is sampled and held by the H circuit 4 and is digitally converted by the A / D conversion circuit 5. That is, the output of the line sensor 2 including the detection information of the edge of the DUT 1 is
It is converted into a digital signal, applied to the subtractor 6, and stored in the first memory 7. This first memory 7
Stores the digital output of the line sensor 2 for each frame. In the subtractor 6, the background signal of the DUT 1 stored in advance in the second memory 8 is A /
After subtracting from the output of the D conversion circuit 5, the edge information signal of only the DUT 1 is output and stored in the third memory 9. Reference numeral 15 is a differentiator, which controls the data of the contents of the third memory 9 by the CPU 13 to sequentially detect the difference between adjacent bits of the digital output of the line sensor 2, and the difference value is detected by the integrator 16. Integrated. The integration at this time is performed by directly integrating when the difference value is positive and by subtracting a constant value when the difference value is negative. The values thus integrated are compared with the values in the fourth memory 19 and the fifth memory 20 by the comparators 17 and 18, respectively. This fourth memory 19
The fifth memory 20 stores a threshold value 1 for determining an edge and a threshold value 2 higher than the threshold value, and the CPU 13 controls the data bus 14 and the memory 9 and calculates data. The algorithm control shown in FIG. 2 is performed to detect the edge.
第2図は、第1図に示された本発明の実施例のエッジ検
出アルゴリズムを説明するフローチャートであり、i
(但し、iは任意の正の整数、以下同じ)はラインセン
サ2のデジタル信号出力のビット位置、Diはラインセン
サ2のiビット目の出力、Kは隣合うビット出力の差分
値、TH1及びTH2はそれぞれ第1及び第2のしきい値であ
り、Meはメモリを示している。FIG. 2 is a flow chart for explaining the edge detection algorithm of the embodiment of the present invention shown in FIG.
(However, i is an arbitrary positive integer, the same applies hereinafter) is the bit position of the digital signal output of the line sensor 2, D i is the i-th output of the line sensor 2, K is the difference value between adjacent bit outputs, and TH 1 and TH 2 are the first and second thresholds, respectively, and Me is the memory.
第2図により、本実施例の動作について説明する。ま
ず、ラインセンサ2の端である1ビット目から、隣合う
ビット出力の差分値Kを、 K=Di+1−Di により求め、差分値Kの正負について判断を行う。The operation of this embodiment will be described with reference to FIG. First, the difference value K between adjacent bit outputs is calculated from K = D i + 1 −D i from the first bit, which is the end of the line sensor 2, to determine whether the difference value K is positive or negative.
ここで、差分値が正のときは、差分値Kを積分して、積
分値Sを S=S+K として求め、フラグFlの値が0か1かを判断する。フ
ラグFlの値が0のときは、ビット位置iをメモリMeに
記憶させ、フラグFlの値を1にして、ビット位置iを
1つ増加させる。一方、フラグFlの値が1のときは、
ビット位置を1つ増加させる。Here, when the difference value is positive, the difference value K is integrated to obtain the integrated value S as S = S + K, and it is determined whether the value of the flag Fl is 0 or 1. When the value of the flag Fl is 0, the bit position i is stored in the memory Me, the value of the flag Fl is set to 1, and the bit position i is incremented by 1. On the other hand, when the value of the flag Fl is 1,
Increase the bit position by one.
すなわち、隣合うビット出力が増加する場合に、そのビ
ット位置iを記憶することになる。That is, when the adjacent bit output increases, the bit position i is stored.
また、差分値が正でないときは、差分値Kを積分して積
分値Sを S=S−a(但し、aは一定値) として求め、積分値Sと第1のしきい値TH1との大小関
係を判断する。積分値Sが第1のしきい値TH1より小さ
い場合は、積分値Sを0にし、フラグFlを0にし、ビ
ット位置iを1つ増加させる。一方、積分値Sが第1の
しきい値TH1より小さくない場合は、ビット位置を1つ
増加させる。すなわち、隣のビット出力が減少するか同
じ場合であって、一定値を差し引いた積分値Sがしきい
値TH1を超えないときには、フラグFlが0となり、そ
れ以前に記憶したメモリが更新されうる状態となり、隣
合うビット出力が減少するか同じである場合であって、
一定値を差し引いた積分値Sがしきい値TH1を超えてい
るときには、そのままビット位置を更新する。When the difference value is not positive, the difference value K is integrated to obtain the integrated value S as S = S−a (where a is a constant value), and the integrated value S and the first threshold value TH 1 are obtained. Judge the relationship between When the integrated value S is smaller than the first threshold value TH 1 , the integrated value S is set to 0, the flag Fl is set to 0, and the bit position i is incremented by 1. On the other hand, when the integrated value S is not smaller than the first threshold value TH 1 , the bit position is incremented by 1. That is, when the adjacent bit output decreases or is the same and the integrated value S obtained by subtracting a constant value does not exceed the threshold value TH 1 , the flag Fl becomes 0 and the memory stored before that is updated. In the active state and the adjacent bit outputs decrease or are the same,
When the integrated value S obtained by subtracting a constant value exceeds the threshold value TH 1 , the bit position is updated as it is.
以上の動作により、積分値Sがしきい値TH1より大きい
ときには、メモリMeに記憶されているビット位置が不変
であるが、しきい値TH1より小さいときは、メモリMeの
記憶は差分値Kが正となるとき、新しいビット位置に更
新される。By the above operation, when the integrated value S is larger than the threshold value TH 1, the bit position stored in the memory Me is unchanged, but when it is smaller than the threshold value TH 1 , the memory Me stores the difference value. When K goes positive, it is updated to the new bit position.
さらに、積分値Sがしきい値TH2より大か小かを判断
し、小であれば、次のビット位置の差分値Kを求め、大
であれば、メモリMeに記憶されているビット位置iをエ
ッジ位置として最終的に検出する。Further, it is judged whether the integral value S is larger or smaller than the threshold value TH 2 , and if it is smaller, the difference value K of the next bit position is obtained, and if it is larger, the bit position stored in the memory Me. Finally, i is detected as an edge position.
以上、本発明を説明したが、第2のフローチャートで
は、ビット位置iを第1番目から開始して説明したが、
ラインセンサの最大のビット位置から逆方向に同様のエ
ッジの検出をすれば、エッジの両端まで検出することが
できる。The present invention has been described above. In the second flowchart, the bit position i is described starting from the first bit.
If similar edges are detected in the opposite direction from the maximum bit position of the line sensor, both edges of the edge can be detected.
(発明の効果) 以上説明したように、本発明によれば、ラインセンサ出
力に変化が現われた位置をエッジと判断するので、エッ
ジの断面が球状のように徐々に変化するときであって
も、エッジの位置を正確に検出でき、誤差がなくなる利
点がある。また、物体が存在するにもかかわらず、ライ
ンセンサ出力が急激に変化して、エッジの誤検出するこ
とを防止することが可能となる。(Effects of the Invention) As described above, according to the present invention, the position where the change in the line sensor output appears is determined to be the edge, and therefore even when the cross section of the edge gradually changes like a sphere. The advantage is that the position of the edge can be detected accurately and there is no error. In addition, it is possible to prevent the line sensor output from abruptly changing and erroneously detecting an edge even if an object exists.
第1図は本発明の一実施例を示すエッジ位置検出装置の
ブロック図、第2図はエッジ検出アルゴリズムのフロー
チャート、第3図は従来のエッジ位置検出装置のブロッ
ク図、第4図及び第5図はラインセンサ出力と判定しき
い値の関係を示す図である。 1……被測定物、2……ラインセンサ、3……マルチプ
レクサ(MPX)、4……サンプルホールド回路(S/
H回路)、5……アナログデジタル変換回路(A/D変
換回路)、6……減算器、7,8,9,19,20……メモ
リ、13……マイクロコンピュータ(CPU)、14……デ
ータバス、15……微分器、16……積分器、17,18……比
較器。FIG. 1 is a block diagram of an edge position detecting apparatus showing an embodiment of the present invention, FIG. 2 is a flow chart of an edge detecting algorithm, FIG. 3 is a block diagram of a conventional edge position detecting apparatus, FIGS. The figure shows the relationship between the line sensor output and the determination threshold value. 1 ... DUT, 2 ... Line sensor, 3 ... Multiplexer (MPX), 4 ... Sample and hold circuit (S /
H circuit), 5 ... Analog-digital conversion circuit (A / D conversion circuit), 6 ... Subtractor, 7, 8, 9, 19, 20 ... Memory, 13 ... Microcomputer (CPU), 14 ... Data bus, 15 ... differentiator, 16 ... integrator, 17, 18 ... comparator.
Claims (1)
の差分を走査方向に沿って順次検出する微分器と、 この差分を積分しあるいは一定値を差し引いて積分する
積分器と、 エッジと判断した走査位置を記憶する記憶手段とを備
え、 前記ラインセンサの一方の端から他方の端に向かって前
記被測定物を走査し、前記微分器による微分結果が正と
なる場合に、この走査位置を前記エッジとして前記記憶
手段に記憶し、前記積分器において前記差分を積分し、
一方、前記微分器による微分結果が負あるいは0となる
場合に、前記積分器において一定値を差し引いて積分
し、この積分結果が第1のしきい値以下であれば、前記
記憶内容を保持し、また、前記積分結果が第1のしきい
値以下であれば、積分値を0とし、微分結果が正となる
新たな走査位置を改めて前記記憶手段に記憶し、前記積
分器による積分結果が前記第1のしきい値よりも大きい
第2のしきい値を超えるとき、前記記憶手段に記憶され
た走査位置を前記エッジとすることを特徴とするエッジ
検出位置。1. A line sensor for scanning an object to be measured, a differentiator for sequentially detecting a difference between outputs at adjacent scanning positions on the line sensor along a scanning direction, and an integral or a constant value of the difference. Is provided with a storage means for storing the scanning position determined to be an edge, scans the DUT from one end of the line sensor to the other end, and When the differential result is positive, this scanning position is stored in the storage means as the edge, and the difference is integrated in the integrator,
On the other hand, when the result of differentiation by the differentiator is negative or 0, the integrator subtracts a constant value for integration, and if the result of integration is less than or equal to the first threshold value, the stored contents are retained. If the integration result is less than or equal to the first threshold value, the integration value is set to 0, and a new scanning position where the differentiation result is positive is stored in the storage means again, and the integration result by the integrator is An edge detection position, wherein a scanning position stored in the storage means is set as the edge when a second threshold value larger than the first threshold value is exceeded.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60158424A JPH0623644B2 (en) | 1985-07-19 | 1985-07-19 | Edge position detector |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60158424A JPH0623644B2 (en) | 1985-07-19 | 1985-07-19 | Edge position detector |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6221006A JPS6221006A (en) | 1987-01-29 |
| JPH0623644B2 true JPH0623644B2 (en) | 1994-03-30 |
Family
ID=15671455
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60158424A Expired - Lifetime JPH0623644B2 (en) | 1985-07-19 | 1985-07-19 | Edge position detector |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0623644B2 (en) |
-
1985
- 1985-07-19 JP JP60158424A patent/JPH0623644B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6221006A (en) | 1987-01-29 |
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