JPH0632382B2 - 回路基板 - Google Patents
回路基板Info
- Publication number
- JPH0632382B2 JPH0632382B2 JP60010143A JP1014385A JPH0632382B2 JP H0632382 B2 JPH0632382 B2 JP H0632382B2 JP 60010143 A JP60010143 A JP 60010143A JP 1014385 A JP1014385 A JP 1014385A JP H0632382 B2 JPH0632382 B2 JP H0632382B2
- Authority
- JP
- Japan
- Prior art keywords
- ceramic substrate
- circuit board
- constant ceramic
- thick film
- dielectric constant
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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Landscapes
- Parts Printed On Printed Circuit Boards (AREA)
- Production Of Multi-Layered Print Wiring Board (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明は電子機器に用いることができる回路基板に関す
るものである。
るものである。
従来の技術 近年、電子機器にセラミック誘電体を応用した回路基板
が幅広く使用されている。
が幅広く使用されている。
以下図面を参照しながら従来の回路基板の一例について
説明する。
説明する。
第３図は従来の回路基板の側断面図を示すものであり、
第３図において、１は基板、２は電子部品、３は導体、
４は抵抗体、５はスルーホール、６は厚膜ガラス，樹脂
等のオーバーコート、８ははんだである。
第３図において、１は基板、２は電子部品、３は導体、
４は抵抗体、５はスルーホール、６は厚膜ガラス，樹脂
等のオーバーコート、８ははんだである。
以上のように構成された回路基板について、以下その動
作を説明する。
作を説明する。
第３図の回路基板は厚膜ハイブリッドＩＣあって、一般
に基板１をアルミナにより構成しており、表面、裏面に
導体３を印刷法にて構成し、スルーホール５によって表
裏面の導体を結線し、抵抗体４を印刷法にて構成し、オ
ーバーコート６を印刷法にて構成した後、電子部品２を
搭載してはんだ８によって結線される。
に基板１をアルミナにより構成しており、表面、裏面に
導体３を印刷法にて構成し、スルーホール５によって表
裏面の導体を結線し、抵抗体４を印刷法にて構成し、オ
ーバーコート６を印刷法にて構成した後、電子部品２を
搭載してはんだ８によって結線される。
一方、第２図は一般的なラジオ受信機におけるＦＭ−Ａ
Ｍ中間周波増幅回路例であり、増幅素子ＩＣ１、コンデ
ンサＣ１−Ｃ１７、抵抗Ｒ１−Ｒ１１、中間周波トラン
スＴ１，Ｔ２、トランジスタＱ１，Ｑ２、コイルＬ１，
Ｌ２、バリコンＶＣ１により構成され、これらは第３図
のような従来の回路基板に搭載され結線されていた。
Ｍ中間周波増幅回路例であり、増幅素子ＩＣ１、コンデ
ンサＣ１−Ｃ１７、抵抗Ｒ１−Ｒ１１、中間周波トラン
スＴ１，Ｔ２、トランジスタＱ１，Ｑ２、コイルＬ１，
Ｌ２、バリコンＶＣ１により構成され、これらは第３図
のような従来の回路基板に搭載され結線されていた。
発明が解決しようとする問題点 しかしながら上記のような構成では、搭載する電子部品
２の数が多く機器の高密度化、小型化が困難であり、部
品の実装コストが多くなるとともに、電子部品の接続点
における信頼性が低下するという問題点を有していた。
一方、回路基板１は回路結線だけの単一機能にとどまり
多機能化が困難という問題点を有していた。
２の数が多く機器の高密度化、小型化が困難であり、部
品の実装コストが多くなるとともに、電子部品の接続点
における信頼性が低下するという問題点を有していた。
一方、回路基板１は回路結線だけの単一機能にとどまり
多機能化が困難という問題点を有していた。
本発明は上記問題点に鑑み、高密度、小型化を実現させ
部品実装コストを低減するとともに信頼性の高い、複合
機能を有する回路基板を提供するものである。
部品実装コストを低減するとともに信頼性の高い、複合
機能を有する回路基板を提供するものである。
問題点を解決するための手段 上記問題点を解決するために本発明の回路基板は、高誘
電率セラミック基板内部に複数の積層コンデンサを設
け、そのコンデンサをスルーホールによって表面に引き
出すとともに表面に厚膜回路を構成して成る第１の複合
部品と、低誘電率セラミック基板内部に複数の積層コン
デンサを設け、そのコンデンサをスルーホールによって
表面に引き出すとともに表面に厚膜回路を構成して成る
第２の複合部品とを樹脂あるいは厚膜ガラス等によって
接着すると同時に対向する導体を接続し、さらに第１あ
るいは第２の複合部品の表面に他の電子部品を装着して
成るという構成を備えたものである。
電率セラミック基板内部に複数の積層コンデンサを設
け、そのコンデンサをスルーホールによって表面に引き
出すとともに表面に厚膜回路を構成して成る第１の複合
部品と、低誘電率セラミック基板内部に複数の積層コン
デンサを設け、そのコンデンサをスルーホールによって
表面に引き出すとともに表面に厚膜回路を構成して成る
第２の複合部品とを樹脂あるいは厚膜ガラス等によって
接着すると同時に対向する導体を接続し、さらに第１あ
るいは第２の複合部品の表面に他の電子部品を装着して
成るという構成を備えたものである。
作 用 本発明は上記した構成によって、高誘電率セラミック基
板と、低誘電率セラミック基板の内部に各々複数の積層
コンデンサを設けるとともに、そのコンデンサをスルー
ホール、厚膜導体により接続することによって回路基板
内にコンデンサ回路を構成し、さらに前記回路基板の表
面に厚膜回路を構成することによって表面に搭載する電
子部品を大幅に削減させることができ、機器の高密度
化、小型化がはかれ、部品の実装コストを下げることが
できるとともに、電子部品の接続箇所が少なくなること
から信頼性を著しく向上させることができる。一方、回
路基板として回路結線だけの単一機能にとどまらずコン
デンサ、抵抗を複合した多機能回路基板が実現できる。
板と、低誘電率セラミック基板の内部に各々複数の積層
コンデンサを設けるとともに、そのコンデンサをスルー
ホール、厚膜導体により接続することによって回路基板
内にコンデンサ回路を構成し、さらに前記回路基板の表
面に厚膜回路を構成することによって表面に搭載する電
子部品を大幅に削減させることができ、機器の高密度
化、小型化がはかれ、部品の実装コストを下げることが
できるとともに、電子部品の接続箇所が少なくなること
から信頼性を著しく向上させることができる。一方、回
路基板として回路結線だけの単一機能にとどまらずコン
デンサ、抵抗を複合した多機能回路基板が実現できる。
実施例 以下本発明の実施例の回路基板について、図面を参照し
ながら説明する。
ながら説明する。
第１図は本発明の一実施例における回路基板の側断面図
である。第１図において、２は電子部品、３は導体、４
は抵抗体、５，７はスルーホール、６は厚膜ガラス，樹
脂等のオーバーコート、８ははんだ、９は高誘電率セラ
ミック基板、１０は低誘電率セラミック基板、１１はス
ルーホール５の表面部導体、１２は高誘電率セラミック
基板９と低誘電率セラミック基板１０とを接着する厚膜
ガラス、Ｃ１０，Ｃ１１は低誘電率セラミック基板１０
の内部に構成した積層コンデンサ、Ｃ１２，Ｃ１３は高
誘電率セラミック基板９の内部に構成した積層コンデン
サである。
である。第１図において、２は電子部品、３は導体、４
は抵抗体、５，７はスルーホール、６は厚膜ガラス，樹
脂等のオーバーコート、８ははんだ、９は高誘電率セラ
ミック基板、１０は低誘電率セラミック基板、１１はス
ルーホール５の表面部導体、１２は高誘電率セラミック
基板９と低誘電率セラミック基板１０とを接着する厚膜
ガラス、Ｃ１０，Ｃ１１は低誘電率セラミック基板１０
の内部に構成した積層コンデンサ、Ｃ１２，Ｃ１３は高
誘電率セラミック基板９の内部に構成した積層コンデン
サである。
以上のように構成された回路基板について、以下第１
図，第２図を用いてその動作を説明する。コンデンサＣ
１０，Ｃ１１は低誘電率セラミック基板１０の内部に積
層法によって作られたコンデンサであり、コンデンサＣ
１２，Ｃ１３は高誘電率セラミック基板９の内部に積層
法によって作られたコンデンサを示してある。これらは
スルーホール５によって各々のセラミック基板９，１０
の表面に導出され、導体１１を前記コンデンサの端子電
極としており、高誘電率セラミック基板９にあっては表
面に構成した導体３、抵抗体４との接続によりネットワ
ークを構成し、低誘電率セラミック基板１０にあっては
表面に構成した導体３との接続により電子部品２との結
線導体としている。一方、前記高誘電率セラミック基板
９、低誘電率セラミック基板１０は厚膜ガラス１２によ
り接着するとともに、高誘電率セラミック基板９と低誘
電率セラミック基板１０との結線を必要とする導体１１
および導体３は各々の箇所で対向させ、厚膜ガラスによ
る接着時に同時に厚膜導体により接続できる。
図，第２図を用いてその動作を説明する。コンデンサＣ
１０，Ｃ１１は低誘電率セラミック基板１０の内部に積
層法によって作られたコンデンサであり、コンデンサＣ
１２，Ｃ１３は高誘電率セラミック基板９の内部に積層
法によって作られたコンデンサを示してある。これらは
スルーホール５によって各々のセラミック基板９，１０
の表面に導出され、導体１１を前記コンデンサの端子電
極としており、高誘電率セラミック基板９にあっては表
面に構成した導体３、抵抗体４との接続によりネットワ
ークを構成し、低誘電率セラミック基板１０にあっては
表面に構成した導体３との接続により電子部品２との結
線導体としている。一方、前記高誘電率セラミック基板
９、低誘電率セラミック基板１０は厚膜ガラス１２によ
り接着するとともに、高誘電率セラミック基板９と低誘
電率セラミック基板１０との結線を必要とする導体１１
および導体３は各々の箇所で対向させ、厚膜ガラスによ
る接着時に同時に厚膜導体により接続できる。
なお、スルーホール７は低誘電率セラミック基板あるい
は高誘電率セラミック基板の表裏面を結線するためのも
のである。
は高誘電率セラミック基板の表裏面を結線するためのも
のである。
以上のように本実施例によれば、第２図におけるＣ１，
Ｃ２，Ｃ３，Ｃ４，Ｃ６，Ｃ７，Ｃ８，Ｃ９，Ｃ１２，
Ｃ１３のコンデンサを高誘電率セラミック基板９の内部
に設け、それらのコンデンサをスルーホール５によって
各々表面に引き出すとともに、表面に第２図におけるＲ
１−Ｒ１１の抵抗体４を構成した第１の複合部品と、第
２図におけるＣ５，Ｃ１０，Ｃ１１のコンデンサを低誘
電率セラミック基板１０の内部に設け、それらのコンデ
ンサをスルーホール５によって表面に引き出すととも
に、表面に厚膜回路を構成した第２の複合部品とを厚膜
ガラス等によって接着すると同時に、対向する導体を接
着面で厚膜導体により接続して回路を構成することによ
り、表面に搭載する他の電子部品２を大幅に削減でき
（第２図においては部品数３８個が１０個になる。）、
実装密度を著しく向上させ、機器の高密度化、小型化が
はかれ、部品の実装コストを下げることができるととも
に、電子部品の接続箇所が少なくなることから信頼性を
著しく向上させることができる回路基板を提供できる。
また、回路基板として回路結線だけの単一機能にとどま
らずコンデンサ、抵抗を複合した多機能回路基板が実現
できる。
Ｃ２，Ｃ３，Ｃ４，Ｃ６，Ｃ７，Ｃ８，Ｃ９，Ｃ１２，
Ｃ１３のコンデンサを高誘電率セラミック基板９の内部
に設け、それらのコンデンサをスルーホール５によって
各々表面に引き出すとともに、表面に第２図におけるＲ
１−Ｒ１１の抵抗体４を構成した第１の複合部品と、第
２図におけるＣ５，Ｃ１０，Ｃ１１のコンデンサを低誘
電率セラミック基板１０の内部に設け、それらのコンデ
ンサをスルーホール５によって表面に引き出すととも
に、表面に厚膜回路を構成した第２の複合部品とを厚膜
ガラス等によって接着すると同時に、対向する導体を接
着面で厚膜導体により接続して回路を構成することによ
り、表面に搭載する他の電子部品２を大幅に削減でき
（第２図においては部品数３８個が１０個になる。）、
実装密度を著しく向上させ、機器の高密度化、小型化が
はかれ、部品の実装コストを下げることができるととも
に、電子部品の接続箇所が少なくなることから信頼性を
著しく向上させることができる回路基板を提供できる。
また、回路基板として回路結線だけの単一機能にとどま
らずコンデンサ、抵抗を複合した多機能回路基板が実現
できる。
発明の効果 以上のように本発明は高誘電率セラミック基板内部に複
数の積層コンデンサを設け、そのコンデンサをスルーホ
ールによって表面に引き出すとともに表面に厚膜回路を
構成して成る第１の複合部品と、低誘電率セラミック基
板内部に複数の積層コンデンサを設け、そのコンデンサ
をスルーホールによって表面に引き出すとともに表面に
厚膜回路を構成して成る第２の複合部品とを樹脂あるい
は厚膜ガラス等によって接着すると同時に、対向する導
体を接続し回路を構成することにより、第１あるいは第
２の複合部品の表面に搭載する他の電子部品を大幅に削
減でき、実装密度を著しく向上させ、機器の高密度化、
小型化がはかれ、部品の実装コストを下げることができ
るとともに、電子部品の接続箇所が少なくなることから
信頼性を著しく向上させることができる。一方、回路基
板として回路結線だけの単一機能にとどまらずコンデン
サ、抵抗を複合した多機能回路基板が実現できる。
数の積層コンデンサを設け、そのコンデンサをスルーホ
ールによって表面に引き出すとともに表面に厚膜回路を
構成して成る第１の複合部品と、低誘電率セラミック基
板内部に複数の積層コンデンサを設け、そのコンデンサ
をスルーホールによって表面に引き出すとともに表面に
厚膜回路を構成して成る第２の複合部品とを樹脂あるい
は厚膜ガラス等によって接着すると同時に、対向する導
体を接続し回路を構成することにより、第１あるいは第
２の複合部品の表面に搭載する他の電子部品を大幅に削
減でき、実装密度を著しく向上させ、機器の高密度化、
小型化がはかれ、部品の実装コストを下げることができ
るとともに、電子部品の接続箇所が少なくなることから
信頼性を著しく向上させることができる。一方、回路基
板として回路結線だけの単一機能にとどまらずコンデン
サ、抵抗を複合した多機能回路基板が実現できる。
第１図は本発明の一実施例における回路基板の側断面
図、第２図は一般的なＦＭ／ＡＭ中間周波増幅回路図、
第３図は従来の回路基板の側断面図である。 ２……電子部品、３……導体、４……抵抗体、５，７…
…スルーホール、６……厚膜ガラス、樹脂等のオーバー
コート、８……はんだ、９……高誘電率セラミック基
板、１０……低誘電率セラミック基板、１１……スルー
ホール５の表面部導体、１２……高誘電率セラミック基
板９と低誘電率セラミック基板１０とを接着する厚膜ガ
ラスまたは樹脂、Ｃ１０，Ｃ１１……低誘電率セラミッ
ク基板１０の内部に構成した積層コンデンサ、Ｃ１２，
Ｃ１３……高誘電率セラミック基板９の内部に構成した
積層コンデンサ。
図、第２図は一般的なＦＭ／ＡＭ中間周波増幅回路図、
第３図は従来の回路基板の側断面図である。 ２……電子部品、３……導体、４……抵抗体、５，７…
…スルーホール、６……厚膜ガラス、樹脂等のオーバー
コート、８……はんだ、９……高誘電率セラミック基
板、１０……低誘電率セラミック基板、１１……スルー
ホール５の表面部導体、１２……高誘電率セラミック基
板９と低誘電率セラミック基板１０とを接着する厚膜ガ
ラスまたは樹脂、Ｃ１０，Ｃ１１……低誘電率セラミッ
ク基板１０の内部に構成した積層コンデンサ、Ｃ１２，
Ｃ１３……高誘電率セラミック基板９の内部に構成した
積層コンデンサ。
Claims (2)
- 【請求項１】高誘電率セラミック基板の内部に設けた複
数の積層コンデンサをスルーホールによって表面に引き
出すとともに表面に厚膜回路を構成して成る第１の複合
部品と、低誘電率セラミック基板の内部に設けた複数の
積層コンデンサをスルーホールによって表面に引き出す
とともに表面に厚膜回路を構成して成る第２の複合部品
とを樹脂あるいは厚膜ガラス等によって接着すると同時
に対向する導体を接続し、さらに第１あるいは第２の複
合部品の表面に他の電子部品を装着して成ることを特徴
とする回路基板。 - 【請求項２】第１，第２の複合部品のスルーホールの内
少なくとも一つ以上が複合部品の表裏面を結線するため
にのみに構成されたことを特徴とする特許請求の範囲第
１項記載の回路基板。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60010143A JPH0632382B2 (ja) | 1985-01-22 | 1985-01-22 | 回路基板 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60010143A JPH0632382B2 (ja) | 1985-01-22 | 1985-01-22 | 回路基板 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61168992A JPS61168992A (ja) | 1986-07-30 |
| JPH0632382B2 true JPH0632382B2 (ja) | 1994-04-27 |
Family
ID=11742059
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60010143A Expired - Lifetime JPH0632382B2 (ja) | 1985-01-22 | 1985-01-22 | 回路基板 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0632382B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007258478A (ja) * | 2006-03-23 | 2007-10-04 | Rohm Co Ltd | 複合回路部品およびこれを備える半導体装置 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6480096A (en) * | 1987-09-19 | 1989-03-24 | Nippon Cmk Kk | Formation of condenser or like on printed wiring board |
| JPH02249294A (ja) * | 1989-03-23 | 1990-10-05 | Mitsubishi Mining & Cement Co Ltd | Ｌｃ内蔵形セラミックス基板 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59136961A (ja) * | 1983-01-27 | 1984-08-06 | Matsushita Electric Ind Co Ltd | 電子回路部品 |
| JPS59136962A (ja) * | 1983-01-27 | 1984-08-06 | Matsushita Electric Ind Co Ltd | 電子回路部品 |
| JPS58166068U (ja) * | 1982-04-30 | 1983-11-05 | 富士通株式会社 | 多層印刷配線板 |
| JPS59111394A (ja) * | 1982-12-16 | 1984-06-27 | 松下電器産業株式会社 | コンデンサ内蔵セラミツク多層基板 |
-
1985
- 1985-01-22 JP JP60010143A patent/JPH0632382B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007258478A (ja) * | 2006-03-23 | 2007-10-04 | Rohm Co Ltd | 複合回路部品およびこれを備える半導体装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61168992A (ja) | 1986-07-30 |
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