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JPH0654332B2 - Power factor transducer - Google Patents
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JPH0654332B2 - Power factor transducer - Google Patents

Power factor transducer

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JPH0654332B2
JPH0654332B2 JP13472287A JP13472287A JPH0654332B2 JP H0654332 B2 JPH0654332 B2 JP H0654332B2 JP 13472287 A JP13472287 A JP 13472287A JP 13472287 A JP13472287 A JP 13472287A JP H0654332 B2 JPH0654332 B2 JP H0654332B2
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circuit
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power
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division
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栄二 林
栄介 阿部
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Yokogawa Electric Corp
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Yokogawa Electric Corp
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、力率をこれに対応した直流信号に変換するト
ランスデューサに関するものである。
TECHNICAL FIELD The present invention relates to a transducer for converting a power factor into a DC signal corresponding to the power factor.

〔従来の技術〕[Conventional technology]

電力をP,無効電力をQとした場合、力率cosφは周知
のように で表わされ、この関係は第2図(イ)で示される。この(1)
式は下式(2)と対応関係にあることも知られている。
Assuming that power is P and reactive power is Q, the power factor cosφ is well known. This relationship is shown in FIG. 2 (a). This (1)
It is also known that the equation has a correspondence relationship with the following equation (2).

tanφ=Q/P …(2) 電力比である第(2)式は第2図の(ロ)で表わされる。tanφ = Q / P (2) Equation (2), which is the power ratio, is represented by (b) in FIG.

力率トランスデューサは既に知られているが、従来のこ
の種のトランスデューサは出力としてアナログの指示計
器が接続されており、この場合トランスデューサ内で
(2)式の演算を行い、指示計器の目盛上で cosφ=(Lag)0.5〜1.0〜0.5(Lead) となるようにスケール変換していた。
Although power factor transducers are already known, this type of conventional transducer has an analog indicating instrument connected as an output, which in this case
The formula (2) was calculated, and the scale was converted so that cos φ = (Lag) 0.5 to 1.0 to 0.5 (Lead) on the scale of the indicating instrument.

〔発明が解決しようとする問題点〕[Problems to be solved by the invention]

ところで、力率cosφを2図(ハ)に示す如く、Lead,
Lag信号を含めた例えば4〜20mAのように統一さ
れたリニアな直流信号に変換したい場合があるが、この
場合スケール変換することなく第2図(イ)から直接リニ
アな直流信号に変換するのは困難である。本発明はこの
ような点にかんがみてなされたもので、第(2)式で表わ
される第2図(ロ)から第2図(ハ)で示される進み(Lea
d),遅れ(Lag)信号を含めた例えば統一されたリ
ニアな直流信号に変換することのできる力率トランスデ
ューサを提供することを目的としたものである。
By the way, as shown in FIG. 2 (C), the power factor cosφ is Lead,
There is a case where it is desired to convert to a unified linear DC signal such as 4 to 20 mA including the Lag signal, but in this case, it is directly converted to a linear DC signal from FIG. 2 (A) without scale conversion. It is difficult. The present invention has been made in consideration of such a point, and the progress (Lea) shown in FIGS. 2 (b) to 2 (c) represented by the equation (2) is shown.
d) The purpose of the present invention is to provide a power factor transducer capable of converting into, for example, a unified linear DC signal including a delay signal.

〔問題点を解決するための手段〕[Means for solving problems]

本発明は上記の目的を達成するために、電力信号Pと無
効電力Qとの比をとる(tanφ=Q/P)回路におい
て、乗除算(Q・Y/P)回路を用い、YをQ/Pのパ
ラメータとすることによって進み及び遅れ力率の判別が
可能で力率をリニアに直流信号に変換するように構成し
た。以下、実施例について詳細に説明する。
In order to achieve the above object, the present invention uses a multiplication / division (Q · Y / P) circuit in a circuit that takes a ratio of a power signal P and a reactive power Q (tan φ = Q / P) and uses Y as Q. By setting the / P parameter, it is possible to distinguish the lead and lag power factors, and the power factor is linearly converted into a DC signal. Hereinafter, examples will be described in detail.

〔実施例〕〔Example〕

第1図は本発明に係る力率トランスデューサの一実施例
のブロック図である。図において、vは交流回路におけ
る電圧、iは同じく電流を示すものである。PTは変圧
器、CTは変流器、PWMはパルス幅変調回路である。
電圧入力vは変圧器PTを介して取り出されたのち、公
知のパルス幅変調回路PWMに加えられてその大きさに
応じたパルス幅信号に変調される。R1〜R3は抵抗
器、Cは90°移相用のコンデンサ、S1〜S3はアナ
ログスイッチ、A1〜A3はアンプである。抵抗器R1
とコンデンサCは変流器CTの二次巻線間に直列に接続
され、その接続点は基準電位点に接続されている。電流
入力iは変流器CTを介して取り出されたのち抵抗器R
1とコンデンサCの回路に加えられる。その結果、抵抗
器R1からは電流iの同相分が取り出され、その出力は
抵抗器R2を介してスイッチS1に加えられる。スイッ
チS1はパルス幅変調回路PWMの出力によって駆動さ
れる。したがって、電圧vと電流iの同相分が掛算さ
れ、スイッチS1の出力端からは周知のように交流回路
における有効電力Pが取り出される。この有効電力Pは
アンプA1に加えられる。
FIG. 1 is a block diagram of an embodiment of a power factor transducer according to the present invention. In the figure, v is a voltage in the AC circuit, and i is a current. PT is a transformer, CT is a current transformer, and PWM is a pulse width modulation circuit.
The voltage input v is taken out via the transformer PT and then applied to a known pulse width modulation circuit PWM to be modulated into a pulse width signal according to its magnitude. R1 to R3 are resistors, C is a 90 ° phase shift capacitor, S1 to S3 are analog switches, and A1 to A3 are amplifiers. Resistor R1
And the capacitor C are connected in series between the secondary windings of the current transformer CT, and the connection point is connected to the reference potential point. The current input i is taken out via the current transformer CT and then the resistor R
1 and capacitor C added to the circuit. As a result, the in-phase component of the current i is taken out from the resistor R1, and its output is applied to the switch S1 via the resistor R2. The switch S1 is driven by the output of the pulse width modulation circuit PWM. Therefore, the in-phase component of the voltage v and the current i is multiplied, and the active power P in the AC circuit is extracted from the output terminal of the switch S1 as is well known. This active power P is applied to the amplifier A1.

一方、コンデンサCからは電流iの90°移相分が取り
出され、その出力は抵抗器R3を介してスイッチS2に
加えられる。スイッチS2はパルス幅変調回路PWMの
出力によって駆動される。この場合、電圧vと電流iの
90°移相分が掛算され、スイッチS2の出力端からは
交流回路における無効電力Q′が取り出されてアンプA
2に加えられる。この無効電力Q′は周波数の項が含ま
れている。FDは交流回路の周波数を検出する例えばモ
ノマルチ等で構成した周波数検出回路で、その入力端は
変圧器PTの二次コイルに接続され、出力端はスイッチ
S3に加えられてこれを駆動する。したがって、無効電
力Q′と周波数fが掛算され、スイッチS3の出力端か
らは周波数の項が含まれない無効電力信号Qが取り出さ
れてアンプA3に加えられる。即ち、アンプA1から交
流回路における有効電力Pに対応した信号が取り出さ
れ、アンプA3から無効電力Qに対応した信号が取り出
される。
On the other hand, the 90 ° phase-shifted portion of the current i is taken out from the capacitor C, and its output is applied to the switch S2 via the resistor R3. The switch S2 is driven by the output of the pulse width modulation circuit PWM. In this case, the 90 ° phase shift of the voltage v and the current i is multiplied, and the reactive power Q ′ in the AC circuit is taken out from the output terminal of the switch S2 and the amplifier A
Added to 2. This reactive power Q'includes a frequency term. The FD is a frequency detection circuit configured by, for example, a mono-multi for detecting the frequency of the AC circuit, the input end thereof is connected to the secondary coil of the transformer PT, and the output end thereof is added to the switch S3 to drive it. Therefore, the reactive power Q'is multiplied by the frequency f, and the reactive power signal Q containing no frequency term is taken out from the output end of the switch S3 and added to the amplifier A3. That is, a signal corresponding to the active power P in the AC circuit is extracted from the amplifier A1, and a signal corresponding to the reactive power Q is extracted from the amplifier A3.

M1,M2はそれぞれX,Y,Zを入力したとき、(X
・Y/Z)の演算を行なうIC化された乗除算回路、B
Cは絶対値回路、FCは関数変換回路、R4は可変抵抗
器である。アンプA1の出力端は乗除算回路M1,M2
のZ入力端子に接続され、アンプA3の出力端は乗除算
回路M1,M2のX入力端子に夫々接続されている。乗
除算回路M1のY入力端子は可変抵抗器R4の刷子に接
続され、乗除算回路M2のY入力端子には一定の電圧V
Pが加えられている。乗除算回路M1の出力端はアンプ
A4に接続されている。乗除算回路M2の出力端は絶対
値回路BCを介して関数変換回路FCに接続され、回路
FCの出力端は可変抵抗器R4に接続されている。関数
変換回路FCは演算増幅器OPとその入,出力端子間に
接続されたツェナーダイオードDz及び可変抵抗器R5
よりなるものである。
When M, M2 input X, Y, Z respectively, (X
.Y / Z) IC multiplication / division circuit, B
C is an absolute value circuit, FC is a function conversion circuit, and R4 is a variable resistor. The output terminal of the amplifier A1 has multiplication and division circuits M1 and M2.
, And the output end of the amplifier A3 is connected to the X input terminals of the multiplication / division circuits M1 and M2, respectively. The Y input terminal of the multiplication / division circuit M1 is connected to the brush of the variable resistor R4, and a constant voltage V is applied to the Y input terminal of the multiplication / division circuit M2.
P is added. The output terminal of the multiplication / division circuit M1 is connected to the amplifier A4. The output terminal of the multiplication / division circuit M2 is connected to the function conversion circuit FC via the absolute value circuit BC, and the output terminal of the circuit FC is connected to the variable resistor R4. The function conversion circuit FC includes an operational amplifier OP, a Zener diode Dz connected between its input and output terminals, and a variable resistor R5.
It consists of

乗除算回路M2はそのZ入力端子に加えられた有効電力
Pと、X入力端子に加えられた無効電力Qとによりtan
φ=(Q/P)・VP(一定)の演算を行なう。即ち、
乗除演算回路M2は入力されるPとQ信号により(2)式
の演算を行ない、第2図(ロ)で示される信号を出力す
る。
The multiplication / division circuit M2 is tanned by the active power P applied to its Z input terminal and the reactive power Q applied to its X input terminal.
The calculation of φ = (Q / P) · VP (constant) is performed. That is,
The multiplication / division operation circuit M2 performs the operation of the equation (2) by the input P and Q signals and outputs the signal shown in FIG.

この電力比に対応した信号は絶対値回路BCに加えられ
てその絶対値|Q/P|がとられ、この絶対値出力は関
数変換回路FCに加えられる。関数変換回路FCにおい
てはツェナーダイオードDzが演算増幅器OPの入,出
力端子間に接続されているので、第3図に示す如くtan
φ=(Q/P)が所定の値aになるまでこの関数発生回
路FCの出力VCは増加するが、入力がツェナーダイオ
ードDzのツェナー電圧を越えるとVCは一定となる。
The signal corresponding to this power ratio is applied to the absolute value circuit BC to take its absolute value | Q / P |, and this absolute value output is applied to the function conversion circuit FC. In the function conversion circuit FC, since the Zener diode Dz is connected between the input and output terminals of the operational amplifier OP, as shown in FIG.
The output VC of the function generating circuit FC increases until φ = (Q / P) reaches a predetermined value a, but when the input exceeds the Zener voltage of the Zener diode Dz, VC becomes constant.

このような関数特性の電圧VCは、 −a≦Φ≦aの範囲では VC=K1|tanΦ| …(3) で表され、Φ<−a,Φ>aでは VC=K2 …(4) となる。なお、K1,K2は夫々係数を表わすものであ
る。このような演算式で表わされる電圧VCが乗除算回
路M1のY入力端子に加えられる。乗除演算回路はその
Z入力端子に加えられた有効電力Pと、X入力端子に加
えられた無効電力Qとによりtanφ=(Q/P)の演算
をすると共に、Y入力端子に加えられる(3),(4)式に示
す電圧VCを掛算する。その結果、乗除演算回路M1の
出力電圧Vo′は Vo′=(P/Q)・Y …(5) ∴−a≦Φ≦aの範囲では、Vo′は Vo′=tanΦ・K1|tanΦ| …(6) で表わされ、Φ<−a,Φ>aでは Vo′=tanΦ・K2 …(7) で表わされる乗除演算回路M1において、(5)式に示す
Yは(P/Q)のパラーメータとして動作し、(6),(7)
式で表わされる。このような(6),(7)式で表わされる電
圧Vo′がアンプA4に加えられて電圧Voとなる。
The voltage VC having such a functional characteristic is represented by VC = K1 | tanΦ | (3) in the range of −a ≦ Φ ≦ a, and VC = K2 (4) in the case of Φ <−a, Φ> a. Become. Note that K1 and K2 represent coefficients, respectively. The voltage VC represented by such an arithmetic expression is applied to the Y input terminal of the multiplication / division circuit M1. The multiplication / division operation circuit calculates tan φ = (Q / P) from the active power P applied to its Z input terminal and the reactive power Q applied to its X input terminal, and also applies it to the Y input terminal (3 ), The voltage VC shown in the equation (4) is multiplied. As a result, the output voltage Vo ′ of the multiplication / division operation circuit M1 is Vo ′ = (P / Q) · Y (5) In the range of ∴−a ≦ Φ ≦ a, Vo ′ is Vo ′ = tanΦ · K1 | tanΦ | (6), and Φ <-a, Φ> a, Vo ′ = tan Φ · K2 (7) In the multiplication / division operation circuit M1, Y shown in equation (5) is (P / Q) Works as a parameter of (6), (7)
It is represented by a formula. The voltage Vo 'represented by the equations (6) and (7) is applied to the amplifier A4 and becomes the voltage Vo.

ここで、(6)式及び(7)式で表わされる電圧Vo′
は、第2図(ロ)で表わした第(2)式のtanφを近似し、リ
ニアな直流信号に変換したものとなる。即ち、位相角φ
が−35°〜0〜35°の範囲(第3図において0〜a
点の範囲)では係数k1として0.402とし、この範
囲を第(6),(7)式で表わした如く0.402・tan2φで
2乗近似し、35°〜65°の範囲では係数k2として
0.402tanφ×0.700=0.281tanφで近似
させるようにしたものである。
Here, the voltage Vo ′ represented by the equations (6) and (7)
Is a value obtained by approximating tan φ of the equation (2) shown in FIG. 2 (b) and converting it into a linear DC signal. That is, the phase angle φ
Is in the range of -35 ° to 0 to 35 ° (0 to a in FIG. 3).
In the range of points), the coefficient k1 is set to 0.402, and this range is squared by 0.402 · tan 2 φ as expressed by the equations (6) and (7), and in the range of 35 ° to 65 ° The coefficient k2 is approximated by 0.402 tanφ × 0.700 = 0.281 tanφ.

上記のように係数k1,k2を選ぶことにより0.5
(Lag)〜1.0〜+0.5(Lead)の間におい
て角度換算で±1.6°以内の力率信号Voに変換する
ことができた。第4図は実験結果を示すもので(なお、
第4図は位相角φが0〜70°のみの場合を示してあ
る)、実線が位相角φに対する1−cosφを、そして鎖
線は第(6),(7)式の出力電圧Voを示したものである。
このように力率cosφをリニアに変換した直流電圧Vo
は出力回路OUTに加えられる。
By selecting the coefficients k1 and k2 as described above, 0.5
It was possible to convert into a power factor signal Vo within ± 1.6 ° in terms of angle between (Lag) and 1.0 to +0.5 (Lead). Figure 4 shows the experimental results (note that
FIG. 4 shows the case where the phase angle φ is only 0 to 70 °), the solid line shows 1-cosφ with respect to the phase angle φ, and the chain line shows the output voltage Vo of the equations (6) and (7). It is a thing.
In this way, the DC voltage Vo obtained by linearly converting the power factor cosφ
Is added to the output circuit OUT.

出力回路OUTにおいて、A5はアンプ、TRはトラン
ジスタ、R6〜R8は抵抗、Dz1はツェナーダイオー
ド、Vは正の電圧源、t1,t2は出力端子である。L
はディジタル電圧計等を示す。この出力回路OUTは出
力電圧Voを例えば4〜20mAのような統一した信号
に変換するもので、抵抗R8と電圧源Vはそのバイアス
回路である。このように、出力回路にバイアス回路を加
えた本発明においては、出力端子t1,t2から2図
(ハ)に示す如く4〜20mAの如く統一された信号が取
り出される。
In the output circuit OUT, A5 is an amplifier, TR is a transistor, R6 to R8 are resistors, Dz1 is a Zener diode, V is a positive voltage source, and t1 and t2 are output terminals. L
Indicates a digital voltmeter or the like. The output circuit OUT converts the output voltage Vo into a unified signal such as 4 to 20 mA, and the resistor R8 and the voltage source V are bias circuits thereof. As described above, in the present invention in which the bias circuit is added to the output circuit, the output terminals t1 and t2 are shown in FIG.
As shown in (c), a unified signal of 4 to 20 mA is taken out.

なお、第1図の回路において、cosφリニアの信号のみ
を必要とする場合には、バイアス回路を除去することに
より、位相角Φが正のときVo=(1−cosΦ),Φが
負のときVo=(cosΦ−1)として出力される。この
場合、位相角φに対するcosφは第2図(ロ)の如く示され
る。
When only the cosφ linear signal is required in the circuit of FIG. 1, by removing the bias circuit, when the phase angle Φ is positive, Vo = (1-cosΦ), and when Φ is negative, It is output as Vo = (cosΦ-1). In this case, cos φ with respect to the phase angle φ is shown as shown in FIG.

〔本発明の効果〕[Effect of the present invention]

以上説明したように、本発明においては電力Pと無効電
力Qとの比(tanφ=P/Q)をとる回路において乗除
演算(Vo=Q・Y/P)回路を用い、YをQ/Pのパ
ラメータとすることによって、Lead,Lag信号も
含めた交流回路における力率信号を直接これに比例した
直流信号に変換することができる。しかも、前記のよう
に電力比によって力率変換を行なうようにしているの
で、歪波対応で、単相は勿論のこと多相でしかも不平衡
型の電力回路においてもその電力回路における力率を直
流信号に変換することのできるトランスデューサを得る
ことができる。
As described above, in the present invention, a multiply / divide operation (Vo = Q · Y / P) circuit is used in a circuit that takes a ratio (tan φ = P / Q) of power P and reactive power Q, and Y is Q / P. By setting the parameter of, the power factor signal in the AC circuit including the Lead and Lag signals can be directly converted into a DC signal in proportion thereto. Moreover, since the power factor conversion is performed by the power ratio as described above, the power factor in the power circuit can be adjusted not only in the distorted wave, but also in the single-phase and unbalanced type power circuits. It is possible to obtain a transducer that can be converted into a DC signal.

【図面の簡単な説明】[Brief description of drawings]

第1図は本発明に係るトランスデューサの一実施例の接
続図、第2図乃至第4図は夫々本発明装置の動作及び特
性を説明する為の図である。 M1…乗除算回路、M2…乗算回路、FC…関数発生回
路。
FIG. 1 is a connection diagram of an embodiment of the transducer according to the present invention, and FIGS. 2 to 4 are diagrams for explaining the operation and characteristics of the device of the present invention. M1 ... Multiplication / division circuit, M2 ... Multiplication circuit, FC ... Function generation circuit.

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】交流回路における有効電力P及び無効電力
Qを得る有効電力・無効電力変換回路、この有効電力・
無効電力変換回路の出力を受け(Q/P)の演算を行う
除算回路、この除算回路の出力の絶対値をとる絶対値回
路、演算増幅器とその入出力端子間に接続されたツェナ
ーダイオードよりなり絶対値回路を介して得られる前記
除算回路の出力を関数変換して出力する関数変換回路、
前記有効電力・無効電力変換回路の出力PとQ及び前記
関数変換回路の出力VCを受けて(P/Q)・VCの乗
除算を行う乗除算回路、及びこの乗除算回路の出力を取
り出す出力端子を具備した力率トランスジューサ。
1. An active power / reactive power conversion circuit for obtaining active power P and reactive power Q in an AC circuit, and this active power
It consists of a division circuit that receives the output of the reactive power conversion circuit and performs the operation of (Q / P), an absolute value circuit that takes the absolute value of the output of this division circuit, a zener diode connected between the operational amplifier and its input / output terminal. A function conversion circuit for function-converting and outputting the output of the division circuit obtained via the absolute value circuit,
A multiplication / division circuit for multiplying / dividing (P / Q) · VC by receiving the outputs P and Q of the active power / reactive power conversion circuit and the output VC of the function conversion circuit, and an output for extracting the output of this multiplication / division circuit Power factor transducer with terminals.
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