JPH0720195B2 - Image reader - Google Patents
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- JPH0720195B2 JPH0720195B2 JP61016509A JP1650986A JPH0720195B2 JP H0720195 B2 JPH0720195 B2 JP H0720195B2 JP 61016509 A JP61016509 A JP 61016509A JP 1650986 A JP1650986 A JP 1650986A JP H0720195 B2 JPH0720195 B2 JP H0720195B2
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Description
【発明の詳細な説明】 [産業上の利用分野] 本発明は、画像読取装置に関する。The present invention relates to an image reading device.
[従来の技術] 従来の画像読取装置は、光源としてたとえば、蛍光灯を
使用している。その蛍光灯を使用すると、蛍光灯中央と
両端とでは、光量に差が出る場合がある。また、光学系
の中にレンズを使用すると、cos4θ則等によって、周辺
光量が低下する。これらの光量分布を補正するために、
機械的シェーディング(周辺の光量を多く通過させる操
作)および電気的シェーディング(ビデオ信号を二値化
するときに、上記蛍光灯の出力に従って基準電圧を変え
る操作)が採用されている。[Prior Art] A conventional image reading apparatus uses, for example, a fluorescent lamp as a light source. When the fluorescent lamp is used, the amount of light may differ between the center and both ends of the fluorescent lamp. Further, when a lens is used in the optical system, the amount of peripheral light decreases due to the cos 4 θ rule or the like. In order to correct these light intensity distributions,
Mechanical shading (operation of passing a large amount of peripheral light) and electrical shading (operation of changing a reference voltage according to the output of the fluorescent lamp when binarizing a video signal) are adopted.
上記機械的シェーディングは、蛍光灯と被写体との間、
または、被写体とレンズとの間に、第5図に示すような
シェーディング板を設け、周辺光量を中央の光量よりも
多く通すようにしている。これによって、蛍光灯または
レンズによる光量の分布を補正している。The mechanical shading is between the fluorescent lamp and the subject,
Alternatively, a shading plate as shown in FIG. 5 is provided between the subject and the lens so that the peripheral light amount is greater than the central light amount. With this, the distribution of the amount of light by the fluorescent lamp or the lens is corrected.
次に、電気的シェーディングについての説明を行なう。Next, electrical shading will be described.
第6図(a)は、1ライン分のビデオ信号の波形(直流
再生した後の波形)と、電気的シェーディングを行なわ
ない場合のスライスレベルとを示す図である。FIG. 6 (a) is a diagram showing a waveform of a video signal for one line (a waveform after direct current reproduction) and a slice level when electrical shading is not performed.
スライスレベルとしては、たとえば、ビデオ信号波形の
ピーク電圧の6割程度を考え、有効読取幅は図示した長
さであるとする。この場合、区間(ア)において、実際
は白信号であるが、黒信号であると判断される。As the slice level, for example, about 60% of the peak voltage of the video signal waveform is considered, and the effective reading width is assumed to be the illustrated length. In this case, in the section (a), it is judged that the signal is actually a white signal but a black signal.
第6図(b)は、1ライン分のビデオ信号の波形(直流
再生した後の波形)と、電気的シェーディングを行なっ
たスライスレベルとを示す図である。FIG. 6 (b) is a diagram showing a waveform of a video signal for one line (waveform after direct current reproduction) and a slice level subjected to electrical shading.
電気的シェーディングを行なう場合、画像が読取位置に
くる前に、基準白板を読取り、この読取ったビデオ信号
をメモリに記憶する。そして、現在のビデオ信号波形の
ピーク電圧の6割程度のレベルで、上記メモリに記憶し
た信号波形(基準白板に応じた信号波形)を再現し、こ
れをスライスレベルとする。これによって、ビデオ信号
波形の特性を考慮して、ビデオ信号波形を二値化するこ
とができる。When performing electrical shading, the reference white plate is read before the image reaches the reading position, and the read video signal is stored in the memory. Then, the signal waveform stored in the memory (the signal waveform corresponding to the reference white board) is reproduced at a level of about 60% of the peak voltage of the current video signal waveform, and this is set as a slice level. Thereby, the video signal waveform can be binarized in consideration of the characteristics of the video signal waveform.
そして、読取位置の手前に原稿がセットされている場
合、原稿が読取位置にかかる手前において、基準となる
全白信号(基準白板に応じたビデオ信号)を読取り(こ
の読取りを以下、「プリスキャン」という)、現在の光
量分布に応じたビデオ信号波形をRAM等に記憶する。そ
して、この記憶したビデオ信号波形を基準にして、スラ
イスレベルを決定する。Then, when the document is set before the reading position, the reference all-white signal (video signal corresponding to the reference white plate) is read before the document reaches the reading position (this reading will be referred to as "prescan" below). The video signal waveform according to the current light intensity distribution is stored in the RAM or the like. Then, the slice level is determined with reference to the stored video signal waveform.
原稿が読取位置の手前にセットされている状態を、第7
図(a)に図示してある。この図において、プリスキャ
ンを行なうときに使用する基準白板1の斜線部側の面が
白くなっている。なお、符号2は蛍光灯であり、符号3
は原稿である。また、複数ページの原稿がセットされて
いる場合、各ページを読み終る毎に、上記プリスキャン
を繰り返す。If the original is set in front of the scanning position,
This is shown in FIG. In this figure, the surface of the reference white plate 1 used when performing the pre-scan is on the side of the hatched portion is white. Reference numeral 2 is a fluorescent lamp, and reference numeral 3
Is a manuscript. In addition, when a plurality of pages of originals are set, the above prescan is repeated each time each page is read.
ところで、第7図(b)に示すように、原稿3が読取位
置を越えて挿入されている場合、プリスキャンを行なう
ことはできない。このため、全白のビデオ信号を得るこ
とができない。したがって、予め記憶したビデオ波形を
基準にして、スライスレベルを決定する。予め記憶した
ビデオ信号波形は、たとえばROMあるいはバッテリバッ
クアップされたRAMに記憶してある。By the way, as shown in FIG. 7B, when the document 3 is inserted beyond the reading position, prescan cannot be performed. Therefore, it is not possible to obtain an all-white video signal. Therefore, the slice level is determined based on the video waveform stored in advance. The video signal waveform stored in advance is stored in, for example, a ROM or a battery-backed RAM.
したがって、従来の読取装置において、原稿が読取位置
の手前にセットされている場合にプリスキャンを行な
い、原稿が読取位置を越えて挿入されている場合に、プ
リスキャンをせずに、既に記憶されているビデオ信号波
形を基準にして、スライスレベルを決定する。Therefore, in the conventional reading device, the prescan is performed when the document is set in front of the reading position, and when the document is inserted beyond the reading position, it is already stored without being prescanned. The slice level is determined based on the waveform of the video signal being generated.
しかし、原稿が読取位置を越えて挿入されるケースは非
常に稀である。この稀なケースのために、ROMまたはバ
ッテリバックアップされたRAMを装着し、ビデオ信号波
形を記憶しておくことは、コスト的、基板スペースの点
から経済的ではないという問題がある。However, it is very rare that a document is inserted beyond the reading position. For this rare case, there is a problem that mounting a ROM or a battery backed up RAM and storing the video signal waveform is not economical in terms of cost and board space.
[発明の目的] 本発明は、上述の問題点に着目してなされたものであ
り、原稿を途中から読み取ることができる読取装置にお
いて、原稿を途中から読み取るために、原稿が通常の読
取位置を越えて深く挿入された状態で読取開始したとき
に、原稿画像の読み取り直前に基準白板を読み取れない
ことによってシェーディング補正ができなくなる不都合
を解消するとともに、原稿を途中から読み取るいう稀な
ケースのみのためにシェーディング補正用のデータを記
憶するメモリを設けることによるコストアップを招く不
都合を解消し、さらに、そのメモリを実装するためのス
ペースを回路基板上に確保することによって経済効率が
悪くなる不都合を解消することができる画像読取装置を
提供することを目的とするものである。[Object of the Invention] The present invention has been made in view of the above-mentioned problems, and in a reading device capable of reading a document halfway, the document is set at a normal reading position in order to read the document halfway. When scanning starts when the document is inserted deeply beyond, it eliminates the inconvenience that shading correction cannot be performed because the reference white plate cannot be read immediately before reading the document image, and is only for the rare case where the document is read halfway. Eliminates the inconvenience of increasing costs due to the provision of a memory for storing shading correction data, and eliminates the inconvenience of economic efficiency by securing a space for mounting the memory on the circuit board. It is an object of the present invention to provide an image reading apparatus capable of performing the above.
[発明の実施例] 第1図は、本発明の一実施例の説明図である。Embodiment of the Invention FIG. 1 is an explanatory diagram of an embodiment of the present invention.
この図において、蛍光灯20と、プリスキャンを行なうと
きに使用する基準白板22と、原稿24と、原稿24がセット
されているか否かを検出するドキュメントセンサ26と、
原稿24の先端を検出するドキュメントエッジセンサ28
と、反射ミラー30と、シェーディング板32と、レンズ34
と、CCD36とが設けられている。In this figure, a fluorescent lamp 20, a reference white plate 22 used when performing a prescan, a document 24, a document sensor 26 for detecting whether the document 24 is set,
Document edge sensor 28 that detects the leading edge of the document 24
, Reflection mirror 30, shading plate 32, lens 34
And CCD 36 are provided.
ドキュメントセンサ26は、原稿24がセットされていない
ときには、レベル「0」の信号を出力し、原稿24がセッ
トされているときには、レベル「1」の信号を出力す
る。ドキュメントエッジセンサ28は、その上に原稿24が
セットされている(いない)ときには、レベル「1」
(レベル「0」)の信号を出力するものである。The document sensor 26 outputs a signal of level "0" when the document 24 is not set, and outputs a signal of level "1" when the document 24 is set. The document edge sensor 28 has a level "1" when the document 24 is set (not present) on it.
It outputs a signal of (level "0").
通常、ドキュメントセンサ26によって原稿24が原稿台に
セットされているか否かを検出し、その原稿24がドキュ
メントエッジセンサ28にかかるまでフィードする。そし
て、プリスキャンを行なう。その後、ドキュメントエッ
ジセンサ28から読取位置までの距離は既知であるので、
その長さに相当する分だけ原稿24をフィードし、読取動
作を開始する。Normally, the document sensor 26 detects whether or not the document 24 is set on the document table, and the document 24 is fed until it reaches the document edge sensor 28. Then, prescan is performed. After that, since the distance from the document edge sensor 28 to the reading position is known,
The document 24 is fed by an amount corresponding to the length, and the reading operation is started.
なお、最初から、センサ26,28に原稿24がセットされて
いるときには、原稿24がどこまで挿入されているか分か
らないので、読取位置に原稿24がセットされていてプリ
スキャンを行なえないと判断する。また、CCD36の代り
に、他のイメージセンサを使用してもよい。From the beginning, when the document 24 is set on the sensors 26 and 28, it is not known how far the document 24 is inserted, so it is determined that the document 24 is set at the reading position and prescanning cannot be performed. Also, instead of the CCD 36, another image sensor may be used.
第2図は、本発明の一実施例を示すブロック図である。FIG. 2 is a block diagram showing an embodiment of the present invention.
タイミング回路42は、転送パルス、シフトパルス、リセ
ットパルス、サンプリングパルス、暗時出力が出ている
間アクティブとなる直流再生用信号、RAMのアドレスを
指定するアドレス信号を出力する回路である。The timing circuit 42 is a circuit that outputs a transfer pulse, a shift pulse, a reset pulse, a sampling pulse, a DC reproduction signal that is active while a dark output is output, and an address signal that specifies a RAM address.
駆動回路44は、C2MOSあるいはTTLのレベルで作ったパル
スを、CCD36が駆動できるレベルに変換し、CCD36にパル
スを供給する回路である。The drive circuit 44 is a circuit that converts a pulse generated at the level of C 2 MOS or TTL into a level that can drive the CCD 36 and supplies the pulse to the CCD 36.
サンプル&ホールド回路48は、増幅回路46が画像信号
(光信号)以外の信号、たとえば、リセット信号、暗示
出力信号を出力するので、画像信号が出力されているタ
イミングで、データをサンプルし、ホールドし、アナロ
グの光信号成分のみを出力するものである。The sample-and-hold circuit 48 outputs a signal other than the image signal (optical signal), such as a reset signal or an implied output signal, by the amplifier circuit 46. Therefore, the sample and hold circuit samples and holds the data at the timing when the image signal is output. However, it outputs only an analog optical signal component.
直流再生回路50は、直流成分を補正し、暗時出力レベル
がグラウンドにくるようにする回路である。また、増幅
回路46と、ピークホールド回路52と、シェーディング補
正回路54とが設けられている。The DC reproducing circuit 50 is a circuit that corrects the DC component so that the output level in the dark is at the ground. Further, an amplifier circuit 46, a peak hold circuit 52, and a shading correction circuit 54 are provided.
次に、プリスキャン動作と、ビデオ信号波形をRAM62に
記憶する動作について説明する。Next, the prescan operation and the operation of storing the video signal waveform in the RAM 62 will be described.
上記RAM62は、スタンバイ電源で記憶可能なものであ
り、全白信号のビデオ信号波形を再現するデータが蓄え
られている。The RAM 62 can be stored by a standby power supply, and stores data for reproducing a video signal waveform of an all-white signal.
原稿がたとえばA3サイズであり、8ライン/mmで読取る
場合、2592画素のCCDが必要である。その各画素に対
し、8ビットのデータを格納できれば、各画素に対し
て、256通りのレベルを設定することができる。上記実
施例においては、ピーク電圧に基づいて、所定の時定数
の充電、放電を繰り返すことによって、全白信号のビデ
オ信号波形を再現する。この場合、RAM62は、2592×1
ビットの容量を有するものであればよい。If the original is, for example, A3 size and is read at 8 lines / mm, a CCD of 2592 pixels is required. If 8-bit data can be stored for each pixel, 256 levels can be set for each pixel. In the above embodiment, the video signal waveform of the all-white signal is reproduced by repeating charging and discharging with a predetermined time constant based on the peak voltage. In this case, RAM62 is 2592 x 1
It may have any bit capacity.
上記全白信号のビデオ信号波形を記憶する場合、まず、
制御回路72からシェーディング補正回路54に向かう信号
をレベル「1」にセットする。すなわち、NONSHD=0に
して、シェーディング補正を行なうモードにセットす
る。そして、制御回路72からディレー回路60に向けてプ
リスキャン開始パルスを発生する。これによって、ディ
レー回路60は、まず、レベル「1」の信号を出力する。When storing the video signal waveform of the all-white signal, first,
The signal from the control circuit 72 to the shading correction circuit 54 is set to level "1". That is, NONSHD = 0 is set and the mode is set to perform shading correction. Then, the control circuit 72 generates a prescan start pulse toward the delay circuit 60. As a result, the delay circuit 60 first outputs a signal of level "1".
そして、タイミング回路42がシフトパルスを2個発生し
たときに、ディレー回路60が「0」を出力する。ここ
で、ディレー回路60が「0」を出力すると、全白のビデ
オ信号波形を再現するデータがRAM62から出力される。
また、ディレー回路60が「1」を出力すると、全白のビ
デオ信号波形を再現するデータを、RAM62が入力する。
また、制御回路72からシェーディング補正回路54に向か
う信号が「0」を出力すると(NONSHD=1になると)、
プリスキャンを行なうことはできない。Then, when the timing circuit 42 generates two shift pulses, the delay circuit 60 outputs "0". Here, when the delay circuit 60 outputs "0", data for reproducing the video signal waveform of all white is output from the RAM 62.
When the delay circuit 60 outputs "1", the RAM 62 inputs data for reproducing the video signal waveform of all white.
When the signal from the control circuit 72 to the shading correction circuit 54 outputs “0” (NONSHD = 1),
Prescan cannot be performed.
制御回路72からプリスキャンパルスが発生し、タイミン
グ回路42からシフトパルスが発生した後、次のシフトパ
ルスが発生するまでの間のデータ(つまり、電圧比較回
路58の出力信号)をRAM62が入力する。After the pre-scan pulse is generated from the control circuit 72 and the shift pulse is generated from the timing circuit 42, the data until the next shift pulse is generated (that is, the output signal of the voltage comparison circuit 58) is input to the RAM 62. .
シェーディング補正回路54は、ラインの先頭において、
グランドレベルの信号を出力している。つまり、ライン
の先頭においては、タイミング回路42から出力される基
準電圧によって、グランドレベルの信号が出力される。
電圧比較回路58は、直流再生回路50の出力信号のレベル
が、シェーディング補正回路54の出力信号のレベルより
も大きい場合に、レベル「0」の信号を出力する。この
ときに、シェーディング補正回路54は、充電動作を行な
うとともに、RAM62がそのデータ「0」を記憶する。Shading correction circuit 54, at the beginning of the line,
Outputs a ground level signal. That is, at the beginning of the line, the ground level signal is output by the reference voltage output from the timing circuit 42.
The voltage comparison circuit 58 outputs a signal of level “0” when the level of the output signal of the DC reproduction circuit 50 is higher than the level of the output signal of the shading correction circuit 54. At this time, the shading correction circuit 54 performs the charging operation, and the RAM 62 stores the data "0".
ここで、マルチプレクサ64は、ディレー回路60の出力信
号のレベルが「0」であるときに、RAM62の出力信号を
出力し、ディレー回路60の出力信号のレベルが「1」で
あるときに、電圧比較回路58の出力信号を出力するもの
である。なお、現在は、マルチプレクサ回路64は、電圧
比較回路58の出力信号が出力されている。以後、同様の
動作を行ない、RAM62は、全白のビデオ信号波形を再現
するデータを格納する。Here, the multiplexer 64 outputs the output signal of the RAM 62 when the level of the output signal of the delay circuit 60 is “0”, and outputs the voltage when the level of the output signal of the delay circuit 60 is “1”. The output signal of the comparison circuit 58 is output. Note that, at present, the multiplexer circuit 64 is outputting the output signal of the voltage comparison circuit 58. After that, the same operation is performed, and the RAM 62 stores the data that reproduces the all-white video signal waveform.
第3図は、プリスキャン時の直流再生波形と、RAM62に
記憶される波形とを示す図である。FIG. 3 is a diagram showing a DC reproduction waveform at the time of prescan and a waveform stored in the RAM 62.
第3図において、たとえば(ア)のポイントにおいて
は、直流再生回路50の出力信号(破線で示す信号)が、
シェーディング補正回路54の出力信号よりも大きいの
で、RAM62には、「0」のデータが記憶されるととも
に、マルチプレクサ64がレベル「0」の信号を出力する
ので、シェーディング補正回路54が充電動作を行なう。In FIG. 3, for example, at the point (a), the output signal of the DC regeneration circuit 50 (the signal indicated by the broken line) is
Since it is larger than the output signal of the shading correction circuit 54, the data of "0" is stored in the RAM 62 and the multiplexer 64 outputs the signal of level "0", so that the shading correction circuit 54 performs the charging operation. .
一方、たとえば(イ)のポイントにおいては、直流再生
回路50の出力信号が、シェーディング補正回路54の出力
信号よりも小さいので、RAM62はレベル「1」のデータ
を記憶されるとともに、マルチプレクサ回路64がレベル
「1」の信号を出力するので、シェーディング補正回路
54が放電動作を行なう。On the other hand, for example, at the point (a), since the output signal of the DC reproducing circuit 50 is smaller than the output signal of the shading correction circuit 54, the RAM 62 stores the data of level “1” and the multiplexer circuit 64 stores the data. Since the signal of level "1" is output, the shading correction circuit
54 discharges.
ここで、たとえば、A3原稿のビット数は、2592ビットで
あるので、そのうちのどの位置に対して「0」(すなわ
ち、充電動作を行なう)か、「1」(すなわち、放電動
作を行なう)かを、RAM62は記憶する必要がある。ビッ
ト数をカウントするアドレスデータは、タイミング回路
42が出力する。Here, for example, since the number of bits of the A3 original is 2592 bits, which position among them is “0” (that is, the charging operation is performed) or “1” (that is, the discharging operation is performed). However, the RAM 62 needs to be stored. Address data that counts the number of bits is the timing circuit
42 outputs.
次に、RAM62に蓄えられたデータを出力し、プリンスキ
ャンするときに記憶した全白信号波形の相似波形をシェ
ーディング補正回路54が出力する方法について述べる。
なお、ここでは、今読取っている画像のピーク値を考え
ているために、ピーク値は変動する。Next, a method of outputting the data stored in the RAM 62 and causing the shading correction circuit 54 to output a similar waveform of the all-white signal waveform stored at the time of the print scan will be described.
Note that here, since the peak value of the image currently being read is considered, the peak value changes.
まず、制御回路72がディレー回路60に対してレベル
「1」の信号を出力し、電気的シェーディングを行なう
モードにセットする。そして、ディレー回路60がレベル
「0」の信号を出力するために、マルチプレクサ回路64
は、RAM62の出力信号を出力する。そして、1ラインの
各ビットに対応し、データ「0」、データ「1」が出力
される。このときに、シェーディング補正回路54は、マ
ルチプレクサ回路64の出力信号に従って、充放電を行な
うので、シェーディング補正回路54は、プリスキャン時
に記憶した全白信号波形の相似波形を出力することが可
能になる。すなわち、電気的シェーディングが可能にな
る。First, the control circuit 72 outputs a signal of level "1" to the delay circuit 60 and sets the mode to perform electric shading. Then, in order for the delay circuit 60 to output the signal of level “0”, the multiplexer circuit 64
Outputs the output signal of the RAM 62. Then, data "0" and data "1" are output corresponding to each bit of one line. At this time, since the shading correction circuit 54 charges and discharges according to the output signal of the multiplexer circuit 64, the shading correction circuit 54 can output a waveform similar to the all-white signal waveform stored during the prescan. . That is, electrical shading is possible.
ここで、制御回路72からディレー回路60に向かう信号の
レベルが「0」の場合、電気的シェーディングは行なわ
れない。すなわち、この場合、充電動作のみを常に行な
う。Here, when the level of the signal from the control circuit 72 to the delay circuit 60 is "0", electrical shading is not performed. That is, in this case, only the charging operation is always performed.
なお、分圧回路56は、シェーディング補正回路54の出力
信号の6割程度の信号を出力し、この出力信号を、スラ
イスレベルとするものである。The voltage dividing circuit 56 outputs about 60% of the output signal of the shading correction circuit 54 and sets this output signal at the slice level.
電圧比較回路66は、直流再生回路50が出力する直流再生
後のビデオ信号波形と、分圧回路56が出力するスライス
レベルとを入力し、二値化を行なう回路である。直流再
生回路50の出力信号のレベルが、分圧回路56の信号レベ
ルよりも大きいとき、すなわち、白信号であるときに
は、電圧比較回路66はレベル「0」の信号を出力する。
逆に、直流再生回路50の出力信号のレベルが分圧回路56
の信号レベルよりも小さいとき、すなわち黒信号である
ときには、電圧比較回路66は、レベル「1」の信号を出
力する。The voltage comparison circuit 66 is a circuit for inputting the video signal waveform after the DC reproduction outputted by the DC reproduction circuit 50 and the slice level outputted by the voltage dividing circuit 56 to perform binarization. When the level of the output signal of the DC reproducing circuit 50 is higher than the signal level of the voltage dividing circuit 56, that is, when it is a white signal, the voltage comparison circuit 66 outputs a signal of level “0”.
On the contrary, the level of the output signal of the DC regeneration circuit 50 is
When the signal level is smaller than the signal level of, that is, when it is a black signal, the voltage comparison circuit 66 outputs a signal of level "1".
信号処理回路68は、電圧比較回路66が出力する二値化さ
れた信号に対して、各種の信号処理を行なう回路であ
る。The signal processing circuit 68 is a circuit that performs various kinds of signal processing on the binarized signal output from the voltage comparison circuit 66.
つまり、上記実施例は、ラインセンサによって原稿を読
み取り、シェーディング板によって機械的シェーディン
グを行い、基準濃度を有する基準白板を読み取って得ら
れたシェーディング補正データによって電気的シェーデ
ィングを行う画像読取装置において、上記基準白板を読
み取って得られたシェーディング補正データを記憶する
第1のメモリと、装置のAC電源がオフ状態からオン状態
へ移行したことを検出する手段と、装置のAC電源のオフ
状態からオン状態への移行を検出するとクリアされ、シ
ェーディング補正データを第1のメモリが記憶するとセ
ットされる第2のメモリと、ラインセンサで読み取った
画像データをシェーディング補正する補正手段とを有す
る画像読取装置である。That is, the above-described embodiment is an image reading apparatus that reads an original with a line sensor, performs mechanical shading with a shading plate, and performs electrical shading with shading correction data obtained by reading a reference white plate having a reference density. A first memory for storing the shading correction data obtained by reading the reference white plate, a means for detecting that the AC power supply of the apparatus has changed from the OFF state to the ON state, and an AC power supply of the apparatus from the OFF state to the ON state The image reading apparatus includes a second memory which is cleared when the shift to the (1) is detected and which is set when the first memory stores the shading correction data, and a correction unit which corrects the shading of the image data read by the line sensor. .
また、上記補正手段は、原稿の読取スタート時に原稿が
読取位置に存在せずしかも基準白板を読み取ることが可
能な場合は、機械的シェーディングと、基準白板を読み
取りこの読取ったシェーディング補正データによる電気
的シェーディングとを行い、基準白板を読み取ったシェ
ーディング補正データを第1のメモリに記憶し、一方、
原稿の読取スタート時に原稿が読取位置に存在ししかも
基準白板を読み取ることができず、また、第2のメモリ
の記憶内容によって、シェーディング補正データが第1
のメモリに記憶されていることが判定された場合は、機
械的シェーディングと、第1のメモリに記憶されている
シェーディング補正データによる電気的シェーディング
とを行い、さらに、原稿の読取スタート時に原稿が読取
位置に存在ししかも基準白板を読み取ることができず、
また、第2のメモリの記憶内容によって、シェーディン
グ補正データが第1のメモリに記憶されていないことが
判定された場合は、機械的シェーディングを行い、電気
的シェーディングを阻止する手段である。Further, when the original is not present at the reading position and the reference white plate can be read at the start of reading the original, the correction means reads mechanical shading and the reference white plate, and electrically reads the shading correction data. Shading is performed, and the shading correction data obtained by reading the reference white board is stored in the first memory.
At the start of reading the original, the original is present at the reading position, the reference white plate cannot be read, and the shading correction data is set to the first shading correction data depending on the stored contents of the second memory.
If it is determined that the original is read, the mechanical shading and the electric shading based on the shading correction data stored in the first memory are performed, and the original is read at the start of reading the original. Is present at the position, and the reference white plate cannot be read,
Further, when it is determined by the stored contents of the second memory that the shading correction data is not stored in the first memory, it is a means for performing mechanical shading and preventing electrical shading.
なお、制御回路72、シェーディング補正回路54は、上記
補正手段の例である。The control circuit 72 and the shading correction circuit 54 are examples of the correction means.
第4図は、制御回路72の制御動作を示すフローチャート
である。FIG. 4 is a flowchart showing the control operation of the control circuit 72.
まず、制御回路72は、スタンバイ電源で動作する。この
ために、上記フローチャートを開始するのは、メイン電
源およびスタンバイ電源がオフ状態になったときであ
る。First, the control circuit 72 operates with a standby power supply. For this reason, the flow chart is started when the main power supply and the standby power supply are turned off.
メイン電源、スタンバイ電源がオフ状態からオン状態に
なると、RAM62にはシェーディング補正を行なうデータ
が格納されていないので、SHDEND(シェーディングエン
ド)というフラグに「0」をセットする(S82)。そし
て、たとえばオペレーション部から、読取動作が選択さ
れると(S84)、原稿が存在するか否かが判断される(S
86)。When the main power supply and the standby power supply are turned from the off state to the on state, the data for performing the shading correction is not stored in the RAM 62, so "0" is set to the flag called SHDEND (shading end) (S82). Then, for example, when the reading operation is selected from the operation section (S84), it is determined whether or not a document exists (S84).
86).
原稿が存在しない場合、エラー処理(S88)を行なった
後に、S84に戻る。原稿がある場合は、ドキュメントエ
ッジセンサ28の上に原稿がセットされているか否かを判
断する(S90)。ドキュメントエッジセンサ28に原稿が
セットされていないときは、ドキュメントエッジセンサ
28まで原稿の頭出しを行ない(S92)、ドキュメントエ
ッジセンサ28まで頭出しが終了したときに、制御回路72
からシェーディング補正回路54に向かう信号のレベルを
「1」にセットし(NONSHD=0にセットし)、電気的シ
ェーディングを行なうモードにセットする。このときは
機械的シェーディングも行なう。If there is no document, error processing (S88) is performed, and then the process returns to S84. If there is a document, it is determined whether the document is set on the document edge sensor 28 (S90). If no document is set on the document edge sensor 28,
The document is cued up to 28 (S92), and when the cued up to the document edge sensor 28 is finished, the control circuit 72
Then, the level of the signal from the shading correction circuit 54 to the shading correction circuit 54 is set to "1" (NONSHD = 0), and the mode is set to the electrical shading. At this time, mechanical shading is also performed.
そして、リレー回路60にプリスキャンパルスを送りプリ
スキャンを行なう。なお、蛍光灯の予熱は、所定時間行
ない、その後、蛍光灯を点灯してから、所定時間経過し
た後に、プリスキャンを行なうのは勿論である。Then, a prescan pulse is sent to the relay circuit 60 to perform prescan. It is needless to say that the fluorescent lamp is preheated for a predetermined time, and after that, the fluorescent lamp is turned on and a predetermined time has elapsed, and then the prescan is performed.
また、プリスキャン動作を行なった後に、SHDENDフラグ
を「1」にセットし、読取動作の完了を待つ(S100)。
その読取動作が完了すると、S84に戻る。After performing the prescan operation, the SHDEND flag is set to "1" and the completion of the reading operation is waited (S100).
When the reading operation is completed, the process returns to S84.
ドキュメントエッジセンサ28に原稿がセットされている
ときは(S90)、プリスキャンを行なわず、SHDENDフラ
グが「0」であるとき(すなわち、RAM62にシェーディ
ング補正を行なうデータが格納されていないとき)は
(S102)、SHDENDフラグを「1」にセットする。逆に、
シェーディング補正を行なうデータが、RAM62に格納さ
れているときは、SHDENDフラグを「0」にセットする。When the document is set on the document edge sensor 28 (S90), the prescan is not performed, and the SHDEND flag is "0" (that is, when the data for performing the shading correction is not stored in the RAM 62). (S102), SHDEND flag is set to "1". vice versa,
When the data for shading correction is stored in the RAM 62, the SHDEND flag is set to "0".
S104において、制御回路72からリレー回路60に向かう信
号としてレベル「0」のみを出力し(NONSHD=1にセッ
トし)、電気的シェーディングは行なわず、機械的シェ
ーディングのみを行なう。In S104, only level "0" is output as a signal from control circuit 72 to relay circuit 60 (NONSHD = 1 is set), and electrical shading is not performed, but only mechanical shading is performed.
また、S106においては、制御回路72からリレー回路60に
向かう信号として、レベル「1」のみを出力し(NONSHD
=0にセットし)、電気的シェーディングおよび機械的
シェーディングを行なう。Further, in S106, only the level "1" is output as a signal from the control circuit 72 to the relay circuit 60 (NONSHD
= 0) and perform electrical and mechanical shading.
上記実施例において、原稿が読取位置を越えて挿入され
る非常に稀なケース(上記実施例においては、それに加
えて、メイン電源がオフ状態からオン状態となる動作が
行なわれるという条件も加わる)のために、ROMまたは
バッテリバックアップ回路を有するという必要性を排除
したので、画像読取装置が経済的なものとなる。In the above-described embodiment, a very rare case in which a document is inserted beyond the reading position (in the above-described embodiment, the condition that the operation of changing the main power supply from the off state to the on state is performed is also added) This eliminates the need to have a ROM or battery backup circuit, making the image reading device economical.
なお、機械的シェーディングのみで画像の読取を行なっ
たとしても、常温であれば満足できる画像を得ることが
できる。Even if the image is read only by mechanical shading, a satisfactory image can be obtained at room temperature.
上記実施例においては、シェーディング波形を記憶する
RAM62を、スタンバイ電源で記憶可能としたが、そのRAM
62をメイン電源でのみ記憶可能とするようにしてもよ
い。In the above embodiment, the shading waveform is stored.
RAM62 can be stored with standby power, but that RAM
The memory 62 may be stored only by the main power supply.
[発明の効果] 本発明によれば、原稿の読取スタート時に原稿が読取位
置に有りしかも基準白板を読み取ることができず、ま
た、基準白板を読み取ったデータがメモリに記憶されて
いる場合は、機械的シェーディングと、メモリに記憶さ
れているデータによる電気的シェーディングとを行うの
で、原稿が通常の読取位置を越えて深く挿入された状態
で読取開始したときに、原稿の読み取り直前に基準白板
を読み取ることができないことによってシェーディング
補正ができなくなる不都合を解消することができるとい
う効果を奏する。EFFECTS OF THE INVENTION According to the present invention, when the original is at the reading position at the start of reading the original and the reference white plate cannot be read, and the data obtained by reading the reference white plate is stored in the memory, Since mechanical shading and electrical shading based on the data stored in the memory are performed, when the document starts to be read deeply inserted beyond the normal reading position, the reference white plate is read immediately before reading the document. This has the effect of eliminating the inconvenience of being unable to perform shading correction due to the inability to read.
また、本発明によれば、原稿の読取スタート時に原稿が
読取位置に有りしかも基準白板を読み取ることができ
ず、また、基準白板を読み取ったデータがメモリに記憶
されていない場合は、機械的シェーディングを行い、電
気的シェーディングを行わないので、原稿を途中から読
み取るという稀なケースのみのためにシェーディング補
正用のデータを記憶する専用のメモリを設けることによ
るコストアップを招く不都合を解消することができ、さ
らには、その専用のメモリを実装するためのスペースを
回路基板上に確保することによって経済効率が悪くなる
不都合を解消することができるという効果を奏する。Further, according to the present invention, when the original is at the reading position at the start of reading the original and the reference white plate cannot be read, and the data obtained by reading the reference white plate is not stored in the memory, mechanical shading is performed. Since electrical shading is not performed, it is possible to eliminate the inconvenience of increasing costs due to the provision of a dedicated memory for storing data for shading correction only in the rare case of reading an original from the middle. Further, by securing a space for mounting the dedicated memory on the circuit board, it is possible to solve the problem that economic efficiency is deteriorated.
さらに、本発明によれば、装置のAC電源がオフ状態から
オン状態へ移行したことを検出する手段と、装置のAC電
源のオフ状態からオン状態への移行を検出するとクリア
され、シェーディング補正データを第1のメモリが記憶
するとセットされる第2のメモリとを設けたので、AC電
源がオフ状態からオン状態へ移行したことを確実に検出
でき、また、シェーディング補正データを第1のメモリ
が記憶していることを確実に検出することができ、シェ
ーディング補正動作が確実になるという効果を奏する。Furthermore, according to the present invention, means for detecting that the AC power supply of the apparatus has changed from the OFF state to the ON state, and clearing when detecting the change of the AC power supply of the apparatus from the OFF state to the ON state, the shading correction data. Since the second memory that is set when the first memory stores is provided, it can be surely detected that the AC power supply has changed from the off state to the on state, and the shading correction data can be stored in the first memory. The effect that the stored information can be surely detected and the shading correction operation becomes reliable is achieved.
第1図は、本発明の一実施例の説明図である。 第2図は、上記実施例を示すブロック図である。 第3図は、上記実施例において、プリスキャン時の直流
再生波形とRAMに記憶される波形とを示す図である。 第4図は、上記実施例の動作を示すフローチャートであ
る。 第5図は、機械的にシェーディングを行なうときに使用
するシェーディング板の一般的なものを示す図である。 第6図は、従来例において、ビデオ信号波形とスライス
レベルとの関係を示す図である。 第7図は、上記従来例における原稿と読取位置との位置
関係を示す図である。 22……基準白板、24……原稿、36……CCD、32……シェ
ーディング板、54……シェーディング補正回路、56……
分圧回路、72……制御回路。FIG. 1 is an explanatory diagram of an embodiment of the present invention. FIG. 2 is a block diagram showing the above embodiment. FIG. 3 is a diagram showing a DC reproduction waveform at the time of prescan and a waveform stored in the RAM in the above embodiment. FIG. 4 is a flow chart showing the operation of the above embodiment. FIG. 5 is a view showing a general shading plate used when performing mechanical shading. FIG. 6 is a diagram showing a relationship between a video signal waveform and a slice level in the conventional example. FIG. 7 is a diagram showing a positional relationship between a document and a reading position in the above conventional example. 22 …… Standard white board, 24 …… Original, 36 …… CCD, 32 …… Shading board, 54 …… Shading correction circuit, 56 ……
Voltage dividing circuit, 72 ... Control circuit.
Claims (1)
ェーディング板によって機械的シェーディングを行い、
基準濃度を有する基準白板を読み取って得られたシェー
ディング補正データによって電気的シェーディングを行
う画像読取装置において、 上記基準白板を読み取って得られたシェーディング補正
データを記憶する第1のメモリと; 装置のAC電源がオフ状態からオン状態へ移行したことを
検出する手段と; 装置のAC電源のオフ状態からオン状態への移行を検出す
るとクリアされ、上記シェーディング補正データを上記
第1のメモリが記憶するとセットされる第2のメモリ
と; 上記ラインセンサで読み取った画像データをシェーディ
ング補正する補正手段と; を有し、上記補正手段は、 上記原稿の読取スタート時に上記原稿が読取位置に存在
せずしかも上記基準白板を読み取ることが可能な場合
は、上記機械的シェーディングと、上記基準白板を読み
取りこの読取った上記シェーディング補正データによる
上記電気的シェーディングとを行い、上記基準白板を読
み取った上記シェーディング補正データを上記第1のメ
モリに記憶し、 一方、上記原稿の読取スタート時に上記原稿が読取位置
に存在ししかも上記基準白板を読み取ることができず、
また、上記第2のメモリの記憶内容によって、上記シェ
ーディング補正データが上記第1のメモリに記憶されて
いることが判定された場合は、上記機械的シェーディン
グと、上記第1のメモリに記憶されている上記シェーデ
ィング補正データによる上記電気的シェーディングとを
行い、 さらに、上記原稿の読取スタート時に上記原稿が読取位
置に存在ししかも上記基準白板を読み取ることができ
ず、また、上記第2のメモリの記憶内容によって、上記
シェーディング補正データが上記第1のメモリに記憶さ
れていないことが判定された場合は、上記機械的シェー
ディングを行い、上記電気的シェーディングを阻止する
ものであることを特徴とする画像読取装置。1. A document is read by a line sensor, and mechanical shading is performed by a shading plate,
In an image reading device that performs electric shading by shading correction data obtained by reading a reference white plate having a reference density, a first memory for storing the shading correction data obtained by reading the reference white plate; A means for detecting the transition of the power supply from the off state to the on state; cleared when the transition of the AC power supply of the apparatus from the off state to the on state is detected, and set when the shading correction data is stored in the first memory A second memory; and a correction unit for shading-correcting the image data read by the line sensor, wherein the correction unit does not exist at the reading position at the start of reading the document, and If the reference white plate can be read, the above mechanical shading and the above reference white plate The shading correction data obtained by reading the reference white plate is stored in the first memory, and the original document is read at the start of reading the original document. In addition, it is not possible to read the reference white plate,
Further, when it is determined that the shading correction data is stored in the first memory based on the stored content of the second memory, the mechanical shading and the first shading data are stored in the first memory. The electric shading is performed by the shading correction data, and the original is present at the reading position when the reading of the original is started, and the reference white plate cannot be read, and the storage of the second memory is performed. If it is determined that the shading correction data is not stored in the first memory, the mechanical shading is performed to prevent the electrical shading. apparatus.
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|---|---|---|---|
| JP61016509A JPH0720195B2 (en) | 1986-01-28 | 1986-01-28 | Image reader |
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| JPS62175067A JPS62175067A (en) | 1987-07-31 |
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