JPH0758940B2 - マルチパスフェージングシミュレータ - Google Patents
マルチパスフェージングシミュレータInfo
- Publication number
- JPH0758940B2 JPH0758940B2 JP2242762A JP24276290A JPH0758940B2 JP H0758940 B2 JPH0758940 B2 JP H0758940B2 JP 2242762 A JP2242762 A JP 2242762A JP 24276290 A JP24276290 A JP 24276290A JP H0758940 B2 JPH0758940 B2 JP H0758940B2
- Authority
- JP
- Japan
- Prior art keywords
- fading
- circuit
- multipath fading
- fading simulator
- multipath
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Mobile Radio Communication Systems (AREA)
- Monitoring And Testing Of Transmission In General (AREA)
Description
【発明の詳細な説明】 〔発明の目的〕 （産業上の利用分野） この発明は、移動信号における伝送路で発生するマルチ
パスフェージングを室内で擬似的に発生させるマルチパ
スフェージングシミュレータに関するものである。
パスフェージングを室内で擬似的に発生させるマルチパ
スフェージングシミュレータに関するものである。
（従来の技術） 従来、移動無線通信において信号伝送を行うと、マルチ
パス伝搬のために受信波のレベルが大きく変動し、伝送
特性が大きく劣化する。伝送特性を室内で効率的に検討
するために、フェージングシミュレータが用いられる。
パス伝搬のために受信波のレベルが大きく変動し、伝送
特性が大きく劣化する。伝送特性を室内で効率的に検討
するために、フェージングシミュレータが用いられる。
フェージングシミュレータは、入力波ｓ（ｔ）が、 ｓ（ｔ）＝s1cos（ωct）−s2sin（ωct） …… のように表されるとすると、出力波ｒ（ｔ）は、 ｒ（ｔ）＝a1（ｔ）s1cos（ωct） −a2（ｔ）s2sin（ωct） …… のように変換されている。ただし、s1、s2は信号の同相
成分および直交成分の振幅、ωｃ搬送波周波数である。
また、a1（ｔ）とa2（ｔ）はフェージング複素包絡線信
号２（ｔ）の実部と虚部であり、ここでa1（ｔ）とa
2（ｔ）は通常、平均値が０のガウス分布をしている。
このようなガウス分布をしている信号は、周期が非常に
長いPN（ピンクノイズ）信号発生器の出力PN信号に対し
て、帯域幅がPN信号のクロック周波数に比較して充分小
さいローパスフィルタで帯域制限することにより得られ
る。すなわち、２つのPN信号発生回路で２系列のPN信号
を生成し、これらのPN信号を白色雑音とみなして、ロー
パスフィルタでスペクトル整形し、フェージング複素包
絡線のa1（ｔ）とa2（ｔ）を発生させている。
成分および直交成分の振幅、ωｃ搬送波周波数である。
また、a1（ｔ）とa2（ｔ）はフェージング複素包絡線信
号２（ｔ）の実部と虚部であり、ここでa1（ｔ）とa
2（ｔ）は通常、平均値が０のガウス分布をしている。
このようなガウス分布をしている信号は、周期が非常に
長いPN（ピンクノイズ）信号発生器の出力PN信号に対し
て、帯域幅がPN信号のクロック周波数に比較して充分小
さいローパスフィルタで帯域制限することにより得られ
る。すなわち、２つのPN信号発生回路で２系列のPN信号
を生成し、これらのPN信号を白色雑音とみなして、ロー
パスフィルタでスペクトル整形し、フェージング複素包
絡線のa1（ｔ）とa2（ｔ）を発生させている。
ところで、信号のシンボル間隔に比べてマルチパス伝搬
による遅延時間が大きくなると、実際の伝搬路では上述
のような受信波のレベル変動だけでなく、伝搬路の周波
数特性が問題になる。このような伝搬路は、上述のフェ
ージングシミュレータでは近似することができない。第
２図は、周波数特性を持った伝搬路をシミュレートする
マルチパスフェージングシミュレータの構成を示したも
のである。
による遅延時間が大きくなると、実際の伝搬路では上述
のような受信波のレベル変動だけでなく、伝搬路の周波
数特性が問題になる。このような伝搬路は、上述のフェ
ージングシミュレータでは近似することができない。第
２図は、周波数特性を持った伝搬路をシミュレートする
マルチパスフェージングシミュレータの構成を示したも
のである。
このマルチパスフェージングシミュレータでは、変調信
号が入力端子30を介して電力分配回路31に供給され、こ
の電力分配回路31によって５波に分けられている。この
５波のうち、１波は直交変調器32に直接供給され、残り
の４波はそれぞれ遅延時間の異なる遅延回路33を通した
後に直交変調器32に供給される。５波に分けられた信号
は直交変調器32において、５つの独立した２次元ガウス
雑音発生回路34が発生した信号で変調され、合成回路35
で合成されて出力端子36より出力される。この例では、
遅延時間の異なる５つの波、すなわち５つのパスを発生
させることができる。
号が入力端子30を介して電力分配回路31に供給され、こ
の電力分配回路31によって５波に分けられている。この
５波のうち、１波は直交変調器32に直接供給され、残り
の４波はそれぞれ遅延時間の異なる遅延回路33を通した
後に直交変調器32に供給される。５波に分けられた信号
は直交変調器32において、５つの独立した２次元ガウス
雑音発生回路34が発生した信号で変調され、合成回路35
で合成されて出力端子36より出力される。この例では、
遅延時間の異なる５つの波、すなわち５つのパスを発生
させることができる。
第３図は、ダイバーシチ受信用のフェージングシミュレ
ータの構成を示したものである。この例は、２ブランチ
のダイバーシチをシミュレートするものであり、電力分
配回路40で２つに分けられた信号を２つのフェージング
シミュレータ41,42にそれぞれ入力している。２つのフ
ェージングシミュレータ41,42の構成は第２図のマルチ
パスフェージングシミュレータの構成と同じであるの
で、同じ構成部材には第２図と同じ符号を付してその説
明を省略する。なお、一般に複数ブランチのマルチパス
フェージングシミュレータでは、対応するパスの遅延時
間は等しいものとする。
ータの構成を示したものである。この例は、２ブランチ
のダイバーシチをシミュレートするものであり、電力分
配回路40で２つに分けられた信号を２つのフェージング
シミュレータ41,42にそれぞれ入力している。２つのフ
ェージングシミュレータ41,42の構成は第２図のマルチ
パスフェージングシミュレータの構成と同じであるの
で、同じ構成部材には第２図と同じ符号を付してその説
明を省略する。なお、一般に複数ブランチのマルチパス
フェージングシミュレータでは、対応するパスの遅延時
間は等しいものとする。
（発明が解決しようとする課題） ところが、第２図に示す従来のマルチパスフェージング
シミュレータでは、遅延回路33として一般にSAW（表面
弾性波）フィルタが用いられるが、SAWフィルタはその
原理から遅延時間を大きくすると信号の通過帯域が狭く
なるという特性を持っている。従って、SAWフィルタを
遅延素子として用いる従来のマルチパスフェージングシ
ミュレータでは、入力変調波の搬送波周波数の範囲を十
分に大きくできないという欠点があった。
シミュレータでは、遅延回路33として一般にSAW（表面
弾性波）フィルタが用いられるが、SAWフィルタはその
原理から遅延時間を大きくすると信号の通過帯域が狭く
なるという特性を持っている。従って、SAWフィルタを
遅延素子として用いる従来のマルチパスフェージングシ
ミュレータでは、入力変調波の搬送波周波数の範囲を十
分に大きくできないという欠点があった。
また、第３図に示す従来のダイバーシチ用マルチパスフ
ェージングシミュレータでは、同じ遅延時間に設定され
た２つのブランチ（フェージングシミュレータ41,42）
間の２次元ガウス雑音に相関を与えられないという欠点
がある。
ェージングシミュレータでは、同じ遅延時間に設定され
た２つのブランチ（フェージングシミュレータ41,42）
間の２次元ガウス雑音に相関を与えられないという欠点
がある。
この発明は上記従来技術の欠点を解消することを課題と
し、その目的とするところは、ダイバーシチ受信のシミ
ュレーションを行う場合に必要となる、ブランチ間の相
関を遅延時間が同一のパスのみに限定することにより非
常に簡単な回路構成で実現できるマルチパスフェージン
グシミュレータを提供することにある。
し、その目的とするところは、ダイバーシチ受信のシミ
ュレーションを行う場合に必要となる、ブランチ間の相
関を遅延時間が同一のパスのみに限定することにより非
常に簡単な回路構成で実現できるマルチパスフェージン
グシミュレータを提供することにある。
（課題を解決するための手段） 上記目的を達成するこの発明のマルチパスフェージング
シミュレータは、複数ブランチのマルチパスフェージン
グ発生回路と、各マルチパスフェージング発生回路の遅
延プロファイルを同一に設定し、かつ同一遅延時間のパ
スにおけるフェージング複素包絡線信号の間にのみ定め
られた相関を入れるマルチパス制御回路とを有すること
を特徴としている。
シミュレータは、複数ブランチのマルチパスフェージン
グ発生回路と、各マルチパスフェージング発生回路の遅
延プロファイルを同一に設定し、かつ同一遅延時間のパ
スにおけるフェージング複素包絡線信号の間にのみ定め
られた相関を入れるマルチパス制御回路とを有すること
を特徴としている。
（作用） この発明のマルチパスフェージングシミュレータによれ
ば、複数ブランチのマルチパスフェージング発生回路の
各回路の遅延プロファイルが同一に設定され、かつ同一
遅延時間のパスにおけるフェージング複素包絡線信号の
間にのみ定められた相関が入れられる。
ば、複数ブランチのマルチパスフェージング発生回路の
各回路の遅延プロファイルが同一に設定され、かつ同一
遅延時間のパスにおけるフェージング複素包絡線信号の
間にのみ定められた相関が入れられる。
（実施例） 以下、この発明を実施例により図面を参照しつつ詳細に
説明する。
説明する。
本発明の一実施例を第１図に示すが、第１図は、ダイバ
ーシチ受信用のフェージングシミュレータの構成を示し
たものである。この例は、２ブランチのダイバーシチを
シミュレートするものであり、電力分配回路40で２つに
分けられた信号を２つのフェージングシミュレータ41,4
2にそれぞれ入力している。２つのフェージングシミュ
レータ41,42の構成は、２次元ガウス雑音発生回路34の
構成を除いて第２図のマルチパスフェージングシミュレ
ータの構成と同じであるので、同じ構成部材には第２図
と同じ符号を付してその説明を省略する。この実施例で
は２つのフェージングシミュレータ41,42の対応する直
交変調器32には、フェージングシミュレータ41,42の外
部に設けられた相関付加回路21を介して独立した２次元
ガウス雑音発生回路22が発生した信号で変調される。
ーシチ受信用のフェージングシミュレータの構成を示し
たものである。この例は、２ブランチのダイバーシチを
シミュレートするものであり、電力分配回路40で２つに
分けられた信号を２つのフェージングシミュレータ41,4
2にそれぞれ入力している。２つのフェージングシミュ
レータ41,42の構成は、２次元ガウス雑音発生回路34の
構成を除いて第２図のマルチパスフェージングシミュレ
ータの構成と同じであるので、同じ構成部材には第２図
と同じ符号を付してその説明を省略する。この実施例で
は２つのフェージングシミュレータ41,42の対応する直
交変調器32には、フェージングシミュレータ41,42の外
部に設けられた相関付加回路21を介して独立した２次元
ガウス雑音発生回路22が発生した信号で変調される。
一般に複数ブランチのマルチパスフェージングシミュレ
ータでは、対応するパスの遅延時間は等しいので、遅延
プロファイルの遅延時間が一致するパスを選択する。こ
こでは、ブランチ１のＭ番目のパスP1Mとブランチ２の
Ｎ番目のパスP2Nが同じ遅延時間であるとする。P1MとP
2Nのフェージング複素包絡線Z1MとZ2Nは、次式で表され
る回路を形成して発生させることができる。
ータでは、対応するパスの遅延時間は等しいので、遅延
プロファイルの遅延時間が一致するパスを選択する。こ
こでは、ブランチ１のＭ番目のパスP1Mとブランチ２の
Ｎ番目のパスP2Nが同じ遅延時間であるとする。P1MとP
2Nのフェージング複素包絡線Z1MとZ2Nは、次式で表され
る回路を形成して発生させることができる。
ただし、X1MとX2NはPN信号発生器とローパスフィルタを
接続することにより得られる互いに独立な複素ガウス信
号である。このとき、 ＜|X1M|2＞＝＜|X2N|2＞＝σ２ とすると、 ＜|Z1M|2＞＝＜|Z2N|2＞＝σ２ ＜Z1MZ＊ 2N＞＝ρσ２ となり、複素ガウス信号Z1MとZ2Nの間にρの相関を有す
る信号が得られる。
接続することにより得られる互いに独立な複素ガウス信
号である。このとき、 ＜|X1M|2＞＝＜|X2N|2＞＝σ２ とすると、 ＜|Z1M|2＞＝＜|Z2N|2＞＝σ２ ＜Z1MZ＊ 2N＞＝ρσ２ となり、複素ガウス信号Z1MとZ2Nの間にρの相関を有す
る信号が得られる。
このように、遅延時間が同一のパスのみに相関を入れる
ことにより、相関を有する信号を得ることができ、全て
の相関を入れる場合に比べて装置規模を非常に小さくで
きる。
ことにより、相関を有する信号を得ることができ、全て
の相関を入れる場合に比べて装置規模を非常に小さくで
きる。
この発明によれば、ダイバーシチ受信のシミュレーショ
ンを行う場合に必要となる、ブランチ間の相関を遅延時
間が同一のパスのみに限定することにより非常に簡単な
回路構成で実現できるという効果がある。
ンを行う場合に必要となる、ブランチ間の相関を遅延時
間が同一のパスのみに限定することにより非常に簡単な
回路構成で実現できるという効果がある。
第１図は本発明の一実施例に係るブランチ間に相関を付
加できる２ブランチ形マルチパスフェージングシミュレ
ータの構成図、 第２図は従来のマルチパスフェージングシミュレータの
構成図、 第３図は従来の２ブランチ形マルチパスフェージングシ
ミュレータの構成図である。 11……入力端子 12……ミキサ、 13……バンドパスフィルタ、 14……周波数変換回路、 15……マルチパスフェージングシミュレータ、 16……ミキサ、 17……出力端子、 18……可変周波数発振器、 19……制御回路、 20……表示回路、 21……相関付加回路、 22,34……２次元ガウス雑音発生回路、 31,40……電力分配回路、 32……直交変調器、 33……遅延回路、 35……合成回路。
加できる２ブランチ形マルチパスフェージングシミュレ
ータの構成図、 第２図は従来のマルチパスフェージングシミュレータの
構成図、 第３図は従来の２ブランチ形マルチパスフェージングシ
ミュレータの構成図である。 11……入力端子 12……ミキサ、 13……バンドパスフィルタ、 14……周波数変換回路、 15……マルチパスフェージングシミュレータ、 16……ミキサ、 17……出力端子、 18……可変周波数発振器、 19……制御回路、 20……表示回路、 21……相関付加回路、 22,34……２次元ガウス雑音発生回路、 31,40……電力分配回路、 32……直交変調器、 33……遅延回路、 35……合成回路。
Claims (1)
- 【請求項１】複数ブランチのマルチパスフェージング発
生回路と、各マルチパスフェージング発生回路の遅延プ
ロファイルを同一に設定し、かつ同一遅延時間のパスに
おけるフェージング複素包絡線信号の間にのみ定められ
た相関を入れるマルチパス制御回路とを有することを特
徴とするマルチパスフェージングシミュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2242762A JPH0758940B2 (ja) | 1990-09-14 | 1990-09-14 | マルチパスフェージングシミュレータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2242762A JPH0758940B2 (ja) | 1990-09-14 | 1990-09-14 | マルチパスフェージングシミュレータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04123537A JPH04123537A (ja) | 1992-04-23 |
| JPH0758940B2 true JPH0758940B2 (ja) | 1995-06-21 |
Family
ID=17093897
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2242762A Expired - Lifetime JPH0758940B2 (ja) | 1990-09-14 | 1990-09-14 | マルチパスフェージングシミュレータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0758940B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8285227B2 (en) | 2008-12-31 | 2012-10-09 | Elektrobit System Test Oy | Communication between transmitter and receiver |
| JP6077476B2 (ja) * | 2014-02-05 | 2017-02-08 | 日本電信電話株式会社 | 光デバイスシミュレーション方法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01135841U (ja) * | 1988-03-09 | 1989-09-18 |
-
1990
- 1990-09-14 JP JP2242762A patent/JPH0758940B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04123537A (ja) | 1992-04-23 |
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