JPH0762798B2 - Keyboard information processing device for electronic musical instruments - Google Patents
Keyboard information processing device for electronic musical instrumentsInfo
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- JPH0762798B2 JPH0762798B2 JP6122062A JP12206294A JPH0762798B2 JP H0762798 B2 JPH0762798 B2 JP H0762798B2 JP 6122062 A JP6122062 A JP 6122062A JP 12206294 A JP12206294 A JP 12206294A JP H0762798 B2 JPH0762798 B2 JP H0762798B2
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- read
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Description
【0001】[0001]
【産業上の利用分野】本発明は電子楽器の鍵盤スイッチ
のオンオフ状態を検知してキースイッチ信号に対するチ
ャンネルの割り当てまたは消去を行なう電子楽器の鍵盤
情報処理装置に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a keyboard information processing apparatus for an electronic musical instrument, which detects the on / off state of a keyboard switch of the electronic musical instrument and assigns or deletes a channel for a key switch signal.
【0002】[0002]
【従来の技術】従来、電子楽器の鍵盤回路は近年デジタ
ル技術により改良されてキースイッチを時分割走査して
キースイッチのオンオフ状態を“1”、“0”の時分割
キー信号として取り出し、該信号によりオン状態のキー
スイッチに対してチャンネルを割り当てる方法が提案さ
れている。さらにキースイッチをいくつかのブロックに
分け、各ブロック毎に時分割走査してオン状態のキース
イッチを検出してチャンネルを割り当てる方法が提案さ
れている。2. Description of the Related Art Conventionally, a keyboard circuit of an electronic musical instrument has been improved by digital technology in recent years, and time-division scanning of a key switch is performed to extract the on / off state of the key switch as a time-division key signal of "1" and "0". A method of allocating a channel to a key switch in an ON state by a signal has been proposed. Further, a method has been proposed in which the key switch is divided into several blocks, and each block is time-divisionally scanned to detect the on-state key switch and assign a channel.
【0003】しかし、これら従来の方法はいずれもキー
スイッチ走査回路が必要であり、また、従来例のうち後
者のキースイッチをブロックに分ける方法は走査時間の
短縮のため改良されたものであるが、その制御用の論理
回路が複雑となり調整もかなり面倒である。また自動演
奏などのキー情報検出を行なわせようとすると極めて複
雑となる。さらに鍵数やチャンネル数を拡張したい場
合、または各種機能を変更したい場合、鍵盤情報処理装
置の構成は拡張分または変更分に対応して大形化、複雑
化し高価格となるのを免れなかった。However, all of these conventional methods require a key switch scanning circuit, and the latter method of dividing the key switch into blocks is improved in order to shorten the scanning time. , The control logic circuit is complicated and the adjustment is quite troublesome. In addition, it is extremely complicated to perform key information detection such as automatic performance. If you want to expand the number of keys or channels, or change various functions, the configuration of the keyboard information processing device has to be large, complicated, and expensive due to the expansion or change. .
【0004】[0004]
【発明が解決しようとする課題】本発明は上述の欠点を
改善するもので、その目的はキースイッチ走査回路を用
いることなく簡単な構成を有しかつ拡張、変更の自由度
の高い電子楽器の鍵盤情報処理装置を提供することであ
る。SUMMARY OF THE INVENTION The present invention is intended to improve the above-mentioned drawbacks, and an object of the present invention is to provide an electronic musical instrument having a simple structure without using a key switch scanning circuit and having a high degree of freedom of expansion and modification. It is to provide a keyboard information processing device.
【0005】[0005]
【課題を解決するための手段】前記目的を達成するた
め、本発明の電子楽器の鍵盤情報処理装置は、(A)複数のキーブロックから成り、各キーブロックは
複数のキースイッチから 構成され、そして各キーブロッ
クにはアドレスが割り当てられたキースイッチ手段と、 (B)アドレス指定手段と、 (C)キー情報を各キーブロック毎に一時記憶する一時
記憶手段と、 (D)チャンネルの割当て情報を記憶するチャンネルレ
ジスタ手段と、 (E)処理プログラムが記憶された記憶手段と、 (F)CPU、 とを有し、 前記CPUは、前記記憶手段に記憶された処
理プログラムに従って、 (a)前記アドレス指定手段に読出し命令を出力するこ
とにより、該アドレス指定手段によってアドレス指定さ
れた前記キースイッチ手段の所定のキーブロックにおけ
る各キースイッチのオン又はオフ状態を示すキー情報を
読み出し、 (b)該読み出されたキー情報と、該読み出されたキー
情報に対応し且つ前記一時記憶手段中に既に一時記憶さ
れている旧キー情報と比較し、 (c)該比較結果が一致すれば、前記アドレス指定手段
に読出し命令を出力することにより前記キースイッチ手
段の次のキーブロックからキー情報を読み出す処理に移
り、 (d)前記比較結果が一致しなければ、オン又はオフ状
態が変化したキースイッチに対応してそのキー情報の前
記チャンネルレジスタ手段への割当て又は消去を行い、
前記読み出されたキー情報を前記一時記憶手段に旧キー
情報として記憶した後、前記アドレス指定手段に読出し
命令を出力することにより前記キースイッチ手段の次の
キーブロックからキー情報を読み出す処理に移ることを
特徴とする。 In order to achieve the above object, a keyboard information processing apparatus for an electronic musical instrument of the present invention comprises (A) a plurality of key blocks, each key block being
It consists of multiple key switches , and each key block
Key switch means to which an address is assigned, (B) address designating means, and (C) temporary storage for temporarily storing key information for each key block.
Storage means and (D) a channel register for storing channel allocation information.
A register means, (E) a storage means in which a processing program is stored, and (F) a CPU , wherein the CPU is a processing means stored in the storage means.
According to a logical program, (a) outputting a read command to the addressing means.
And are addressed by the addressing means.
The specified key block of the key switch means
Key information indicating the on or off state of each key switch
Read, (b) the read key information and the read key
Corresponding to the information and already stored in the temporary storage means.
Compared with old key information that, if a match is (c) the comparison result, said addressing means
By outputting a read command to the key switch hand
Move to the process to read the key information from the next key block in the row.
Ri, if match; (d) the comparison result, on or off like
Corresponding to the key switch whose state has changed
Assign or delete to the channel register means,
The read key information is stored in the temporary storage means as an old key.
After storing as information, read out to the addressing means
By outputting a command, the next
Move to the process of reading the key information from the key block.
Characterize.
【0006】[0006]
【実施例】以下本発明を実施例につき詳述する。EXAMPLES The present invention will be described in detail below with reference to examples.
【0007】図1は本発明の実施例の構成を示す概略説
明図である。FIG. 1 is a schematic explanatory view showing the structure of an embodiment of the present invention.
【0008】同図において、キースイッチ回路1は複数
のキースイッチより成るキーブロックを複数個含み、キ
ーブロック毎のキーのオンオフ情報はアドレス指定回路
2により一括してアドレス指定され、そのアドレス指定
信号に同期してキーブロック情報がゲート回路3を介し
て共通バス7に送出される。In FIG. 1, a key switch circuit 1 includes a plurality of key blocks each composed of a plurality of key switches, and key ON / OFF information for each key block is collectively addressed by an addressing circuit 2. The key block information is transmitted to the common bus 7 via the gate circuit 3 in synchronization with the.
【0009】これらのキーブロック情報を共通バス7よ
り記憶回路5のランダムアクセスメモリ(RAM)領域
に記憶させ、さらにその固定メモリ(ROM)領域に記
憶されたプログラムを読み出し共通バスを通して情報処
理部(CPU)4を動作させる。すなわち、CPU4に
共通バス7を介しキースイッチ回路1からの新しいブロ
ック情報を取り入れ、そして記憶回路5のRAM領域に
書き込まれている旧いキーブロック情報とを比較してキ
ー状態に変化のあったキー信号に対し必要に応じてチャ
ンネル割り当てまたは消去を行なう。そして各チャンネ
ルに対応するチャンネルレジスタ6に新しいキーデータ
を書き込む。以上の場合、ゲート回路3のほか記憶回路
5およびチャンネルレジスタ6はそれぞれアドレスが割
り当てられていて、アドレス指定回路2により指定され
る。The key block information is stored in the random access memory (RAM) area of the storage circuit 5 from the common bus 7, the program stored in the fixed memory (ROM) area is read out, and the information processing unit (via the common bus). CPU) 4 is operated. That is, the new block information from the key switch circuit 1 is taken into the CPU 4 via the common bus 7, and compared with the old key block information written in the RAM area of the memory circuit 5, the key whose key state has changed Channels are assigned to or deleted from the signals as needed. Then, new key data is written in the channel register 6 corresponding to each channel. In the above case, addresses are assigned to the memory circuit 5 and the channel register 6 in addition to the gate circuit 3 and are designated by the address designating circuit 2.
【0010】図2は図1のキースイッチ回路1およびゲ
ート回路3の詳細説明図である。FIG. 2 is a detailed explanatory diagram of the key switch circuit 1 and the gate circuit 3 of FIG.
【0011】電子楽器のキースイッチは少ないもので数
十個、多いもので数百個であるが、これをn個ずつのm
個のブロックに分ける。この時nはCPU4のビット数
によって定める。本実施例ではn=12として1オクタ
ーブを1つのブロックに対応させて、ブロックコードと
オクターブコードを一部において一致させて、後述する
ブロックコードからオクターブコードへの変換を容易に
したが、必ずしもn=12にする必要はない。なお本実
施例ではCPU4として12ビットのマイクロコンピュ
ータたとえば東芝社製TLCS−12Aを使用した。The number of key switches of an electronic musical instrument is small, dozens, and large, hundreds.
Divide into blocks. At this time, n is determined by the number of bits of the CPU 4. In the present embodiment, one octave is made to correspond to one block with n = 12, and the block code and the octave code are partially matched to facilitate the conversion of the block code to the octave code, which will be described later. There is no need to set = 12. In this embodiment, a 12-bit microcomputer such as TLCS-12A manufactured by Toshiba Corp. is used as the CPU 4.
【0012】図2に示すように、キースイッチ11は1
2個毎に区切られていて各ブロック毎にアドレスが割り
当てられる。同図において、たとえば、4080番地、
4081番地、4082番地を割り当てる。アドレス指
定回路2からラインl1を介してキースイッチ情報の読
出し命令により指定されたアドレス、たとえば4080
番地に“1”レベルの信号を与え、該信号はキースイッ
チ11の共通バー11−1に与えられる。この時当該ブ
ロックのオン状態のキースイッチ11よりラインl2を
通しダイオード12を介して共通ラインl3に接続し、
共通ラインl3は3ステートゲート回路14を介してバ
スバーl4に接続される。3ステートゲート回路14は
各ブロックの何れかが読み出し指定される時にOR回路
13を介したアドレス指定信号により開かれる。As shown in FIG. 2, the key switch 11 is 1
It is divided into two blocks, and an address is assigned to each block. In the figure, for example, address 4080,
Addresses 4081 and 4082 are assigned. The address designated by the read command of the key switch information from the address designating circuit 2 via the line l 1 , for example, 4080
A "1" level signal is given to the address, and the signal is given to the common bar 11-1 of the key switch 11. This time through the diode 12 through a line l 2 from the key switch 11 in the ON state of the block is connected to a common line l 3,
The common line l 3 is connected to the bus bar l 4 via the 3-state gate circuit 14. The tri-state gate circuit 14 is opened by an addressing signal via the OR circuit 13 when any of the blocks is designated for reading.
【0013】すなわち、<4080>、<4081>、
<4082>の各番地の各ビットがキースイッチ11に
対応していて、読み出し命令によりCPU4に読み出さ
れるものである。なお、本実施例では3オクターブ36
鍵を図示しているが、さらに多くのブロック数、鍵数に
適用できることはいうまでもない。That is, <4080>, <4081>,
Each bit of each address of <4082> corresponds to the key switch 11 and is read by the CPU 4 by a read command. In this embodiment, 3 octaves 36
Although the key is shown in the figure, it goes without saying that it can be applied to a larger number of blocks and keys.
【0014】図3は本発明の実施例の情報処理部(CP
U)4の動作を示す流れ図である。以下図1を参照しつ
つ説明する。FIG. 3 is a block diagram of the information processing unit (CP) of the embodiment of the present invention.
4 is a flow chart showing the operation of U) 4. This will be described below with reference to FIG.
【0015】図1において、各ブロックのキー情報は各
ブロックに対応するアドレスを指定することにより、順
次読み出されバスバーl4を介してCPU4に与えられ
る。このCPU4は記憶回路5内の同一ブロックに対応
するキー情報(以下旧キー情報と称する。)と、ゲート
回路3からのキー情報(以下新キー情報と称する。)と
を比較し、一致すれば次のブロックアドレス(+1)の
読出しを行なう。以上の手順は図3の〜のプログラ
ムのループで示される。一致しなければ以下のプログ
ラムに移る。すなわち、新キー情報と旧キー情報の各ビ
ット毎に排他的論理和(EX−OR)を計算し、キー情
報に変化のあったビットを検出する()。そして該変
化のあったビットと当該ブロックのアドレスコードから
この変化のあったキーの属するオクターブコード、ノー
トコードを算出して一時記憶する()。次に新キー情
報のうち上記の変化ビットをチェックすることにより、
キースイッチの変化を識別するオンオフビットが検出さ
れる()。In FIG. 1, the key information of each block is sequentially read out by designating an address corresponding to each block and given to the CPU 4 via the bus bar l 4 . The CPU 4 compares the key information (hereinafter referred to as old key information) corresponding to the same block in the memory circuit 5 with the key information from the gate circuit 3 (hereinafter referred to as new key information), and if they match each other. The next block address (+1) is read. The above procedure is shown by the loop of the program of FIG. If they do not match, move to the following program. That is, the exclusive OR (EX-OR) is calculated for each bit of the new key information and the old key information, and the bit in which the key information has changed is detected (). Then, the octave code and the note code to which the changed key belongs is calculated from the changed bit and the address code of the block and temporarily stored (). Next, by checking the change bit above in the new key information,
An on-off bit that identifies a key switch change is detected ().
【0016】そして新キー情報を旧キー情報の記憶され
ていたRAM領域内のアドレスに転送する()。この
オンオフビットキーコード(オクターブコード、ノート
コード)はチャンネル割り当てプログラムによりキーオ
ンの場合は空き番地へ書き込まれ、キーオフの場合は該
当するキーコードを有するチャンネルのコードが消去さ
れる()。Then, the new key information is transferred to the address in the RAM area where the old key information was stored (). This on / off bit key code (octave code, note code) is written to an empty address in the case of key-on by the channel assignment program, and the code of the channel having the corresponding key code is erased in the case of key-off ().
【0017】なおこのチャンネル割り当てのプログラム
については特願昭52−13684号「電子楽器のチャ
ンネル割りあて回路」と同等である。そしてチャンネル
割り当てプログラムが終了すると、再び次のプログラム
の読み出しに移る。This channel allocation program is equivalent to that of Japanese Patent Application No. 52-13684 "Electronic Musical Instrument Channel Allocation Circuit". When the channel assignment program is finished, the next program is read again.
【0018】以上説明したように、この実施例によれ
ば、キースイッチ回路からの新キー情報を記憶装置に記
憶させた同一ブロックに対応する旧キー情報とを比較
し、キー状態に変化のあったキー信号に対しチャンネル
の割り当てまたは消去を行なう装置を具え、たとえばそ
の機能を記憶回路内の制御情報により動作する情報処理
部で行なわせるものであり、とくにこの情報処理部とし
てマイクロコンピュータを用いることにより、構成が簡
単化、小形化され、しかも低価格の鍵盤処理装置が得ら
れる。さらに鍵数やチャンネル数を拡張する場合でも情
報処理部の改変、対応が非常に容易であるし、またキー
スイッチに番地が割り当てられているので、ある特定の
スイッチだけを選択的に読み出すこともプログラムを変
更することも可能となる。このことは自動演奏におい
て、たとえば伴奏用コードのアルペジオを決定する部分
のみを優先して読み出すことも可能であり、同様のこと
が他の効果にも適用される。As described above , according to this embodiment,
For example, a device that compares new key information from the key switch circuit with old key information corresponding to the same block stored in the memory device and assigns or erases a channel to a key signal whose key state has changed. For example, the function is performed by an information processing unit that operates according to control information in a memory circuit. Especially, by using a microcomputer as the information processing unit, the configuration is simplified and downsized, and the price is low. The keyboard processing device of is obtained. Further, even if the number of keys or the number of channels is expanded, it is very easy to modify and deal with the information processing unit, and since the address is assigned to the key switch, it is possible to selectively read only a specific switch. It is also possible to change the program. In the automatic performance, it is possible to preferentially read out only the part of the accompaniment chord that determines the arpeggio, and the same applies to other effects.
【0019】[0019]
【発明の効果】以上説明したように、この発明によれば
キースイッチ手段の所定のキーブロックから読み出され
たキー情報とこのキーブロックに対応して一時記憶手段
に記憶されている旧キー情報とを比較し、変化のあった
キースイッチに対してチャンネルの割当てまたは消去を
記憶手段の処理プログラムに従って動作するCPUによ
り行わせるので、一時記憶手段には旧キー情報のみを記
憶しておくだけで、変化 のあったキースイッチに対する
発音の割当て消去ができ、構成が簡単化、小型化され
る。また、キーブロック毎にキー情報を読み出してキー
スイッチの変化の有無を調べ、変化があれば直ちに発音
の割当てまたは消去を行うので、従来の一定周期毎にキ
ーブロックからキー情報を読み出してキースイッチの変
化の有無を調べ、変化があれば発音の割当て又は消去を
行う構成に比べてCPUの遊びがなくなる。さらに、C
PUはアドレス指定手段に読出し命令を出力することに
よりキースイッチ手段中の特定のキーブロックを選択的
に読出すことが可能となるので特定の鍵域だけを優先し
て読み出すという応用が可能となる。 As described above, according to the present invention,
Read out from a given key block of the key switch means
Key information and temporary storage means corresponding to this key block
There was a change by comparing with the old key information stored in
Assign or delete channels for key switches
By the CPU operating according to the processing program of the storage means
Only the old key information is recorded in the temporary storage means.
Just remember it for the changed key switch
The pronunciation assignment can be deleted, the configuration is simplified and the size is reduced.
It In addition, the key information is read for each key block and the key is
Investigate whether the switch has changed, and if there is a change, sound immediately
Since it is assigned or deleted, the key is
Key information is read from the block and the key switch
Check if there is any change, and if there is a change, assign or delete the pronunciation
There is no CPU play compared to the configuration. Furthermore, C
PU is to output read command to addressing means
Selective key block in the key switch means
It is possible to read the
It becomes possible to read out by reading.
【図面の簡単な説明】[Brief description of drawings]
【図1】本発明の実施例の構成を示す概略説明図であ
る。FIG. 1 is a schematic explanatory diagram showing a configuration of an embodiment of the present invention.
【図2】図1の実施例の要部の詳細説明図である。FIG. 2 is a detailed explanatory diagram of a main part of the embodiment of FIG.
【図3】図1の実施例の要部の動作を示す流れ図であ
る。FIG. 3 is a flowchart showing an operation of a main part of the embodiment shown in FIG.
【符号の説明】 1 キースイッチ回路 2 アドレス指定回路 3 ゲート回路 4 情報処理部 5 記憶回路 6 チャンネルレジスタ[Explanation of symbols] 1 key switch circuit 2 address designating circuit 3 gate circuit 4 information processing unit 5 memory circuit 6 channel register
Claims (1)
ーブロックは複数のキースイッチから構成され、そして
各キーブロックにはアドレスが割り当てられたキースイ
ッチ手段と、 (B)アドレス指定手段と、 (C)キー情報を各キーブロック毎に一時記憶する一時
記憶手段と、 (D)チャンネルの割当て情報を記憶するチャンネルレ
ジスタ手段と、 (E)処理プログラムが記憶された記憶手段と、 (F)CPU、 とを有し、 前記CPUは、前記記憶手段に記憶された処理プログラ
ムに従って、 (a)前記アドレス指定手段に読出し命令を出力するこ
とにより、該アドレス指定手段によってアドレス指定さ
れた前記キースイッチ手段の所定のキーブロックにおけ
る各キースイッチのオン又はオフ状態を示すキー情報を
読み出し、 (b)該読み出されたキー情報と、該読み出されたキー
情報に対応し且つ前記一時記憶手段中に既に一時記憶さ
れている旧キー情報と比較し、 (c)該比較結果が一致すれば、前記アドレス指定手段
に読出し命令を出力することにより前記キースイッチ手
段の次のキーブロックからキー情報を読み出す処理に移
り、 (d)前記比較結果が一致しなければ、オン又はオフ状
態が変化したキースイッチに対応してそのキー情報の前
記チャンネルレジスタ手段への割当て又は消去を行い、
前記読み出されたキー情報を前記一時記憶手段に旧キー
情報として記憶した後、前記アドレス指定手段に読出し
命令を出力することにより前記キースイッチ手段の次の
キーブロックからキー情報を読み出す処理に移ることを
特徴とする電子楽器の鍵盤情報処理装置。 1. (A) Each key block comprises a plurality of key blocks.
Block consists of multiple key switches, and
An address is assigned to each key block.
Switch means, (B) address designating means, and (C) temporary storage of key information for each key block.
Storage means and (D) a channel register for storing channel allocation information.
A register means, (E) a storage means for storing a processing program, and (F) a CPU , wherein the CPU is a processing program stored in the storage means.
According to the system, (a) a read command is output to the addressing means.
And are addressed by the addressing means.
The specified key block of the key switch means
Key information indicating the on or off state of each key switch
Read, (b) the read key information and the read key
Corresponding to the information and already stored in the temporary storage means.
Compared with old key information that, if a match is (c) the comparison result, said addressing means
By outputting a read command to the key switch hand
Move to the process to read the key information from the next key block in the row.
Ri, if match; (d) the comparison result, on or off like
Corresponding to the key switch whose state has changed
Assign or delete to the channel register means,
The read key information is stored in the temporary storage means as an old key.
After storing as information, read out to the addressing means
By outputting a command, the next
Move to the process of reading the key information from the key block.
A key information processing device for electronic musical instruments.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6122062A JPH0762798B2 (en) | 1994-05-12 | 1994-05-12 | Keyboard information processing device for electronic musical instruments |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6122062A JPH0762798B2 (en) | 1994-05-12 | 1994-05-12 | Keyboard information processing device for electronic musical instruments |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0772861A JPH0772861A (en) | 1995-03-17 |
| JPH0762798B2 true JPH0762798B2 (en) | 1995-07-05 |
Family
ID=14826686
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6122062A Expired - Lifetime JPH0762798B2 (en) | 1994-05-12 | 1994-05-12 | Keyboard information processing device for electronic musical instruments |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0762798B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN110443053B (en) * | 2019-07-31 | 2023-03-14 | 四川效率源信息安全技术股份有限公司 | Key generation method based on key cycle table and mapping table |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3899951A (en) * | 1973-08-09 | 1975-08-19 | Nippon Musical Instruments Mfg | Key switch scanning and encoding system |
| JPS5922238B2 (en) * | 1974-08-14 | 1984-05-25 | ヤマハ株式会社 | key assigner |
-
1994
- 1994-05-12 JP JP6122062A patent/JPH0762798B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0772861A (en) | 1995-03-17 |
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