JPH077322B2 - Keyboard device - Google Patents
Keyboard deviceInfo
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- JPH077322B2 JPH077322B2 JP60016781A JP1678185A JPH077322B2 JP H077322 B2 JPH077322 B2 JP H077322B2 JP 60016781 A JP60016781 A JP 60016781A JP 1678185 A JP1678185 A JP 1678185A JP H077322 B2 JPH077322 B2 JP H077322B2
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- key
- return
- return line
- voltage
- keyboard device
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Description
【発明の詳細な説明】 〔発明の技術分野〕 本発明は、スキャンタイプのキーボード装置に関する。Description: TECHNICAL FIELD OF THE INVENTION The present invention relates to a scan type keyboard device.
スキャンタイプのキーボードにおいて、データを取込む
モードに2キーロックアウトとNキーロールオーバがあ
る。後者は、例えば5ミリ秒の間隔をおいて2度スキャ
ンし、共にONとなっていたときにそのキーコードが格納
されるニューバッファ(N個のキーコードが格納)と前
回スキャン時に押下されていたキーコードが格納されて
いたオールドバッファの内容とを比較することによりそ
のキーが押下されたか、あるいは放されたかが判断され
る。即ち、多重打鍵を許すものであり、比較的熟練操作
者に適す。In the scan type keyboard, there are 2 key lockout and N key rollover as modes for capturing data. The latter is, for example, a new buffer (where N key codes are stored) that stores the key code when both are turned on after scanning twice with an interval of 5 milliseconds. The key code is compared with the contents of the old buffer in which the key code is stored to determine whether the key is pressed or released. That is, it allows multiple keystrokes and is suitable for relatively skilled operators.
ところでこの種キーボード装置が持つキーマトリクスは
第4図に示す様に構成される。又、その動作は第5図に
タイミングチャートとして示されている。即ち、制御部
(図示せず)からの制御により、キーマトリクスはSCAN
11〜SCAN14として示すスキャンニング信号が供給されて
おり、またキーマトリクスからのリターンラインはRETU
RN11〜14読取りタイミングに示すタイミングでリターン
読取り回路(図示せず)を介して制御部に読取られる。The key matrix of this type of keyboard device is constructed as shown in FIG. The operation is shown as a timing chart in FIG. That is, the key matrix is scanned by the control unit (not shown).
The scanning signals shown as 11-SCAN14 are supplied and the return line from the key matrix is RETU
It is read by the control unit via a return reading circuit (not shown) at the timing indicated by RN11 to 14 reading timing.
今仮りにS106・S107・S111のキースイッチが同時にN
状態にある場合、それらは各々T12・T13の時刻に読取ら
れる。Now temporarily switch the S106 / S107 / S111 key switches to N at the same time.
When in the state, they are read at times T 12 and T 13 , respectively.
ここでD1〜D16として示す電流廻り込み防止用ダイオー
ドが存在しない場合の回路(第2図参照)の動作を第6
図に示すタイミングチャートに基づいて説明すると以下
の様になる。即ち、制御部からの制御により、キーマト
リクスにはSCAN1〜SCAN4に示すスキャンニング信号が供
給されており、またキーマトリクスからのリターンライ
ンはRETURN1〜4読取りタイミングに示すタイミングで
リターン読取り回路を介して制御部に読取られる。今、
仮りにS6・S7・S11のキースイッチが同時にN状態に
ある場合、SCAN2とRETURN2及びRETURN3により、T2の時
刻にS6及びS7は正しく読取る事が出来る。しかしT3の時
刻に於いて、SCAN3とRETURN2及びRETURN3により、第2
図の経路に流れる電流によって、S11と同時に、S10は
NしていないにもかかわらずNしているかの様に読
取られてしまう。Here, the operation of the circuit (see FIG. 2) in the case where there is no current sneak prevention diode shown as D 1 to D 16
The following is a description based on the timing chart shown in the figure. That is, under the control of the control unit, the scanning signals shown in SCAN1 to SCAN4 are supplied to the key matrix, and the return line from the key matrix passes through the return reading circuit at the timing shown in RETURN1 to 4 reading timing. Read by the control unit. now,
If the S6, S7, and S11 key switches are in the N state at the same time, S6 and S7 can be correctly read at the time of T 2 by SCAN2, RETURN2, and RETURN3. However, at the time of T 3 , SCAN 3 and RETURN 2 and RETURN 3 cause the second
Due to the current flowing through the path shown in the figure, at the same time as S11, S10 is read as if it is N although it is not N.
従がって、多重打鍵を可能とするキーボード装置にはキ
ースイッチ個々に対応して電流廻り込み防止用ダイオー
ドが必要となり、部品展数の増加と価格の上昇といった
潜在的な欠点があった。Therefore, a keyboard device capable of multiple keystrokes requires a current sneak prevention diode corresponding to each key switch, which has potential drawbacks such as an increased number of parts and an increased price.
本発明は上記欠点に鑑みてなされたものであり、マトリ
クスを構成するキー個々に対応した、電流廻り込み防止
ダイオードを備える事無く、廉価に多重打鍵可能なキー
ボード装置を提供することを目的とする。The present invention has been made in view of the above-mentioned drawbacks, and an object of the present invention is to provide a keyboard device capable of multiple keystrokes at low cost, which does not include a current sneak prevention diode corresponding to each key forming a matrix. .
本発明は、上記キーボード装置を実現するため、キーマ
トリクスのスキャンニングに対応して、リターンライン
個々を、各々時刻を変えて読み取り、さらにそのリター
ンラインのレベルをアナログ入力しA−D変換した値を
予め個々のキースイッチのリターンレベルとして登録し
てある値と比較し、それが有効と認められる範囲にある
場合にのみキー入力を有効とすることにより、マトリク
スを構成するキーに対しての電流廻り込み防止用ダイオ
ードを持つこと無く、多重打鍵可能としたものである。
このことにより、廉価で回路部品展数の少ないキーボー
ド装置を提供することが出来る。According to the present invention, in order to realize the above-mentioned keyboard device, each return line is read at a different time in response to scanning of a key matrix, and the level of the return line is analog-input and AD converted. Is compared with the value registered in advance as the return level of each key switch, and the key input is enabled only when it is within the valid range. Multiple keys can be typed without a wraparound prevention diode.
This makes it possible to provide a keyboard device that is inexpensive and has a small number of circuit components.
以下、第1図ないし第3図を使用して本発明実施例につ
き詳細に説明する。Hereinafter, embodiments of the present invention will be described in detail with reference to FIGS.
第1図は本発明の実施例を示すブロック図である。図に
おいて、1は制御部である。制御部1はマイクロプロセ
ッサ等により構成され、予め、各スイッチが単独でN
状態になった場合のリターン信号読取り回路4に於ける
アナログ−ディジタル(A−D)変換されたデータが記
憶されている。2はスキャン駆動回路である。スキャン
駆動回路2はキーマトリクス3にスキャンニング信号を
供給するキーマトリクス3は第2図にその詳細が示され
ている。FIG. 1 is a block diagram showing an embodiment of the present invention. In the figure, 1 is a control unit. The control unit 1 is composed of a microprocessor, etc.
The analog-digital (A-D) converted data in the return signal reading circuit 4 in the case of the state is stored. Reference numeral 2 is a scan drive circuit. Scan driving circuit 2 is key matrix 3 for supplying a scanning signal to the key matrix 3 has its details are shown in Figure 2.
4はキーマトリクスからのリターン信号を読み取る為の
読取り回路であり、従来例ではリターン信号をディジタ
ル的に読取るものであったが、本発明ではA−D変換機
能を備えているものである。5は制御部とスキャン駆動
回路及びリターン信号読取り回路を結び、データや制御
信号を伝える為のバスラインである。Reference numeral 4 is a reading circuit for reading a return signal from the key matrix. In the conventional example, the return signal was digitally read, but in the present invention, it has an AD conversion function. A bus line 5 connects the control unit to the scan drive circuit and the return signal reading circuit to transmit data and control signals.
尚、第2図に示したキーマトリクス3中、S1〜S16はキー
マトリクスを構成する、例えばゴム接点方式の、キース
イッチ、R1〜R4はキーマトリクスに供給する電流を抑え
る、プルアップ抵抗である。又、SCAN1〜SCAN4はスキャ
ンニング信号、RETURN1〜RETURN4はリターン信号であ
る。In the key matrix 3 shown in FIG. 2, S1 to S16 form a key matrix, for example, a rubber contact type key switch, and R1 to R4 are pull-up resistors that suppress the current supplied to the key matrix. . Further, SCAN1 to SCAN4 are scanning signals, and RETURN1 to RETURN4 are return signals.
第3図は本発明実施例の動作を示すタイミングチャート
であり、図中記された記号及び符号は第2図のそれと合
致する。FIG. 3 is a timing chart showing the operation of the embodiment of the present invention, and the symbols and reference numerals shown in the figure match those of FIG.
以下、本発明実施例の動作につき第3図のタイミングチ
ャートを参照しながら説明する。The operation of the embodiment of the present invention will be described below with reference to the timing chart of FIG.
まず制御部1からの制御により、キーマトリクス3にはS
CAN1〜SCAN4に示すスキャンニング信号が供給されてお
り、またキーマトリクス3からのリターンラインは、RET
URN1の読取り〜RETURN4の読取りに示すタイミングでリ
ターン読取り回路4を介して制御部1に読取られる。即
ち、すべてのキースイッチの状態は、各々異なるタイミ
ングで読取られ、今、仮りにS6・S7・S11のキースイッ
チが同時にN状態にある場合を想定しよう。それらは
各々、T122・T132・T133の時刻にリターン信号読取り回
路4でリターン信号の電圧レベルが読取られ、それをA
−D変換したデータを制御部1に送り、制御部1は、予
め各スイッチのN時の電圧値と比較し、リターン信号
が廻り込みにより生じる、みかけ上のもので無いと判断
された場合にそれを有効打鍵として受け入れる。First, under the control of the control unit 1, S is set in the key matrix 3.
The scanning signals shown in CAN1 to SCAN4 are supplied, and the return line from the key matrix 3 is RET.
It is read by the control unit 1 via the return reading circuit 4 at the timing shown in reading URN1 to reading RETURN4. That is, the states of all the key switches are read at different timings, and now assume that the S6, S7, and S11 key switches are in the N state at the same time. The voltage levels of the return signals are read by the return signal reading circuit 4 at the times of T 122 , T 132, and T 133 , respectively.
When the -D converted data is sent to the control unit 1, the control unit 1 compares it with the voltage value of each switch at the time of N in advance, and when it is determined that the return signal is caused by the wraparound and is not apparent. Accept it as a valid keystroke.
尚、T123の時刻にRETURN2ラインには、経路に流れる
電流によって、みかけ上のS10検出信号が生じる。しか
し、この時のRETURN2ラインには、スイッチS6・S7・S11
の持つ抵抗分によって電圧降下が生じ、その値は実際に
スイッチS10がNした時のものとは値が異なるので、
制御部1は予めスイッチS10のN時の電圧値と比較す
ることにより、それが廻り込みによる見かけ上のリター
ン信号である事を認識し、受け入れない。Note that an apparent S10 detection signal is generated in the RETURN2 line at the time of T 123 due to the current flowing in the path. However, at this time, in the RETURN2 line, the switches S6 ・ S7 ・ S11
A voltage drop occurs due to the resistance of the switch, and its value is different from that when switch S10 is actually N.
The control unit 1 recognizes that it is an apparent return signal due to wraparound by comparing with the voltage value of the switch S10 at the time of N, and does not accept it.
尚、本発明はキーボード装置に限らず、マトリクス状に
配置されたスイッチの検出方式全てに応用可能である。The present invention is not limited to the keyboard device, but can be applied to all detection methods of switches arranged in a matrix.
以上の説明のように本発明によれば、キーマトリクスを
構成するキースイッチ、個々に対応する電流廻り込み防
止ダイオードを備える必要が無い為、廉価で、かつ回路
部品の少ない多重打鍵可能なキーボード装置を提供する
ことができる。As described above, according to the present invention, it is not necessary to provide a key switch that constitutes a key matrix and a corresponding current sneak prevention diode, so that the keyboard device is inexpensive and has a small number of circuit components and is capable of multiple keystrokes. Can be provided.
第1図は本発明の実施例を示すブロック図、第2図は第
1図に示したキーマトリクスの内部構成を示す図、第3
図は本発明実施例の動作を示すタイミングチャート、第
4図は従来におけるキーマトリクスの内部構成を示す
図、第5図・第6図は従来例における動作タイミングチ
ャートを示す。 1……制御部、2……スキャン駆動回路、3……キーマ
トリクス、4……リターン信号読取り回路。1 is a block diagram showing an embodiment of the present invention, FIG. 2 is a diagram showing the internal structure of the key matrix shown in FIG. 1, and FIG.
FIG. 4 is a timing chart showing the operation of the embodiment of the present invention, FIG. 4 is a diagram showing the internal structure of a conventional key matrix, and FIGS. 5 and 6 are operation timing charts of the conventional example. 1 ... Control unit, 2 ... Scan drive circuit, 3 ... Key matrix, 4 ... Return signal reading circuit.
Claims (1)
インとの交叉部で両ラインを電気的接続/非接続状態と
する複数のキースイッチ部と、 前記スキャンラインに時間を変えて電圧を印加する手段
と、 前記リターンラインに接続され、前記各リターンライン
の電圧が所定レベルであるか否かを検出し、前記リター
ンラインの電圧が所定レベルの時に入力キーを有効とす
る検出手段と を具備し、前記リターンラインの電圧が所定レベルでな
ければ多重打鍵の回り込み電流による誤検出とすること
より、電流回り込み防止ダイオードを不要としたことを
特徴とするキーボード装置。1. A plurality of keys having a plurality of scan lines, a plurality of return lines, and a resistance component, and electrically connecting / disconnecting both lines at an intersection of the scan line and the return line. A switch unit, means for applying a voltage to the scan line at different times, connected to the return line to detect whether the voltage of each return line is at a predetermined level, and the voltage of the return line is A detection means for validating the input key at a predetermined level is provided, and if the voltage of the return line is not at a predetermined level, the current sneak-prevention diode is not necessary because it is erroneously detected by the sneak current of multiple keystrokes Keyboard device characterized by.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60016781A JPH077322B2 (en) | 1985-01-31 | 1985-01-31 | Keyboard device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60016781A JPH077322B2 (en) | 1985-01-31 | 1985-01-31 | Keyboard device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61175811A JPS61175811A (en) | 1986-08-07 |
| JPH077322B2 true JPH077322B2 (en) | 1995-01-30 |
Family
ID=11925731
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60016781A Expired - Lifetime JPH077322B2 (en) | 1985-01-31 | 1985-01-31 | Keyboard device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH077322B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100971289B1 (en) * | 2008-03-04 | 2010-07-20 | 주식회사 팬택 | Key input device to prevent misdetection of key input |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5467327A (en) * | 1977-11-08 | 1979-05-30 | Matsushita Electric Ind Co Ltd | Digital input circuit |
-
1985
- 1985-01-31 JP JP60016781A patent/JPH077322B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61175811A (en) | 1986-08-07 |
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Legal Events
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