JPH0820462B2 - Direction detector - Google Patents
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- JPH0820462B2 JPH0820462B2 JP62334402A JP33440287A JPH0820462B2 JP H0820462 B2 JPH0820462 B2 JP H0820462B2 JP 62334402 A JP62334402 A JP 62334402A JP 33440287 A JP33440287 A JP 33440287A JP H0820462 B2 JPH0820462 B2 JP H0820462B2
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Description
【発明の詳細な説明】 産業上の利用分野 本発明は、可動体の方向検出装置に関するものであ
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a device for detecting a direction of a movable body.
従来の技術 第3図、第4図(A)〜(C)に従来の方向検出装置
の構成及び動作波形を示す。方向検出装置の働きは、可
動体における動作方向情報の信号を出力することであ
る。2. Description of the Related Art FIG. 3 and FIGS. 4 (A) to 4 (C) show the configuration and operation waveform of a conventional direction detecting device. The function of the direction detecting device is to output a signal of motion direction information in the movable body.
可動体の動作に同期した位相の異なる2相のパルス信
号s2(第2相)及びパルス信号s1(第1相)がそれぞれ
フリップ・フロップ回路100のデータ端子D及びクロッ
ク端子CKに入力され、入力信号s1の立ち上がりエッジで
の入力信号s2の状態を検出して出力端子Qより動作方向
出力yを出力する。動作方向出力yは、第1相のパルス
信号s1が第2相のパルス信号s2よりも進んだ状態ではロ
ー・レベルとなり、第1相のパルス信号S1が第2相のパ
ルス信号S2よりも遅れた状態ではハイ・レベルとなる。Two-phase pulse signals s2 (second phase) and pulse signals s1 (first phase) having different phases synchronized with the operation of the movable body are input to the data terminal D and the clock terminal CK of the flip-flop circuit 100, respectively, and input. The state of the input signal s2 at the rising edge of the signal s1 is detected and the operation direction output y is output from the output terminal Q. The operation direction output y becomes a low level when the first-phase pulse signal s1 is ahead of the second-phase pulse signal s2, and the first-phase pulse signal S1 lags behind the second-phase pulse signal S2. It becomes high level when it is in a closed state.
発明が解決しようとする問題点 しかしながら従来の方向検出装置では、動作方向出力
を入力信号の第1相の立ち上がりエッジのみで検出して
いるため入力信号の1周期相当の検出精度しか持たない
という問題を有していた。Problems to be Solved by the Invention However, in the conventional direction detecting device, since the operation direction output is detected only by the rising edge of the first phase of the input signal, there is only a detection accuracy equivalent to one cycle of the input signal. Had.
本発明は上記問題点に鑑み、動作方向検出精度を高め
た方向検出装置を提供するものである。The present invention has been made in view of the above problems, and provides a direction detection device with improved motion direction detection accuracy.
問題点を解決するための手段 上記問題点を解決するために、本発明の方向検出装置
では、可動体の動作に同期した第1のパルス信号を発生
する第1のパルス発生器と、前記可動体の動作に同期し
て前記第1のパルス信号と位相の異なる第2のパルス信
号を発生する第2のパルス発生器と、前記第1のパルス
信号の状態と前記第2のパルス信号の状態が一致すると
きに一方の状態になり、一致しないときに他方の状態と
なる出力信号を得る論理回路と、前記第1のパルス信号
の立ち上がりエッジ及び立ち下がりエッジの両方のエッ
ジにおいて所定の時間幅の出力パルス信号を得る第1の
両エッジ検出回路と、前記第2のパルス信号の立ち上が
りエッジ及び立ち下がりエッジの両方のエッジにおいて
所定の時間幅の出力パルス信号を得る第2の両エッジ検
出回路と、前記論理回路の出力信号の状態を前記第1の
両エッジ検出回路の出力パルス信号発生時に入力・保持
し、前記論理回路の出力信号の反転状態を前記第2の両
エッジ検出回路の出力パルス信号発生時に入力・保持す
るフリップ・フロップ回路を含んで構成され、前記第1
の両エッジ検出回路の出力パルス信号発生時点及び前記
第2の両エッジ検出回路の出力パルス信号発生時点にお
いて前記可動体の動作方向を検出し、前記フリップ・フ
ロップ回路の出力信号により動作方向出力を得る方向検
出回路を具備するという構成を備えたものである。Means for Solving the Problems In order to solve the above problems, in the direction detecting device of the present invention, a first pulse generator that generates a first pulse signal synchronized with the operation of a movable body, and the movable body are provided. A second pulse generator that generates a second pulse signal having a phase different from that of the first pulse signal in synchronization with the movement of the body, the state of the first pulse signal, and the state of the second pulse signal And a logic circuit that obtains an output signal that is in one state when they do not match and the other state when they do not match, and a predetermined time width at both the rising edge and the falling edge of the first pulse signal. First edge detection circuit for obtaining the output pulse signal of the second pulse signal, and the second both edge circuit for obtaining the output pulse signal of a predetermined time width at both the rising edge and the falling edge of the second pulse signal. The state of the output signal of the edge detection circuit and the logic circuit is input and held when the output pulse signal of the first both-edge detection circuit is generated, and the inverted state of the output signal of the logic circuit is detected by the second both-edge detection. A first flip-flop circuit for inputting / holding when an output pulse signal of the circuit is generated;
The operation direction of the movable body is detected at the time point when the output pulse signal of the both edge detection circuit and the time point when the output pulse signal of the second both edge detection circuit is generated, and the operation direction output is made by the output signal of the flip-flop circuit. The configuration includes a direction detection circuit for obtaining the obtained direction.
作用 本発明は、上記の構成にすることによって、第1のパ
ルス信号の両エッジ発生時点及び第2のパルス信号の両
エッジ発生時点の各エッジにおいて、迅速かつ高精度に
回転方向を検出することができ、方向検出結果をフリッ
プ・フロップ回路の出力信号により動作検出方向として
出力できる。Effect of the Invention With the above configuration, the present invention can detect the rotation direction at each edge at the time when both edges of the first pulse signal occur and at the time when both edges occur of the second pulse signal quickly and accurately. The direction detection result can be output as the operation detection direction by the output signal of the flip-flop circuit.
実施例 以下、本発明の方向検出装置の一実施例について、図
面を参照しながら説明する。第1図は、本発明の一実施
例の回路構成図である。第2図(A)〜(I)は、第1
図に於ける要部信号波形図である。1は第1のパルス発
生器であり、可動体の動作に同期した第1相のパルス信
号S1を発生する。2は第2のパルス発生器であり、前記
可動体の動作に同期して前記第1相のパルス信号S1と位
相の異なる第2相のパルス信号S2を発生する。2は排他
的論理和回路であり、第1相のパルス信号S1と第2相の
パルス信号S2が入力されS1とS2が不一致のときのみにハ
イ・レベルとなる信号aを出力する。4は第1の両エッ
ジ検出回路であり、Dフリップ・フロップ40,41と排他
的論理和回路42により構成されている。Dフリップ・フ
ロップ40は、データ入力端子D1に第1相のパルス信号S1
を入力してクロック端子CK1に入力される基準クロックC
LK(但し、基準クロックCLKの周波数は、第1相のパル
ス信号S1及び第2相のパルス信号S2の周波数よりも十分
に高い。)の立ち上がりエッジによって同期化して出力
端子Q1から出力する。Dフリップ・フロップ41は、デー
タ入力端子D2にDフリップ・フロップ40の出力端子Q1か
らの出力信号を入力してクロック端子CK2に入力される
基準クロックCLKの立ち上がりエッジによって同期化し
て出力端子Q2から出力する。排他的論理和回路42は、D
フリップ・フロップ40の出力端子Q1からの出力信号及び
Dフリップ・フロップ41の出力端子Q2からの出力信号を
入力し、不一致のときのみハイ・レベルとなるパルス信
号bを出力する。5は第2の両エッジ検出回路であり、
Dフリップ・フロップ50,51と排他的論理和回路52によ
り構成されている。Dフリップ・フロップ50は、データ
入力端子D3に第2相のパルス信号S2を入力してクロック
端子CK3に入力される基準クロックCLKの立ち上がりエッ
ジによって同期化して出力端子Q3から出力する。Dフリ
ップ・フロップ51は、データ入力端子D4にDフリップ・
フロップ50の出力端子Q3からの出力信号を入力してクロ
ック端子CK4に入力される基準クロックCLKの立ち上がり
エッジによって同期化して出力端子Q4から出力する。排
他的論理和回路52は、Dフリップ・フロップ50の出力端
子Q3からの出力信号及びDフリップ・フロップ51の出力
端子Q4からの出力信号を入力して、不一致のときのみハ
イ・レベルとなるパルス信号cを出力する。6は方向検
出回路であり、インバータ回路60とアンド回路61,62,6
3,64とオア回路65,66及びノア回路67,68によって構成さ
れる。インバータ回路60は排他的論理和回路3の出力信
号を入力して反転した信号を出力する。アンド回路61及
び63は第1の両エッジ検出回路4の出力信号bを入力し
て、アンド回路61は排他的論理和回路3の出力信号がハ
イ・レベルのときのみ、アンド回路63は排他的論理和回
路3の出力信号がロー・レベルのときのみ第1の両エッ
ジ検出回路4の出力信号bを検出する。アンド回路62及
び64は第2の両エッジ検出回路5の出力信号cを入力し
て、アンド回路62は排他的論理和回路3の出力信号がロ
ー・レベルのときのみ、アンド回路64は排他的論理和回
路3の出力信号がハイ・レベルのときのみ第2の両エッ
ジ検出回路5の出力信号cを出力する。ノア回路65はア
ンド回路61及び62の出力信号を入力して、合成した出力
信号dを出力する。ノア回路66はアンド回路63及び64の
出力信号を入力して、合成した出力信号eを出力する。
よって第1相のパルス信号S1と第2相のパルス信号S2の
立ち上がり及び立ち下がりエッジを検出したパルス信号
は、第1相のパルス信号S1が第2相のパルス信号S2より
も進んだ状態(第1の状態)ではオア回路65より出力さ
れ、第1相のパルス信号S1が第2相のパルス信号S2より
も遅れた状態(第2の状態)では、オア回路66より出力
される。オア回路65の出力信号dはノア回路67に入力さ
れ、オア回路66の出力信号eはノア回路68に入力され
る。ノア回路67,68によって構成されるフリップ・フロ
ップ回路によってノア回路67が出力する動作方向出力Y
は、第1の状態のときにはロー・レベルとなり、第2の
状態のときにはハイ・レベルとなる。この動作方向出力
Yは、第1相のパルス信号S1と第2相のパルス信号S2の
立ち上がり及び立ち下がりエッジで検出が行われている
ために従来例で示されている第1相のパルス信号S1の立
ち上がりエッジでのみ検出する場合よりも精度が高い。Embodiment An embodiment of the direction detecting device of the present invention will be described below with reference to the drawings. FIG. 1 is a circuit configuration diagram of an embodiment of the present invention. 2 (A) to (I) show the first
FIG. 4 is a signal waveform diagram of a main part in the figure. Reference numeral 1 is a first pulse generator, which generates a first-phase pulse signal S1 synchronized with the operation of the movable body. A second pulse generator 2 generates a second-phase pulse signal S2 having a phase different from that of the first-phase pulse signal S1 in synchronization with the operation of the movable body. Reference numeral 2 is an exclusive OR circuit, which outputs a signal a which becomes a high level only when the first-phase pulse signal S1 and the second-phase pulse signal S2 are input and S1 and S2 do not match. Reference numeral 4 is a first both-edge detection circuit, which is composed of D flip-flops 40 and 41 and an exclusive OR circuit 42. The D flip-flop 40 has a first phase pulse signal S1 at the data input terminal D1.
Of the reference clock C input to the clock terminal CK1
The frequency of the reference clock CLK (however, the frequency of the reference clock CLK is sufficiently higher than the frequencies of the pulse signal S1 of the first phase and the pulse signal S2 of the second phase) is synchronized and output from the output terminal Q1. The D flip-flop 41 inputs the output signal from the output terminal Q1 of the D flip-flop 40 to the data input terminal D2 and synchronizes with the rising edge of the reference clock CLK input to the clock terminal CK2 to output from the output terminal Q2. Output. The exclusive OR circuit 42 is D
The output signal from the output terminal Q1 of the flip-flop 40 and the output signal from the output terminal Q2 of the D flip-flop 41 are input, and a pulse signal b which becomes high level only when they do not match is output. 5 is a second double edge detection circuit,
It is composed of D flip-flops 50 and 51 and an exclusive OR circuit 52. The D flip-flop 50 inputs the second phase pulse signal S2 to the data input terminal D3, synchronizes with the rising edge of the reference clock CLK input to the clock terminal CK3, and outputs from the output terminal Q3. The D flip-flop 51 has a D flip-flop connected to the data input terminal D4.
The output signal from the output terminal Q3 of the flop 50 is input, synchronized with the rising edge of the reference clock CLK input to the clock terminal CK4, and output from the output terminal Q4. The exclusive OR circuit 52 inputs the output signal from the output terminal Q3 of the D flip-flop 50 and the output signal from the output terminal Q4 of the D flip-flop 51, and becomes a high level pulse only when they do not match. The signal c is output. 6 is a direction detection circuit, which is an inverter circuit 60 and AND circuits 61, 62, 6
3, 64, OR circuits 65, 66 and NOR circuits 67, 68. The inverter circuit 60 inputs the output signal of the exclusive OR circuit 3 and outputs an inverted signal. The AND circuits 61 and 63 receive the output signal b of the first both-edge detection circuit 4, and the AND circuit 61 outputs the exclusive OR circuit 3 only when the output signal is high level. The output signal b of the first both-edge detection circuit 4 is detected only when the output signal of the OR circuit 3 is at the low level. The AND circuits 62 and 64 receive the output signal c of the second both-edge detection circuit 5, and the AND circuit 62 outputs the exclusive OR circuit 3 only when the output signal of the exclusive OR circuit 3 is low level. Only when the output signal of the OR circuit 3 is at the high level, the output signal c of the second both edge detection circuit 5 is output. The NOR circuit 65 inputs the output signals of the AND circuits 61 and 62 and outputs a combined output signal d. The NOR circuit 66 inputs the output signals of the AND circuits 63 and 64 and outputs a combined output signal e.
Therefore, in the pulse signal in which the rising and falling edges of the first-phase pulse signal S1 and the second-phase pulse signal S2 are detected, the state in which the first-phase pulse signal S1 leads the second-phase pulse signal S2 ( The OR circuit 65 outputs the signal in the first state), and the OR circuit 66 outputs the pulse signal S1 of the first phase later than the pulse signal S2 of the second phase (second state). The output signal d of the OR circuit 65 is input to the NOR circuit 67, and the output signal e of the OR circuit 66 is input to the NOR circuit 68. Operation direction output Y output from the NOR circuit 67 by the flip-flop circuit configured by the NOR circuits 67 and 68
Becomes a low level in the first state and becomes a high level in the second state. Since this operation direction output Y is detected at the rising and falling edges of the first-phase pulse signal S1 and the second-phase pulse signal S2, the first-phase pulse signal shown in the conventional example. It is more accurate than detecting only on the rising edge of S1.
以上のように本実施例によれば、可動体の動作に同期
した第1相のパルス信号と第2相のパルス信号の不一致
状態を、第1相の入力パルス信号と第2相の入力パルス
信号の立ち上がり及び立ち下がりの両エッジで検出する
ことによって精度の高い動作方向出力を得ることが出来
る。また本発明の方向検出装置の具体的な実施例は、上
述の実施例に限定されるものではなく、本発明の主旨を
変えずに種々の変形が可能である。As described above, according to the present embodiment, the disagreement between the pulse signal of the first phase and the pulse signal of the second phase, which are synchronized with the operation of the movable body, is changed to the input pulse signal of the first phase and the input pulse of the second phase. By detecting at both the rising and falling edges of the signal, it is possible to obtain a highly accurate output in the operating direction. Further, the specific embodiment of the direction detecting device of the present invention is not limited to the above-mentioned embodiment, and various modifications can be made without changing the gist of the present invention.
発明の効果 以上のように本発明の方向検出装置によれば、第1の
パルス信号の両エッジ発生時点及び第2のパルス信号の
両エッジ発生時点において、正確な動作方向出力の検出
(方向検出)が可能になる、すなわち、簡単な回路構成
によって、多くのパルスエッジにおいて迅速かつ高精度
の方向検出が可能になる、という優れた効果を奏する。EFFECTS OF THE INVENTION As described above, according to the direction detection device of the present invention, accurate detection of the output of the operation direction (direction detection) is performed at both edges of the first pulse signal and both edges of the second pulse signal. 2) is possible, that is, the simple circuit configuration enables rapid and highly accurate direction detection at many pulse edges.
第1図は本発明の一実施例の回路構成図、第2図は第1
図に於ける要部信号波形図、第3図は従来の方向検出装
置の回路構成図、第4図は第3図に於ける信号波形図で
ある。 1……第1のパルス発生器、2……第2のパルス発生
器、3……排他的論理和回路、4……第1の両エッジ検
出回路、5……第2の両エッジ検出回路、6……方向検
出回路。FIG. 1 is a circuit configuration diagram of an embodiment of the present invention, and FIG.
FIG. 3 is a signal waveform diagram of a main part in the figure, FIG. 3 is a circuit configuration diagram of a conventional direction detecting device, and FIG. 4 is a signal waveform diagram in FIG. 1 ... First pulse generator, 2 ... Second pulse generator, 3 ... Exclusive OR circuit, 4 ... First double-edge detection circuit, 5 ... Second double-edge detection circuit , 6 ... Direction detection circuit.
Claims (1)
を発生する第1のパルス発生器と、前記可動体の動作に
同期して前記第1のパルス信号と位相の異なる第2のパ
ルス信号を発生する第2のパルス発生器と、前記第1の
パルス信号の状態と前記第2のパルス信号の状態が一致
するときに一方の状態になり、一致しないときに他方の
状態となる出力信号を得る論理回路と、前記第1のパル
ス信号の立ち上がりエッジ及び立ち下がりエッジの両方
のエッジにおいて所定の時間幅の出力パルス信号を得る
第1の両エッジ検出回路と、前記第2のパルス信号の立
ち上がりエッジ及び立ち下がりエッジの両方のエッジに
おいて所定の時間幅の出力パルス信号を得る第2の両エ
ッジ検出回路と、前記論理回路の出力信号の状態を前記
第1の両エッジ検出回路の出力パルス信号発生時に入力
・保持し、前記論理回路の出力信号の反転状態を前記第
2の両エッジ検出回路の出力パルス信号発生時に入力・
保持するフリップ・フロップ回路を含んで構成され、前
記第1の両エッジ検出回路の出力パルス信号発生時点及
び前記第2の両エッジ検出回路の出力パルス信号発生時
点において前記可動体の動作方向を検出し、前記フリッ
プ・フロップ回路の出力信号により動作方向出力を得る
方向検出回路を具備する方向検出装置。1. A first pulse generator for generating a first pulse signal synchronized with the operation of a movable body, and a second pulse generator having a phase different from that of the first pulse signal in synchronization with the operation of the movable body. A second pulse generator that generates a pulse signal is in one state when the states of the first pulse signal and the second pulse signal match, and is in the other state when they do not match. A logic circuit for obtaining an output signal, a first both-edge detecting circuit for obtaining an output pulse signal having a predetermined time width at both the rising edge and the falling edge of the first pulse signal, and the second pulse A second both-edge detection circuit that obtains an output pulse signal of a predetermined time width at both the rising edge and the falling edge of the signal, and a state of the output signal of the logic circuit, that is, the first both-edge detection circuit. Input and held in the output pulse signal generating circuit, and inputting the inverted state of the output signal of the logic circuit when the output pulse signal generator of the second both-edge detection circuit
A flip-flop circuit for holding is included, and the operation direction of the movable body is detected at the output pulse signal generation time of the first both-edge detection circuit and the output pulse signal generation time of the second both-edge detection circuit. And a direction detection device including a direction detection circuit that obtains an operation direction output by the output signal of the flip-flop circuit.
Priority Applications (1)
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|---|---|---|---|
| JP62334402A JPH0820462B2 (en) | 1987-12-29 | 1987-12-29 | Direction detector |
Applications Claiming Priority (1)
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|---|---|---|---|
| JP62334402A JPH0820462B2 (en) | 1987-12-29 | 1987-12-29 | Direction detector |
Publications (2)
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| JPH01174980A JPH01174980A (en) | 1989-07-11 |
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Family
ID=18276965
Family Applications (1)
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|---|---|---|---|
| JP62334402A Expired - Lifetime JPH0820462B2 (en) | 1987-12-29 | 1987-12-29 | Direction detector |
Country Status (1)
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| JP (1) | JPH0820462B2 (en) |
Families Citing this family (1)
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Family Cites Families (2)
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| JPS59216062A (en) * | 1983-05-23 | 1984-12-06 | Victor Co Of Japan Ltd | Method and device for detecting rotation direction |
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-
1987
- 1987-12-29 JP JP62334402A patent/JPH0820462B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |