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D-mosとは 意味・読み方・使い方
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「D-mos」の部分一致の例文検索結果
該当件数 : 61件
To provide a resistance voltage-dividing type D/A converting circuit whose nonuniformity of MOS resistance value is eliminated.例文帳に追加
、MOS抵抗値の不均一性を無くした抵抗分圧型のD/A変換回路を実現する。 - 特許庁
METHOD FOR MANUFACTURING ELEVATED SOURCE/DRAIN(S/D) FOR MOS DEVICE例文帳に追加
MOSデバイス用の隆起ソース/ドレーン(S/D)の製造方法 - 特許庁
To provide a method for manufacturing the elevated source/drain(S/D) for a MOS device.例文帳に追加
MOSデバイス用の隆起ソース/ドレーン(S/D)の製造方法である。 - 特許庁
A drain terminal D and a gate terminal G of a shunt MOS transistor 12 are installed sharing those of the power MOS transistor 11.例文帳に追加
分流MOSトランジスタ12は、パワーMOSトランジスタ11とドレイン端子Dおよびゲート端子Gが共通に設けられている。 - 特許庁
A MOS transistor MR discharges unnecessary charge which is stored in parasitic capacitances of the photodiode D and the MOS transistors MC, MR during the OFF period of the MOS transistor MC.例文帳に追加
MOSトランジスタMRは、MOSトランジスタMCのOFF期間にフォトダイオードDおよびMOSトランジスタMC,MRの寄生容量に蓄積された不要電荷を排出する。 - 特許庁
A D-type N-channel MOS transistor HND3, an I-type N-channel MOS transistor HN1, and an E-type N-channel MOS transistor HNE1 are connected in parallel between node N2 and node N3.例文帳に追加
ノードN2とノードN3との間には、D型NチャネルMOSトランジスタHND3、I型NチャネルMOSトランジスタHN1、及びE型NチャネルMOSトランジスタHNE1が並列に接続されている。 - 特許庁
The first differential amplification portion 11 is provided with a differential pair of D-type Pch MOS transistors MDPT1 and MDPT2, and a Pch MOS transistor MPT1.例文帳に追加
第1の差動増幅部11には差動対をなすD型Pch MOSトランジスタMDPT1及びMDPT2とPch MOSトランジスタMPT1が設けられる。 - 特許庁
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「D-mos」の部分一致の例文検索結果
該当件数 : 61件
To provide a MOS transistor including a Schottky-S/D structure having small interface resistance Rc.例文帳に追加
界面抵抗Rcが小さいSchottky−S/D構造を含むMOSトランジスタを提供すること。 - 特許庁
With respect to n-channel MOS transistors TN-A and TN-B and p-channel MOS transistors TP-A and TP-B comprising the level shift circuit, p-channel MOS transistors TP-C and TP-D comprising a current mirror circuit are formed at the drain of the p-channel MOS transistors TP-A and TP-B.例文帳に追加
レベルシフト回路を構成するNチャネルMOSトランジスタTN‐A、TN‐BおよびPチャネルMOSトランジスタTP‐A、TP‐Bにおいて、TP‐A、TP‐Bのドレインにカレントミラー回路を構成するPチャネルMOSトランジスタTP‐CおよびTP‐Dを構成する。 - 特許庁
The drain and the gate of a MOS transistor T1 are connected to the anode of a photo diode PD with a d-c voltage VPD applied to its cathode, and the drain and the gate of a MOS transistor T3 are connected to the source of the MOS transistor T1.例文帳に追加
カソードに直流電圧VPDが印加されたフォトダイオードPDのアノードにMOSトランジスタT1のドレインとゲートを接続するとともに、このMOSトランジスタT1のソースにMOSトランジスタT3のドレインとゲートを接続する。 - 特許庁
A MOS transistor 36 as a switch element is connected between output terminals of first, second D/A converters 12, 13.例文帳に追加
第1,第2D/A変換器12,13の出力端子の間に、スイッチ素子としてのMOSトランジスタ36を接続する。 - 特許庁
Power voltage for operation is supplied to the respective drain electrodes D of the pair of power MOS-FETs from a supply end of the power voltage for operation.例文帳に追加
動作用電源電圧の供給端からは1対のパワーMOS・FETの各ドレイン電極を供給する。 - 特許庁
When MOS transistors in the same shape are arranged like a matrix, an inside MOS transistor is used as the constant current cell U, and MOS transistors arranged in the surroundings are used as dummy transistors D and MOS capacity C, the gate electrode, the source electrode, and the drain electrode of each dummy transistor D are connected to the same metal wire as that of a gate electrode of the constant current cell U.例文帳に追加
同一形状のMOSトランジスタをマトリクス状に配置し、内側のMOSトランジスタを定電流セルUとして用い、周囲に配置されたMOSトランジスタをダミートランジスタD及びMOS容量Cとして用いるときに、ダミートランジスタDのゲート電極、ソース電極及びドレイン電極を、定電流セルUのゲート電極と同じメタル配線に接続する。 - 特許庁
The source terminal S of the p-channel MOS transistor PT1 is connected to a node ND1, and the drain terminal D is made an ground terminal.例文帳に追加
pチャネルMOSトランジスタPT1のソース端子SがノードND1に接続され、そのドレイン端子Dが接地端子とされる。 - 特許庁
In the inverter, each arm A contains normally-on elements P and N-channel MOS transistors Q connected in series, built-in diodes D for the N-channel MOS transistors Q are used as free wheel diodes and the breakdown voltage of each N-channel MOS transistor Q is 10 to 50 V.例文帳に追加
このインバータでは、各アームAは直列接続されたノーマリーオン素子PおよびNチャネルMOSトランジスタQを含み、NチャネルMOSトランジスタQの内蔵ダイオードDはフリーホイールダイオードとして使用され、NチャネルMOSトランジスタQの耐圧は10〜50Vである。 - 特許庁
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