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simulation clockとは 意味・読み方・使い方
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「simulation clock」の部分一致の例文検索結果
該当件数 : 34件
CLOCK CONTROLLER, AND LOGIC SIMULATION METHOD AND LOGIC SIMULATION DEVICE USING IT例文帳に追加
クロックコントローラ及びそれを用いた論理シミュレーション方法と論理シミュレーション装置 - 特許庁
To automatically generate a description for clock base simulation.例文帳に追加
クロックベースシミュレーション用の記述を自動的に生成すること。 - 特許庁
To attain simulation for the variance of a clock skew in the design of a semiconductor integrated circuit by an efficient(realistic) circuit scale which is equivalent to the simulation of a whole clock tree.例文帳に追加
半導体集積回路の設計におけるクロックスキューのばらつきに対するシミュレーションを、クロックツリー全体をシミュレーションするのと等価で且つ効率的（現実的）な回路規模で行なえるようにする。 - 特許庁
The clock base simulator 8 captures the clock base description and operation synthesis information to execute a clock base simulation and compute power consumption factors of storage elements from both clock base description and operation synthesis information.例文帳に追加
クロックベースシミュレーション装置８は、クロックベース記述と動作合成情報を入力し、クロックベースシミュレーションを実行すると共に、クロックベース記述と動作合成情報の双方に基づいて記憶素子の消費電力因子を計算する。 - 特許庁
Further, since a value of a clock frequency division ratio generated on the simulation model 31 side is made to be taken into the clock controller 50 simultaneously with access to a slave model 32 from the CPU 41, a simulation method having extremely small overhead for clock control (adjustment) can be achieved.例文帳に追加
更に、シミュレーションモデル３１側で生成されたクロック分周比の値を、ＣＰＵ４１からスレーブモデル３２へのアクセスと同時に、クロックコントローラ５０内に取り込むようにしたので、クロック制御（調整）のためのオーバヘッドが極めて少ないシミュレーション方法を実現できる。 - 特許庁
To provide a highly-precise logical simulation device and to reduce a verification period in logical simulation by taking into consideration the simulation execution sequence of sequence circuits whose output signal is a clock signal.例文帳に追加
論理シミュレーションにおいて順序回路の出力信号がクロックである順序回路のシミュレーション実行順序を考慮することによる高精度論理シミュレーション装置の提供と検証期間削減を実現する。 - 特許庁
If the first and second simulation results are matched, the target module is subjected to clock gating.例文帳に追加
そして、第１および第２のシミュレーション結果が一致する場合に、クロック・ゲーティングの適用対象に決定する。 - 特許庁
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「simulation clock」の部分一致の例文検索結果
該当件数 : 34件
To provide a simulation method for a PLL(phase-locked loop) circuit which permits simulation by accurately deciding the frequency of a feedback clock signal even when the frequency of an output clock signal is varied (multiplied or divided) upon occasion.例文帳に追加
出力クロック信号の周波数が場合に応じて変更（逓倍ないし分周）せしめられる場合であっても、帰還クロック信号の周波数を的確に判定してシミュレーションが行えるＰＬＬ回路のシミュレーション方法を提供する。 - 特許庁
Therefore, since simulation can be performed in a form approximate to the case that the CPU board 40 and the simulation model 31 inside a PC 30 operate at the same clock frequency, the co-simulation well adapted for the actual LSI or the like is possible.例文帳に追加
そのため、ＣＰＵボード４０と、ＰＣ３０内のシミュレーションモデル３１とが、同一クロック周波数で動作する場合に近い形でシミュレーションができるので、実際のＬＳＩ等に適応したコ・シミュレーションが可能である。 - 特許庁
A simulated asynchronous sequence is synchronized by extracting a state at each clock period to generate a simulation synchronous sequence.例文帳に追加
シミュレートされる非同期シーケンスはシミュレーション同期シーケンスの生成の為に各クロック周期にて状態を引き出し同期される。 - 特許庁
According to the input information, the top-level description generation device 9 automatically generates a description for clock base simulation.例文帳に追加
さらに、トップレベル記述生成装置９は、入力された情報に基づいてクロックベースシミュレーション用の記述を自動生成する。 - 特許庁
To provide a test facility system, with which all applications can be operated at arbitrary simulation time without changing a system clock.例文帳に追加
システムクロックを変更することなく、任意のシミュレーション時刻で全てのアプリケーションを動作可能な試験設備システムを提供する。 - 特許庁
To suppress the occurrence of clock skew at the time of logic simulation concerning the logic circuit of gated clock design.例文帳に追加
ゲーテッドクロック設計された論理回路についての論理シミュレーション時におけるクロックスキューの発生を抑制する論理シミュレーション用ディレイ情報を生成する生成装置及び生成方法を提供する。 - 特許庁
An edge timing of the clock and an effective signal value of the signal input/output to/from the clock synchronization circuit at this timing are calculated using the second discrete model to execute the simulation.例文帳に追加
そして、クロックのエッジタイミングおよびこのタイミングでのクロック同期回路に入出力される信号の実効的信号値が、第２離散モデルを用いて計算され、シミュレーションが実行される。 - 特許庁
A clock frequency is automatically adjusted by a clock controller 50 inside a CPU board 40 having a CPU 41 so as to follow speed of a simulation model 31 that is a logic model having a slow operation frequency (the clock frequency).例文帳に追加
動作周波数（クロック周波数）の遅い論理モデルであるシミュレーションモデル３１の速度に追随するように、ＣＰＵ４１を有するＣＰＵボード４０内のクロックコントローラ５０によって自動的にクロック周波数を調整するようにしている。 - 特許庁
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