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activation bitとは 意味・読み方・使い方
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意味・対訳 アクトビット
「activation bit」の部分一致の例文検索結果
該当件数 : 40件
A bit line equalizer circuit 30a equalizes respectively bit lines BL to a bit line potential VBLA and bit lines /BL to a bit line potential VBLB in accordance with activation of a bit line equalizing signal BLEQ.例文帳に追加
ビット線イコライズ回路３０ａは、ビット線イコライズ信号ＢＬＥＱの活性化に応じて、ビット線ＢＬをビット線電位ＶＢＬＡに、ビット線／ＢＬをビット線電位ＶＢＬＢに、それぞれイコライズする。 - 特許庁
The normal operation precharge circuit connected to each bit line of the bit line pair, the inspection precharge circuit connected to one bit line of the bit line pair, and the inspection precharge circuit connected to the other bit line of the bit line pair are respectively activated by the same first activation signal, a second activation signal, and a third activation signal.例文帳に追加
ビット線対の各ビット線のそれぞれに接続された通常動作用プリチャージ回路は同一の第１の活性化信号で、ビット線対の一方のビット線に接続された検査用プリチャージ回路は第２の活性化信号で、ビット線対の他方のビット線に接続された検査用プリチャージ回路は第３の活性化信号でそれぞれ活性化される。 - 特許庁
During inspection, by activation of the second or third activation signal before a reading operation, one bit line and the other bit line of of the bit line pair are precharged to different precharge potentials.例文帳に追加
検査時において、読出し動作前に第２または第３の活性化信号の活性化によって、ビット線対の一方のビット線と他方のビット線とを互いに異なるプリチャージ電位までプリチャージする。 - 特許庁
The reference bit verification signal responses to activation of the first counting signal in a first mode, and responses to activation of the second counting signal.例文帳に追加
基準ビット確認信号は、第１モードでは第１カウンティング信号の活性に応答し、第２モードでは第２カウンティング信号の活性に応答する。 - 特許庁
The stacked memory is constituted to satisfy data bit:ECC bit=number of data layers:number of ECC layers=number of activation mats for data:number of activation mats for ECC.例文帳に追加
本発明の積層メモリは、データビット：ＥＣＣビット＝データ層数：ＥＣＣ層数＝データ用活性化マット数：ＥＣＣ用活性化マット数として構成する。 - 特許庁
First precharge circuits PR0-PR7 precharge bit-line pairs in response to the activation of precharge signals.例文帳に追加
第１のプリチャージ回路ＰＲ０〜ＰＲ７は、プリチャージ信号の活性化に応じてビット線対をプリチャージする。 - 特許庁
An equalizing circuit connects a pair of bit lines each other, while connects the pair of bit lines to a pre-charge voltage line, in response to activation of an equalization control signal.例文帳に追加
イコライズ回路は、イコライズ制御信号の活性化に応答して、ビット線対を相互に接続するとともにビット線対をプリチャージ電圧線に接続する。 - 特許庁
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「activation bit」の部分一致の例文検索結果
該当件数 : 40件
Thereby, the time from activation of a word line by a signal WLT to the activation of a sense amplifier can be set longer than normal, and minute leakage of bit line can be detected.例文帳に追加
信号ＷＬＴによるワード線の活性化からセンスアンプ活性化までの時間を通常よりも長くすることができ、ビット線の微小リークを検出することができる。 - 特許庁
A decoder circuit generates a decoding pulse DP for which an activation period is set according to an n-bit video signal.例文帳に追加
デコード回路は、ｎビットの映像信号に応じて活性化期間が設定されるデコードパルスＤＰを生成する。 - 特許庁
A latch for amplifying data on a bit line is activated simultaneously in accordance with activation of a first activating signal.例文帳に追加
ビット線上のデータを増幅するラッチは、第１活性化信号の活性化に応じて同時に活性化される。 - 特許庁
An inverter 15 for adjusting a bit line potential level is provided in common for a plurality of pairs of bit line, and sets a potential level of bit line of one side and a potential level of a bit line of the other side out of each pair of bit line to a complementary level in an activation period of a reset signal.例文帳に追加
ビット線電位レベル調整用インバータ１５は、複数のビット線対に対して共通に設けられ、リセット信号の活性期間中において、各ビット線対のうちの一方のビット線の電位と他方のビット線の電位レベルを互いに相補レベルに設定する。 - 特許庁
An arrow 150 shows that a bit line pre-charge and column selecting operation 136 is transferred from the activation command to the pre-active command.例文帳に追加
矢印１５０は、ビット線プレチャージ及びカラム選択動作１３６が、アクティベートコマンドからプレアクティブコマンドに移動されることを示す。 - 特許庁
When configured to detect a switch activation, the microprocessor transmits a bit within a period that includes a debounce time interval.例文帳に追加
スイッチ起動を検出するように構成された場合、マイクロプロセッサは、デバウンス時間間隔を含む期間内にビットを送信する。 - 特許庁
Selection of a write column is performed in the non- activation state of the sense amplifier 3, write data are written in the pair of bit lines BLt/BLc belonging to a selected column when the sense amplifier 3 is in a non-activation state.例文帳に追加
そして、書き込みカラムの選択をセンスアンプ３が非活性状態のときに行い、書き込みデータを選択されたカラムに属するビット線対BLt/BLcに、センスアンプ３が非活性状態のときに書き込む。 - 特許庁
During from this time to detection of transition of the next address by the reset control section 20, all reset transistors 2 hold an activation state, and reset bit lines BL0-BLn and dummy bit lines BLG.例文帳に追加
このときから、リセット制御部２０が次のアドレスの遷移を検出するまでの間、すべてのリセットトランジスタ２は活性化状態を保ち、ビット線ＢＬ０〜ＢＬｎ及びダミービット線ＢＬＧのリセットを行う。 - 特許庁
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