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JP2656532B2 - Electric circuit state detecting device and electric device using the same - Google Patents
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JP2656532B2 - Electric circuit state detecting device and electric device using the same - Google Patents

Electric circuit state detecting device and electric device using the same

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JP2656532B2
JP2656532B2 JP63056069A JP5606988A JP2656532B2 JP 2656532 B2 JP2656532 B2 JP 2656532B2 JP 63056069 A JP63056069 A JP 63056069A JP 5606988 A JP5606988 A JP 5606988A JP 2656532 B2 JP2656532 B2 JP 2656532B2
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、有接点コンタクタにおける接点溶着又はソ
リッドステートコンタクタにおける主回路素子の導通状
態での故障検出回路に係り、特に広範な負荷電圧におけ
る異常検出に好適な故障検出回路に関する。
Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a failure detection circuit in a contact contactor in a contact welding or a conduction state of a main circuit element in a solid state contactor, and particularly to an abnormality in a wide range of load voltage. The present invention relates to a failure detection circuit suitable for detection.

〔従来の技術〕[Conventional technology]

従来の装置は特開昭61−220221号に記載のように、制
御電圧と負荷側電圧との不一致を検出して不一致状態に
なった時に出力信号を発するよう構成されている。
As described in Japanese Patent Application Laid-Open No. Sho 61-220221, a conventional device is configured to detect a mismatch between a control voltage and a load side voltage and to output an output signal when a mismatch occurs.

〔発明が解決しようとする課題〕[Problems to be solved by the invention]

上記従来技術は故障検出回路を広い電圧範囲で使用と
することについては考慮されて居らず、例えば200V用の
ものを100V回路に使用すると制御電圧と負荷側電圧とが
ともに正常であっても不一致状態と見なされてしまうの
で、製品を共用化できないという問題があった。
The above prior art does not consider using a failure detection circuit in a wide voltage range.For example, if a failure detection circuit is used for a 200V circuit for a 100V circuit, the control voltage and the load side voltage will not match even if both are normal. There is a problem that the product cannot be shared because it is regarded as a state.

本発明の目的は広範な電圧範囲で使用可能であり、例
えば100V,200Vという異なる電圧でも製品を共用可能な
電路状態検出装置およびそれを用いた電気装置を提供す
ることにある。
An object of the present invention is to provide an electric circuit state detecting device which can be used in a wide voltage range, for example, can share a product even at different voltages of 100 V and 200 V, and an electric device using the same.

〔課題を解決するための手段〕[Means for solving the problem]

上記目的は、電路状態検出装置を、3相の電路の電圧
を検出してその正常時の電圧に実質的に比例した第1の
電圧を発生して保持する電圧保持手段と、電路の現在の
電圧に実質的に比例した第2の電圧を発生する電圧発生
手段と、第1の電圧と第2の電圧とを比較する比較手段
と、比較手段の出力が供給されるよう接続された判断手
段とを備え、比較手段は第2の電圧値の第1の電圧値に
対する比率が高レベルのときに電路がON状態である信号
を発生するとともに、第2の電圧値の第1の電圧値に対
する比率が低レベルのときに電路がOFFである信号を発
生し、判断手段は第2の電圧値の第1の電圧値に対する
比率が高レベルのときおよび低レベルのときに電路が正
常であると判断し、第2の電圧値の第1の電圧値に対す
る比率が中レベルのときに電路が異常であることを判断
するよう構成することにより達成される。
The above object is to provide a circuit state detecting device that detects a voltage of a three-phase circuit, generates and holds a first voltage substantially proportional to a normal voltage, and a current holding circuit that detects a current of the circuit. Voltage generating means for generating a second voltage substantially proportional to the voltage, comparing means for comparing the first voltage with the second voltage, and judging means connected to be supplied with the output of the comparing means The comparing means generates a signal indicating that the electric circuit is ON when the ratio of the second voltage value to the first voltage value is at a high level, and compares the second voltage value with respect to the first voltage value. When the ratio is low, a signal indicating that the circuit is OFF is generated, and the determining means determines that the circuit is normal when the ratio of the second voltage value to the first voltage value is high and low. It is determined that the ratio of the second voltage value to the first voltage value is a medium level. Path is achieved by configured to determine that an abnormality.

〔作用〕[Action]

電路状態検出装置に設けられた比較手段は、電路の最
大電圧に基く第1の電圧と、電路の電圧に基く第2の電
圧とを比較して、第2の電圧が第1の電圧に対して所定
の割合以上であるかどうかを判断して電路のON,OFF状態
を判定する。これにより電路の電圧が異なってもその電
圧に対する比率でON,OFFを判定できる。また、電路の1
相が非導通状態であるときは、ON状態とは異なる波形の
出力を発生するので電路の異常を判定できる。
The comparing means provided in the circuit state detecting device compares the first voltage based on the maximum voltage of the circuit with the second voltage based on the voltage of the circuit, and compares the second voltage with the first voltage. Then, it is determined whether the ratio is equal to or more than a predetermined ratio to determine the ON / OFF state of the electric circuit. Thus, even if the voltage of the electric circuit is different, ON / OFF can be determined at a ratio to the voltage. In addition, 1 of electric circuit
When the phase is in a non-conductive state, an output having a waveform different from that in the ON state is generated.

〔実施例〕〔Example〕

以下、本発明の実施例を第1図〜第16図により説明す
る。
Hereinafter, an embodiment of the present invention will be described with reference to FIGS.

本発明の第1実施例における電路状態検出装置を第1
図〜第3図により説明する。
The electric circuit state detecting device according to the first embodiment of the present invention
This will be described with reference to FIGS.

本実施例の電路状態検出装置は3相の電路1に接続さ
れた整流回路10と、整流回路10に接続されて略一定の電
源電圧VCCを発生する電源回路12と、整流回路10の出力
電圧を入力とし、電源回路12から電源電圧VCCが供給さ
れる電圧減衰検出回路14とより成る。整流回路10はダイ
オードD1〜D6を組合わせて成る周知の3相ブリッジ回路
である。電源回路には基準電圧発生用のツエナダイオー
ドZD1と、ツエナダイオードZD1の付加抵抗R1と、ベース
がツエナダイオードZD1のアノードに接続され、コレク
タが整流回路のプラス側出力に接続され、エミッタがダ
イオードD7およびコンデンサC1を介して整流回路のマイ
ナス側出力に接続されたトランジスタQ1とより成る。電
源回路12の出力VCCトランジスタQ1のエミッタに順方向
に接続されたダイオードD7のアノード側より得るよう構
成されている。電圧減衰検出回路14は直列に接続された
抵抗R2、R3とより成る電圧発生手段としての分圧回路10
と、直列に接続されたダイオードD8、抵抗R4、R5および
抵抗R5と並列に接続されたコンデンサC2とから成る電圧
保持手段としての電圧保持回路12と、分圧回路の抵抗R
2、R3により分圧された電圧と、電圧保持回路の抵抗R
4、R5とにより分圧された電圧とをそれぞれ比較器Q2と
により構成される。比較器Q2は電源回路12から電源電圧
VCCが供給され、分圧回路の抵抗R2、R3により分圧され
た電圧V1がプラス側入力に、電圧保持回路の抵抗R4、R5
により分圧された電圧V2がマイナス側入力にそれぞれ供
給される。これにより、第2図(A)に示されるように
分圧回路により供給される電圧V1が電圧保持回路より供
給される電圧V2を越えたときに、比較器Q3に出力が発生
し、電路1に正常に3相交流電圧が印加去れている場合
には比較器Q3の出力V3は第2図(B)に示すように略一
定周期のパルス列となる。いま、整流回路10の出力電
圧、すなわち、A点における電圧V0、ダイオードD8の順
方向電圧降下をVDとすると、V1はV0をR2、R3で分圧した
ときのR3の両端電圧値となり、V2はV0−VDをR4、R5で分
圧したときのR5の両端電圧値をピークとして時定数C2R5
で指数関数的に減少する値となる。ダイオードD8の順方
向電圧降下VDは通常0.8V位であるので、V0値が大きくV0
を無視できる場合には、V2はV0をR4、R5で分圧したとき
のR5の両端電圧値をピークとして時定数C2R5で指数関数
的に減少する値となる。
The circuit state detecting device of the present embodiment includes a rectifier circuit 10 connected to the three-phase circuit 1, a power circuit 12 connected to the rectifier circuit 10 to generate a substantially constant power supply voltage VCC, and an output voltage of the rectifier circuit 10. And a voltage attenuation detection circuit 14 to which a power supply voltage VCC is supplied from the power supply circuit 12. The rectifier circuit 10 is a well-known three-phase bridge circuit formed by combining diodes D1 to D6. The power supply circuit has a Zener diode ZD1 for generating a reference voltage, an additional resistor R1 of the Zener diode ZD1, a base connected to the anode of the Zener diode ZD1, a collector connected to the positive output of the rectifier circuit, and an emitter connected to the diode D7. And a transistor Q1 connected to the negative output of the rectifier circuit via the capacitor C1. The power supply circuit 12 is configured to obtain the output from the anode side of a diode D7 connected to the emitter of the output VCC transistor Q1 in the forward direction. The voltage decay detecting circuit 14 is a voltage dividing circuit 10 as a voltage generating means comprising resistors R2 and R3 connected in series.
A voltage holding circuit 12 as voltage holding means including a diode D8 connected in series, resistors R4, R5 and a capacitor C2 connected in parallel with the resistor R5, and a resistor R of a voltage dividing circuit.
2, The voltage divided by R3 and the resistance R of the voltage holding circuit
4 and the voltage divided by R5 and the comparator Q2. The comparator Q2 receives the power supply voltage from the power supply circuit 12.
VCC is supplied, and the voltage V1 divided by the resistors R2 and R3 of the voltage divider circuit is input to the plus side input, and the resistors R4 and R5 of the voltage holding circuit are
The voltage V2 divided by the above is supplied to the minus input. As a result, when the voltage V1 supplied from the voltage dividing circuit exceeds the voltage V2 supplied from the voltage holding circuit as shown in FIG. When the three-phase AC voltage is normally applied and removed, the output V3 of the comparator Q3 becomes a pulse train having a substantially constant period as shown in FIG. 2 (B). Now, assuming that the output voltage of the rectifier circuit 10, that is, the voltage V0 at the point A and the forward voltage drop of the diode D8 is VD, V1 is the voltage value across R3 when V0 is divided by R2 and R3, and V2 Is the time constant C2R5 with the peak value of the voltage across R5 when V0-VD is divided by R4 and R5.
Becomes a value that decreases exponentially. Since the forward voltage drop VD of the diode D8 is usually about 0.8 V, the V0 value is large and V0
Is negligible, V2 is a value that decreases exponentially with a time constant C2R5 with the voltage value across R5 as a peak when V0 is divided by R4 and R5.

そのため、電圧減衰検出回路14は整流回路出力電圧V0
に関係なくV1>V2が成立するときにHレベルの出力を発
生する。
Therefore, the voltage decay detection circuit 14 outputs the rectifier circuit output voltage V0
H1 is output when V1> V2 holds regardless of the above.

これにより、第3図(A)のようにV0がコンデンサC2
の放電時定数よりも早く降下すると、比較器Q2の出力V3
はLレベルのままとなる。
As a result, as shown in FIG.
Drop faster than the discharge time constant of
Remain at the L level.

これにより、電路1にモータ等の残留電圧を発生する
負荷が接続されていても電路1のON,OFF状態を判別でき
る。
Thus, even if a load such as a motor that generates a residual voltage is connected to the electric circuit 1, the ON / OFF state of the electric circuit 1 can be determined.

電路1に欠相がある場合には第3図(B)に示すよう
に整流回路10の出力はリップルが大きくなり、比較器Q2
の出力V3は正常状態とは異なる周期および異なるデュー
ティ比のパルス列を発生する。これにより、本実施例の
電路状態検出装置は電路電圧にかかりなく電路が正常な
ON状態か、あるいは欠相状態かを判別できる。この判別
を電気的に行うには、1例として出力V3を抵抗R6、コン
デンサC3で積分して電圧の高低に変換し、この電圧を比
較器Q3、Q4により高レベルか、中レベルか、低レベルか
を判定すればよい。判別手段16はこのように構成され、
ON状態で高レベル出力、OFF状態で低レベル出力、欠相
状態で中レベル出力となることにより電路の正常、異常
を判別できる。なお、抵抗R7、R8で分圧された電圧は抵
抗R9、R10で分圧された電圧より高くなるよう設定され
る。また、Q5はAND回路、Q6はNOT回路である。
When there is an open phase in the electric circuit 1, the output of the rectifier circuit 10 has a large ripple as shown in FIG.
Generates a pulse train having a different cycle and a different duty ratio from the normal state. As a result, the circuit state detecting device of the present embodiment has a normal circuit without being affected by the circuit voltage.
It can be determined whether it is in the ON state or the open phase state. In order to make this determination electrically, as an example, the output V3 is integrated by a resistor R6 and a capacitor C3 and converted into a high or low voltage, and this voltage is converted to a high level, a medium level, or a low level by comparators Q3 and Q4. What is necessary is just to judge whether it is a level. The determination means 16 is configured as described above,
The normal or abnormal state of the electric circuit can be determined by the high level output in the ON state, the low level output in the OFF state, and the medium level output in the open phase state. The voltage divided by the resistors R7 and R8 is set to be higher than the voltage divided by the resistors R9 and R10. Q5 is an AND circuit, and Q6 is a NOT circuit.

本発明の第2実施例を第4図〜第9図により説明す
る。
A second embodiment of the present invention will be described with reference to FIGS.

本実施例は電子式コンタクタの故障検出回路に本発明
を適用したものである。
In this embodiment, the present invention is applied to a failure detection circuit of an electronic contactor.

第4回は本実施例における故障検出回路を備えた電子
式コンタクタのブロック図を示すもので、その構成は入
力端子105に接続された入力回路121、次段の制御回路12
2、制御回路122に接続されたトリガ回路123及び遅延回
路124、トリガ回路123により付勢される主回路素子125
から成る接続器102と、負荷側電圧を整流する整流回路1
41と内部回路用電源回路142と負荷側電圧減衰検知回路1
43と、遅延回路124と検知回路143の信号状態によって駆
動される平滑回路144、次段の駆動回路145から成る故障
検出回路によって構成される。
The fourth shows a block diagram of an electronic contactor provided with a failure detection circuit according to the present embodiment, which is composed of an input circuit 121 connected to an input terminal 105, and a control circuit 12 of the next stage.
2. The trigger circuit 123 and the delay circuit 124 connected to the control circuit 122, and the main circuit element 125 activated by the trigger circuit 123.
And a rectifier circuit 1 for rectifying the load side voltage
41, internal circuit power supply circuit 142, and load-side voltage attenuation detection circuit 1
43, a smoothing circuit 144 driven by the signal states of the delay circuit 124 and the detection circuit 143, and a failure detection circuit including a next-stage drive circuit 145.

本実施例の主要部を第5図により説明する。 The main part of this embodiment will be described with reference to FIG.

整流回路141は電路の各相に接続されて電路の電圧を
取り込み、整流して電源回路142および減衰検知回路143
に供給する。電源回路142は定電圧回路で、整流回路141
から供給された電圧を略一定の殿圧にして、電源電圧VC
Cとして故障検出回路143およびリレー108に供給する。
The rectifier circuit 141 is connected to each phase of the electric circuit, takes in the voltage of the electric circuit, rectifies the voltage, and rectifies the power circuit 142 and the attenuation detection circuit 143.
To supply. The power supply circuit 142 is a constant voltage circuit, and the rectifier circuit 141
From the voltage supplied from
C is supplied to the failure detection circuit 143 and the relay 108.

電圧減衰検知回路143は、前記整流回路141の出力を分
圧する抵抗172、173と、非反転入力端子がこの分圧点に
接続された増幅器171と、増幅器171の出力端子に接続さ
れたダイオード174、抵抗175の直列回路に接続されたコ
ンデンサ176、抵抗177の並列回路より成るコンデンサ17
6の正極が増幅器171の反転入力端子に接続されたピーク
ホールド回路と、増幅器171の出力端子に接続され、利
得1となるよう負帰還がかけられてボルテージフォロワ
として動作する増幅器178とで構成されている。平滑回
路144はダイオード179、抵抗180、コンデンサ181の直列
接続より成り、遅延回路124は周知の遅延回路とその出
力に接続されたフォトカプラ発光部107a,平滑回路144の
コンデンサ181に並列接続された抵抗182、発光部107bの
直列接続回路より成る。
The voltage attenuation detection circuit 143 includes resistors 172 and 173 for dividing the output of the rectifier circuit 141, an amplifier 171 having a non-inverting input terminal connected to the voltage dividing point, and a diode 174 connected to an output terminal of the amplifier 171. , A capacitor 176 connected to a series circuit of a resistor 175, and a capacitor 17 formed of a parallel circuit of a resistor 177.
6 comprises a peak hold circuit having a positive electrode connected to the inverting input terminal of the amplifier 171 and an amplifier 178 connected to the output terminal of the amplifier 171 and operated as a voltage follower which is negatively fed back so as to have a gain of 1. ing. The smoothing circuit 144 includes a diode 179, a resistor 180, and a capacitor 181 connected in series, and the delay circuit 124 is connected in parallel to a known delay circuit and a photocoupler light emitting unit 107a connected to the output thereof, and a capacitor 181 of the smoothing circuit 144. It comprises a series connection circuit of the resistor 182 and the light emitting unit 107b.

駆動回路145は平滑回路144のコンデンサ181の正極に
抵抗160を介してベースが接続されたトランジスタ163
と、トランジスタ163のベース、エミッタ間荷それぞれ
並列に接続されたコンデンサ161、抵抗162とより成る。
駆動回路145のトランジスタ163のコレクは故障検出回路
の出力端子106に接続され、出力端子106にはリレー108
と抵抗164との直列回路、およびこの直列回路と並列に
接続されフライホイール回路となるダイオード165が接
続される。
The drive circuit 145 includes a transistor 163 having a base connected to the positive electrode of the capacitor 181 of the smoothing circuit 144 via a resistor 160.
And a capacitor 161 and a resistor 162 connected in parallel to the load between the base and the emitter of the transistor 163, respectively.
The collector of the transistor 163 of the drive circuit 145 is connected to the output terminal 106 of the failure detection circuit, and the output terminal 106 is connected to the relay 108.
And a series circuit of a resistor 164 and a diode 165 connected in parallel with the series circuit and serving as a flywheel circuit.

次にその動作を説明する。第6図波形中の英文字は第
5図の回路図の英文字部の波形を示す。
Next, the operation will be described. The English characters in the waveforms of FIG. 6 indicate the waveforms of the English characters in the circuit diagram of FIG.

主回路素子125が正常オン動作しているときは、減衰
検知回路143の増幅期171は整流回路141の整流波形のリ
ップル毎に非反転入力端子の電圧が反転入力端子の電圧
を越えたときに出力を発生する。これによりD部は
(エ)のようにパルス出力となっているが、制御回路12
2の出力がHレベルであるためフォトカプラ107の発光部
107aが発光し、受光部107bが導通して電流がシンクされ
るため、E部波形は(オ)のようにLレベルとなる。こ
れにより平滑回路144の出力はLレベルとなり、これに
接続された駆動回路145のトランジスタ163は非導通状態
となり、リレー108は励磁されず、主回路素子125が正常
状態であることを示す。
When the main circuit element 125 is operating normally, the amplification period 171 of the attenuation detection circuit 143 is performed when the voltage of the non-inverting input terminal exceeds the voltage of the inverting input terminal for each ripple of the rectified waveform of the rectifying circuit 141. Generate output. As a result, the D section outputs a pulse as shown in FIG.
Since the output of 2 is at the H level, the light emitting portion of the photocoupler 107
Since the light 107a emits light and the light receiving section 107b conducts and current is sunk, the waveform of the section E becomes L level as shown in FIG. As a result, the output of the smoothing circuit 144 becomes L level, the transistor 163 of the driving circuit 145 connected thereto becomes non-conductive, the relay 108 is not excited, and the main circuit element 125 is in a normal state.

次に、正常オン動作しているコンタクタ125の制御回
路からオフ信号(第6図(イ)のH→L)が出されると
A部電圧は減衰する。このとき、電路101の負荷側に電
動機等の残留電圧を発生する負荷が接続されていると、
電路101の負荷側電圧は例えば(ア)の様に減衰に、釈
放時間遅延後、遅延回路出力も(ウ)のようにH→Lと
なる。
Next, when an off signal (H → L in FIG. 6 (a)) is output from the control circuit of the contactor 125 that is operating normally, the voltage at the portion A is attenuated. At this time, if a load that generates a residual voltage such as an electric motor is connected to the load side of the electric circuit 101,
For example, the load side voltage of the electric circuit 101 is attenuated as shown in (a), and after the release time delay, the output of the delay circuit is changed from H to L as shown in (c).

これによりフォトカプラ受光部107bはオフ状態となる
が、D部はすでにパルス出力が無く、コンデンサ181の
電位はE部波形の(オ)に示すようにLレベルのままで
ある。これにより、検出回路出力端子106に接続された
リレー108は励磁されず、主回路素子125が正常状態であ
るかとを示す。
As a result, the photocoupler light receiving unit 107b is turned off, but no pulse is output from the D portion, and the potential of the capacitor 181 remains at the L level as shown in the waveform (e) of the E portion. Accordingly, the relay 108 connected to the detection circuit output terminal 106 is not excited, and indicates whether the main circuit element 125 is in a normal state.

次に主回路素子125が故障した場合について説明す
る。主回路素子125として半導体素子を用いると、定格
を越える電流が流れたときに短絡モードの故障を起こ
す。3相の場合1素子のみの短絡故障時は、他の2素子
により負荷103は正常にオン、オフされ、安全性が確保
することができる。
Next, a case where the main circuit element 125 has failed will be described. When a semiconductor element is used as the main circuit element 125, a short-circuit mode failure occurs when a current exceeding the rating flows. In the case of three phases, when a short circuit fault occurs in only one element, the load 103 is normally turned on and off by the other two elements, so that safety can be ensured.

次に主回路素子125のうち2素子が短絡故障した場合
には、残る正常な1素子がオフしても故障した2素子を
通して欠相状態で負荷103に電流が流れ続け、危険な状
態となる場合がある。
Next, when two of the main circuit elements 125 are short-circuited, current continues to flow to the load 103 in an open phase state through the failed two elements even if the remaining normal one is turned off, resulting in a dangerous state. There are cases.

この場合、前記制御回路122からオフ信号(第6図
(イ)のH→L)が出されるとA部電圧は(カ)のよう
に欠相(単相)波形となる。遅延時間ののち、遅延回路
路出力が(ウ)のようにLレベルになるとフォトカプラ
発光部107aがOFFになり、フォトカプラ受光部107bがオ
フ状態になる。これにより平滑回路144のコンデンサ181
は充電可能な状態となり、電圧減衰検知回路143から供
給される第6図の(キ)に示すパルス波形は抵抗180を
介してコンデンサ181に充電され、第6図(7)Eのよ
うにコンデンサ181の正極の電位が上昇する。これによ
り駆動回路145のトランジスタ163がONとなり、リレー10
8のコイルは励磁されて主回路素子125が故障状態である
ことを示す。リレー108には図示していないが接点が設
けられている。一例として常開接線を用いる場合には、
この常開接点を上位に設けた回路遮蔽器(図示せず)の
磁気引きはずし装置に接続して、故障検出時にこの回路
遮断器より回路を遮断するようにしてもよい。また、一
例として常閉接点を用いる場合には、この常閉接点を上
位に設けた電磁接触器のコイルに接続し、故障検出時に
この電磁接触器により回路を遮断するようにしてもよ
い。また、これらの接点を利用し、必要に応じて表示灯
の点灯、あるいはブザー灯による警報をおこなってもよ
い。
In this case, when an off signal (H → L in FIG. 6 (a)) is output from the control circuit 122, the voltage at the portion A has an open-phase (single-phase) waveform as shown in (f). After the delay time, when the output of the delay circuit becomes L level as shown in (c), the photocoupler light emitting unit 107a is turned off and the photocoupler light receiving unit 107b is turned off. As a result, the capacitor 181 of the smoothing circuit 144
Is in a chargeable state, the pulse waveform shown in FIG. 6G supplied from the voltage decay detection circuit 143 is charged to the capacitor 181 via the resistor 180, and the capacitor is charged as shown in FIG. The potential of the positive electrode 181 increases. As a result, the transistor 163 of the drive circuit 145 is turned on, and the relay 10 is turned on.
The coil 8 is excited to indicate that the main circuit element 125 is in a fault state. Although not shown, the relay 108 is provided with a contact. When using a normally open tangent as an example,
The normally open contact may be connected to a magnetic trip device of a circuit shield (not shown) provided at a higher position, and the circuit may be interrupted by the circuit breaker when a failure is detected. When a normally closed contact is used as an example, the normally closed contact may be connected to a coil of an electromagnetic contactor provided at an upper position, and the circuit may be shut off by the electromagnetic contactor when a failure is detected. In addition, using these contacts, an indicator lamp may be turned on or a buzzer lamp may be used to issue an alarm if necessary.

本実施例によれば、遅延時間を設定する必要がなく、
しかも短絡故障時の負荷電圧の最初のピーク時に動作で
きるので高速である。又、ツェナダイオード等の固定設
定電圧を使用せず。正常時の電圧を基準電圧として使っ
ているので、例えば100V〜200Vという広範囲な電圧に対
して高速に動作できる効果がある。なお、ツェナ電圧を
基準電圧とした場合は、故障時に負荷電圧が基準電圧に
まで減衰する時間が、電圧クラスにより異なるため狭い
範囲の電圧にしか対応できず、例えば100V,200V共用可
能な装置を得ることができない。
According to the present embodiment, there is no need to set a delay time,
Moreover, the operation can be performed at the first peak of the load voltage at the time of the short-circuit failure, so that the operation speed is high. Also, do not use a fixed setting voltage such as a Zener diode. Since the normal voltage is used as the reference voltage, there is an effect that high-speed operation can be performed with respect to a wide voltage range of, for example, 100V to 200V. When the zener voltage is used as the reference voltage, the time required for the load voltage to attenuate to the reference voltage in the event of a failure differs depending on the voltage class, so that it can only handle a narrow range of voltages. I can't get it.

本実施例の変形例を第7図〜第9図により説明する。 A modification of this embodiment will be described with reference to FIGS.

本実施例の第1の変形例を第7図に示す。 FIG. 7 shows a first modification of the present embodiment.

本変形例は、第4図の平滑回路144をラッチ回路146に
したものである。ラッチ回路146は、周知のサイリス
タ、ラッチ用ICなどを使用したものでよい。これによ
り、コンデンサ容量のばらつきによる動作時間のばらつ
きをなくすことができ、正確な動作特性を得ることがで
きる。
In this modification, the smoothing circuit 144 in FIG. The latch circuit 146 may use a well-known thyristor, latch IC, or the like. This makes it possible to eliminate variations in operating time due to variations in capacitor capacitance, and to obtain accurate operating characteristics.

本実施例の第2の変形例を第8図に示す。 FIG. 8 shows a second modification of the present embodiment.

本変形例は、平滑回路144に比較器182を追加したもの
で、本変形例によれば、高インピーダンス入力であるた
め、コンデンサ181のリップルを小さくする効果があ
る。
In this modification, a comparator 182 is added to the smoothing circuit 144. According to this modification, since the input is a high impedance, the ripple of the capacitor 181 is reduced.

本実施例の第3の変形例を第9図に示す。 FIG. 9 shows a third modification of the present embodiment.

本変形例は電圧減衰検知回路自体に遅延特性をもた
せ、遅延回路124を用いずに同様の機能を得るものであ
る。本変形例における電圧減衰検知回路148は、制御回
路122のON信号、OFF信号をフォトカプラ107を介して電
源減衰検知回路148に伝達し、この信号によりアナログ
スイッチ190を導通、または非道通の状態にさせて、こ
の状態をアナログスイッチ190と直列に接続された微分
回路を介して他のアナログスイッチ191に伝達して遅延
を得るようにしたものである。
In this modification, the voltage attenuation detection circuit itself has a delay characteristic, and a similar function is obtained without using the delay circuit 124. The voltage attenuation detection circuit 148 in this modification transmits the ON signal and the OFF signal of the control circuit 122 to the power supply attenuation detection circuit 148 via the photocoupler 107, and the analog switch 190 is turned on or off by this signal. Then, this state is transmitted to another analog switch 191 via a differentiating circuit connected in series with the analog switch 190 to obtain a delay.

制御回路122からON信号出力時、アナログスイッチ190
のC端子はLOWとなり、i−o間は非導通となるので、
アナログスイッチ191のC端子もLOWとなり、i−o間非
導通となるため、次段のピークホールド回路コンデンサ
176は抵抗173のピーク電圧に充電される。
When an ON signal is output from the control circuit 122, the analog switch 190
C terminal becomes LOW, and between i-o becomes non-conductive.
Since the C terminal of the analog switch 191 also becomes LOW and becomes non-conductive between i and o, the capacitor of the next stage peak hold circuit
176 is charged to the peak voltage of the resistor 173.

次に制御回路122からOFF信号出力時、アナログスイッ
チ190のC端子はHighとなり、i−o間は導通となるた
め、アナログスイッチ191のc端子は、微分回路コンデ
ンサ194と抵抗193および、195とにより構成された微分
回路により、Highレベルから、漸次電位が下がり、微分
回路時定数による一定時間後にLowとなる。よってアナ
ログスイッチ191のi−o間は、c端子がHighの時に導
通、即ち比較器171の非反転入力端子はほぼ0となるの
で、次段のコンデンサ181の電位はほぼ0となり、アナ
ログスイッチ191が非導通となるまで、電圧減衰検知回
路出力を遅延させることができる。
Next, when an OFF signal is output from the control circuit 122, the C terminal of the analog switch 190 becomes High, and conduction is performed between i and o. Therefore, the c terminal of the analog switch 191 is connected to the differential circuit capacitor 194, the resistors 193, and 195. , The potential gradually decreases from the high level, and goes low after a certain period of time according to the time constant of the differentiating circuit. Accordingly, between i and o of the analog switch 191, conduction is performed when the terminal c is high, that is, the non-inverting input terminal of the comparator 171 is almost 0, so that the potential of the capacitor 181 at the next stage becomes almost 0, and The output of the voltage decay detection circuit can be delayed until becomes nonconductive.

本実施例によれば、負荷電圧、三相2素子短絡、三相
3素子短絡、負荷残留電圧の減衰特性によらず、常に釈
放時間遅延後の負荷電圧の最初のピークで、短絡故障検
出ができるので、例えば100V,200V共用などの広範囲な
電圧に適用可能であり、種々の負荷に対して無調整で高
速動作可能な、汎用性のある故障検出回路を達成できる
効果がある。
According to the present embodiment, regardless of the load voltage, the three-phase two-element short-circuit, the three-phase three-element short-circuit, and the decay characteristic of the load residual voltage, the short-circuit failure detection is always performed at the first peak of the load voltage after the release time delay. Therefore, the present invention can be applied to a wide range of voltages, for example, common use of 100 V and 200 V, and has an effect of achieving a general-purpose failure detection circuit that can operate at high speed without adjustment for various loads.

本発明の第3実施例を第10図〜第16図により説明す
る。
A third embodiment of the present invention will be described with reference to FIGS.

本実施例は可逆形の電子式コンタクタに本発明を適用
したものである。
In this embodiment, the present invention is applied to a reversible electronic contactor.

従来の故障検出装置は、例えば実開昭61−157214号記
載のように、負荷電圧と導通信号とが不一致の場合に素
子の短絡故障として検出するようになっていた。しか
し、可逆形電子コンタクタの故障検出については配慮さ
れておらず、これを単に可逆形電子式コンタクタに適用
した場合には、例えば、正転時、逆転用接触器は非導通
入力となっているが、負荷電圧は略電源電圧が印加され
ているため、故障検出回路が逆転用接触器に内蔵されて
いるときは、正常であっても故障である信号を発生して
しまうという問題があった。
A conventional failure detection device detects a short-circuit failure of an element when a load voltage and a conduction signal do not match, as described in Japanese Utility Model Application Laid-Open No. 61-157214, for example. However, no consideration is given to failure detection of the reversible electronic contactor, and when this is simply applied to the reversible electronic contactor, for example, during forward rotation, the reverse contactor has a non-conductive input. However, since the power supply voltage is substantially applied to the load voltage, when the failure detection circuit is built in the reverse contactor, there is a problem that a signal indicating a failure is generated even if it is normal. .

本実施例は、故障検出回路内蔵の接触器又は各々の接
触器に故障検出回路が設置された場合にあっては、導通
接触器の信号で非導通接触器の故障検出回路の動作を禁
止(ロック)するか、あるいは、正転、逆転の論理和出
力と、負荷電圧の論理(該論理和出力があり、負荷電圧
が零の場合は開放故障、逆の場合は短絡故障)により故
障検出することにより可逆形電子式コンタクタにも適用
し得る故障検出回路を得るものである。
In the present embodiment, when a failure detection circuit is installed in a contactor with a built-in failure detection circuit or each contactor, the operation of the failure detection circuit of the non-conduction contactor is prohibited by the signal of the conduction contactor ( Lock), or a failure is detected by the logical sum output of normal rotation and reverse rotation and the logic of the load voltage (there is an output of the logical sum, the open fault occurs when the load voltage is zero, and the short-circuit fault occurs when the load voltage is reverse). Thus, a failure detection circuit applicable to a reversible electronic contactor can be obtained.

第10図は、本実施例における故障検出回路内蔵のソリ
ッドステートコンタクタの内部ブロック図と可逆接続を
示したのである。正転用コンタクタ201と逆転用コンタ
クタ202とは同一構成であるため、正転用について説明
する。電源回路280は入力回路281、制御回路282に電源
を供給する。入力回路281は例えば交流入力にあっては
リップルを平滑する回路で構成される。制御回路282
は、入力信号が、所定の電圧範囲にあるか否かを判断
し、後段回路の動作、不動作を決定する。制御回路282
の一方の出力はゲート回路283を介し主スイッチング素
子288を導通させ、他方の出力は、遅延回路284を介して
導通、非導通信号を故障検出回路285、可逆インタロッ
ク回路287、および故障検出インタロック回路286へ伝達
する。
FIG. 10 shows an internal block diagram and a reversible connection of the solid state contactor having a built-in failure detection circuit according to the present embodiment. Since the forward contactor 201 and the reverse contactor 202 have the same configuration, the forward rotation will be described. The power supply circuit 280 supplies power to the input circuit 281 and the control circuit 282. The input circuit 281 is composed of, for example, a circuit for smoothing a ripple in an AC input. Control circuit 282
Determines whether the input signal is within a predetermined voltage range, and determines the operation or non-operation of the subsequent circuit. Control circuit 282
One output of the main switching element 288 is turned on through a gate circuit 283, and the other output is turned on and off by a delay circuit 284 to output a failure detection circuit 285, a reversible interlock circuit 287, and a failure detection interface. The signal is transmitted to the lock circuit 286.

今、正転投入スイッチ206がオンしたとすると、可逆
インタロック回路287は端子213、224を介し逆転用コン
タクタ202の入力回路291又は制御回路292又はゲート回
路293のいずれかをロックする。これにより、逆転用コ
ンタクタ202は非導通となる。また、故障検出インタロ
ック回路286は端子212、226を介し、故障検出回路295を
ロックするので、正転用コンタクタ201のみの回路動作
となる。
Now, assuming that the forward rotation switch 206 is turned on, the reversible interlock circuit 287 locks either the input circuit 291 or the control circuit 292 or the gate circuit 293 of the reverse contactor 202 via the terminals 213 and 224. Thereby, the reverse contactor 202 becomes non-conductive. Further, the failure detection interlock circuit 286 locks the failure detection circuit 295 via the terminals 212 and 226, so that only the forward contactor 201 operates.

正転用コンタクタ201の内部回路を第11図に示す。故
障検出回路285はフォトカプラ217を介して遅延回路に接
続されている。なお、故障検出回路285内でD203〜D208
は整流用のダイオード、RY201はリレーで、共通接点215
cと常開接点215a,常閉接点215bとを有している。
FIG. 11 shows an internal circuit of the forward contactor 201. The failure detection circuit 285 is connected to the delay circuit via the photo coupler 217. Note that D203 to D208 in the failure detection circuit 285.
Is a diode for rectification, RY201 is a relay, common contact 215
c, a normally open contact 215a, and a normally closed contact 215b.

第11図において、R201〜211は抵抗器、D201ダイオー
ドブリッジ、D202〜D208はダイオード、C201〜C203はコ
ンデンサ、Q201はトランジスタ、Q202は比較器、Q203は
反転回路、Q204はバッファ、Q205〜Q209はフォトカプ
ラ、211a,211bは制御信号の入力端子、214a,214bは逆転
用コンタクタの可逆インタロック回路からのインタロッ
ク信号の入力端子、212a,212bは故障検出インタロック
回路の出力端子、213a,213bは可逆インタロック回路の
出力端子、216a,216bは逆転用コンタクタの故障検出回
路を不動作状態にロックする信号の出力端子である。ま
た、283a,283b,283cは電路の各相のスイッチング素子28
8のゲート回路である。
In FIG. 11, R201 to 211 are resistors, D201 diode bridge, D202 to D208 are diodes, C201 to C203 are capacitors, Q201 is a transistor, Q202 is a comparator, Q203 is an inverting circuit, Q204 is a buffer, and Q205 to Q209 are Photocouplers, 211a and 211b are control signal input terminals, 214a and 214b are interlock signal input terminals from the reversible interlock circuit of the reverse contactor, 212a and 212b are failure detection interlock circuit output terminals, 213a and 213b. Is an output terminal of the reversible interlock circuit, and 216a and 216b are output terminals of a signal for locking the failure detection circuit of the reverse contactor to an inoperative state. 283a, 283b, 283c are switching elements 28 of each phase of the electric circuit.
8 gate circuits.

本実施例によれば、故障検出回路内蔵のソリットステ
ートコンタクタでも、可逆形であっては互いに他方の故
障検出回路をロックするので、誤検出することがない。
According to the present embodiment, even in the case of the solid state contactor with a built-in failure detection circuit, the reversible type locks the other failure detection circuits with each other, so that there is no erroneous detection.

第12図および第13図は、本実施例の実装図を示す図
で、インタロック信号授受端子212a,212b,213a,213b,21
4a,214b,216a,216bはプリント基板実装用のリセプタク
ル215とし、フラットケーブル253で他方のリセプタクル
252と接続するものである。
FIG. 12 and FIG. 13 are views showing a mounting diagram of the present embodiment, in which interlock signal transfer terminals 212a, 212b, 213a, 213b, 21
4a, 214b, 216a, and 216b are receptacles 215 for mounting on a printed circuit board, and the other receptacle is a flat cable 253.
Connect with 252.

本実施例によれば、非可逆形にあっては、単体でその
まま使用でき、可逆形にあってはコネクタで簡単にイン
タロックを得ることができると共に、ねじ端子に比べ実
装スペースを小さくすることができる。
According to this embodiment, the non-reversible type can be used alone as it is, and the reversible type can easily obtain an interlock with a connector, and the mounting space can be reduced as compared with the screw terminal. Can be.

本実施例の第1変形例を第14図、第15図に示す。 FIGS. 14 and 15 show a first modification of the present embodiment.

本変形例は、正転用コンタクタ、逆転用コンタクタを
同一のヒートシンク上に取り付け、インタロック信号等
の授受を互いに対向して設けられたフォトダイオードお
よびフォトトランジスタにより行うよう構成したもので
ある。
In this modification, a forward contactor and a reverse contactor are mounted on the same heat sink, and transmission and reception of an interlock signal and the like are performed by a photodiode and a phototransistor provided to face each other.

本変形例によれば、正転用コンタクタと逆転用コンタ
クタとを隣接して設けるだけでインタロックをとること
ができる。
According to the present modification, the interlock can be obtained simply by providing the forward contactor and the reverse contactor adjacent to each other.

本実施例の第2変形例を第16図に示す。 FIG. 16 shows a second modification of the present embodiment.

本変形例は、可逆用故障検出ユニット208を別置した
もので、正転入力、逆転入力の論理和出力と、負荷電圧
との論理で、検出するもので、該論理和出力がなく、負
荷電圧がある場合に短絡故障と検出するよう成したもの
である。
In this modification, the reversible failure detection unit 208 is separately provided, and is detected by the logic of the logical sum output of the normal rotation input and the reverse rotation input and the load voltage. When a voltage is present, a short-circuit fault is detected.

本変形側によれば、検出回路が一つで良いため、経済
的である。
According to the present modified side, it is economical because only one detection circuit is required.

本実施例によれば、可逆形の場合でも主スイッチング
素子の故障検出ができるので、システムの安全性を高め
る効果がある。
According to this embodiment, the failure of the main switching element can be detected even in the case of the reversible type, so that there is an effect of improving the safety of the system.

〔発明の効果〕〔The invention's effect〕

本発明によれば、広範な電圧範囲で使用可能で異なる
電圧範囲にわたって製品を共用することが可能な電路状
態検出装置およびそれを用いた電気装置を得ることがで
きる。
ADVANTAGE OF THE INVENTION According to this invention, the electric circuit state detection apparatus which can be used in a wide voltage range and can share a product over a different voltage range, and an electric device using the same can be obtained.

【図面の簡単な説明】[Brief description of the drawings]

第1図は本発明の第1実施例における電路状態検出装置
の構成を示す電気回路図、第2図(A),(B)はそれ
ぞれ本実施例における比較器の入力波形および出力波形
を示す図、第3図(A),(B)はそれぞれ電路が正常
な場合および電路が欠相した場合における電路状態検出
装置の入力波形と出力波形とをそれぞれ示す図、第4図
は本発明の第2実施例における電路状態検出装置を故障
検出回路に用いた電子式コンタクタの構成を示すブロッ
ク図、第5図は本実施例における故障検出回路部の具体
的構成を示す電気回路図、第6図(ア)〜(オ)は正常
な場合における第5図A〜E部の波形をそれぞれ示す
図、第6図(カ)〜(ク)は故障時における第5図A,D,
E部の波形をそれぞれ示す図、第7図は本実施例の第1
変形例の主要部を示すブロック図、第8図は本実施例の
第2変形例の主要部を示す電気回路図、第9図は本実施
例の第3変形側の主要部を示す電気回路図、第10図は本
発明の第3実施例における電路状態検出装置を用いた故
障検出回路を備えた可逆インタロック付電子式コンタク
タの構成を示すブロック図、第11図は本実施例の主要部
の構成を示す電気回路図、第12図は本実施例実装時の各
端子間の配線を示す電子回路図、第13図は本実施例の実
装状態を示す斜視図、第14図、第15図はそれぞれ本実施
例の第1変形例の主要部を示す平面断面図および正面断
面図、第16図は本実施例の第2変形例を示す電気回路図
である。 10、110:電圧発生手段、12、112:電圧保持手段、16:判
別手段、104、285、295:故障検出回路、125、288、298:
開閉手段、144:制御手段、145:出力手段、171、Q2:比較
手段
FIG. 1 is an electric circuit diagram showing a configuration of an electric circuit state detecting device according to a first embodiment of the present invention, and FIGS. 2A and 2B show an input waveform and an output waveform of a comparator in the present embodiment, respectively. FIGS. 3 (A) and 3 (B) show the input waveform and the output waveform of the circuit condition detecting device when the circuit is normal and when the circuit is out of phase, respectively. FIG. 4 shows the present invention. FIG. 5 is a block diagram showing a configuration of an electronic contactor using the circuit state detecting device in the second embodiment for a failure detection circuit. FIG. 5 is an electric circuit diagram showing a specific configuration of a failure detection circuit unit in the present embodiment. FIGS. 5A to 5E show waveforms of portions A to E in a normal case, and FIGS. 5A to 5C show waveforms at the time of failure in FIGS.
FIG. 7 is a diagram showing waveforms of the portion E, and FIG.
FIG. 8 is a block diagram showing a main part of a modification, FIG. 8 is an electric circuit diagram showing a main part of a second modification of the embodiment, and FIG. 9 is an electric circuit showing a main part of a third modification of the embodiment. FIG. 10 is a block diagram showing a configuration of an electronic contactor with a reversible interlock provided with a failure detection circuit using a circuit state detecting device according to a third embodiment of the present invention. FIG. FIG. 12 is an electronic circuit diagram showing wiring between terminals when the present embodiment is mounted, FIG. 13 is a perspective view showing a mounting state of the present embodiment, FIG. 14, FIG. FIG. 15 is a plan sectional view and a front sectional view showing a main part of a first modification of the present embodiment, and FIG. 16 is an electric circuit diagram showing a second modification of the present embodiment. 10, 110: voltage generation means, 12, 112: voltage holding means, 16: determination means, 104, 285, 295: failure detection circuit, 125, 288, 298:
Opening / closing means, 144: control means, 145: output means, 171, Q2: comparison means

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】3相の電路の電圧を検出してその正常時の
電圧に実質的に比例した第1の電圧を発生して保持する
電圧保持手段と、前記電路の現在の電圧に実質的に比例
した第2の電圧を発生する電圧発生手段と、前記第1の
電圧と前記第2の電圧とを比較する比較手段と、該比較
手段の出力が供給されるよう接続された判断手段とを備
え、前記比較手段は前記第2の電圧値の前記第1の電圧
値に対する比率が高レベルのときに電路がON状態である
信号を発生するとともに、前記第2の電圧値の前記第1
の電圧値に対する比率が低レベルのときに電路がOFFで
ある信号を発生し、前記判断手段は前記第2の電圧値の
前記第1の電圧値に対する比率が高レベルのときおよび
低レベルのときに電路が正常であると判断し、前記第2
の電圧値の前記第1の電圧値に対する比率が中レベルの
ときに電路が異常であることを判断するよう構成された
ことを特徴とする電路状態検出装置。
1. Voltage holding means for detecting a voltage of a three-phase circuit and generating and holding a first voltage substantially proportional to a normal voltage, and a voltage substantially equal to a current voltage of the circuit. Voltage generating means for generating a second voltage proportional to the first voltage, comparing means for comparing the first voltage with the second voltage, and determining means connected to be supplied with the output of the comparing means. Wherein the comparing means generates a signal indicating that an electric circuit is ON when a ratio of the second voltage value to the first voltage value is at a high level, and outputs the first voltage of the second voltage value to the first voltage value.
When the ratio of the second voltage value to the first voltage value is low and the ratio of the second voltage value to the first voltage value is low. It is determined that the electric circuit is normal, and the second
An electric circuit condition detecting device configured to judge that the electric circuit is abnormal when a ratio of the voltage value to the first voltage value is at a middle level.
【請求項2】3相の電路に接続されて制御信号によりON
状態およびOFF状態のいずれか一方となるよう制御され
る開閉手段と、該開閉手段の2次側に設けられて該開閉
手段の故障を検出する故障検出回路とを備えてなる電気
装置において、前記故障検出回路は前記電路の電圧を検
出してその正常時の電圧に実質的に比例した第1の電圧
を発生して保持する電圧保持手段と、前記電路の現在の
電圧に実質的に比例した第2の電圧を発生する電圧発生
手段と、前記第1の電圧と前記第2の電圧とを比較する
比較手段と、該比較手段の出力を前記開閉手段の制御信
号に基づいて制御する制御手段と、該制御手段の出力に
基づいて出力を発生する出力手段とを備え、前記比較手
段は前記第2の電圧値の前記第1の電圧値に対する比率
が高レベルのときに電路がON状態である信号を発生する
とともに前記第2の電圧値の前記第1の電圧値に対する
比率が低レベルのときに電路がOFFである信号を発生す
るよう構成され、前記制御手段は前記開閉手段をOFFに
する制御信号が前記制御手段に与えられたときに前記比
較手段の出力を前記出力手段に伝達するよう構成され、
該出力手段が出力を発生することにより前記開閉手段の
異常を検出するよう構成されたことを特徴とする電気装
置。
2. Connected to a three-phase electric circuit and turned on by a control signal
An electrical device comprising: a switching unit controlled to be in one of a state and an OFF state; and a failure detection circuit provided on a secondary side of the switching unit and detecting a failure of the switching unit. A failure detecting circuit for detecting a voltage of the electric circuit and generating and holding a first voltage substantially proportional to the normal voltage; and a voltage holding means for substantially generating a first voltage substantially proportional to a current voltage of the electric circuit. Voltage generating means for generating a second voltage, comparing means for comparing the first voltage with the second voltage, and control means for controlling an output of the comparing means based on a control signal of the switching means And an output means for generating an output based on the output of the control means, wherein the comparing means sets the electric circuit in an ON state when a ratio of the second voltage value to the first voltage value is at a high level. To generate a signal and the second When the ratio of the pressure value to the first voltage value is at a low level, the control circuit is configured to generate a signal that the electric circuit is off, and the control means is provided with a control signal for turning off the open / close means to the control means. Is configured to transmit the output of the comparing means to the output means when
An electric device, wherein the output means generates an output to detect an abnormality of the opening / closing means.
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