JP2960835B2 - 低雑音コンバータ回路 - Google Patents
低雑音コンバータ回路Info
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- JP2960835B2 JP2960835B2 JP16678593A JP16678593A JP2960835B2 JP 2960835 B2 JP2960835 B2 JP 2960835B2 JP 16678593 A JP16678593 A JP 16678593A JP 16678593 A JP16678593 A JP 16678593A JP 2960835 B2 JP2960835 B2 JP 2960835B2
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- semiconductor integrated
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Description
【０００１】
【産業上の利用分野】本発明は、受信アンテナで受信し
た放送衛星からの信号を増幅および周波数変換してチュ
ーナ回路に出力する低雑音コンバータ回路に関する。
た放送衛星からの信号を増幅および周波数変換してチュ
ーナ回路に出力する低雑音コンバータ回路に関する。
【０００２】
【従来の技術】ローノイズ・ブロック・ダウン・コンバ
ータ（以下、ＬＮＢ、という）は受信アンテナで受信し
た周波数１０数ＧＨｚの水平偏波信号および垂直偏波信
号を低雑音増幅し、さらに周波数１ＧＨｚ前後の中間周
波信号に変換して後段のチューナ回路に出力するもので
ある。
ータ（以下、ＬＮＢ、という）は受信アンテナで受信し
た周波数１０数ＧＨｚの水平偏波信号および垂直偏波信
号を低雑音増幅し、さらに周波数１ＧＨｚ前後の中間周
波信号に変換して後段のチューナ回路に出力するもので
ある。
【０００３】図４に示す従来のＬＮＢ回路は、水平およ
び垂直偏波信号を同時に受信して出力する２出力型の回
路で、各偏波信号毎に構成した２系統の回路によって各
偏波信号を増幅および周波数変換するもので、各系の混
合回路には１つの局部発振器から局部発振信号が２分割
して供給されている。
び垂直偏波信号を同時に受信して出力する２出力型の回
路で、各偏波信号毎に構成した２系統の回路によって各
偏波信号を増幅および周波数変換するもので、各系の混
合回路には１つの局部発振器から局部発振信号が２分割
して供給されている。
【０００４】すなわち、この回路は入力端子２１に入力
した水平偏波信号ＨＰを３段構成のＨＥＭＴ（高電子移
動度トランジスタ）素子からなる低雑音増幅回路（以
下、ＬＮＡ、という）２２で増幅し、混合回路２３で局
部発振器２４からの局部発振信号Ｌo と混合して中間周
波信号ＩＨに変換し、スイッチ回路２５を経て２段構成
の中間周波増幅回路（以下、ＩＦＡ、という）２６（ま
たは２７）で適切なレベルの信号に増幅して出力端子２
８（または２９）から出力する。
した水平偏波信号ＨＰを３段構成のＨＥＭＴ（高電子移
動度トランジスタ）素子からなる低雑音増幅回路（以
下、ＬＮＡ、という）２２で増幅し、混合回路２３で局
部発振器２４からの局部発振信号Ｌo と混合して中間周
波信号ＩＨに変換し、スイッチ回路２５を経て２段構成
の中間周波増幅回路（以下、ＩＦＡ、という）２６（ま
たは２７）で適切なレベルの信号に増幅して出力端子２
８（または２９）から出力する。
【０００５】また、入力端子３０に入力した垂直偏波信
号ＶＰを、ＬＮＡ２２と同一構成のＬＮＡ３１で低雑音
増幅し、混合回路３２で局部発振器２４からの局部発振
信号Ｌo と混合して中間周波信号ＩＶ に変換し、スイ
ッチ回路２５を経て２段構成のＩＦＡ２７（または２
６）で適切なレベルの信号に増幅して出力端子２９（ま
たは２８）から出力する。
号ＶＰを、ＬＮＡ２２と同一構成のＬＮＡ３１で低雑音
増幅し、混合回路３２で局部発振器２４からの局部発振
信号Ｌo と混合して中間周波信号ＩＶ に変換し、スイ
ッチ回路２５を経て２段構成のＩＦＡ２７（または２
６）で適切なレベルの信号に増幅して出力端子２９（ま
たは２８）から出力する。
【０００６】図５は、局部発振器２４から２つの混合回
路２３，３２にＹ形電力分配器３３を通して局部発振信
号Ｌo を供給する構成を示した図である。また、図６
は、ミキサ素子としてガリウム砒素ショットキダイオー
ドを用いた混合回路２３，３２を、局部発振器２４に対
して互いに対称となるように配置することで高アイソレ
ーション（水平偏波信号と垂直偏波信号との分離度）を
得ることができた構成である。
路２３，３２にＹ形電力分配器３３を通して局部発振信
号Ｌo を供給する構成を示した図である。また、図６
は、ミキサ素子としてガリウム砒素ショットキダイオー
ドを用いた混合回路２３，３２を、局部発振器２４に対
して互いに対称となるように配置することで高アイソレ
ーション（水平偏波信号と垂直偏波信号との分離度）を
得ることができた構成である。
【０００７】
【発明が解決しようとする課題】ところで、混合回路と
してダイオードミキサを使用した場合、混合回路には増
幅作用がないためＬＮＡの増幅素子を多段構成としなけ
ればならず、回路基板の小型化が困難となる。
してダイオードミキサを使用した場合、混合回路には増
幅作用がないためＬＮＡの増幅素子を多段構成としなけ
ればならず、回路基板の小型化が困難となる。
【０００８】そこで、増幅素子とミキサ素子とを含むＭ
ＭＩＣ（マイクロ波モノリシック集積回路）を使用して
低コスト化および小型化を実現するようにしたコンバー
タ回路が提案されている。しかし、ミキサ素子としてＦ
ＥＴ（電界効果トランジスタ）やＨＥＭＴ素子またはこ
れらのアクティブ素子を含むＭＭＩＣを使用する場合、
局部発振器と２つのＭＭＩＣとをＹ形電力分配器で接続
すると、ＭＭＩＣ間での影響がダイオードミキサに比べ
て大きくなり、アイソレーションが悪化するという不都
合がある。
ＭＩＣ（マイクロ波モノリシック集積回路）を使用して
低コスト化および小型化を実現するようにしたコンバー
タ回路が提案されている。しかし、ミキサ素子としてＦ
ＥＴ（電界効果トランジスタ）やＨＥＭＴ素子またはこ
れらのアクティブ素子を含むＭＭＩＣを使用する場合、
局部発振器と２つのＭＭＩＣとをＹ形電力分配器で接続
すると、ＭＭＩＣ間での影響がダイオードミキサに比べ
て大きくなり、アイソレーションが悪化するという不都
合がある。
【０００９】また、ＭＭＩＣの構造上、ピン配置が１通
りであるため、図７に示すように、Ｙ形電力分配器３３
と２つのＭＭＩＣ４１，４２とを接続する場合、ＭＭＩ
Ｃ４１，４２の局発入力ピンがこの図においては共にパ
ッケージの下側に位置しているため、ＭＭＩＣ４２の配
線は破線で示すように迂回しなければならず、局部発振
器２４に対して２つのＭＭＩＣ４１，４２を対称に配置
できないことになる。このため、局部発振信号Ｌo をＭ
ＭＩＣ４１，４２に均等に分配できないといった不都合
が生じる。
りであるため、図７に示すように、Ｙ形電力分配器３３
と２つのＭＭＩＣ４１，４２とを接続する場合、ＭＭＩ
Ｃ４１，４２の局発入力ピンがこの図においては共にパ
ッケージの下側に位置しているため、ＭＭＩＣ４２の配
線は破線で示すように迂回しなければならず、局部発振
器２４に対して２つのＭＭＩＣ４１，４２を対称に配置
できないことになる。このため、局部発振信号Ｌo をＭ
ＭＩＣ４１，４２に均等に分配できないといった不都合
が生じる。
【００１０】そこで、本発明は局部発振信号の電力を２
つの混合回路に均等に２分割して供給し、かつ回路基板
の小型を図ることを目的とする。
つの混合回路に均等に２分割して供給し、かつ回路基板
の小型を図ることを目的とする。
【００１１】
【課題を解決するための手段】本発明は、受信アンテナ
で受信した水平および垂直偏波信号を中間周波信号に変
換して出力する２出力型の低雑音コンバータ回路におい
て、水平および垂直偏波信号を中間周波信号に変換する
ミキサ素子を含む第１および第２のマイクロ波半導体集
積回路と、第１および第２のマイクロ波半導体集積回路
に局部発振信号を供給する局部発振器と、局部発振器と
第１および第２のマイクロ波半導体集積回路とを接続す
るＹ形電力分配器とを設け、第１および第２の半導体集
積回路は、局部発振器に対しＹ形電力分配器を介して互
いに対称となる位置に配置されるように互いに異なるピ
ン配置を有するように構成する。
で受信した水平および垂直偏波信号を中間周波信号に変
換して出力する２出力型の低雑音コンバータ回路におい
て、水平および垂直偏波信号を中間周波信号に変換する
ミキサ素子を含む第１および第２のマイクロ波半導体集
積回路と、第１および第２のマイクロ波半導体集積回路
に局部発振信号を供給する局部発振器と、局部発振器と
第１および第２のマイクロ波半導体集積回路とを接続す
るＹ形電力分配器とを設け、第１および第２の半導体集
積回路は、局部発振器に対しＹ形電力分配器を介して互
いに対称となる位置に配置されるように互いに異なるピ
ン配置を有するように構成する。
【００１２】この場合、第１および第２の半導体集積回
路は、共にＹ形電力分配器側に局部発振信号入力ピンを
有し、それぞれコンデンサを介してＹ形電力分配器に接
続されている。
路は、共にＹ形電力分配器側に局部発振信号入力ピンを
有し、それぞれコンデンサを介してＹ形電力分配器に接
続されている。
【００１３】
【作用】本発明の構成において、第１および第２のマイ
クロ波半導体集積回路は、局部発振器に対して互いに対
称の位置に配置されるように互いに異なるピン配置、例
えば共にＹ形電力分配器側に局部発振信号入力ピンを有
している。このため、局部発振器からの局部発振信号は
Ｙ形電力分配器を介して均等に２分配されて供給され
る。
クロ波半導体集積回路は、局部発振器に対して互いに対
称の位置に配置されるように互いに異なるピン配置、例
えば共にＹ形電力分配器側に局部発振信号入力ピンを有
している。このため、局部発振器からの局部発振信号は
Ｙ形電力分配器を介して均等に２分配されて供給され
る。
【００１４】
【実施例】図１は、本発明によるコンバータ回路の一実
施例を示すブロック図である。本実施例は、水平偏波信
号ＨＰが入力される入力端子１と垂直偏波信号ＶＰが入
力される入力端子２とを備え、入力端子１は２段構成の
ＨＥＭＴ素子からなるＬＮＡ３に接続され、入力端子２
は同じく２段構成のＨＥＭＴ素子からなるＬＮＡ４に接
続されている。
施例を示すブロック図である。本実施例は、水平偏波信
号ＨＰが入力される入力端子１と垂直偏波信号ＶＰが入
力される入力端子２とを備え、入力端子１は２段構成の
ＨＥＭＴ素子からなるＬＮＡ３に接続され、入力端子２
は同じく２段構成のＨＥＭＴ素子からなるＬＮＡ４に接
続されている。
【００１５】ＬＮＡ３の出力はアクティブミキサを含む
ＭＭＩＣ５に接続され、ＬＮＡ４の出力は同じくアクテ
ィブミキサを含むＭＭＩＣ６に接続されている。ＭＭＩ
Ｃ５には、図４に示すスイッチ回路２５も含まれている
ので、ＭＭＩＣ６の出力はＭＭＩＣ５に接続されてい
る。ＭＭＩＣ５および６には、後述するように、局部発
振器７からの局部発振信号Ｌo が均等に分配されるよう
に接続されている。
ＭＭＩＣ５に接続され、ＬＮＡ４の出力は同じくアクテ
ィブミキサを含むＭＭＩＣ６に接続されている。ＭＭＩ
Ｃ５には、図４に示すスイッチ回路２５も含まれている
ので、ＭＭＩＣ６の出力はＭＭＩＣ５に接続されてい
る。ＭＭＩＣ５および６には、後述するように、局部発
振器７からの局部発振信号Ｌo が均等に分配されるよう
に接続されている。
【００１６】ＭＭＩＣ５の出力は、１段構成のＩＦＡ８
および９に接続されており、増幅回路８，９の出力は、
それぞれ出力端子１０および１１に接続されている。
および９に接続されており、増幅回路８，９の出力は、
それぞれ出力端子１０および１１に接続されている。
【００１７】図２は、２つのＭＭＩＣ５，６と局部発振
器７との接続関係を示す配置図である。この場合、ＭＭ
ＩＣ５は、図３(a) に示すように、図においてパッケー
ジの左側に信号入力ピン５ａが、右側に信号出力ピン５
ｂが、上側に直流電源ＤＣの供給される直流電源ピン５
ｃが、下側に局部発振信号Ｌo が入力される局発入力ピ
ン５ｄがそれぞれ配置された構成となっている。
器７との接続関係を示す配置図である。この場合、ＭＭ
ＩＣ５は、図３(a) に示すように、図においてパッケー
ジの左側に信号入力ピン５ａが、右側に信号出力ピン５
ｂが、上側に直流電源ＤＣの供給される直流電源ピン５
ｃが、下側に局部発振信号Ｌo が入力される局発入力ピ
ン５ｄがそれぞれ配置された構成となっている。
【００１８】これに対し、ＭＭＩＣ６は、図３(b) に示
すように、図においてパッケージの左側に信号入力ピン
６ａが、右側に信号出力ピン６ｂが、上側に局発入力ピ
ン６ｃが、下側に直流電源ピン６ｄがそれぞれ配置され
た構成となっており、ＭＭＩＣ５とは直流電源ピンと局
発入力ピンとが入れ替わった構造となっている。
すように、図においてパッケージの左側に信号入力ピン
６ａが、右側に信号出力ピン６ｂが、上側に局発入力ピ
ン６ｃが、下側に直流電源ピン６ｄがそれぞれ配置され
た構成となっており、ＭＭＩＣ５とは直流電源ピンと局
発入力ピンとが入れ替わった構造となっている。
【００１９】このため、図２に示すように、局部発振器
７に対するＭＭＩＣ５，６の位置が鏡像となり、Ｙ形電
力分配器１２を通って局発電力を均等に２分配する構成
を実現できる。また、この実施例では、局発伝送線路上
にコンデンサＣ１，Ｃ２を挿入することによって高アイ
ソレーション設計が可能となり、さらに、ピン配置のみ
ならず電力分配器で２系統回路に存在するＭＭＩＣが結
合されるところで互いのＭＭＩＣの影響を少なくし、高
アイソレーションの実現が可能な構成となっている。
７に対するＭＭＩＣ５，６の位置が鏡像となり、Ｙ形電
力分配器１２を通って局発電力を均等に２分配する構成
を実現できる。また、この実施例では、局発伝送線路上
にコンデンサＣ１，Ｃ２を挿入することによって高アイ
ソレーション設計が可能となり、さらに、ピン配置のみ
ならず電力分配器で２系統回路に存在するＭＭＩＣが結
合されるところで互いのＭＭＩＣの影響を少なくし、高
アイソレーションの実現が可能な構成となっている。
【００２０】この構成において、入力端子１に入力した
水平偏波信号ＨＰはＬＮＡ３によって低雑音増幅され、
ＭＭＩＣ５で局部発振信号Ｌo と混合されて中間周波数
信号ＩＨに周波数変換される。例えば、ＬＮＡ３で増幅
された周波数１0.９５〜１1.７ＧＨｚの水平偏波信号Ｈ
Ｐが、ＭＭＩＣ５内の混合回路で周波数１０ＧＨｚの局
部発振信号Ｌo と混合されて周波数９５０〜１７００Ｍ
Ｈｚの中間周波信号ＩＨに変換される。入力端子２に入
力した垂直偏波信号ＶＰも同様にして中間周波信号ＩＶ
に変換される。
水平偏波信号ＨＰはＬＮＡ３によって低雑音増幅され、
ＭＭＩＣ５で局部発振信号Ｌo と混合されて中間周波数
信号ＩＨに周波数変換される。例えば、ＬＮＡ３で増幅
された周波数１0.９５〜１1.７ＧＨｚの水平偏波信号Ｈ
Ｐが、ＭＭＩＣ５内の混合回路で周波数１０ＧＨｚの局
部発振信号Ｌo と混合されて周波数９５０〜１７００Ｍ
Ｈｚの中間周波信号ＩＨに変換される。入力端子２に入
力した垂直偏波信号ＶＰも同様にして中間周波信号ＩＶ
に変換される。
【００２１】中間周波信号ＩＨおよびＩＶは、ＭＭＩＣ
５内のスイッチ回路によって切り換えられ、中間周波信
号ＩＨはＩＦＡ８（または９）で増幅された後に出力端
子１０（または１１）から出力され、中間周波信号ＩＶ
はＩＦＡ９（または８）で増幅された後に出力端子１１
（または１０）から出力される。
５内のスイッチ回路によって切り換えられ、中間周波信
号ＩＨはＩＦＡ８（または９）で増幅された後に出力端
子１０（または１１）から出力され、中間周波信号ＩＶ
はＩＦＡ９（または８）で増幅された後に出力端子１１
（または１０）から出力される。
【００２２】
【発明の効果】本発明によれば、ピン配置の異なる２種
類のＭＭＩＣを使用することによって２つのＭＭＩＣを
Ｙ形電力分配器に対して対象に配置することができるの
で、局部発振信号の電力を均等に分割して供給すること
ができる。
類のＭＭＩＣを使用することによって２つのＭＭＩＣを
Ｙ形電力分配器に対して対象に配置することができるの
で、局部発振信号の電力を均等に分割して供給すること
ができる。
【００２３】また、アクティブミキサを含むＭＭＩＣを
使用することによって、基板の小型化を図ることがで
き、加えて前後の増幅回路、すなわちＬＮＡおよびＩＦ
Ａの段数を減らすことができるので、部品点数の削減お
よび伝送線路の簡素化によってさらなる小型化を図るこ
とができ、ＬＮＢの低コスト化および小型化が可能とな
る。
使用することによって、基板の小型化を図ることがで
き、加えて前後の増幅回路、すなわちＬＮＡおよびＩＦ
Ａの段数を減らすことができるので、部品点数の削減お
よび伝送線路の簡素化によってさらなる小型化を図るこ
とができ、ＬＮＢの低コスト化および小型化が可能とな
る。
【図１】本発明による低雑音コンバータ回路の一実施例
を示すブロック図である。
を示すブロック図である。
【図２】局部発振器とＭＭＩＣとの接続状態を示す配置
図である。
図である。
【図３】異なる２種類のピン配置を有するＭＭＩＣの構
成図である。
成図である。
【図４】従来の低雑音コンバータ回路の一例を示すブロ
ック図である。
ック図である。
【図５】Ｙ形電力分配器による局部発振器と混合回路と
の結合関係を示す図である。
の結合関係を示す図である。
【図６】混合回路としてショットキダイオードを使用し
た構成図である。
た構成図である。
【図７】混合回路としてＭＭＩＣを使用できないことを
説明する図である。
説明する図である。
１，２ 入力端子 ３，４ 低雑音増幅回路（ＬＮＡ） ５，６ ＭＭＩＣ ７ 局部発振器 ８，９ 中間周波増幅回路（ＩＦＡ） １０，１１ 出力端子 １２ Ｙ形電力分配器 ５ａ，６ａ 信号入力ピン ５ｂ，６ｂ 信号出力ピン ５ｃ，６ｄ 直流電源ピン ５ｄ，６ｃ 局発入力ピン
Claims (2)
- 【請求項１】 受信アンテナで受信した水平および垂直
偏波信号を中間周波信号に変換して出力する２出力型の
低雑音コンバータ回路において、 前記水平および垂直偏波信号を中間周波信号に変換する
ミキサ素子を含む第１および第２のマイクロ波半導体集
積回路と、 前記第１および第２のマイクロ波半導体集積回路に局部
発振信号を供給する局部発振器と、 前記局部発振器と前記第１および第２のマイクロ波半導
体集積回路とを接続するＹ形電力分配器とを備え、 前記第１および第２の半導体集積回路は、前記局部発振
器に対し前記Ｙ形電力分配器を介して互いに対称の位置
に配置されるように互いに異なるピン配置を有すること
を特徴とする低雑音コンバータ回路。 - 【請求項２】 前記第１および第２の半導体集積回路
は、共に前記Ｙ形電力分配器側に局部発振信号入力ピン
を有し、それぞれコンデンサを介して前記Ｙ形電力分配
器に接続されていることを特徴とする請求項１記載の低
雑音コンバータ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16678593A JP2960835B2 (ja) | 1993-07-06 | 1993-07-06 | 低雑音コンバータ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16678593A JP2960835B2 (ja) | 1993-07-06 | 1993-07-06 | 低雑音コンバータ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0730333A JPH0730333A (ja) | 1995-01-31 |
| JP2960835B2 true JP2960835B2 (ja) | 1999-10-12 |
Family
ID=15837635
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16678593A Expired - Lifetime JP2960835B2 (ja) | 1993-07-06 | 1993-07-06 | 低雑音コンバータ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2960835B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN102201789B (zh) * | 2010-07-14 | 2014-04-23 | 锐迪科科技有限公司 | Lnb下变频芯片电路及芯片、lnb下变频电路及方法 |
-
1993
- 1993-07-06 JP JP16678593A patent/JP2960835B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0730333A (ja) | 1995-01-31 |
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Legal Events
| Date | Code | Title | Description |
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