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JP3181440B2 - Ｃｄｍａ方式通信装置 - Google Patents
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JP3181440B2 - Ｃｄｍａ方式通信装置 - Google Patents

Ｃｄｍａ方式通信装置

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JP3181440B2 JP19064693A JP19064693A JP3181440B2 JP 3181440 B2 JP3181440 B2 JP 3181440B2 JP 19064693 A JP19064693 A JP 19064693A JP 19064693 A JP19064693 A JP 19064693A JP 3181440 B2 JP3181440 B2 JP 3181440B2
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明 洋 東
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  • Computer Networks & Wireless Communication (AREA)
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  • Mobile Radio Communication Systems (AREA)

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、移動通信装置、有線通
信装置等に利用されるＣＤＭＡ（Ｃode Ｄivision Ｍul
tiple Ａccess ）方式の通信装置に関する。
【０００２】
【従来の技術】ＣＤＭＡの通信装置は、基地局におい
て、各局に特定の符号を割り当て、通常の１次変調信号
をこの符号を用いて行ない、さらにこれを２次変調して
送信し、受信局では、受信信号の中から基地局で用いた
のと同じ符号を用いて逆変調することにより所望の１次
変調波を得、次いで通常の２次変調を行なうことでベー
スバンド信号を得るように構成されている。このような
装置において、基地局送信部で符号の割り当てを行なっ
て下り回線のチャネル間の干渉を除去するための装置を
送信デコリレータという。
【０００３】図３は従来のＣＤＭＡ方式通信装置の基地
局送信部における送信デコリレータの概略構成を示して
いる。図３において、３１は送信ベースバンド部、３２
は送信ベースバンド部３１から得られた送信情報ビット
と拡散符号との乗算を行なう乗算回路、３３は乗算回路
３２の出力と相互相関行列の逆行列の各要素との乗算を
行なう乗算回路、３４は拡散符号発生回路、３５は相互
相関行列の逆行列の各要素、３６は乗算回路３３の出力
の合計を加算する加算回路、３７はＤ／Ａ変換回路であ
る。Ｄ／Ａ変換回路３７の出力は、無線送信部に送られ
る。
【０００４】次に上記従来例の動作について説明する。
送信ベースバンド部３１の各チャネルの送信情報ビット
は、乗算回路３２で拡散符号との乗算が行なわれ、乗算
回路３３でチャネル間の干渉を打ち消すための各項に対
応した係数、すなわち各チャネルの拡散符号系列間の相
互相関行列の逆行列の要素３５が掛けられ、加算回路３
６で乗算回路３３の全ての乗算結果の和が求められる。
そして加算回路３６の出力をＤ／Ａ変換回路３７でアナ
ログ変換して無線送信部を通じて移動局に送信する。こ
のような操作を行なうことにより、移動局の受信部で
は、他のチャネルからの干渉を受けない逆拡散出力が得
られる。
【０００５】
【発明が解決しようとする課題】しかしながら、上記従
来の送信デコリレータでは、デコリレーション演算のた
めの多数の乗算器が必要であり、また加算器では、全チ
ャネル数の２乗の数の項の加算を拡散符号の速度で行な
わなければならず、全チャネル数の多い装置の場合は実
現が難しいという問題があった。また、各チャネル毎に
独立したパワーコントロールを行なう場合には、多ビッ
ト対多ビットの乗算を行なう乗算器が多数必要になると
いう問題があった。
【０００６】本発明は、このような従来の問題を解決す
るものであり、基地局送信部における送信デコリレータ
の構成を簡略化することのできるＣＤＭＡ方式通信装置
を提供することを目的とする。
【０００７】
【課題を解決するための手段】本発明は、上記目的を達
成するために、各チャネルの拡散符号系列間の相互相関
行列の逆行列を予め求めておき、各チャネルの送信情報
ビットと拡散符号系列と相互相関行列の逆行列の要素と
の積を、相互相関行列の逆行列の行または列の方向につ
いて加算したものを記憶部にテーブル化して保持してお
き、これをカウンタの信号により順次出力してその総和
を計算するようにしたものである。
【０００８】
【作用】したがって、本発明によれば、送信デコリレー
ション演算における計算内容を予め記憶部にテーブル化
して保持してあるので、加算回路で行なう加算の項数を
全チャネル数の２乗ではなく、全チャネル数の１乗に減
少させることができ、また各チャネル毎のパワーコント
ロールを行なう場合でも、多数の乗算器を必要とせず、
構成を簡略化することができる。
【０００９】
【実施例】図１は本発明の第１の実施例におけるＣＤＭ
Ａ方式通信装置の基地局送信部での送信デコリレータの
概略構成を示すものである。図１において、１１は２値
信号（１ビット）の送信情報ビットを出力する送信ベー
スバンド部、１２は各チャネル毎に設けられたＲＯＭ
（Ｒead Ｏnly Ｍemory ）を有し、予め求めた各チャネ
ルの拡散符号系列間の相互相関行列の逆行列を参照し
て、各チャネルの送信情報ビットと拡散符号系列と相互
相関行列の逆行列の要素との積を、相互相関行列の逆行
列の行または列の方向について加算したものをテーブル
化して保持しておく記憶部である。１３は記憶部１２の
各チャネル毎のＲＯＭの出力の総和を計算する加算回路
である。１４はクロックに応じて記憶部１２の各ＲＯＭ
の内容を順次出力させるカウンタである。１５は加算回
路１３の出力をＤ／Ａ変換して無線送信部へ出力するＤ
／Ａ変換回路である。
【００１０】次に上記第１の実施例の動作について説明
する。カウンタ１４には拡散符号系列と同じ速度のクロ
ックが入力されており、拡散符号の１周期をスキャンし
ている。すなわち、拡散符号の周期を２m とする場合、
記憶部１２の各ＲＯＭのアドレス線の下位ｍビットを０
から２m −１まで走査することにより、データ線から拡
散符号の１チップ毎の演算結果が出力される。送信ベー
スバンド部１１から出力された各チャネル毎の送信情報
ビット（２値：１ビット）は、記憶部１２の各ＲＯＭの
最上位のアドレス線に接続され、送信情報ビットに応じ
たデコリレーションの行列の列方向または行方向の演算
結果が、各ＲＯＭから順次出力される。すなわち、送信
情報ビットと各チャネルの拡散符号系列と相互相関行列
の逆行列の要素との積を行列の１行または１列について
加算したものが、各ＲＯＭのデータバスから加算回路１
３に出力される。このとき記憶部１２の各ＲＯＭの記憶
容量は２m+1 ワード必要である。そして、加算回路１３
では、記憶部１２の各チャネル毎のＲＯＭの出力の総和
を計算して、Ｄ／Ａ変換回路１５へ出力する。
【００１１】このように、上記第１の実施例によれば、
各チャネルの拡散符号系列間の相互相関行列の逆行列を
予め求めておき、記憶部１２の各チャネル毎に配置した
ＲＯＭに、各チャネルの送信情報ビットと拡散符号系列
と相互相関行列の逆行列の要素との積を、相互相関行列
の逆行列の行または列の方向について加算したものをテ
ーブル化して保持しておき、これをカウンタ１４の信号
により順次出力してその総和を加算回路１３で計算する
ようにしたので、ＣＤＭＡ方式通信装置の基地局送信部
での下り回線のチャネル間の干渉を除去する送信デコリ
レーションの演算を、多数の乗算器を必要とせずに簡単
な構成で行なうことができ、装置の小型化およびコスト
の低減を図ることができる。
【００１２】次に本発明の第２の実施例について説明す
る。図２は本発明の第２の実施例におけるＣＤＭＡ方式
通信装置の基地局送信部での送信デコリレータの概略構
成を示すものである。図２において、２１は各チャネル
毎の２n 段階のパワーコントロール実施後のパワー情報
を含んだ送信情報ビット（多値：ｎビット）を出力する
送信ベースバンド部である。２２は各チャネル毎に設け
られたＲＯＭを有し、送信ベースバンド部２１からの多
値信号と拡散符号系列と相互相関行列の逆行列の要素と
の積をテーブル化して保持しておく記憶部である。２３
は記憶部２２の各チャネル毎のＲＯＭの出力の総和を計
算する加算回路である。２４はクロックに応じて記憶部
２２の各ＲＯＭの内容を順次出力させるカウンタであ
る。２５は加算回路２３の出力をＤ／Ａ変換して無線送
信部へ出力するＤ／Ａ変換回路である。
【００１３】次に上記第２の実施例の動作について説明
する。カウンタ２４には拡散符号系列と同じ速度のクロ
ックが入力されており、記憶部２２の各ＲＯＭのアドレ
ス線の下位ｍビットで拡散符号の１周期をスキャンする
ことにより、上位ｎビットでベースバンド部２１の送信
情報ビットの値（多値：ｎビット）に応じた演算結果を
選択して各ＲＯＭから出力させる。そして、加算回路２
３では、記憶部２２における各チャネル毎のＲＯＭの出
力の総和を計算して、Ｄ／Ａ変換回路２５へ出力する。
したがって上記第１の実施例におけるＲＯＭのｎ倍の記
憶容量、すなわち２m+n ワードのＲＯＭを使用すること
により、パワーコントロール実施後にｎビットとなった
送信情報ビットに対応させることができる。
【００１４】このように、上記第２の実施例によれば、
下り回線のチャネル毎のパワーコントロールを行なう場
合に、各チャネルの送信情報ビットをパワー情報を含ん
だ多値信号とし、この多値信号と拡散符号系列と相互相
関行列の逆行列の要素との積を記憶部２２の各ＲＯＭに
テーブルかして保持しておき、これをカウンタ２４の信
号により順次出力してその総和を加算回路２３で計算す
るようにしたので、各チャネル毎のパワーコントロール
を行なう場合でも、多ビット対多ビットの乗算を行なう
多数の乗算器を必要とせずに簡単な構成で送信デコリレ
ーションの演算を行なうことができ、装置の小型化およ
びコストの低減を図ることができる。
【００１５】
【発明の効果】本発明は、上記各実施例から明らかなよ
うに、ＣＤＭＡ方式通信装置の基地局送信部における送
信デコリレーションの演算を、多数の乗算器を必要とせ
ずに行なうこができ、また加算回路で行なう加算の項数
を全チャネル数の２乗ではなく全チャネル数の１乗に減
少させることができるので、全チャネル数の多い場合に
も十分に対応することができ、また各チャネル毎のパワ
ーコントロールを行なう場合でも、多数の乗算器を必要
とせずに多ビット対多ビットの乗算を行なうことができ
るので、構成を簡略化できるとともに、装置の小型化お
よびコストの低減を図ることができる。
【図面の簡単な説明】
【図１】本発明の第１の実施例におけるＣＤＭＡ方式通
信装置の基地局送信部での送信デコリレータの概略ブロ
ック図
【図２】本発明の第２の実施例におけるＣＤＭＡ方式通
信装置の基地局送信部での送信デコリレータの概略ブロ
ック図
【図３】従来例におけるＣＤＭＡ方式通信装置の基地局
送信部での送信デコリレータの概略ブロック図
【符号の説明】
１１、２２ 送信ベースバンド部 １２、２２ 記憶部 １３、２３ 加算回路 １４、２４ カウンタ １５、２５ Ｄ／Ａ変換回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 松 本 正 東京都港区虎ノ門二丁目10番１号 エ ヌ・ティ・ティ移動通信網株式会社内 (72)発明者 東 明 洋 東京都港区虎ノ門二丁目10番１号 エ ヌ・ティ・ティ移動通信網株式会社内 (56)参考文献 特開 平５−327654（ＪＰ，Ａ) 特開 平６−141021（ＪＰ，Ａ) ＩＥＥＥ ＴＲＡＮＳＡＣＴＩＯＮＳ ＯＮ ＣＯＭＭＵＮＩＣＡＴＩＯＮ Ｓ，Ｖｏｌ．38，Ｎｏ．４（1990− ４．），ｐ．496−508 (58)調査した分野(Int.Cl.7，ＤＢ名) H04B 1/69 - 1/713 H04J 13/00 - 13/06 H04Q 7/38

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項１】 ＣＤＭＡ通信装置の基地局送信部での下
    り回線のチャネル間の干渉を除去するための送信デコリ
    レータにおいて、各チャネルの拡散符号系列間の相互相
    関行列の逆行列を予め求めておき、各チャネルの送信情
    報ビットと拡散符号系列と相互相関行列の逆行列の要素
    との積を、相互相関行列の逆行列の行または列の方向に
    ついて加算したものをテーブル化して保持しておく記憶
    部と、前記記憶部の内容を順次出力させるカウンタと、
    前記記憶部の出力の総和を計算する加算回路とを備えた
    ＣＤＭＡ方式通信装置。
  2. 【請求項２】 ＣＤＭＡ通信装置の基地局送信部での下
    り回線のチャネル間の干渉を除去するための送信デコリ
    レータにおいて、各チャネルの拡散符号系列間の相互相
    関行列の逆行列を予め求めておき、下り回線のチャネル
    毎のパワーコントロールを行なう場合に、各チャネルの
    送信情報ビットをパワー情報を含んだ多値信号とし、こ
    の多値信号と拡散符号系列と相互相関行列の逆行列の要
    素との積をテーブル化して保持しておく記憶部と、前記
    記憶部の内容を順次出力さるカウンタと、前記記憶部の
    出力の総和を計算する加算回路とを備えたＣＤＭＡ方式
    通信装置。
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