Deprecated: The each() function is deprecated. This message will be suppressed on further calls in /home/zhenxiangba/zhenxiangba.com/public_html/phproxy-improved-master/index.php on line 456
JP3929178B2 - Ic実装構造 - Google Patents
[go: Go Back, main page]

JP3929178B2 - Ic実装構造 - Google Patents

Ic実装構造 Download PDF

Info

Publication number
JP3929178B2
JP3929178B2 JP21514098A JP21514098A JP3929178B2 JP 3929178 B2 JP3929178 B2 JP 3929178B2 JP 21514098 A JP21514098 A JP 21514098A JP 21514098 A JP21514098 A JP 21514098A JP 3929178 B2 JP3929178 B2 JP 3929178B2
Authority
JP
Japan
Prior art keywords
bump
chip
directional
mounting structure
circuit board
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP21514098A
Other languages
English (en)
Other versions
JP2000049196A (ja
Inventor
芳弘 石田
順生 井口
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Citizen Watch Co Ltd
Original Assignee
Citizen Watch Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Citizen Watch Co Ltd filed Critical Citizen Watch Co Ltd
Priority to JP21514098A priority Critical patent/JP3929178B2/ja
Publication of JP2000049196A publication Critical patent/JP2000049196A/ja
Application granted granted Critical
Publication of JP3929178B2 publication Critical patent/JP3929178B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/072Connecting or disconnecting of bump connectors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/073Connecting or disconnecting of die-attach connectors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W74/00Encapsulations, e.g. protective coatings
    • H10W74/10Encapsulations, e.g. protective coatings characterised by their shape or disposition
    • H10W74/15Encapsulations, e.g. protective coatings characterised by their shape or disposition on active surfaces of flip-chip devices, e.g. underfills
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/721Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors
    • H10W90/724Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors between a chip and a stacked insulating package substrate, interposer or RDL
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/731Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
    • H10W90/734Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked insulating package substrate, interposer or RDL

Landscapes

  • Wire Bonding (AREA)

Description

【0001】
【発明の属する技術分野】
本発明はICチップの実装構造に係わり、更に詳しくは突起電極を有するフリップチップ実装構造に関するものである。
【0002】
【従来の技術】
近年、半導体パッケージの小型化、高密度化に伴いベア・チップを直接フェイスダウンで、基板上に実装するフリップチップボンディングが開発されている。カメラ一体型VTRや携帯電話機等の登場により、ベア・チップと略同じ寸法の小型パッケージ、所謂CSP(チップサイズ/スケール・パッケージ)を載せた携帯機器が相次いで登場してきている。最近CSPの開発は急速に進み、その市場要求が本格化している。
【0003】
図5は、ICウエファー上に突起電極を製造する工程を示している。図5(a)のICウエファー製造工程では、ICウエファー8上に電気回路を形成し、外部接続用にボンディングパッド9を形成する。
【0004】
図5(b)に示すUBM(UnderBumpMetal)析出工程では、ICウエファー8のボンディングパッド9側に、電解バンプ析出用の共通電極とバンプとボンディングパッド9を接続するための金属であるUBM10を、スパッター等により析出させる。
【0005】
図5(c)に示すメッキレジスト形成工程では、UBM10上に電解バンプ析出用のメッキレジスト11をフォトリソ工程により形成する。
【0006】
図5(d)に示す半田メッキ工程では、メッキレジスト11の開口部に電気メッキ法により半田12を電解析出させる。
【0007】
図5(e)に示すレジスト剥離工程では、メッキレジスト11をレジスト剥離液により剥離する。
【0008】
図5(f)に示すUBMエッチィング工程では、半田12下のUBM10を残し、ICウエファー8上のUBM10をエッチィングにより除去する。
【0009】
図5(g)に示すリフロー工程では、半田12にフラックスを塗布し、リフローすることで、半田バンプ13を形成する。その後、フラックスを洗浄し、突起電極付ICウエファー14が完成する。
【0010】
図6にIC実装工程を示す。図6(a)の突起電極付ICウエファー製造工程は、図5で示した製造工程であり、突起電極付ICウエファー14を製造する。
【0011】
図6(b)に示すダイシング工程では、突起電極付ICウエファー14をダイシングソーで、個々の突起電極付ICチップ15に切断する。
【0012】
図6(c)に示すフラックス塗布工程では、突起電極付ICチップ15をフラックス槽に浸けてICチップ15の半田バンプ13上に、フラックス16を塗布する。
【0013】
図6(d)に示すプレースメント工程では、ICチップ15と回路基板5上のボンディングパターン2を認識し、ICチップ15の半田バンプ13をボンディングパターン2上に載置する。
【0014】
図6(e)に示すリフロー工程では、半田バンプ13をリフローすることで、ICチップ15を回路基板5に接続する。
【0015】
図6(f)に示す封止工程では、ICチップ15と回路基板5の空隙を封止樹脂4により封止する。こうして、IC実装基板17が完成する。
【0016】
図7は、従来のIC実装基板17のX線透過図を示す。ICチップ1上に半田バンプ13が対称に配置され、ボンディングされている。
【0017】
【発明が解決しようとする課題】
しかしながら、前述したIC実装構造には次のような問題点がある。即ち、IC実装後、ICが正常な方向を向いて、正しい位置にプレースメントされたかどうかを検査するには、ICチップは裏面が出ているため、外観では判別できない。ICをプレースメントした基板をX線透過させることで、バンプとボンディングパターンが判別できるが、半田バンプが対称に配列された場合、ICチップの方向性が判別できなくなる。そのため、判定には、電気検査をする必要があるので生産性が低く、コストアップ等の問題があった。
【0018】
本発明は、上記従来の課題に鑑みなされたものであり、その目的は、小型携帯機器等に搭載する信頼性及び生産性に優れたフリップチップ実装をにおいて容易なプレースメント判別法をもつIC実装構造を提供するものである。
【0019】
【課題を解決するための手段】
上記目的を達成するために、本発明におけるIC実装構造は、回路基板上のボンディングパターンと接続させるための接続用突起電極を有するICチップを回路基板にフリップチップ実装したIC実装構造において、前記ICチップの接続用突起電極形成面内に該ICチップの方向性を示す方向性突起電極を有すると共に、前記回路基板と接触しないように前記方向性突起電極の高さを前記接続用突起電極の高さよりも低く形成したことを特徴とするものである。
【0020】
また、前記方向性を示す方向性突起電極は、ICチップと電気的に接触していないこと
を特徴とするものである。
【0021】
また、前記方向性を示す方向性突起電極は、その根本形状が他の接続用突起電極とは形状が異なることを特徴とするものである。
【0023】
また、前記接続用突起電極と前記方向性突起電極の材料は、半田により形成したことを特徴とするものである。
【0024】
【発明の実施の形態】
以下図面に基づいて本発明におけるIC実装構造について説明する。図1は本発明の実施形態で、(a)は実装回路基板のX線投影図、(b)はバンプ断面図を示す図(a)のA−A′断面図である。図2は本発明の実施の形態で、方向性バンプの形状を示す説明図である。図3(a)、(b)および図4(a)、(b)は、方向性バンプの断面図で、バンプ高さを示す説明図である。従来技術と同一部材は同一符号で示す。
【0025】
図1(a)は、実装回路基板のX線透過図を示す。回路基板5に実装されたバンプの中で、方向性バンプ3は、他の半田バンプ13と比べ、その平面形状が異なるため、容易にチップの方向性が判断できる。また、回路基板5に接続しないため、回路基板5上には、対応するボンディングパターンが存在しない。
【0026】
図1(b)は、図1(a)のA−A′断面図である。方向性バンプ3の高さは、他の半田バンプ13より低いため、リフロー後も、回路基板5に接触しない。そのため、ICチップ1を回路基板5にプレースメントしたとき、方向性バンプ3が他の半田バンプ13よりも高くなって、半田バンプ13がボンディングパターンと接続できないという問題は発生しない。さらに、方向性バンプ3はICチップと電気的に独立していると同時に、回路基板5とも電気的に独立しているため、封止後も確実に絶縁され、信頼性上の問題も発生しない。
【0027】
図2は、方向性バンプの根本形状と半田バンプ形成時の上面図を示す。バンプ根本形状6を十字型にすることで、半田バンプ形状は円形とは異なる形状になる。通常半田バンプは円形をしているので、X線透過図において、どのバンプが、方向性バンプ3であるかは容易に判断でき、回路基板上に正常にプレースメントできたか容易に判断できる。
【0028】
図3は、電解半田メッキバンプにおける一般バンプと方向性バンプのバンプ高さを変える方法である。電気メッキにおけるメッキレジスト開口径を“一般バンプレジスト開口径(R)”>“方向性バンプレジスト開口径(r)”の関係にすることで、電気メッキ後の方向性バンプのメッキ量が少なくなる。この半田をリフローすることで形成される半田バンプ高さは“一般バンプ高さ(H)”>“方向性バンプ高さ(h)”の関係になる。バンプ材料に半田を使うことで容易にバンプ高さを変えることができる。
【0029】
図4は、無電解半田バンプにおける一般バンプと方向性バンプのバンプ高さを変える方法である。無電解バンプ形成法に、1個の半田ボール供給方法を考えた場合、供給半田量は同じである。レジスト開口径を“一般バンプ径(R)”<“方向性バンプ径(r)”の関係にし、リフローすることで形成される半田バンプ高さは“一般バンプ高さ(H)”>“方向性バンプ高さ(h)”の関係になる。バンプ材料に半田を使うことで容易にバンプ高さを変えることができる。
【0030】
【発明の効果】
以上説明したように、本発明のIC実装構造によれば、ICチップの接続用突起電極である一般バンプの形成面内に方向性突起電極を形成したことで、ボンディング時に容易に方向性の判定をすることが出来る。また、方向性突起電極である方向性バンプをICと電気的に接触させないことで、ICチップ内に自由に配置できる。また、この方向性バンプ形状を他のバンプと変えることで、容易に方向性を判定できる。また、この方向性バンプが、固定基板と接触しないことで、実装を容易に出来ると同時に、信頼性を向上できる。また、方向性バンプ材料と一般バンプ材料に半田を使うことで、容易に高さを変えることができる。
【図面の簡単な説明】
【図1】本発明の実施の形態に係わるIC実装構造を示す説明図である。
【図2】本発明の実施の形態に係わる方向性バンプの形状をを示す説明図である。
【図3】本発明の実施の形態に係わる電解バンプの高さを変える方法を示す説明図である。
【図4】本発明の実施の形態に係わる無電解バンプの高さを変える方法を示す説明図である。
【図5】ウエファーでの突起電極の製造方法を示す説明図である。
【図6】突起電極を回路基板に実装する方法を示す説明図である。
【図7】従来のIC実装基板のX線透過図である。
【符号の説明】
1 ICチップ
2 ボンディングパターン
3 方向性バンプ
4 封止樹脂
5 回路基板
6 バンプ根本形状
7 バンプ形状
8 ウエファー
9 ボンディングパッド
10 UBM
11 メッキレジスト
12 半田
13 半田バンプ
14 突起電極付ICウエファー
15 ICチップ
16 フラックス
17 IC実装基板

Claims (4)

  1. 回路基板上のボンディングパターンと接続させるための接続用突起電極を有するICチップを回路基板にフリップチップ実装したIC実装構造において、前記ICチップの接続用突起電極形成面内に該ICチップの方向性を示す方向性突起電極を有すると共に、前記回路基板と接触しないように前記方向性突起電極の高さを前記接続用突起電極の高さよりも低く形成したことを特徴とするIC実装構造。
  2. 前記方向性を示す方向性突起電極は、ICチップと電気的に接触していないことを特徴とする請求項1記載のIC実装構造。
  3. 前記方向性を示す方向性突起電極は、その根本形状が他の接続用突起電極とは形状が異なることを特徴とする請求項1または2記載のIC実装構造。
  4. 前記接続用突起電極と前記方向性突起電極の材料は、半田により形成したことを特徴とする請求項1から3のいずれか1項に記載のIC実装構造。
JP21514098A 1998-07-30 1998-07-30 Ic実装構造 Expired - Lifetime JP3929178B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP21514098A JP3929178B2 (ja) 1998-07-30 1998-07-30 Ic実装構造

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP21514098A JP3929178B2 (ja) 1998-07-30 1998-07-30 Ic実装構造

Publications (2)

Publication Number Publication Date
JP2000049196A JP2000049196A (ja) 2000-02-18
JP3929178B2 true JP3929178B2 (ja) 2007-06-13

Family

ID=16667366

Family Applications (1)

Application Number Title Priority Date Filing Date
JP21514098A Expired - Lifetime JP3929178B2 (ja) 1998-07-30 1998-07-30 Ic実装構造

Country Status (1)

Country Link
JP (1) JP3929178B2 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TW543172B (en) 2001-04-13 2003-07-21 Yamaha Corp Semiconductor device and package, and method of manufacture therefor
US6563905B1 (en) * 2001-10-30 2003-05-13 Qualcomm, Incorporated Ball grid array X-ray orientation mark

Also Published As

Publication number Publication date
JP2000049196A (ja) 2000-02-18

Similar Documents

Publication Publication Date Title
CN102386158B (zh) 半导体装置及其制法
CN100382304C (zh) 半导体装置及其制造方法
US9165898B2 (en) Method of manufacturing semiconductor device with through hole
JP3888854B2 (ja) 半導体集積回路の製造方法
TWI404175B (zh) 具電性連接結構之半導體封裝件及其製法
JP4602350B2 (ja) ランド・グリッド・アレイ実装デバイスおよびその形成方法
JP3679199B2 (ja) 半導体パッケージ装置
WO2008032944A1 (en) Flip chip semiconductor package and fabrication method thereof
JP2002050716A (ja) 半導体装置及びその作製方法
JP2004349593A (ja) 半導体装置及びその製造方法
JP2003037135A (ja) 配線基板及びその製造方法
JP2013546196A (ja) ピンアタッチメント
KR100631939B1 (ko) 비지에이 패키지와 티에스오피 패키지를 적층하여 형성한반도체 소자
KR100234694B1 (ko) 비지에이 패키지의 제조방법
JP3850967B2 (ja) 半導体パッケージ用基板及びその製造方法
US20080303134A1 (en) Semiconductor package and method for fabricating the same
JP2004235420A (ja) 電子素子、電子素子の製造方法、回路基板、回路基板の製造方法、電子装置及び電子装置の製造方法
JP3929178B2 (ja) Ic実装構造
JPH11163024A (ja) 半導体装置とこれを組み立てるためのリードフレーム、及び半導体装置の製造方法
TW457662B (en) Fabrication method and structure of a chip size package
KR20110119342A (ko) 범프를 갖는 반도체 디바이스
JP3875407B2 (ja) 半導体パッケージ
JP3831109B2 (ja) 半導体パッケージ
JP2001230345A (ja) 半導体装置及びその製造方法並びにその製造に用いられるリードフレーム
JP2003017655A (ja) 半導体実装体およびそれを用いた半導体装置

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20050609

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20061129

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20061205

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20070130

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20070220

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20070306

S533 Written request for registration of change of name

Free format text: JAPANESE INTERMEDIATE CODE: R313533

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120316

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20140316

Year of fee payment: 7

S533 Written request for registration of change of name

Free format text: JAPANESE INTERMEDIATE CODE: R313533

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

EXPY Cancellation because of completion of term