Deprecated: The each() function is deprecated. This message will be suppressed on further calls in /home/zhenxiangba/zhenxiangba.com/public_html/phproxy-improved-master/index.php on line 456
JP4052804B2 - 電極基板および電極基板の作製方法 - Google Patents
[go: Go Back, main page]

JP4052804B2 - 電極基板および電極基板の作製方法 - Google Patents

電極基板および電極基板の作製方法 Download PDF

Info

Publication number
JP4052804B2
JP4052804B2 JP2001012526A JP2001012526A JP4052804B2 JP 4052804 B2 JP4052804 B2 JP 4052804B2 JP 2001012526 A JP2001012526 A JP 2001012526A JP 2001012526 A JP2001012526 A JP 2001012526A JP 4052804 B2 JP4052804 B2 JP 4052804B2
Authority
JP
Japan
Prior art keywords
insulating film
film
transparent conductive
conductive film
electrode
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2001012526A
Other languages
English (en)
Other versions
JP2001345024A (ja
Inventor
隆 藤川
雅史 小倉
義晴 片岡
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sharp Corp filed Critical Sharp Corp
Priority to JP2001012526A priority Critical patent/JP4052804B2/ja
Priority to US09/814,168 priority patent/US6568978B2/en
Priority to TW90106764A priority patent/TW521227B/zh
Priority to KR1020010015455A priority patent/KR20010095001A/ko
Publication of JP2001345024A publication Critical patent/JP2001345024A/ja
Application granted granted Critical
Publication of JP4052804B2 publication Critical patent/JP4052804B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Landscapes

  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)
  • Liquid Crystal (AREA)
  • Manufacturing Of Electric Cables (AREA)

Description

【0001】
【発明の属する技術分野】
本発明は、電極基板および電極基板の作製方法に関する。さらに詳しくは、無機絶縁膜からなる無機絶縁膜領域および有機絶縁膜からなる有機絶縁膜領域の両方に接する透明導電膜が形成される電極基板および電極基板の作製方法に関する。
【0002】
【従来の技術】
ITO(インジウムスズ酸化物)を含む透明導電膜は、光を透過させ,且つ、光を制御する電極として利用可能である。そのような特性を有する透明導電膜を使用した電極基板は、エレクトロルミネセンス表示装置などの表示装置だけでなくタッチパネル、太陽電池などの用途への実用化が進められている。
【0003】
有機絶縁膜および無機絶縁膜の両方の上に透明導電膜を形成した電極基板を使用した表示装置として液晶表示装置が挙げられる。液晶表示装置は、CRTに替わるフラットパネルディスプレイの一つとして盛んに研究が行われており、とくに消費電力が小さく、薄型であるという特徴を活かして、電池駆動の超小型テレビやノートブック型のパーソナルコンピュータの表示装置としてすでに実用化されている。ここでは、有機絶縁膜および無機絶縁膜の両方の上に透明導電膜を形成した電極基板を使用した表示装置としての具体例として液晶表示装置を説明する。
【0004】
図1は液晶表示装置100の基本的な構成を模式的に示す。液晶表示装置100は、薄膜トランジスタ(以下TFTと記す)をスイッチング素子に用いたアクティブマトリクス型TFTアレイタイプであり、これは高表示品質が望まれる場合に有利である。
【0005】
図1に示されるように液晶表示装置100は、上側基板102と下側基板(電極基板)101との間に液晶層(図示せず)が設けられており、液晶層が上側基板102上の上側電極104と下側基板101上の複数の画素電極103とにより制御されるようになっている。下側基板101において、複数の画素電極103のそれぞれはスイッチング素子(TFT)108を介してソース配線105に接続され、TFT108のゲートはゲート配線106にそれぞれ接続されている。
【0006】
図2は液晶表示装置の下側基板101(電極基板)の上面図を示す。ここで、液晶表示装置として、透過型アクティブマトリクスの液晶表示装置を想定している。ただし、液晶表示装置は、透過型に限定されず、透過/反射両用型液晶表示装置の透過領域も同様に考えることができる。
【0007】
電極基板101は、絶縁性基板20とその上に形成される構成要素全体を指す。電極基板101は、表示領域150および周辺領域160の2つの領域に分けられる。図2において、表示領域150を斜線で示す。表示領域150では、複数の画素電極103および複数の各画素電極103を制御する複数のTFT108が設けられる。画素電極103は透明導電膜により形成される。電極基板101を透過型液晶表示装置に使用する場合、絶縁性基板20の少なくとも一部を透明材料で形成し、表示側の反対側からの光(一般に光源)を利用して表示を行うために電極を透明導電膜により形成することで、光の透過および制御を行う。
【0008】
一方、周辺領域160には、複数のゲート接続端子部110、複数のソース接続端子部120、複数のコモン接続端子部130が設けられる。各ゲート接続端子部110、ソース接続端子部120、コモン接続端子部130にそれぞれ対応するゲート配線105、ソース配線106、コモン配線107が、周辺領域160から表示領域150にわたって形成されている。本明細書において、ゲート接続端子部110、ソース接続端子部120、コモン接続端子部130を総称して、周辺端子部と名付ける。
【0009】
図3は、電極基板101の表示領域150を拡大した上面図を示す。図3において、破線で囲まれる領域が1つの画素電極103に相当する。各ゲート配線105と各コモン配線107とはそれぞれ平行に設けられ、各ゲート配線105および各コモン配線107とそれぞれ直交するように複数のソース配線106がそれぞれ設けられている。図3に示されるように、各ゲート配線105と各ソース配線106とのそれぞれの交差部では、各ゲート配線105およびソース配線106は、スイッチング素子であるTFT108のゲート電極またはソース電極と少なくとも接続するように分岐されている。TFT108のドレイン電極に接続される接続電極48はコモン配線107と一部が重なるように設けられ、さらに、接続電極48とコモン配線107とが重なる領域の一部にコンタクトホール50が設けられる。
【0010】
図4は、図3のA−A’線に沿った電極基板101の表示領域150の断面図を示す。図4において、左側(A側)にTFT108、右側(A’側)にコンタクトホール50が示される。ここで、図4のA側をTFT部、A’側をコンタクトホール部とよぶ。
【0011】
TFT部において、絶縁性基板20上にゲート配線105の分岐部分が形成され、ゲート絶縁膜44がそれらを覆うように設けられている。ゲート絶縁膜44としてはシリコンナイトライド(SiNx)が使用され得る。ゲート絶縁膜44上にアモルファス半導体層45が形成され、アモルファス半導体層45の左側上方にソース電極46a、アモルファス半導体層45の右側上方にドレイン電極46bが形成される。ソース電極46aはソース配線106と接続され、ドレイン電極46bは接続電極48と接続されている。このように形成されたTFT108は透明材料からなる有機絶縁膜49で覆われ、平坦化された有機絶縁膜49は透明導電膜からなる画素電極103で覆われている。
【0012】
コンタクト部において、絶縁性基板20上にコモン配線107が形成され、ゲート絶縁膜44がそれらを覆うように設けられている。ゲート絶縁膜44は接続電極48で覆われている。コンタクトホール部において、接続電極48上に有機絶縁膜49が形成され、有機絶縁膜49は画素電極103で覆われている。ただし、接続電極48と画素電極103とが直接的に接続するコンタクトホール50が設けられている。
【0013】
電極基板101の表示領域150を上述したように形成することで、主に2つの利点により高開口率が得られる。第1の理由は、表面が平坦化された有機絶縁膜49上に画素電極103が形成されるので、画素電極103の段差部分により生じていた液晶層内の液晶分子(図示せず)の配向乱れによる表示不良(ドメイン現象)を無くすことができ、液晶層内の表示有効面積を増やすことができるためである。第2の理由は、0.3μmから2μmの比較的膜厚の厚い有機絶縁膜49を形成して、その上に画素電極103を形成することによって、有機絶縁膜103の基板側にあるゲート配線105・ソース配線106と上面側(表示側)にある画素電極103との間の電気的短絡を生じることがないためである。したがって、表示を目視する側から見た場合、ゲート配線105・ソース配線106などの配線にオーバーラップさせるような広い面積で画素電極103を形成することが可能となる。
【0014】
一方、周辺端子部では、実装部材との接続不良などを生じるリワーク時の信頼性が欠けるため、一般的に、電極となる無機絶縁膜上に透明導電膜が形成される。透明導電膜の形成は、周辺端子部の電極が酸化し、その結果、電極が高抵抗化することを防ぐ。周辺端子部の電極材料を有機絶縁膜上に形成することも考えられるが、有機絶縁膜の上に透明導電膜を形成することは、信頼性の観点から好ましいものではない。
【0015】
透明導電膜の成膜後のエッチングは、一般にウエットエッチングを行う。なぜなら、ドライエッチングを行うと有機絶縁膜が変質し、絶縁性が脆化してしまうからである。また、電極基板を液晶表示装置に適用する場合、ドライエッチングに起因して液晶層が汚染され、表示品位の劣化が引き起こされる可能性がある。したがって、本明細書において、特に言及しない限り「エッチング」はウエットエッチングを意味する。
【0016】
【課題を解決するための手段】
上述したように有機絶縁膜および無機絶縁膜の両方の上に形成された透明導電膜をエッチングする場合、同時にエッチングすることができるように考えられるが、実際には両者のエッチングシフトは異なる。本明細書において、エッチングシフトとは、エッチングによって除去される膜の長さを意味する。また、単位時間あたりのエッチングシフトを「エッチングレート」と規定する。有機絶縁膜上の透明導電膜と無機絶縁膜上の透明導電膜とを実質的に同じサイズで設計して、同じようなエッチングを行う場合、エッチングシフトが異なることにより、両者の透明導電膜の大きさにずれが生じる。すなわち、エッチングレートが異なる。したがって、透明導電膜をエッチングした際に、図5に示すように、一方の透明導電膜の設計寸法と仕上寸法との間に差が生じてしまう。したがって、有機絶縁膜上の透明導電膜と無機絶縁膜上の透明導電膜は、同時にエッチングすることができない。
【0017】
ここで、図6を参照して、図2に示す液晶表示装置の電極基板の作製方法を説明する。図6は、工程(a)〜(g)によりTFT部の画素電極103、ゲート接続端子部110・コモン接続端子部130、ソース接続端子部120(図2参照)を形成する方法を示す。図6では、TFT部の画素電極103の形成工程を示すが、画素電極103の形成工程はTFT部に特に限定されるものではなく、表示領域150内の画素電極103は同じように形成されると考えられる。
【0018】
工程(a)において、透明導電膜155(例えばITO)を、TFT部および周辺領域160(図2参照)の周辺端子部に同時に成膜する。
【0019】
TFT部の画素電極103となる透明導電膜155は、平坦に形成された有機絶縁膜49上に形成される。
【0020】
ゲート・コモン接続端子部110、130では、絶縁性基板20上にゲート配線105またはコモン配線107を形成し、ゲート配線105またはコモン配線107の上の中央部を除去した状態で、無機絶縁膜144が形成される。ゲート配線105またはコモン配線107の上の中央部は電極154が設けられている。電極154上には、安定した接続抵抗をもつ透明電極157となる透明導電膜155を成膜する。
【0021】
ソース接続端子部120では、絶縁性基板20を覆うように無機絶縁膜144を形成し、無機絶縁膜144上にソース配線106を設けて,それらを覆うように、透明電極157となる透明導電膜155を成膜する。
【0022】
工程(b)において、周辺端子部のフォトレジストパターニングを行う。周辺端子部において、透明導電膜155を残す部分(すなわち、透明電極157を形成する部分)上に第1のレジスト165を形成する。第1のレジスト165は、例えば、東京応化製のノボラック樹脂のポジ型レジストを用いる。工程(b)の際、TFT部の透明導電膜155上全面に第1のレジスト165を形成する。
【0023】
工程(c)において、ウエットエッチングを行い、周辺端子部の不必要な透明導電膜155を除去する。
【0024】
工程(d)において、第1のレジスト165を剥離する。この時、周辺端子部において透明導電膜155よりなる透明電極157が形成される一方で、TFT部の透明導電膜155は全面に形成されたままである。
【0025】
工程(e)において、画素電極103のフォトレジストパターニングを行う。透明導電膜155を残す部分(すなわち、画素電極103となる部分)上に第2のレジスト167を形成する。第2のレジスト167は、例えば、東京応化製のノボラック樹脂のポジ型レジストを用いる。工程(e)の際、周辺端子部全面に第2のレジスト167を形成する。
【0026】
工程(f)において、ウエットエッチングを行い、TFT部の不必要な透明導電膜155を除去する。
【0027】
工程(g)において、第2のレジスト167を剥離することで、画素電極103が形成される。
【0028】
このように、電極基板101は形成されるが、上述したように、無機絶縁膜144上の透明導電膜155のエッチング(図6の(c))と有機絶縁膜49上の透明導電膜155のエッチング(図6の(f))とは、それぞれエッチングレートが異なるため別々に行う必要がある。
【0029】
本発明は、このような現状に鑑みてなされたものであり、その目的は、有機絶縁膜上に形成された透明導電膜と無機絶縁膜上に形成される透明導電膜を同時に精度良くエッチングすることができる、電極基板および電極基板の作製方法を提供することである。
【0030】
【課題を解決するための手段】
本発明の電極基板の作製方法は、液晶表示装置、エレクトロルミネッセンス素子等の表示装置に使用され、絶縁性基板の同一面側にアクリル樹脂膜である有機絶縁膜と無機絶縁膜の両方の上にITO膜が形成された電極基板の作製方法であって、絶縁性基板の同一面側にアクリル樹脂膜が形成された表示領域と無機絶縁膜が形成された周辺領域とを形成する工程と、次いで、該表示領域および該周辺領域にプラズマ処理を行い、前記アクリル樹脂を、該アクリル樹脂上に形成されるITO膜の結晶粒径が成膜後に20nm以上50nm以下になるように所定の表面粗さとする工程と、
その後に、前記表示領域および前記周辺領域上に、該表示領域の前記アクリル樹脂および該周辺領域の前記無機絶縁膜に接してITO膜を、結晶粒径が20nm以上50nm以下に形成するITO膜形成工程と、前記表示領域の前記アクリル樹脂および前記周辺領域の前記無機絶縁膜に接して形成された前記ITO膜を同時にウェットエッチングする工程とを包含する。
【0031】
前記ITO膜形成工程において、前記表示領域の前記アクリル樹脂に接する前記ITO膜の結晶粒径が20nm以上40nm以下とされる。
【0033】
本発明の電極基板は、請求項1に記載の電極基板の作製方法によって作成されていることを特徴とする
【0035】
前記表示領域の前記アクリル樹脂に接する前記ITO膜の結晶粒径は、20nm以上40nm以下である。
【0036】
【発明の実施の形態】
本願発明者らは、上記の課題を解決するために、すなわち、無機絶縁膜からなる無機絶縁膜領域に接する透明導電膜と、有機絶縁膜からなる有機絶縁膜領域に接する透明導電膜のエッチングレートを同程度にするために、透明導電膜の結晶粒径の制御を行えばよいことを見出した。
【0037】
尚、ここでいう有機絶縁膜領域とは、透明導電膜に接する層または膜として、例えば、図10に示される有機絶縁膜49、図11に示される有機絶縁膜1449が形成された領域、または、図12に示されるプラスチック基板1420において、無機絶縁膜が形成されていない領域を示す。また、無機絶縁膜領域とは、透明導電膜に接する層または膜として、図10に示される無機絶縁膜144、図11または図12に示される無機絶縁膜1444が形成された領域を示す。
【0038】
図7は、透明導電膜をウエットエッチングする時間(分)とエッチングシフト(μm)との関係を示すグラフである。図7のグラフにおいて、有機絶縁膜上の透明導電膜の結晶粒径が約40nmの場合の結果を●、およびその線形補間を太線で示す。また、無機絶縁膜上の透明導電膜の結果を■、およびその線形補間を細線で示す。ここで、有機絶縁膜としてアクリル樹脂、透明導電膜としてITO、無機絶縁膜としてSiNxを使用した。図7のグラフに示されるように、エッチング時間が3〜5分の場合、有機絶縁膜上の透明導電膜のエッチングシフトは、1.5μmより小さく、無機絶縁膜上の透明導電膜のエッチングシフトは1.0μmより小さい。したがって、有機絶縁膜上の透明導電膜のエッチングシフトと無機絶縁膜上の透明導電膜のエッチングシフトとの差が比較的小さいため、所定のエッチング時間で有機絶縁膜上の透明導電膜と無機絶縁膜上の透明導電膜とを同時にエッチングすることが可能である。
【0039】
図7のグラフでは、有機絶縁膜上の透明導電膜の結晶粒径は約40nmの場合を示したが、有機絶縁膜上の透明導電膜の結晶粒径が20nm以上50nm以下の範囲であれば、同様に、有機絶縁膜上の透明導電膜と無機絶縁膜上の透明導電膜とのエッチングシフトの差は小さく、両者を同時にエッチングすることができる。
【0040】
比較のために、有機絶縁膜上の透明導電膜の結晶粒径が約100nmの場合の透明導電膜をウエットエッチングする時間(分)とエッチングシフト(μm)との関係を示すグラフを図8に示す。図8に示されるように、無機絶縁膜上の透明導電膜の結晶は、有機絶縁膜上の透明導電膜のエッチングシフトは、エッチング時間が3分〜5分の場合、2.0μm以上であり、無機絶縁膜上の透明導電膜のエッチングシフトと比べて大きく、その差も大きい。したがって、両者を同時にエッチングすることは困難である。
【0041】
なお、図7および図8に示されるグラフは、有機絶縁膜が形成される有機絶縁膜領域の透明導電膜の結晶粒径を調整するための処理を、無機絶縁膜が形成される無機絶縁膜領域に対しても同様に行った結果を示している。図7および図8のグラフの比較から理解されるように、無機絶縁膜上の透明導電膜のエッチングシフトは、有機絶縁膜上の透明導電膜の結晶粒径を制御するための処理を行ってもほぼ一定である。一般に無機絶縁膜上の透明導電膜の結晶粒径は透明導電膜の成膜条件によってほぼ決定される。
【0042】
有機絶縁膜上の透明導電膜の結晶粒径は、例えば、有機絶縁膜上に透明導電膜を成膜する前にプラズマ処理を行うことによって制御され得る。有機絶縁膜上の透明導電膜を成膜する前に酸素プラズマ処理またはCF4プラズマ処理を長時間行うと、有機絶縁膜表面が荒れるため、その上に形成される透明導電膜の結晶粒径が大きくなる傾向がある。また、透明導電膜の成膜前にArプラズマ処理を行うと有機絶縁膜の表面粗さが緩和されるため、その上に形成される透明導電膜の結晶粒径が小さくなる傾向がある。
【0043】
図9は、有機絶縁膜上の透明導電膜のウエットエッチング時間とエッチングシフトとの関係を示すグラフである。有機絶縁膜としてアクリル樹脂、透明導電膜としてITOを使用し、ウエットエッチング時間は3.0分とした。図9に示されるように、有機絶縁膜上の透明導電膜の結晶粒径が20nm以上50nm以下であれば、エッチングシフトは1.0μm以下であり、無機絶縁膜上の透明導電膜のエッチングシフト(約0.2μm、図7参照)との差が小さいため、所定のエッチング時間で同時エッチングができる。有機絶縁膜上の透明導電膜の結晶粒径が20nm以上40nm以下であれば、さらにエッチングシフトが小さいため、有機絶縁膜上の透明導電膜の制御性は改善される。また、発明者らは、有機絶縁膜上の透明導電膜表面の結晶粒径が60nm以上の場合、図8に示されるようにエッチングシフトは大きく増大し、有機絶縁膜上の透明導電膜と無機絶縁膜上の透明導電膜とのエッチングレートが大きく異なるため、同時エッチングパターニングができなくなることを確認している。
【0044】
本発明による電極基板の適用例として液晶表示装置を、従来技術の電極基板を適用した液晶表示装置と対比して説明する。ただし、液晶表示装置は、単なる例示にすぎず、本発明は有機絶縁膜および無機絶縁膜の両方の上に透明導電膜を形成した電極基板であればどのような形態であっても適用できる。例えば、エレクトロルミネッセンス素子において、発光領域内では有機絶縁体からなる基板上に陽極として透明導電膜を形成し、他方、端子領域においては無機絶縁体上に透明導電膜を形成するような場合にも本発明を適用することができる。
【0045】
本発明による電極基板を作製する方法を示す図10は、従来の電極基板の形成方法を説明する図6に対応する。
【0046】
具体的には、図10の工程(a)において、表示領域150内の有機絶縁膜49上、ならびに周辺領域160の無機絶縁膜144上に透明導電膜155を成膜する。プラズマ処理を行う場合、透明導電膜155を形成する前に、有機絶縁膜49および、有機絶縁膜49と無機絶縁膜144の両方に適切なプラズマ処理を行い、すくなくとも有機絶縁膜49上の透明導電膜155の結晶粒径を20nm以上50nm以下にする。プラズマ処理は、例えば、Arガス290sccm、1.7Paの雰囲気で、RF power1.0kwにて30秒行われる。
【0047】
工程(b)において、画素電極および周辺端子部のフォトレジストパターニングを行う。周辺端子部において、透明導電膜155を残す部分(すなわち、画素電極103または透明電極157を形成する部分)上にレジスト169を形成する。レジスト169は、例えば、東京応化製のノボラック樹脂のポジ型レジストを用いる。
【0048】
工程(c)において、ウエットエッチングを行い、画素電極および周辺端子部の不必要な透明導電膜155を除去する。ウエットエッチングは、例えば40℃の第2塩化鉄をウエットエッチング液として、180秒間行う。エッチング液としては、液温40℃のFeCl3とHClの混合液が使用される。
【0049】
工程(d)において、レジスト169を剥離する。この時、周辺端子部において透明導電膜155よりなる透明電極157が形成され、表示領域150内において画素電極103が形成される。
【0050】
すなわち、本発明により、図6に示す工程(b)〜(d)と(e)〜(g)とを同時に行うことができる。したがって、製造プロセスが短縮され、その結果、製造コストを下げ、また、製造現場の生産能力を向上させることができる。さらに、フォトレジストパターニング工程が減少するため、パターン不良による歩留まり低下を回避することができ、また、レジストおよび剥離液の使用量が減少する。さらに、有機絶縁膜を剥離液に晒す回数が減少するため、有機絶縁膜の膨潤を少なくすることができ、その結果、パネルの品質信頼性が向上する。
【0051】
また、一般に透明導電膜の結晶粒径が20nm以上50nm以下である場合、透明導電膜は電極として機能するのに好適な電気抵抗を有する。しかし、逆に透明導電膜の結晶粒径が20nmより小さい場合、透明導電膜の粒径が小さすぎて電気抵抗が高くなり、その結果、電極として有効に機能しなくなる。また、このように透明導電膜の抵抗が大きい電極基板を液晶表示装置に適用すると、表示領域の画素電極、および、周辺領域のゲート接続端子部、コモン接続端子部、ソース接続端子部の電気抵抗が増加する。とくに、周辺領域のゲート接続端子部、コモン接続端子部、ソース接続端子部の電気抵抗の増加は、高精細・大型液晶表示装置を製造する際に望ましくない。
【0052】
図11の工程(a)〜(e)を参照して本発明の概略を模式的に説明する。
【0053】
工程(a)において、絶縁性基板1420上に、無機絶縁膜1444を形成する。絶縁性基板1420として、透明ガラスのほかにプラスチック基板を使用できる。プラスチック基板の材料としてポリイミド、ポリエチレンテレフタレート、ポリアクリレート、ポリエチレンなどが使用される。無機絶縁膜1444としては、例えば、SiO2、SiNxまたはTaO2を使用し、500〜5000Åの厚さで形成する。
【0054】
工程(b)において、絶縁性基板1420上の別の領域に有機絶縁膜1449を形成する。有機絶縁膜1449としては、例えば、エポキシ樹脂、アクリル樹脂、ポリカーボネートなどを使用し、100Å〜1mmの厚さで形成する。
【0055】
プラズマ処理によって、後に形成される透明導電膜1455の結晶粒径の制御を行う場合、プラズマ処理のガスとして、Ar、CF4または酸素を使用して、少なくとも有機絶縁膜1449表面をプラズマ処理する。
【0056】
工程(c)において、透明導電膜1455をスパッタなどで、絶縁性基板1420、無機絶縁膜1444、有機絶縁膜1449を覆うように成膜する。透明導電膜1455として、ITOを使用してもよい。透明導電膜1455は、厚さ500〜3000Åで形成する。上述のプラズマ処理を行った場合、少なくとも有機絶縁膜1449透明導電膜1455の結晶粒径は、20nm以上50nm以下である。
【0057】
工程(d)において、フォトレジスト1465をパターニングした後、ウエットエッチングを行い、透明導電膜1455のパターニングを行う。フォトレジスト1465はノボラック樹脂を使用してもよく、ウエットエッチングのエッチング液として、FeCl3とHClの混合液またはHBrを使用してもよい。
【0058】
工程(e)において、無機絶縁膜1444、有機絶縁膜1449上に所望の形状の透明導電膜1455が形成され、電極基板1700が完成する。この時、無機絶縁膜1444上の透明導電膜1455と有機絶縁膜1449上の透明導電膜1455とのエッチングシフトの差は、2μm以下であることが望ましいが、これに限定されない。
【0059】
無機絶縁膜1444、有機絶縁膜1449の成膜方法は、材料によって適切に選択される。具体的な方法としては、凸版印刷、スクリーン印刷、スピンコータなどがある。また、成膜後、さらに熱処理または紫外線照射を行ってもよい。
【0060】
このように形成された透明導電膜1455と無機絶縁膜1444の密着性ならびに透明導電膜1455と有機絶縁膜1449との密着性は、ピールテストの結果、良好であることがわかった。
【0061】
上述の説明では、絶縁性基板1420上に無機絶縁膜1444および有機絶縁膜1449を形成する電極基板1700を示した。しかし、本発明はこれに限定されるものではなく、図18に示すように、絶縁性基板1420としてプラスチック基板を使用し、その一部の領域に無機絶縁膜1444を形成し、無機絶縁膜1444とプラスチック基板1420上の一部に透明導電膜1455を形成する電極基板1800も範囲に含む。このような電極基板1800は、無機絶縁膜1444上にスイッチング素子等を含む集積回路を組み込み、透明導電膜1455は制御を行う電極だけでなく配線としても利用可能である。
【0062】
【発明の効果】
本発明によれば、透明導電膜の結晶粒径の制御を行うことにより、有機絶縁膜領域に接するように形成された透明導電膜と無機絶縁膜領域に接するように形成された透明導電膜を同時にエッチング処理でき、工程の短縮が可能となる。これにより、電極基板の製造コストを低減することが出来る。
【図面の簡単な説明】
【図1】液晶表示装置の構成を模式図である。
【図2】電極基板の上面図である。
【図3】図2の電極基板の表示領域の拡大図である。
【図4】図3のA−A’線に沿った断面図である。
【図5】設計寸法と仕上寸法との差をあらわす図である。
【図6】従来の電極基板の作製方法を説明する図である。
【図7】有機絶縁膜上の透明導電膜の結晶粒径が約40nmの場合のエッチング時間とエッチングシフトとの関係を示すグラフである
【図8】有機絶縁膜上の透明導電膜の結晶粒径が約100nmの場合のエッチング時間とエッチングシフトとの関係を示すグラフである。
【図9】有機絶縁膜上の透明導電膜の結晶粒径とエッチングシフトとの関係を示すグラフである。
【図10】本発明による電極基板の作製方法を説明する図である。
【図11】本発明の電極基板作製の概略を説明する図である。
【図12】本発明の別の実施形態による電極基板を示す図である。

Claims (4)

  1. 液晶表示装置、エレクトロルミネッセンス素子等の表示装置に使用され、絶縁性基板の同一面側にアクリル樹脂膜である有機絶縁膜と無機絶縁膜の両方の上にITO膜が形成された電極基板の作製方法であって、
    絶縁性基板の同一面側にアクリル樹脂膜が形成された表示領域と無機絶縁膜が形成された周辺領域とを形成する工程と、
    次いで、該表示領域および該周辺領域にプラズマ処理を行い、前記アクリル樹脂を、該アクリル樹脂上に形成されるITO膜の結晶粒径が成膜後に20nm以上50nm以下になるように所定の表面粗さとする工程と、
    その後に、前記表示領域および前記周辺領域上に、該表示領域の前記アクリル樹脂および該周辺領域の前記無機絶縁膜に接してITO膜を、結晶粒径が20nm以上50nm以下に形成するITO膜形成工程と、
    前記表示領域の前記アクリル樹脂および前記周辺領域の前記無機絶縁膜に接して形成された前記ITO膜を同時にウェットエッチングする工程と、
    を包含する電極基板の作製方法。
  2. 前記ITO膜形成工程において、前記表示領域の前記アクリル樹脂に接する前記ITO膜の結晶粒径が20nm以上40nm以下とされる、請求項1に記載の電極基板の作製方法。
  3. 請求項1に記載の電極基板の作製方法によって作成されていることを特徴とする電極基板。
  4. 前記表示領域の前記アクリル樹脂に接する前記ITO膜の結晶粒径は、20nm以上40nm以下である、請求項3に記載の電極基板。
JP2001012526A 2000-03-31 2001-01-19 電極基板および電極基板の作製方法 Expired - Fee Related JP4052804B2 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP2001012526A JP4052804B2 (ja) 2000-03-31 2001-01-19 電極基板および電極基板の作製方法
US09/814,168 US6568978B2 (en) 2000-03-31 2001-03-22 Electrode substrate, method for producing the same, and display device including the same
TW90106764A TW521227B (en) 2000-03-31 2001-03-22 Electrode substrate, method for producing the same and display device including the same
KR1020010015455A KR20010095001A (ko) 2000-03-31 2001-03-24 전극 기판, 전극 기판 제조 방법 및 전극 기판을 포함한표시 장치

Applications Claiming Priority (7)

Application Number Priority Date Filing Date Title
JP2000099934 2000-03-31
JP2000-99933 2000-03-31
JP2000099935 2000-03-31
JP2000-99935 2000-03-31
JP2000-99934 2000-03-31
JP2000099933 2000-03-31
JP2001012526A JP4052804B2 (ja) 2000-03-31 2001-01-19 電極基板および電極基板の作製方法

Publications (2)

Publication Number Publication Date
JP2001345024A JP2001345024A (ja) 2001-12-14
JP4052804B2 true JP4052804B2 (ja) 2008-02-27

Family

ID=27481182

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2001012526A Expired - Fee Related JP4052804B2 (ja) 2000-03-31 2001-01-19 電極基板および電極基板の作製方法

Country Status (1)

Country Link
JP (1) JP4052804B2 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3880568B2 (ja) 2002-10-25 2007-02-14 鹿児島日本電気株式会社 液晶表示装置の製造方法
JP2004260133A (ja) 2003-02-04 2004-09-16 Seiko Epson Corp 配線基板及び電気光学装置並びにこれらの製造方法並びに電子機器

Also Published As

Publication number Publication date
JP2001345024A (ja) 2001-12-14

Similar Documents

Publication Publication Date Title
JP4458563B2 (ja) 薄膜トランジスタの製造方法およびこれを用いた液晶表示装置の製造方法
US9054195B2 (en) Array substrate, method for fabricating the same, and display device
CN101196668B (zh) 显示装置及其制造方法
KR101019048B1 (ko) 어레이 기판 및 이의 제조방법
WO2016041304A1 (zh) 薄膜晶体管及制备方法、阵列基板及制备方法、显示装置
WO2013155840A1 (zh) 阵列基板及其制造方法和显示装置
US9502577B2 (en) Oxide thin film transistor, display device, and method for manufacturing array substrate
WO2013170605A1 (zh) 薄膜晶体管阵列基板及其制造方法、显示面板、显示装置
WO2015100898A1 (zh) 薄膜晶体管、tft阵列基板及其制造方法和显示装置
CN102033370B (zh) 液晶显示基板及其制造方法
JP2019537282A (ja) アレイ基板とその製造方法及び表示装置
KR100421480B1 (ko) 유기절연막의 표면처리 방법 및 그를 이용한박막트랜지스터 기판 제조방법
JP2006018239A (ja) 液晶表示装置のパッド構造及び液晶表示装置のパッド製造方法
KR20010095001A (ko) 전극 기판, 전극 기판 제조 방법 및 전극 기판을 포함한표시 장치
US8421941B2 (en) TFT substrate and method of manufacturing the same
JP2004055735A (ja) 薄膜トランジスタおよびアクティブマトリクス基板
JP2007027710A (ja) コンタクトホール形成方法及びこれ用いた薄膜トランジスタ基板の製造方法
JP3724787B2 (ja) 電極基板およびその作製方法、ならびに、電極基板を備える液晶表示装置
CN104681626A (zh) 氧化物薄膜晶体管及其制作方法、阵列基板
JP2007140556A (ja) 薄膜トランジスタの製造方法およびこれを用いた液晶表示装置
JP5221082B2 (ja) Tft基板
JP4052804B2 (ja) 電極基板および電極基板の作製方法
WO2014117444A1 (zh) 阵列基板及其制作方法、显示装置
JP2006351844A (ja) 電気光学表示装置およびその製造方法
JP2007180511A (ja) 薄膜トランジスタ基板、その製造方法、及びこれを有する表示パネル

Legal Events

Date Code Title Description
A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20050104

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20050701

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20050826

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20050916

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20051017

A911 Transfer of reconsideration by examiner before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20051101

A912 Removal of reconsideration by examiner before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A912

Effective date: 20051126

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20071109

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20071204

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101214

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101214

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111214

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111214

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121214

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121214

Year of fee payment: 5

LAPS Cancellation because of no payment of annual fees