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JP6465679B2 - Laser annealing method and laser annealing apparatus - Google Patents
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Description

本発明は、レーザアニール方法及びレーザアニール装置に関する。   The present invention relates to a laser annealing method and a laser annealing apparatus.

イオン注入されたドーパントを含む半導体基板にレーザビームを入射させることにより、ドーパントを活性化させるレーザアニール方法が公知である。下記の特許文献1に、絶縁ゲートバイポーラトランジスタ(IGBT)の形成に適用されるレーザアニール方法が開示されている。このレーザアニール方法では、表層部の高濃度層(コレクタ層)と、高濃度層より深い位置に配置された低濃度層(バッファ層)との両方のドーパントを効率的に活性化することが可能である。   A laser annealing method for activating a dopant by making a laser beam incident on a semiconductor substrate containing the ion-implanted dopant is known. Patent Document 1 below discloses a laser annealing method applied to the formation of an insulated gate bipolar transistor (IGBT). With this laser annealing method, it is possible to efficiently activate dopants in both the high concentration layer (collector layer) in the surface layer portion and the low concentration layer (buffer layer) disposed deeper than the high concentration layer. It is.

特開2013−258288号公報JP 2013-258288 A

IGBTは、半導体基板の表側の面に、ゲートやエミッタ等の素子構造が配置され、裏側の面にコレクタが配置される。裏側の面にコレクタを形成するためのレーザアニールを行うときに、表側の面には、既にゲート、エミッタ等の素子構造が形成されている。表側の面は、素子構造を反映した凹凸を有する。レーザアニール時には、表側の面を吸着テーブルに吸着させた状態で、裏側の面にレーザビームを入射する。   In the IGBT, an element structure such as a gate and an emitter is disposed on the front surface of the semiconductor substrate, and a collector is disposed on the back surface. When laser annealing is performed to form a collector on the back side surface, element structures such as a gate and an emitter are already formed on the front side surface. The front side surface has irregularities reflecting the element structure. At the time of laser annealing, a laser beam is incident on the back side surface with the front side surface adsorbed to the adsorption table.

本願の発明者らは、上述のレーザアニール方法で種々の評価実験を行った。その結果、基板面内方向に関して、レーザ加工品質にムラが生じる場合があることが分かった。本発明の目的は、加工品質にムラの生じにくいレーザアニール方法、及びレーザアニール装置を提供することである。   The inventors of the present application conducted various evaluation experiments using the laser annealing method described above. As a result, it was found that the laser processing quality may be uneven with respect to the in-plane direction of the substrate. An object of the present invention is to provide a laser annealing method and a laser annealing apparatus that are less likely to cause unevenness in processing quality.

本発明の一観点によると、
表側の面が凹凸を有する半導体ウエハを準備する工程と、
前記表側の面の凹部に充填剤を空洞が発生しないように充填する工程と、
前記充填剤が充填された前記半導体ウエハを、前記表側の面がアニールテーブルに対向する姿勢で、前記アニールテーブルに保持する工程と、
前記アニールテーブルに保持された前記半導体ウエハの、前記表側の面とは反対の裏側の面にレーザビームを入射させることにより、アニールを行う工程と
を有するレーザアニール方法が提供される。
According to one aspect of the invention,
Preparing a semiconductor wafer having an uneven surface on the front side;
A step of filling the front surface of the concave portion with a filler so as not to generate a cavity ;
Holding the semiconductor wafer filled with the filler on the annealing table in a posture in which the surface on the front side faces the annealing table;
There is provided a laser annealing method including a step of performing annealing by making a laser beam incident on a back surface opposite to the front surface of the semiconductor wafer held on the anneal table.

本発明の他の観点によると、
貼付テーブルと、
表側の面が凹凸を有する半導体ウエハが前記貼付テーブルに置かれた状態で、前記表側の面に接着剤層付の粘着部材の接着剤層を対向させ、前記粘着部材に対して前記表側の面に密着する方向に、前記半導体ウエハの表面の凹部内に空洞が発生しないように圧力を印加しながら、前記粘着部材を前記表側の面に貼付する加圧機構と、
前記貼付テーブルで前記粘着部材が接着された前記半導体ウエハを保持するアニールテーブルと、
前記アニールテーブルに保持された前記半導体ウエハに、レーザビームを入射させるレーザ光学系と
を有するレーザアニール装置が提供される。
According to another aspect of the invention,
Affixing table;
In a state where a semiconductor wafer having an uneven surface is placed on the sticking table, the adhesive layer of the adhesive member with an adhesive layer is opposed to the front surface, and the surface on the front side with respect to the adhesive member A pressure mechanism for applying the pressure-sensitive adhesive member to the front side surface while applying pressure so that no cavity is generated in the concave portion of the surface of the semiconductor wafer in the direction of tightly contacting the surface ,
An annealing table for holding the semiconductor wafer to which the adhesive member is bonded by the pasting table;
There is provided a laser annealing apparatus having a laser optical system for making a laser beam incident on the semiconductor wafer held on the annealing table.

凹部に充填剤を充填することにより、半導体ウエハとアニールテーブルとの間に空洞が生じ難くなる。半導体ウエハとアニールテーブルとの間に空洞が形成されると、半導体ウエハからアニールテーブルへの熱伝達が阻害される。熱伝達が阻害されると、半導体ウエハの温度が、面内方向に関してばらついてしまう。上述の構成を採用すると、空洞の発生が抑制されるため、温度のばらつきも少なくなる。これにより、加工品質のムラを抑制することができる。   By filling the concave portion with the filler, a cavity is hardly generated between the semiconductor wafer and the annealing table. If a cavity is formed between the semiconductor wafer and the annealing table, heat transfer from the semiconductor wafer to the annealing table is hindered. When the heat transfer is hindered, the temperature of the semiconductor wafer varies in the in-plane direction. When the above-described configuration is employed, the generation of cavities is suppressed, so that temperature variations are reduced. Thereby, the nonuniformity of processing quality can be suppressed.

図1は、実施例によるレーザアニール装置の概略図である。FIG. 1 is a schematic diagram of a laser annealing apparatus according to an embodiment. 図2A〜図2Cは、半導体ウエハに粘着テープを貼り付ける工程での貼付テーブル、半導体ウエハ、及び粘着テープの断面図である。2A to 2C are cross-sectional views of the sticking table, the semiconductor wafer, and the adhesive tape in the step of attaching the adhesive tape to the semiconductor wafer. 図3A〜図3Cは、実施例によるレーザアニール方法の途中段階における半導体ウエハ及び粘着テープの断面図である。3A to 3C are cross-sectional views of the semiconductor wafer and the adhesive tape in the middle of the laser annealing method according to the embodiment. 図3D〜図3Eは、実施例によるレーザアニール方法の途中段階における半導体ウエハ及び粘着テープの断面図である。3D to 3E are cross-sectional views of the semiconductor wafer and the adhesive tape in the middle of the laser annealing method according to the embodiment. 図4A及び図4Bは、それぞれ比較例及び実施例による方法でレーザアニールを行う場合の半導体ウエハ及びアニールテーブルの断面図である。4A and 4B are cross-sectional views of a semiconductor wafer and an annealing table when laser annealing is performed by a method according to a comparative example and an example, respectively. 図5は、比較例による方法でレーザアニールを行った半導体ウエハの断面図である。FIG. 5 is a cross-sectional view of a semiconductor wafer subjected to laser annealing by a method according to a comparative example. 図6A及び図6Bは、シミュレーションモデルの断面図であり、図6Cは、シミュレーション結果を示すグラフである。6A and 6B are cross-sectional views of the simulation model, and FIG. 6C is a graph showing a simulation result. 図7Aは、シミュレーションモデルの断面図であり、図7Bは、シミュレーション結果を示すグラフである。FIG. 7A is a cross-sectional view of a simulation model, and FIG. 7B is a graph showing a simulation result. 図8Aは、実施例による方法で製造される半導体装置の例として示されたIGBTの断面図であり、図8Bは、レーザアニールを行う段階の半導体ウエハの断面図である。FIG. 8A is a cross-sectional view of an IGBT shown as an example of a semiconductor device manufactured by the method according to the embodiment, and FIG. 8B is a cross-sectional view of a semiconductor wafer at a stage where laser annealing is performed.

図1に、実施例によるレーザアニール装置の概略図を示す。半導体レーザ発振器21が、例えば波長808nmの第1のパルスレーザビームを出力する。なお、波長690nm以上950nm以下のパルスレーザビームを出力する半導体レーザ発振器を用いてもよい。固体レーザ発振器31が、緑色の波長域の第2のパルスレーザビームを出力する。固体レーザ発振器31には、例えば第2高調波を出力するNd:YAG、Nd:YLF、Nd:YVO等のQスイッチレーザが用いられる。 FIG. 1 shows a schematic diagram of a laser annealing apparatus according to an embodiment. The semiconductor laser oscillator 21 outputs a first pulse laser beam having a wavelength of 808 nm, for example. A semiconductor laser oscillator that outputs a pulse laser beam having a wavelength of 690 nm or more and 950 nm or less may be used. The solid-state laser oscillator 31 outputs a second pulse laser beam in the green wavelength region. For the solid-state laser oscillator 31, for example, a Q-switched laser such as Nd: YAG, Nd: YLF, Nd: YVO 4 or the like that outputs the second harmonic is used.

半導体レーザ発振器21から出力された第1のパルスレーザビーム及び固体レーザ発振器31から出力された第2のパルスレーザビームが、伝搬光学系27を経由して、アニール対象物である半導体ウエハ50に入射する。第1のパルスレーザビームと第2のパルスレーザビームとは、半導体ウエハ50の表面の同一の領域に入射する。   The first pulse laser beam output from the semiconductor laser oscillator 21 and the second pulse laser beam output from the solid-state laser oscillator 31 are incident on the semiconductor wafer 50 that is an object to be annealed via the propagation optical system 27. To do. The first pulse laser beam and the second pulse laser beam are incident on the same region of the surface of the semiconductor wafer 50.

次に、伝搬光学系27の構成及び作用について説明する。半導体レーザ発振器21から出力された第1のパルスレーザビームが、アッテネータ22、ビームエキスパンダ23、ホモジナイザ24、ダイクロイックミラー25、及び集光レンズ26を経由して、半導体ウエハ50に入射する。   Next, the configuration and operation of the propagation optical system 27 will be described. The first pulse laser beam output from the semiconductor laser oscillator 21 is incident on the semiconductor wafer 50 via the attenuator 22, the beam expander 23, the homogenizer 24, the dichroic mirror 25, and the condenser lens 26.

固体レーザ発振器31から出力された第2のパルスレーザビームが、可変アッテネータ32、ビームエキスパンダ33、ホモジナイザ34、ベンディングミラー35、ダイクロイックミラー25、及び集光レンズ26を経由して、半導体ウエハ50に入射する。   The second pulse laser beam output from the solid-state laser oscillator 31 passes through the variable attenuator 32, the beam expander 33, the homogenizer 34, the bending mirror 35, the dichroic mirror 25, and the condenser lens 26 to the semiconductor wafer 50. Incident.

アッテネータ22は、第1のパルスレーザビームの強度を減衰させる。可変アッテネータ32は、第2のパルスレーザビームの強度を減衰させる。可変アッテネータ32による第2のパルスレーザビームの減衰量は可変である。ビームエキスパンダ23、33は、入射したパルスレーザビームをコリメートするとともに、ビーム径を拡大する。ホモジナイザ24、34及び集光レンズ26は、半導体ウエハ50の表面におけるビーム断面を長尺形状に整形するとともに、ビーム断面内の光強度分布を均一化する。第1のパルスレーザビームと第2のパルスレーザビームとは、半導体ウエハ50の表面において、ほぼ同一の長尺領域に入射する。   The attenuator 22 attenuates the intensity of the first pulse laser beam. The variable attenuator 32 attenuates the intensity of the second pulse laser beam. The attenuation amount of the second pulse laser beam by the variable attenuator 32 is variable. The beam expanders 23 and 33 collimate the incident pulse laser beam and expand the beam diameter. The homogenizers 24 and 34 and the condenser lens 26 shape the beam cross section on the surface of the semiconductor wafer 50 into a long shape, and uniformize the light intensity distribution in the beam cross section. The first pulse laser beam and the second pulse laser beam are incident on substantially the same long region on the surface of the semiconductor wafer 50.

半導体ウエハ50は、アニールテーブル40に保持されている。アニールテーブル40は、半導体ウエハ50を吸着する。吸着機構として、例えば真空チャックが用いられる。半導体ウエハ50の表面に平行な面をxy面とし、半導体ウエハ50の表面の法線方向をz方向とするxyz直交座標系を定義する。移動機構41が、制御装置10からの制御を受けて、アニールテーブル40をx方向及びy方向に移動させる。制御装置10は、移動機構41の他に、半導体レーザ発振器21、固体レーザ発振器31、可変アッテネータ32、及びアニールテーブル40の吸着機構を制御する。   The semiconductor wafer 50 is held on the annealing table 40. The annealing table 40 sucks the semiconductor wafer 50. For example, a vacuum chuck is used as the suction mechanism. An xyz orthogonal coordinate system is defined in which a plane parallel to the surface of the semiconductor wafer 50 is defined as an xy plane, and a normal direction of the surface of the semiconductor wafer 50 is defined as a z direction. The moving mechanism 41 receives the control from the control device 10 and moves the annealing table 40 in the x direction and the y direction. The control device 10 controls the suction mechanism of the semiconductor laser oscillator 21, the solid state laser oscillator 31, the variable attenuator 32, and the annealing table 40 in addition to the moving mechanism 41.

レーザアニール装置は、さらに、貼付テーブル45を含む。半導体ウエハ50が貼付テーブル45の上に保持された状態で、半導体ウエハ50の素子構造が形成されている面(表側の面)に、粘着テープ51が貼り付けられる。加圧機構46が、粘着テープ51に、半導体ウエハ50に密着する方向の圧力を印加する。   The laser annealing apparatus further includes a pasting table 45. In a state where the semiconductor wafer 50 is held on the sticking table 45, the adhesive tape 51 is attached to the surface (surface on the front side) where the element structure of the semiconductor wafer 50 is formed. The pressurizing mechanism 46 applies a pressure in a direction in close contact with the semiconductor wafer 50 to the adhesive tape 51.

粘着テープ51が接着された半導体ウエハ50が、移送機構49によって、貼付テーブル45からアニールテーブル40まで移送される。移送機構49には、例えば伸縮、昇降及び回転可能なロボットアームが用いられる。   The semiconductor wafer 50 to which the adhesive tape 51 is bonded is transferred from the sticking table 45 to the annealing table 40 by the transfer mechanism 49. For the transfer mechanism 49, for example, a robot arm that can be expanded, contracted, moved up and down, and rotated is used.

図2A〜図2Cを参照して、半導体ウエハ50に粘着テープ51を貼り付ける工程について説明する。   With reference to FIGS. 2A to 2C, the process of attaching the adhesive tape 51 to the semiconductor wafer 50 will be described.

図2Aに示すように、貼付テーブル45の上に、半導体ウエハ50の素子形成面(表側の面501)が上方を向く姿勢で、半導体ウエハ50が載せられる。粘着テープ51が、例えば繰り出しロール48に巻かれた状態で準備されている。粘着テープ51を繰り出しロール48から送り出すことにより、半導体ウエハ50の表側の面501に、接着剤層付の粘着テープ51の接着剤層を対向させる。   As shown in FIG. 2A, the semiconductor wafer 50 is placed on the sticking table 45 with the element forming surface (front surface 501) of the semiconductor wafer 50 facing upward. For example, the adhesive tape 51 is prepared in a state of being wound around the feeding roll 48. By feeding the adhesive tape 51 from the feeding roll 48, the adhesive layer of the adhesive tape 51 with the adhesive layer is made to face the front surface 501 of the semiconductor wafer 50.

この状態で、加圧機構46により、粘着テープ51に対して、半導体ウエハ50に密着する方向の圧力を印加しながら、粘着テープ51を半導体ウエハ50の表側の面501に貼付する。加圧機構46として、例えば加圧ローラが用いられる。加圧ローラと半導体ウエハ50との間に粘着テープ51を挟んで、加圧ローラを半導体ウエハ50に押し付けながら移動させることにより、粘着テープ51が半導体ウエハ50に貼付される。   In this state, the pressure-sensitive adhesive mechanism 51 applies the pressure-sensitive adhesive tape 51 to the front surface 501 of the semiconductor wafer 50 while applying a pressure in a direction in close contact with the semiconductor wafer 50 to the pressure-sensitive adhesive tape 51. For example, a pressure roller is used as the pressure mechanism 46. The pressure-sensitive adhesive tape 51 is attached to the semiconductor wafer 50 by sandwiching the pressure-sensitive adhesive tape 51 between the pressure roller and the semiconductor wafer 50 and moving the pressure roller against the semiconductor wafer 50.

図2Bに、粘着テープ51が半導体ウエハ50の表側の面の全域に貼り付けられた状態を示す。   FIG. 2B shows a state where the adhesive tape 51 is attached to the entire front surface of the semiconductor wafer 50.

図2Cに示すように、切断機47で粘着テープ51を切断する。これにより、半導体ウエハ50に貼付された粘着テープ51が、繰り出しロール48(図2A)に巻かれている部分から切り離される。   As shown in FIG. 2C, the adhesive tape 51 is cut by the cutting machine 47. Thereby, the adhesive tape 51 affixed to the semiconductor wafer 50 is cut off from the portion wound around the feeding roll 48 (FIG. 2A).

図3A〜図3Eを参照して、半導体ウエハ50と粘着テープ51との接着部分に着目して、レーザアニール方法について説明する。   With reference to FIG. 3A to FIG. 3E, the laser annealing method will be described by paying attention to the bonded portion between the semiconductor wafer 50 and the adhesive tape 51.

図3Aに示すように、貼付テーブル45の上に、半導体ウエハ50が、その表側の面501を上方に向けた姿勢で保持されている。表側の面501に凹凸形成されている。表側の面501に凹部503が現れている。裏側の面502は、ほぼ平坦である。表側の面501に、樹脂製の保護膜55が形成されている。保護膜55の表面は、半導体ウエハ50の表側の面501の凹凸を反映した形状を有する。粘着テープ51の接着剤層512が、半導体ウエハ50の表側の面501に対向する。接着剤層512の基材として、例えばアクリルが用いられる。   As shown in FIG. 3A, the semiconductor wafer 50 is held on the sticking table 45 in a posture in which the front surface 501 is directed upward. Concavities and convexities are formed on the front surface 501. A recess 503 appears on the surface 501 on the front side. The back surface 502 is substantially flat. A resin protective film 55 is formed on the front surface 501. The surface of the protective film 55 has a shape reflecting the unevenness of the front surface 501 of the semiconductor wafer 50. The adhesive layer 512 of the adhesive tape 51 faces the surface 501 on the front side of the semiconductor wafer 50. As the base material of the adhesive layer 512, for example, acrylic is used.

図3Bに、粘着テープ51が貼付された状態の半導体ウエハ50の断面図を示す。粘着テープ51の貼付時に、加圧機構46(図2A)が粘着テープ51を半導体ウエハ50に押し付けるため、接着剤層512の接着剤が、表側の面501の凹部503内に充填される。接着剤が、充填剤としての役割を担う。粘着テープ51の外側の表面は平坦なままである。   FIG. 3B shows a cross-sectional view of the semiconductor wafer 50 with the adhesive tape 51 attached. When the pressure-sensitive adhesive tape 51 is applied, the pressure mechanism 46 (FIG. 2A) presses the pressure-sensitive adhesive tape 51 against the semiconductor wafer 50, so that the adhesive of the adhesive layer 512 is filled in the concave portion 503 of the front surface 501. The adhesive plays a role as a filler. The outer surface of the adhesive tape 51 remains flat.

図3Cに示すように、粘着テープ51が貼付された半導体ウエハ50を、貼付テーブル45(図3B)からアニールテーブル40に移送する。半導体ウエハ50が、その表側の面501をアニールテーブル40に対向させた姿勢で、アニールテーブル40に保持される。粘着テープ51の外側の表面が、そのほぼ全域においてアニールテーブル40に密着する。   As shown in FIG. 3C, the semiconductor wafer 50 to which the adhesive tape 51 is attached is transferred from the attachment table 45 (FIG. 3B) to the annealing table 40. The semiconductor wafer 50 is held on the annealing table 40 in a posture in which the front surface 501 faces the annealing table 40. The outer surface of the adhesive tape 51 is in close contact with the annealing table 40 in almost the entire area.

図3Dに示すように、アニールテーブル40を、x方向またはy方向(図1)に移動させながら、パルスレーザビーム38を、半導体ウエハ50の裏側の面502に入射させる。これにより、半導体ウエハ50のアニールが行われる。   As shown in FIG. 3D, the pulse laser beam 38 is incident on the back surface 502 of the semiconductor wafer 50 while moving the annealing table 40 in the x direction or the y direction (FIG. 1). Thereby, annealing of the semiconductor wafer 50 is performed.

図3Eに示すように、アニールテーブル40から半導体ウエハ50を取り出し、さらに、半導体ウエハ50から粘着テープ51を剥離する。半導体ウエハ50が十分な機械的強度を持つ場合には、半導体ウエハ50を吸着テーブルに吸着させた状態で、粘着テープ51を半導体ウエハ50から剥離することが可能である。半導体ウエハ50の機械的強度が十分でない場合には、紫外線硬化性の接着剤層を持つ粘着テープ51を用いることが好ましい。接着剤層に紫外線を照射することにより、粘着テープ51を半導体ウエハ50から容易に剥離することができる。   As shown in FIG. 3E, the semiconductor wafer 50 is taken out from the annealing table 40, and the adhesive tape 51 is peeled from the semiconductor wafer 50. When the semiconductor wafer 50 has sufficient mechanical strength, the adhesive tape 51 can be peeled from the semiconductor wafer 50 in a state where the semiconductor wafer 50 is adsorbed on the adsorption table. When the mechanical strength of the semiconductor wafer 50 is not sufficient, it is preferable to use the adhesive tape 51 having an ultraviolet curable adhesive layer. The adhesive tape 51 can be easily peeled from the semiconductor wafer 50 by irradiating the adhesive layer with ultraviolet rays.

次に、図4A〜図7Bを参照して、上記実施例によるレーザアニール方法の優れた効果について説明する。   Next, with reference to FIGS. 4A to 7B, the excellent effect of the laser annealing method according to the above embodiment will be described.

図4Aに、比較例による方法でレーザアニールを行う場合の半導体ウエハ50及びアニールテーブル40の断面図を示す。半導体ウエハ50の表側の面501に凹部503が形成されている。表側の面501に粘着テープ51が貼り付けられているが、凹部503内に接着剤は充填されておらず、凹部503は空洞のままである。   FIG. 4A shows a cross-sectional view of the semiconductor wafer 50 and the annealing table 40 when laser annealing is performed by the method according to the comparative example. A recess 503 is formed on the front surface 501 of the semiconductor wafer 50. Although the adhesive tape 51 is affixed on the surface 501 on the front side, the concave portion 503 is not filled with adhesive, and the concave portion 503 remains hollow.

半導体ウエハ50の裏側の面502にレーザビームを入射させると、裏側の面502の表層部が加熱される。これにより、裏側の面502から表側の面501に向かう熱流57が発生する。凹部503が設けられていない部分では、熱が、半導体ウエハ50から粘着テープ51を介してアニールテーブル40に伝達される。これに対し、凹部503が設けられている部分では、熱の伝達経路に空気が存在する。このため、凹部503が設けられている部分の熱の伝達率が、凹部503が設けられていない部分の熱の伝達率より低い。このため、凹部503の底面の温度が高くなりやすい。   When a laser beam is incident on the back surface 502 of the semiconductor wafer 50, the surface layer portion of the back surface 502 is heated. As a result, a heat flow 57 from the back surface 502 toward the front surface 501 is generated. In a portion where the recess 503 is not provided, heat is transferred from the semiconductor wafer 50 to the annealing table 40 via the adhesive tape 51. On the other hand, air exists in the heat transfer path in the portion where the recess 503 is provided. For this reason, the heat transfer rate of the portion where the recess 503 is provided is lower than the heat transfer rate of the portion where the recess 503 is not provided. For this reason, the temperature of the bottom surface of the recess 503 tends to be high.

図5に、比較例による方法でレーザアニールを行った半導体ウエハ50の断面図の一例を示す。表側の面501に樹脂製の保護膜55が形成されている。レーザアニール中に凹部503の底部の温度が過度に上昇すると、保護膜55に気泡551または変質部分552が発生する場合がある。   FIG. 5 shows an example of a cross-sectional view of a semiconductor wafer 50 that has been subjected to laser annealing by a method according to a comparative example. A protective film 55 made of resin is formed on the surface 501 on the front side. If the temperature of the bottom of the recess 503 rises excessively during laser annealing, bubbles 551 or altered portions 552 may be generated in the protective film 55.

図4Bに、実施例による方法でレーザアニールを行う場合の半導体ウエハ50及びアニールテーブル40の断面図を示す。実施例による方法では、凹部503内に粘着テープ51の接着剤が充填されている。接着剤は、空気に比べて高い熱伝導率を有する。また、半導体ウエハ50と接着剤との界面の熱伝達率は、半導体ウエハ50と空気との界面の熱伝達率よりも高い。このため、凹部503が設けられている部分においても、半導体ウエハ50から粘着テープ51を介してアニールテーブル40まで熱が伝達される。これにより、凹部503の底面の温度の過度の上昇を抑制することができる。温度上昇が抑制されるため、保護膜55(図3E)の変質を抑制することができ、気泡の発生も抑制することができる。   FIG. 4B shows a cross-sectional view of the semiconductor wafer 50 and the annealing table 40 when laser annealing is performed by the method according to the embodiment. In the method according to the embodiment, the adhesive of the adhesive tape 51 is filled in the recess 503. The adhesive has a higher thermal conductivity than air. The heat transfer coefficient at the interface between the semiconductor wafer 50 and the adhesive is higher than the heat transfer coefficient at the interface between the semiconductor wafer 50 and air. For this reason, heat is transferred from the semiconductor wafer 50 to the annealing table 40 via the adhesive tape 51 even in the portion where the recess 503 is provided. Thereby, an excessive increase in the temperature of the bottom surface of the recess 503 can be suppressed. Since the temperature rise is suppressed, the deterioration of the protective film 55 (FIG. 3E) can be suppressed, and the generation of bubbles can also be suppressed.

図6A〜図6Cを参照して、凹部503(図4A、図4B)が設けられた部分と設けられていない部分との温度上昇のシミュレーション結果について説明する。図6A及び図6Bは、シミュレーションモデルの断面図を示す。   With reference to FIGS. 6A to 6C, simulation results of temperature rises in the portion where the recess 503 (FIGS. 4A and 4B) is provided and the portion where the recess 503 is not provided will be described. 6A and 6B show cross-sectional views of the simulation model.

図6Aに示したシミュレーションモデルAは、厚さ100μmの半導体ウエハと、その下に配置された厚さ60μmの空気層とで構成される。図6Bに示したシミュレーションモデルBは、厚さ100μmの半導体ウエハと、その下に配置された厚さ60μmの樹脂層とで構成される。空気層(図6A)及び樹脂層(図6B)の下には、SiO(ガラス)が配置されているという条件でシミュレーションを行った。この条件は、接着剤層付のガラス板を半導体ウエハに貼り付けた状態に対応する。 The simulation model A shown in FIG. 6A includes a semiconductor wafer having a thickness of 100 μm and an air layer having a thickness of 60 μm disposed below the semiconductor wafer. The simulation model B shown in FIG. 6B includes a semiconductor wafer having a thickness of 100 μm and a resin layer having a thickness of 60 μm disposed below the semiconductor wafer. The simulation was performed under the condition that SiO 2 (glass) was disposed under the air layer (FIG. 6A) and the resin layer (FIG. 6B). This condition corresponds to a state where a glass plate with an adhesive layer is attached to a semiconductor wafer.

シミュレーションモデルAは、半導体ウエハ50の凹部503(図4A)が設けられている部分に対応し、シミュレーションモデルBは、凹部503(図4A)が設けられていない部分に対応する。シミュレーションモデルA及びシミュレーションモデルBの半導体ウエハの上面にレーザビームを3ショット入射させ、3ショット目の入射直後における最高到達温度をシミュレーションによって算出した。   The simulation model A corresponds to a portion where the recess 503 (FIG. 4A) of the semiconductor wafer 50 is provided, and the simulation model B corresponds to a portion where the recess 503 (FIG. 4A) is not provided. The laser beam was incident on the upper surface of the semiconductor wafer of the simulation model A and the simulation model B, and the maximum temperature reached immediately after the third shot was incident was calculated by simulation.

図6Cに、シミュレーション結果を示す。横軸は半導体ウエハの上面からの深さを単位「μm」で表し、縦軸は最高到達温度を単位「K」で表す。図6Cのグラフ中の丸記号及び四角記号は、それぞれシミュレーションモデルA及びシミュレーションモデルBの半導体ウエハ内の温度を示す。   FIG. 6C shows the simulation result. The horizontal axis represents the depth from the upper surface of the semiconductor wafer in the unit of “μm”, and the vertical axis represents the maximum temperature reached in the unit of “K”. A circle symbol and a square symbol in the graph of FIG. 6C indicate temperatures in the semiconductor wafer of the simulation model A and the simulation model B, respectively.

シミュレーションモデルAの最高到達温度が、シミュレーションモデルBの最高到達温度より高いことがわかる。これは、半導体ウエハとアニールテーブルとの界面に空気層が配置されることにより、熱伝達効率が低下したことに起因する。   It can be seen that the maximum temperature reached by simulation model A is higher than the maximum temperature reached by simulation model B. This is because the heat transfer efficiency is lowered due to the air layer disposed at the interface between the semiconductor wafer and the annealing table.

一般的に、IGBTのコレクタ層は、半導体ウエハの表面から1μm〜5μm程度まで達する。図6Cに示したシミュレーション結果から、半導体ウエハの深さ5μmより浅い領域においても、最高到達温度に差が生じていることがわかる。シミュレーションモデルAとシミュレーションモデルBとで、半導体ウエハの深さ5μmより浅い領域の最高到達温度に差が生じることは、図4Aに示した比較例において、凹部503が設けられた領域と、凹部503が設けられていない領域とで、ドーパントの活性化率が異なることを示唆している。   In general, the collector layer of the IGBT reaches about 1 μm to 5 μm from the surface of the semiconductor wafer. From the simulation results shown in FIG. 6C, it can be seen that there is a difference in the maximum temperature reached even in a region where the depth of the semiconductor wafer is less than 5 μm. The difference in the maximum temperature reached in the region shallower than the depth of 5 μm of the semiconductor wafer between the simulation model A and the simulation model B is that in the comparative example shown in FIG. 4A, the region where the recess 503 is provided and the recess 503 This suggests that the activation rate of the dopant differs in the region where no is provided.

実施例においては、凹部503(図4B)が接着剤で充填されるため、空洞が発生しない。このため、最高到達温度が凹部503の影響を受けにくい。これにより、面内方向に関して、ドーパントの活性化率を均一化することが可能である。   In the embodiment, since the recess 503 (FIG. 4B) is filled with the adhesive, no cavity is generated. For this reason, the maximum temperature reached is not easily affected by the recess 503. Thereby, the activation rate of the dopant can be made uniform in the in-plane direction.

図7A及び図7Bを参照して、半導体ウエハの下に配置される樹脂層の厚さを変化させたときの最高到達温度のシミュレーション結果について説明する。   With reference to FIG. 7A and FIG. 7B, the simulation result of the highest temperature achieved when the thickness of the resin layer disposed under the semiconductor wafer is changed will be described.

図7Aに、シミュレーションモデルの断面図を示す。厚さ100μmの半導体ウエハの下に、厚さ10μm乃至200μmの樹脂層が配置されている。この樹脂層は、図3Cに示した接着剤層付の粘着テープ51に対応する。樹脂層の下には、SiO(ガラス)が配置されているという条件でシミュレーションを行った。 FIG. 7A shows a cross-sectional view of the simulation model. A resin layer having a thickness of 10 μm to 200 μm is disposed under a semiconductor wafer having a thickness of 100 μm. This resin layer corresponds to the adhesive tape 51 with the adhesive layer shown in FIG. 3C. The simulation was performed under the condition that SiO 2 (glass) was disposed under the resin layer.

図7Bに、シミュレーション結果を示す。横軸は樹脂層の厚さを単位「μm」で表し、縦軸は最高到達温度を単位「K」で表す。図7Bのグラフ中の丸記号、四角記号、三角記号、五角形記号、六角形記号、及び星形記号は、それぞれ半導体ウエハの上面からの深さが0μm、1μm、2μm、3μm、5μm、及び10μmの位置の最高到達温度を示す。図3Cに示した断面図において、凹部503が設けられている部分が、樹脂層の厚いシミュレーションモデルに対応し、凹部503が設けられていない部分が、樹脂層の薄いシミュレーションモデルに対応する。   FIG. 7B shows the simulation result. The horizontal axis represents the thickness of the resin layer in the unit “μm”, and the vertical axis represents the maximum temperature reached in the unit “K”. The circle symbol, square symbol, triangle symbol, pentagon symbol, hexagon symbol, and star symbol in the graph of FIG. 7B have a depth from the top surface of the semiconductor wafer of 0 μm, 1 μm, 2 μm, 3 μm, 5 μm, and 10 μm, respectively. The highest temperature reached at the position of. In the cross-sectional view shown in FIG. 3C, a portion where the recess 503 is provided corresponds to a simulation model with a thick resin layer, and a portion where no recess 503 is provided corresponds to a simulation model with a thin resin layer.

いずれの深さにおいても、樹脂層が厚くなるに従って最高到達温度が低くなっている。これは、樹脂層が厚くなると、樹脂層の熱容量が大きくなり、半導体ウエハから樹脂層に、より多くの熱が吸収されるためと考えられる。   At any depth, the maximum temperature reached decreases as the resin layer becomes thicker. This is presumably because as the resin layer becomes thicker, the heat capacity of the resin layer increases and more heat is absorbed from the semiconductor wafer into the resin layer.

樹脂層の厚さ変化に対する最高到達温度の変化の傾きは、樹脂層が厚くなるほど緩やかである。これは、粘着テープ51が厚くなると、最高到達温度が凹部503(図3C)の有無の影響を受け難いことを意味する。面内方向に関する温度のばらつきを少なくするために、粘着テープ51の厚さを100μm以上にすることが好ましい。粘着テープ51の厚さが200μmを超えると、粘着テープ51を厚くしても、温度のばらつきを少なくする効果に大きな変化はない。従って、粘着テープ51の厚さは、200μm以下とすることが好ましい。   The gradient of the change in the maximum temperature achieved with respect to the thickness change of the resin layer becomes more gradual as the resin layer becomes thicker. This means that when the pressure-sensitive adhesive tape 51 becomes thick, the maximum temperature reached is less affected by the presence or absence of the recess 503 (FIG. 3C). In order to reduce the variation in temperature in the in-plane direction, the thickness of the adhesive tape 51 is preferably 100 μm or more. When the thickness of the adhesive tape 51 exceeds 200 μm, even if the adhesive tape 51 is thickened, there is no significant change in the effect of reducing the temperature variation. Therefore, the thickness of the adhesive tape 51 is preferably 200 μm or less.

図8Aに、実施例による方法で製造される半導体装置の例として、IGBTの断面図を示す。n型のシリコンからなる半導体ウエハ50の表側の面501にエミッタとゲートが形成される。裏側の面502コレクタが形成される。半導体ウエハ50として、通常はシリコン単結晶ウエハが用いられる。表側の面501に形成されるエミッタとゲート等の構造は、一般的なMOSFETの作製工程と同様の工程で作製される。例えば、図8Aに示すように、半導体ウエハ50の表側の面501の表層部に、p型のベース領域61、n型のエミッタ領域62、ゲート電極63、ゲート絶縁膜64、エミッタ電極65が配置される。ゲート−エミッタ間の電圧で、電流のオンオフ制御を行うことができる。   FIG. 8A shows a cross-sectional view of an IGBT as an example of a semiconductor device manufactured by the method according to the embodiment. An emitter and a gate are formed on the front surface 501 of the semiconductor wafer 50 made of n-type silicon. A backside surface 502 collector is formed. As the semiconductor wafer 50, a silicon single crystal wafer is usually used. Structures such as an emitter and a gate formed on the surface 501 on the front side are manufactured in the same process as a general MOSFET manufacturing process. For example, as shown in FIG. 8A, a p-type base region 61, an n-type emitter region 62, a gate electrode 63, a gate insulating film 64, and an emitter electrode 65 are disposed on the surface layer portion of the front surface 501 of the semiconductor wafer 50. Is done. Current on / off control can be performed by the voltage between the gate and the emitter.

半導体ウエハ50の裏側の面502の表層部に、p型のコレクタ層67及び低濃度のn型のバッファ層66が形成されている。バッファ層66は、コレクタ層67よりも深い位置に配置される。コレクタ層67及びバッファ層66は、それぞれドーパントとして、例えばボロン及びリンをイオン注入し、活性化アニールを行うことにより形成される。この活性化アニールに、図1に示したレーザアニール装置が適用される。コレクタ電極68が、活性化アニールの後に、コレクタ層67の表面に形成される。   A p-type collector layer 67 and a low-concentration n-type buffer layer 66 are formed on the surface layer portion of the back surface 502 of the semiconductor wafer 50. The buffer layer 66 is disposed at a position deeper than the collector layer 67. The collector layer 67 and the buffer layer 66 are formed by implanting boron and phosphorus, for example, as dopants and performing activation annealing. The laser annealing apparatus shown in FIG. 1 is applied to this activation annealing. A collector electrode 68 is formed on the surface of the collector layer 67 after the activation annealing.

裏側の面502からコレクタ層67とバッファ層66との界面までの深さは、例えば約0.3μmである。裏側の面502からバッファ層66の最も深い位置までの深さは、例えば1μm〜5μmの範囲内である。   The depth from the back surface 502 to the interface between the collector layer 67 and the buffer layer 66 is, for example, about 0.3 μm. The depth from the back surface 502 to the deepest position of the buffer layer 66 is, for example, in the range of 1 μm to 5 μm.

図8Bに、レーザアニールを行う段階の半導体ウエハ50の断面図を示す。半導体ウエハ50の裏側の面502の表面近傍の相対的に浅い部分67aにボロンがイオン注入されている。相対的に深い部分66aにリンがイオン注入されている。浅い部分67a内のボロン、及び深い部分66a内のリンは、活性化していない。   FIG. 8B shows a cross-sectional view of the semiconductor wafer 50 at a stage where laser annealing is performed. Boron is ion-implanted into a relatively shallow portion 67 a near the surface 502 of the back surface 502 of the semiconductor wafer 50. Phosphorus ions are implanted into the relatively deep portion 66a. Boron in the shallow portion 67a and phosphorus in the deep portion 66a are not activated.

半導体ウエハ50の表側の面501に凹部503が形成されている。凹部503内に、粘着テープ51の接着剤層512の接着剤が充填されている。粘着テープ51がアニールテーブル40に吸着されている。半導体ウエハ50の裏側の面502にパルスレーザビーム38を入射させることにより、レーザアニールが行われる。このレーザアニールにより、浅い部分67a内のボロン及び深い部分66a内のリンが活性化される。   A recess 503 is formed on the front surface 501 of the semiconductor wafer 50. The recess 503 is filled with the adhesive of the adhesive layer 512 of the adhesive tape 51. The adhesive tape 51 is adsorbed on the annealing table 40. Laser annealing is performed by causing the pulse laser beam 38 to enter the back surface 502 of the semiconductor wafer 50. By this laser annealing, boron in the shallow portion 67a and phosphorus in the deep portion 66a are activated.

レーザアニール時に、表側の面501の凹部503に接着剤層512の接着剤が充填されているため、ウエハ面内方向に関して、一様なアニールを行うことが可能である。   At the time of laser annealing, since the adhesive of the adhesive layer 512 is filled in the concave portion 503 of the front surface 501, uniform annealing can be performed in the wafer in-plane direction.

図8A及び図8Bでは、実施例によるレーザアニール装置をIGBTの製造に適用したが、実施例によるレーザアニール装置は、その他の半導体素子、例えばイメージセンサ用の素子の製造にも適用することが可能である。   8A and 8B, the laser annealing apparatus according to the embodiment is applied to the manufacture of the IGBT. However, the laser annealing apparatus according to the embodiment can be applied to the manufacture of other semiconductor elements, for example, an element for an image sensor. It is.

上記実施例では、半導体ウエハ50の凹部503に充填する充填剤として、粘着テープ51(図3A)の接着剤層を用いたが、粘着テープ51以外の粘着部材の接着剤層を用いてもよい。例えば、粘着部材として、接着剤層付のガラス板を用いることも可能である。粘着部材として、接着剤層付のガラス板を用いる場合には、加圧機構46(図1、図2A)として、平面に均一な荷重を印加するプレス装置を用いることができる。   In the above embodiment, the adhesive layer of the pressure-sensitive adhesive tape 51 (FIG. 3A) is used as the filler that fills the recesses 503 of the semiconductor wafer 50, but an adhesive layer of a pressure-sensitive adhesive member other than the pressure-sensitive adhesive tape 51 may be used. . For example, a glass plate with an adhesive layer can be used as the adhesive member. When a glass plate with an adhesive layer is used as the adhesive member, a press device that applies a uniform load to the plane can be used as the pressurizing mechanism 46 (FIGS. 1 and 2A).

以上実施例に沿って本発明を説明したが、本発明はこれらに制限されるものではない。例えば、種々の変更、改良、組み合わせ等が可能なことは当業者に自明であろう。   Although the present invention has been described with reference to the embodiments, the present invention is not limited thereto. It will be apparent to those skilled in the art that various modifications, improvements, combinations, and the like can be made.

10 制御装置
21 半導体レーザ発振器
22 アッテネータ
23 ビームエキスパンダ
24 ホモジナイザ
25 ダイクロイックミラー
26 集光レンズ
27 伝搬光学系
31 固体レーザ発振器
32 可変アッテネータ
33 ビームエキスパンダ
34 ホモジナイザ
35 ベンディングミラー
38 パルスレーザビーム
40 アニールテーブル
41 移動機構
45 貼付テーブル
46 加圧機構
47 切断機
48 繰り出しロール
49 移送機構
50 半導体ウエハ
501 表側の面
502 裏側の面
503 凹部
51 粘着テープ
512 接着剤層
55 保護膜
551 気泡
552 変質部分
57 熱流
61 p型のベース領域
62 n型のエミッタ領域
63 ゲート電極
64 ゲート絶縁膜
65 エミッタ電極
66 n型のバッファ層
66a 深い部分
67 p型のコレクタ層
67a 浅い部分
68 コレクタ電極
DESCRIPTION OF SYMBOLS 10 Control apparatus 21 Semiconductor laser oscillator 22 Attenuator 23 Beam expander 24 Homogenizer 25 Dichroic mirror 26 Condensing lens 27 Propagation optical system 31 Solid laser oscillator 32 Variable attenuator 33 Beam expander 34 Homogenizer 35 Bending mirror 38 Pulse laser beam 40 Annealing table 41 Moving mechanism 45 Adhering table 46 Pressurizing mechanism 47 Cutting machine 48 Feeding roll 49 Transfer mechanism 50 Semiconductor wafer 501 Front side surface 502 Back side surface 503 Recess 51 Adhesive tape 512 Adhesive layer 55 Protective film 551 Bubble 552 Altered portion 57 Heat flow 61 p Type base region 62 n type emitter region 63 gate electrode 64 gate insulating film 65 emitter electrode 66 n type buffer layer 66a deep portion 67 p type collector layer 67a shallow portion Min 68 Collector electrode

Claims (5)

表側の面が凹凸を有する半導体ウエハを準備する工程と、
前記表側の面の凹部に充填剤を空洞が発生しないように充填する工程と、
前記充填剤が充填された前記半導体ウエハを、前記表側の面がアニールテーブルに対向する姿勢で、前記アニールテーブルに保持する工程と、
前記アニールテーブルに保持された前記半導体ウエハの、前記表側の面とは反対の裏側の面にレーザビームを入射させることにより、アニールを行う工程と
を有するレーザアニール方法。
Preparing a semiconductor wafer having an uneven surface on the front side;
A step of filling the front surface of the concave portion with a filler so as not to generate a cavity ;
Holding the semiconductor wafer filled with the filler on the annealing table in a posture in which the surface on the front side faces the annealing table;
And a step of annealing the semiconductor wafer held on the annealing table by causing a laser beam to be incident on a back surface opposite to the front surface.
前記充填剤は、接着剤層付の粘着部材の接着剤であり、前記充填剤を充填する工程において、前記粘着部材に対して前記表側の面に密着する方向の圧力を印加しながら、前記粘着部材を前記表側の面に貼付する請求項1に記載のレーザアニール方法。   The filler is an adhesive for an adhesive member with an adhesive layer. In the step of filling the filler, the adhesive is applied while applying pressure in a direction in close contact with the surface on the front side to the adhesive member. The laser annealing method according to claim 1, wherein a member is attached to the front side surface. 前記表側の面に樹脂製の保護膜が形成されており、前記保護膜の表面は、前記表側の面の凹凸を反映した形状を有する請求項1または2に記載のレーザアニール方法。   The laser annealing method according to claim 1, wherein a protective film made of a resin is formed on the front side surface, and the surface of the protective film has a shape reflecting the irregularities of the front side surface. 貼付テーブルと、
表側の面が凹凸を有する半導体ウエハが前記貼付テーブルに置かれた状態で、前記表側の面に接着剤層付の粘着部材の接着剤層を対向させ、前記粘着部材に対して前記表側の面に密着する方向に、前記半導体ウエハの表面の凹部内に空洞が発生しないように圧力を印加しながら、前記粘着部材を前記表側の面に貼付する加圧機構と、
前記貼付テーブルで前記粘着部材が接着された前記半導体ウエハを保持するアニールテーブルと、
前記アニールテーブルに保持された前記半導体ウエハに、レーザビームを入射させるレーザ光学系と
を有するレーザアニール装置。
Affixing table;
In a state where a semiconductor wafer having an uneven surface is placed on the sticking table, the adhesive layer of the adhesive member with an adhesive layer is opposed to the front surface, and the surface on the front side with respect to the adhesive member A pressure mechanism for applying the pressure-sensitive adhesive member to the front side surface while applying pressure so that no cavity is generated in the concave portion of the surface of the semiconductor wafer in the direction of tightly contacting the surface ,
An annealing table for holding the semiconductor wafer to which the adhesive member is bonded by the pasting table;
A laser annealing apparatus comprising: a laser optical system that causes a laser beam to be incident on the semiconductor wafer held on the annealing table.
さらに、前記貼付テーブルに保持された前記半導体ウエハを、前記アニールテーブルまで移送する移送機構を有する請求項4に記載のレーザアニール装置。
The laser annealing apparatus according to claim 4, further comprising a transfer mechanism that transfers the semiconductor wafer held on the sticking table to the annealing table.
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JP2006196710A (en) * 2005-01-13 2006-07-27 Fuji Electric Device Technology Co Ltd Manufacturing method of semiconductor device
JP5455598B2 (en) * 2009-05-07 2014-03-26 住友重機械工業株式会社 Manufacturing method of semiconductor device
JP2011171712A (en) * 2010-01-21 2011-09-01 Hitachi Chem Co Ltd Adhesive tape for semiconductor wafer processing, method of manufacturing semiconductor wafer with adhesive tape for semiconductor wafer processing, method of manufacturing semiconductor device, and semiconductor device
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