JPS5855693B2 - パルス発生回路 - Google Patents
パルス発生回路Info
- Publication number
- JPS5855693B2 JPS5855693B2 JP52160765A JP16076577A JPS5855693B2 JP S5855693 B2 JPS5855693 B2 JP S5855693B2 JP 52160765 A JP52160765 A JP 52160765A JP 16076577 A JP16076577 A JP 16076577A JP S5855693 B2 JPS5855693 B2 JP S5855693B2
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- transistors
- input signal
- flip
- flop circuit
- Prior art date
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- Expired
Links
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- 230000000630 rising effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
- 230000010354 integration Effects 0.000 description 3
- 239000004065 semiconductor Substances 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000004069 differentiation Effects 0.000 description 1
Landscapes
- Manipulation Of Pulses (AREA)
Description
【発明の詳細な説明】
本発明は、入力信号の立上り、および立下りにそれぞれ
同期したパルスを同一方向に出力するパルス発生回路に
関する。
同期したパルスを同一方向に出力するパルス発生回路に
関する。
従来、入力信号の立上りおよび立下りに同期したパルス
を得るために、入力信号を容量等を用いた微分回路を通
して立上りおよび立下りに同期した微小パルス幅のパル
スを得、その後両波整流器により同一方向のパルスとし
て取り出すことが一般的であった。
を得るために、入力信号を容量等を用いた微分回路を通
して立上りおよび立下りに同期した微小パルス幅のパル
スを得、その後両波整流器により同一方向のパルスとし
て取り出すことが一般的であった。
しかし、この従来方式は容量を必要とし、半導体集積化
には適しないものである。
には適しないものである。
本発明は、前記従来回路の欠点を除去した半導体集積化
に適したパルス発生回路を提供するものである。
に適したパルス発生回路を提供するものである。
第１図は本発明のパルス発生回路の実施例である。
差動接続されたトランジスタ１と２及び直流レベルシフ
ト用トランジスタ３と４及びほぼ等しい値の抵抗５と６
の接続は、トランジスタ１と２のいずれか一方が導通、
他方がカットオフ状態で安定するフリップフロップの接
続となっている。
ト用トランジスタ３と４及びほぼ等しい値の抵抗５と６
の接続は、トランジスタ１と２のいずれか一方が導通、
他方がカットオフ状態で安定するフリップフロップの接
続となっている。
トランジスタ７と８は前記トランジスタ１と２等で構成
するフリップフロップ回路にトリガーを与える差動増幅
器で、入力信号源９が互いのベース間に印加されている
。
するフリップフロップ回路にトリガーを与える差動増幅
器で、入力信号源９が互いのベース間に印加されている
。
したがってフリップフロップ回路はトランジスタ７と８
のコレクタ電流により状態が制御され、例えはトランジ
スタ１が導通、トランジスタ２がカットオフとなって安
定している場合、入力信号源９によってトランジスタ８
が導通し、トランジスタ８のコレクタ電流が抵抗６を流
れることによってトランジスタ１のベース電圧が低下し
、トランジスタ１のベース電圧がトランジスタ２のベー
ス電圧より低下したときトランジスタ１がカットオフ、
トランジスタ２が導通してフリップフロップ回路の状態
が反転する。
のコレクタ電流により状態が制御され、例えはトランジ
スタ１が導通、トランジスタ２がカットオフとなって安
定している場合、入力信号源９によってトランジスタ８
が導通し、トランジスタ８のコレクタ電流が抵抗６を流
れることによってトランジスタ１のベース電圧が低下し
、トランジスタ１のベース電圧がトランジスタ２のベー
ス電圧より低下したときトランジスタ１がカットオフ、
トランジスタ２が導通してフリップフロップ回路の状態
が反転する。
また、フリップフロップ回路を反転させるトランジスタ
７及び８のコレクタ電流は入力信号源９の信号により制
御されるので、入力信号が平均電圧を通過後にフリップ
フロップ回路が反転するように電流源１０の電流■えを
選ぶと各部の信号は第２図に示すようになる。
７及び８のコレクタ電流は入力信号源９の信号により制
御されるので、入力信号が平均電圧を通過後にフリップ
フロップ回路が反転するように電流源１０の電流■えを
選ぶと各部の信号は第２図に示すようになる。
第２図Ａはトランジスタ７のベース電圧、Ｂの実線はト
ランジスタ７のコレクタ電流、Ｂの破線はトランジスタ
８のコンフタ電流、Ｃの実線はトランジスタ１のコレク
タ電流、Ｃの破線はトランジスタ２のコレクタ電流、Ｄ
の実線はトランジスタ７のコレクタ電圧、Ｄの破線はト
ランジスタ８のコレクタ電圧である。
ランジスタ７のコレクタ電流、Ｂの破線はトランジスタ
８のコンフタ電流、Ｃの実線はトランジスタ１のコレク
タ電流、Ｃの破線はトランジスタ２のコレクタ電流、Ｄ
の実線はトランジスタ７のコレクタ電圧、Ｄの破線はト
ランジスタ８のコレクタ電圧である。
入力信号が平均電圧を通過後にフリップフロップ回路が
反転するとトランジスタ７と８のコレクタ電圧は第２図
りに示すように入力信号に対し位相が遅れた信号となる
。
反転するとトランジスタ７と８のコレクタ電圧は第２図
りに示すように入力信号に対し位相が遅れた信号となる
。
よってトランジスタ１１と１３とを用いて整流した出力
端１４の波形はＥに示すように入力信号の立上りと立下
りに同期したパルスを得ることができる。
端１４の波形はＥに示すように入力信号の立上りと立下
りに同期したパルスを得ることができる。
またパルス振幅の立上りの中間点が入力信号の平均レベ
ルにほぼ同期しているので、後段の信号処理回路の動作
点をパルス振幅のほぼ中間点に設定すれば、入力信号が
入力信号の平均レベルを交差する点を検出できる。
ルにほぼ同期しているので、後段の信号処理回路の動作
点をパルス振幅のほぼ中間点に設定すれば、入力信号が
入力信号の平均レベルを交差する点を検出できる。
このことは、人力信号がＦＭ信号の場合、入力信号の振
幅変動にかかわらず入力信号周波数にのみ関係したパル
スを出力することができることを示す。
幅変動にかかわらず入力信号周波数にのみ関係したパル
スを出力することができることを示す。
以上説明のように本発明のパルス発生回路は、容量やイ
ンダクタンス素子を用いずに構成され、半導体集積化に
適したパルス発生回路である。
ンダクタンス素子を用いずに構成され、半導体集積化に
適したパルス発生回路である。
第１図は本発明のパルス発生回路の一実施例を示す図、
第２図は同実施例の動作説明図である。 １ ．２，３，４，７，８，１２，１３・・・・・・ト
ランジスタ、９・・・・・・入力信号源、１０，１１・
・・・・・定電流源、１４・・・・・・出力端子。
第２図は同実施例の動作説明図である。 １ ．２，３，４，７，８，１２，１３・・・・・・ト
ランジスタ、９・・・・・・入力信号源、１０，１１・
・・・・・定電流源、１４・・・・・・出力端子。
Claims (1)
- １ 差動接続された第１と第２のトランジスタのコレク
タに第１と第２の負荷抵抗を接続し、前記第１のトラン
ジスタのコレクタ出力信号を前記第２のトランジスタの
ベースへ印加し、前記第２のトランジスタのコレクタ出
力信号を第１のトランジスタのベースへ印加することに
よりフリップフロップ回路を構成し、そのフリップフロ
ップ回路を構成する前記第１と第２のトランジスタのコ
レクタにそれぞれ第３と第４のトランジスタのコレクタ
を接続し、前記第３と第４のトランジスタは共通エミッ
タ電流源を有する差動接続とし、前記第３と第４のトラ
ンジスタのベース間に入力信号を供給し、前記共通エミ
ッタ電流源の電流値を前記入力信号が平均電位を通過後
に前記フリップフロップ回路が反転するように設定し、
前記フリップフロップ回路の相異なる２つの出力信号を
整流回路へ供給して入力信号の立上り及び立下りに同期
したパルスを得ることを特徴としたパルス発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52160765A JPS5855693B2 (ja) | 1977-12-26 | 1977-12-26 | パルス発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52160765A JPS5855693B2 (ja) | 1977-12-26 | 1977-12-26 | パルス発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5488761A JPS5488761A (en) | 1979-07-14 |
| JPS5855693B2 true JPS5855693B2 (ja) | 1983-12-10 |
Family
ID=15721964
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52160765A Expired JPS5855693B2 (ja) | 1977-12-26 | 1977-12-26 | パルス発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5855693B2 (ja) |
-
1977
- 1977-12-26 JP JP52160765A patent/JPS5855693B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5488761A (en) | 1979-07-14 |
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