JPS5925231B2 - Chord storage device in electronic musical instruments - Google Patents
Chord storage device in electronic musical instrumentsInfo
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- JPS5925231B2 JPS5925231B2 JP50050766A JP5076675A JPS5925231B2 JP S5925231 B2 JPS5925231 B2 JP S5925231B2 JP 50050766 A JP50050766 A JP 50050766A JP 5076675 A JP5076675 A JP 5076675A JP S5925231 B2 JPS5925231 B2 JP S5925231B2
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- pressed
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- key
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Description
【発明の詳細な説明】 本発明は電子楽器におけるコード記憶装置に関する。[Detailed description of the invention] The present invention relates to a chord storage device for an electronic musical instrument.
従来、この種装置は記憶されたコードを解除するに際し
ては、解除用の別個のリセットスイッチを操作していた
。Conventionally, in this type of device, a separate reset switch was operated to clear the stored code.
このリセットスイッチは他の操作スイッチと同じように
鍵盤から離れた′々ネル上に設けるを一般としている。
そのため演奏に支障を来すことが多々あつた。本発明は
このような演奏に支障を来すことのないコード記憶装置
を提供することを目的とするもので、第1発明は入力イ
ンピーダンスの高い制御電極を有するFET等の楽音信
号出力回路開閉用半導体素子の複数個を併設し、各制御
電極にキーの押圧で充電され充電電圧で前記半導体素子
を導通させるコンデンサと放電回路とを接続し、各半導
体素子の入力電極にはコードに応じた複数の音源信号の
出力端子を接続し、且つキーを押した瞬間にパルスを発
生するノゞルス発生器を設け、その出力パルスで前記各
放電回路を瞬時閉路せしめ前記コンデンサを瞬時に放電
せしめるようにしたものにおいて、2個以上のキーを同
時に押圧したことを検出しその押圧されている間出力信
号を発生する該検出回路の出力信号で前記各放電回路を
2個以上のキーが押圧されている間閉路するようにした
ことを特徴とする。This reset switch, like other operation switches, is generally installed on a channel remote from the keyboard.
This often caused problems with performances. It is an object of the present invention to provide a chord storage device that does not cause any hindrance to such musical performance. A plurality of semiconductor elements are installed together, and each control electrode is connected to a discharge circuit and a capacitor that is charged by pressing a key and makes the semiconductor element conductive with a charging voltage. A noise generator is connected to the output terminal of the sound source signal and generates a pulse at the moment a key is pressed, and the output pulse instantaneously closes each of the discharge circuits and instantly discharges the capacitor. in which each of the discharge circuits is activated by the output signal of the detection circuit which detects when two or more keys are pressed simultaneously and generates an output signal while the keys are being pressed. It is characterized by a closed circuit.
第2発明は第1発明において該検出回路に2個のキーを
時間を異ならせて押圧を解いたとき、一方のキーの押圧
の解除で充電を開始してその所定の充電で作動を開始す
る補助回路を設け、該補助回路の作動で前記各放電回路
の閉路を維持せしめるようにしたことを特徴とする。A second aspect of the present invention is that in the first aspect, when two keys are released from being pressed at different times in the detection circuit, charging is started when one key is released from being pressed, and operation is started with the predetermined charging. The present invention is characterized in that an auxiliary circuit is provided, and the operation of the auxiliary circuit maintains the closed circuit of each of the discharge circuits.
次に、本発明の実施の一例を別紙図面につき説明する。Next, an example of the implementation of the present invention will be described with reference to the attached drawings.
図面で、1−1、1−2・・・・・・は入ガイシヒータ
ンスの高い制御電極1a−1,1a−2・・・・・・を
有する半導体素子を示し、これら反導体素子1−1,1
−2・・・・・・は例えばFETからなり、その制御電
極1a21,1a−2・・・・・・即ち、ゲート極を夫
々キースイツチ2−1,2−2・・・・・・を介して電
源の一極3aに接続すると共に、コンデンサ4−1,4
−2・・・・・・を各介して前記電源の他極3bに接続
した。In the drawings, 1-1, 1-2, . . . indicate semiconductor devices having control electrodes 1a-1, 1a-2, . -1,1
-2... consists of, for example, an FET, whose control electrodes 1a21, 1a-2..., i.e., gate electrodes are connected via key switches 2-1, 2-2, respectively. and connect it to one pole 3a of the power supply, and connect the capacitors 4-1, 4
-2... were connected to the other pole 3b of the power supply via each terminal.
2a−1,2a−2・・・・・・は前記キースイツチ2
一1,2−2・・・・・・に並設したキースイツチを示
し、これらキースイツチ2a−1,2a−2・・・・・
・は、一方は負電源5aに他方は夫々抵抗6を介して共
通に接続し、共通の抵抗7を介してアース電源5b〔正
〕に接続した。2a-1, 2a-2... are the key switches 2
Key switches 2a-1, 2-2, . . . are arranged in parallel.
* is connected in common to the negative power supply 5a through the respective resistors 6, and to the earth power supply 5b (positive) through the common resistor 7.
その共通の接続点8には微分回路9及びダイオード10
からなるパルス発生回階11を接続し、その出力端は第
1第2トランジスタ12,13及びダイオード14を介
して各コンデンサ4−1,4−2・・・・・・の共通の
放電回路15に介入したスイツチング素子たるトランジ
スタ16の制御電極16aに接続した。共通の放電回路
15は夫々ダイオード17を介して前記コンデンサ4−
1,4−2・・・・・・を接続した制御電極1a−1,
1a−2・・・・・・に接続した。各半導体素子1−1
,1−2・・・・・・の各入力電極、即ちソース極1b
−1,1b−2・・・・・・にはコードに応じた複数の
音源信号の出力端子を接続する。18はその接続回路に
介入した信号分離用の抵抗を示す0その出力電極1c−
1,1c−2・・・・・・は共通に接続し、リズムパル
ス発生器の出力信号によつて開かれるリズムゲート回路
19及び増幅器20を介してスピーカー21に接続した
。A differentiating circuit 9 and a diode 10 are connected to the common connection point 8.
The output terminal is connected to a common discharge circuit 15 for each capacitor 4-1, 4-2, . The control electrode 16a of the transistor 16, which is a switching element, is connected to the control electrode 16a. A common discharge circuit 15 connects the capacitors 4 to 4 through respective diodes 17.
Control electrode 1a-1, connected to 1, 4-2...
Connected to 1a-2... Each semiconductor element 1-1
, 1-2..., each input electrode, that is, the source electrode 1b
-1, 1b-2, . . . are connected to output terminals for a plurality of sound source signals corresponding to the code. 18 indicates a signal separation resistor inserted in the connection circuit 0 and its output electrode 1c-
1, 1c-2, . . . are connected in common and connected to a speaker 21 via a rhythm gate circuit 19 and an amplifier 20, which are opened by the output signal of the rhythm pulse generator.
かくて、今キーを押してキースイツチ2−1,2a−1
を閉じたとすると、パルス発生回路11からりセツトパ
ルスが発生し、第1トランジスタ12を0Nし、第2ト
ランジスタ13を0FFする0かくて、スイツチング素
子16の制御電極16aにはダイオード14を介して負
電位におかれ、該スイツチング素子16は導通し、夫々
ダイオード17を介して各コンデンサ4−1,4−2・
・・・・・は閉回路内におかれて瞬間的に放電される。Thus, if you press the key now, the key switch 2-1, 2a-1
When closed, a reset pulse is generated from the pulse generation circuit 11, which turns the first transistor 12 ON and the second transistor 13 OFF. When placed at a potential, the switching element 16 becomes conductive and connects each capacitor 4-1, 4-2, 4-2 through a diode 17, respectively.
... is placed in a closed circuit and is instantaneously discharged.
そして、そのりセツトパルスの消滅と共に第1トランジ
スタ12は0FF1第2トランジスタ13は0Nしてス
イツチング素子16は0FFとなる。かくして、コンデ
ンサ4−1キースイツチ2−1を介して充電され、半導
体素子1−1は導通し、複数の音源信号C,E,Gが同
時にこれを通つてリズムゲート19がリズムパルスによ
つて開路されることによりスピーカー21からCメジヤ
一のリズム音が得られる。半導体素子1−1はその制御
電極1a−1の入力インピーダンスは高いので、該コン
デンサ4−1の放電は容易に行なわれることなく、長時
間にわたつてその充電伏態を維持し、リズム音の発生を
続ける。次で、キースイツチ2−2,2a−2を閉じる
と、前記したようにりセツトパルスが発生してスイツチ
ング素子16が導通して前記コンデンサ4−1は瞬間的
に放電される。Then, when the set pulse disappears, the first transistor 12 becomes 0FF1, the second transistor 13 becomes 0N, and the switching element 16 becomes 0FF. Thus, the capacitor 4-1 is charged via the key switch 2-1, the semiconductor element 1-1 becomes conductive, a plurality of sound source signals C, E, and G pass through it simultaneously, and the rhythm gate 19 is opened by the rhythm pulse. As a result, a C major rhythm sound can be obtained from the speaker 21. Since the input impedance of the control electrode 1a-1 of the semiconductor element 1-1 is high, the capacitor 4-1 is not easily discharged and maintains its charged state for a long time, and the rhythm sound is Continue to occur. Next, when the key switches 2-2 and 2a-2 are closed, a reset pulse is generated as described above, the switching element 16 becomes conductive, and the capacitor 4-1 is instantaneously discharged.
続いて、牛−スイツチ2−2を介してコンデンサ4−2
は充電され、半導体素子1−2に導通が与えられ、Cマ
イナ一のリズム音が得られる。このようにして、各キー
を瞬間的に押すことによつて前の記憶が解かれて新たに
記憶されて自動的にリズム音が得られる。Subsequently, the capacitor 4-2 is connected via the cow-switch 2-2.
is charged, conduction is provided to the semiconductor element 1-2, and a C-minor rhythm sound is obtained. In this way, by momentarily pressing each key, the previous memory is cleared and a new memory is stored, automatically producing a rhythm sound.
尚、以上はコンデンサ4−1,4−2・・・・・・に連
がる午一スイツチ2−1,2−2・・・・・・とりセツ
トパルス発生用のキースイツチ2a−1,2a−2・・
・・・・とを各別に設けた場合について示したが、これ
らキースイツチ2−1,2−2・・・・・・,2a−1
,2a−2・・・・・・を第2図に示すように接続する
ことによつて共用することが出来る。In addition, the above describes the key switches 2a-1, 2a- for generating reset pulses, which are connected to the capacitors 4-1, 4-2, 2-1, 2-2, . 2...
. . . are provided separately, but these key switches 2-1, 2-2 . . . , 2a-1
, 2a-2, . . . can be shared by connecting them as shown in FIG.
第1図において22は2個以上のキースイツチを同時に
閉じたとき、これを検出する検出回路を示し、その検出
で各コンデンサ4−1,4−2・・・・・・を放電回路
15内に位置させて全ての記憶が解かれるようにした。In FIG. 1, 22 indicates a detection circuit that detects when two or more key switches are closed at the same time, and upon this detection, each capacitor 4-1, 4-2, etc. I placed it in such a way that all memories were released.
該検出回路22はキースイツチ2a−1,2a−2・・
・・・・の共通の接続点8に接続したゼナーダイオード
23と第1第2トランジスタ24,25と第2トランジ
スタ25コレクタをスイツチング素子16の制御電極1
6aに接続する回路に介入したダイオード26とからな
る。かくて、2個以上のキースイツチ2a−1,2a一
2・・・・・・を閉じると該ゼナーダイオード23は導
通し、第1トランジスタ24は0N1第2トランジスタ
25は0FFとなる。スイツチング素子16の制御電極
16aはダイオード26を介して負電源−Bに接続され
て該スイツチング素子16は導通し、各コンデンサ4−
1,4−2・・・・・・は放電回路15内におかれて各
半導体素子1−1,1−2・・・・・・を非導通の状態
におく、かかる状態においてキースイツチ2−1,2−
2・・・・・・,2a−1,2a−2・・・・・・を開
路すると何れのコンデンサ4一1,4−2・・・・・・
にも充電が行なわれないので、リズム演奏は停止される
。これらのキースイツチ2−1,2−2・・・・・・,
22a−1,2a−2・・・・・・はキーの押圧の解除
によつて開路されるのであるが、完全に同時に開路され
ることはありえない。The detection circuit 22 includes key switches 2a-1, 2a-2...
The Zener diode 23, the first and second transistors 24, 25, and the collector of the second transistor 25 connected to the common connection point 8 of the switching element 16 are connected to the control electrode 1 of the switching element 16.
6a and a diode 26 inserted into the circuit. Thus, when two or more key switches 2a-1, 2a-2, . The control electrode 16a of the switching element 16 is connected to the negative power supply -B through the diode 26, so that the switching element 16 is conductive, and each capacitor 4-
1, 4-2, . . . are placed in the discharge circuit 15 to put the respective semiconductor elements 1-1, 1-2, . 1,2-
2..., 2a-1, 2a-2...... When the circuit is opened, which capacitor 4-1, 4-2...
Since the battery is not charged, the rhythm performance is stopped. These key switches 2-1, 2-2...
22a-1, 2a-2, . . . are opened when the key is released, but they cannot be opened completely at the same time.
従つて、何れか遅く開路される牛一スイツチを通して充
電が行なわれ、予定しないコードが記憶される虞れがあ
る。かくて、これを防止すべく、補助回路28を設けた
。該補助回路28は第1トランジスタ24のコレクタに
連らなるコンデンサ29と前記第2トランジスタ25と
からなり、かくて、前記第1トランジスタ24の導通時
には該コンデンサ29は該トランジスタ24を介して閉
回路内におかれるので充電されない、そして、他のキー
スイツチが開かれてその1個ののみの閉路の維持により
該第1トランジスタ24は0FFとなると、該コンデン
サ29は充電を開始し、その電位が所定値に達するまで
、第2トランジスタ25は0FFを維持する。Therefore, there is a risk that charging will occur through the first switch which is opened later, and an unexpected code may be stored. Therefore, in order to prevent this, the auxiliary circuit 28 was provided. The auxiliary circuit 28 consists of a capacitor 29 connected to the collector of the first transistor 24 and the second transistor 25. Thus, when the first transistor 24 is conductive, the capacitor 29 is closed via the transistor 24. When the other key switch is opened and only one of them remains closed, the first transistor 24 becomes OFF, the capacitor 29 starts charging and its potential reaches a predetermined level. The second transistor 25 maintains 0FF until the value is reached.
かくて、同時に2つ以上のキーの押圧を解いて、各キー
スイツチの開路の時間的差に見合せた値にその時定数を
定めておくことにより、記憶されることが阻止される。
このように本発明によるときは、簡単な回路でコード記
憶回路が構成され、また、別個にリセツトスイツチを設
けることなく2個以上のキーを同時に押すことにより記
憶を消失せしめることができ、またその2個のキーを時
間を違えて押圧を解くようなことがあつても記憶が開始
されることなく、完全に記憶の消失を行うことができる
等の効果を有する。Thus, by releasing two or more keys at the same time and setting the time constant to a value commensurate with the time difference between opening of each key switch, memorization is prevented.
As described above, according to the present invention, the code storage circuit is configured with a simple circuit, and the memory can be erased by pressing two or more keys at the same time without providing a separate reset switch. Even if two keys are released from being pressed at different times, it is possible to completely erase the memory without starting the memory.
第1図は本発明の実施の一例の回路図、第2図は他の実
施例の回路図である。
1−1,1−2・・・・・・半導体素子、1a−1,,
1a2・・・・・・制御電極、2−1,2−2・・・・
・・,2a−1,2a−2・・・・・・午−スイツチ、
4−1,4〜2・・・・・・コンデンサ、11・・・・
・・パルス発生器、15・・・・・・放電回路、22・
・・・・・検出回路、28・・・・・・補助回路。FIG. 1 is a circuit diagram of one embodiment of the present invention, and FIG. 2 is a circuit diagram of another embodiment. 1-1, 1-2... Semiconductor element, 1a-1,,
1a2... Control electrode, 2-1, 2-2...
..., 2a-1, 2a-2...morning switch,
4-1, 4-2... Capacitor, 11...
...Pulse generator, 15...Discharge circuit, 22.
...Detection circuit, 28...Auxiliary circuit.
Claims (1)
等の楽音信号出力回路開閉用半導体素子の複数個を併設
し、各制御電極にキーの押圧で充電され充電電圧で前記
半導体素子を導通させるコンデンサと放電回路とを接続
し、各半導体素子の入力電極にはコードに応じた複数の
音源信号の出力端子を接続し、且つキーを押した瞬間に
パルスを発生するパルス発生器を設け、その出力パルス
で前記各放電回路を瞬時閉路せしめ前記コンデンサを瞬
時に放電せしめるようにしたものにおいて、2個以上の
キーを同時に押圧したことを検出しその押圧されている
間出力信号を発生する検出回路を設け、該検出回路の出
力信号で前記各放電回路を2個以上のキーが押圧されて
いる間閉路するようにしたことを特徴とする電子楽器に
おけるコード記憶装置。 2 該検出回路に2個のキーを時間を異ならせて押圧を
解いたとき、一方のキーの押圧の解除で充電を開始して
その所定の充電で作動を開始する補助回路を設け、該補
助回路が作動するまで前記各放電回路の閉路を維持せし
めるようにしたことを特徴とする特許請求の範囲1の電
子楽器におけるコード記憶装置。[Claims] 1. FET having a control electrode with high input impedance
A plurality of semiconductor elements for opening and closing musical sound signal output circuits such as the above are installed together, and each control electrode is connected to a discharge circuit and a capacitor that is charged by pressing a key and makes the semiconductor element conductive with the charging voltage, and the input of each semiconductor element is connected to a discharge circuit. A plurality of sound source signal output terminals corresponding to the code are connected to the electrodes, and a pulse generator is provided that generates a pulse at the moment a key is pressed, and the output pulse instantaneously closes each of the discharge circuits and causes the capacitor to close. In a device designed to cause instantaneous discharge, a detection circuit is provided that detects when two or more keys are pressed at the same time and generates an output signal while the keys are being pressed, and the output signal of the detection circuit is used to control each of the discharge circuits. A chord storage device for an electronic musical instrument, characterized in that the circuit is closed while two or more keys are pressed. 2. The detection circuit is provided with an auxiliary circuit that, when two keys are released from being pressed at different times, starts charging when one key is released and starts operating at a predetermined level of charging. 2. The chord storage device for an electronic musical instrument according to claim 1, wherein each discharge circuit is maintained closed until the circuit is activated.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50050766A JPS5925231B2 (en) | 1975-04-28 | 1975-04-28 | Chord storage device in electronic musical instruments |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50050766A JPS5925231B2 (en) | 1975-04-28 | 1975-04-28 | Chord storage device in electronic musical instruments |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS51126816A JPS51126816A (en) | 1976-11-05 |
| JPS5925231B2 true JPS5925231B2 (en) | 1984-06-15 |
Family
ID=12867948
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP50050766A Expired JPS5925231B2 (en) | 1975-04-28 | 1975-04-28 | Chord storage device in electronic musical instruments |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5925231B2 (en) |
-
1975
- 1975-04-28 JP JP50050766A patent/JPS5925231B2/en not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS51126816A (en) | 1976-11-05 |
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