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JPS593043B2 - Electronic tuning receiver preset display device - Google Patents
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JPS593043B2 - Electronic tuning receiver preset display device - Google Patents

Electronic tuning receiver preset display device

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Publication number
JPS593043B2
JPS593043B2 JP7808077A JP7808077A JPS593043B2 JP S593043 B2 JPS593043 B2 JP S593043B2 JP 7808077 A JP7808077 A JP 7808077A JP 7808077 A JP7808077 A JP 7808077A JP S593043 B2 JPS593043 B2 JP S593043B2
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JP
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down counter
preset
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switch
read
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JP7808077A
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政直 岡谷
洋 大西
禎秋 石橋
令介 佐藤
尚 菅沼
朋尚 横川
喜治 植木
春雄 釜
正 小菅
忠史 小川
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Pioneer Corp
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Pioneer Electronic Corp
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Publication date
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Priority to US05/921,155 priority patent/US4196395A/en
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  • Channel Selection Circuits, Automatic Tuning Circuits (AREA)

Description

【発明の詳細な説明】 この発明は電子同調受信機において、プリセットが確実
に行なわれることを表示するプリセット表示装・置に関
するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a preset display device/apparatus for indicating that preset is reliably performed in an electronically tuned receiver.

近年、電子技術の急速な発達に伴なって、電子的なプリ
セット選局が行なえる受信機が提案されている。
In recent years, with the rapid development of electronic technology, receivers that can perform electronic preset tuning have been proposed.

このプリセット受信機は、バンドセレクトスイッチとチ
ャンネルセレクトスイッチの出力によってメモリをアド
レスし、このアドレスされたメモリの番地にプリセット
されたバンドおよびチャンネル信号を読み出してマニュ
アルセット用のアップ・ダウンカウンタにセットし、そ
の出力をアナログ信号に変換して同調回路を構成する可
変容量ダイオードに供給することによりプリセツトされ
た所望のバンドおよびチャンネルの電波を受信するよう
に構成されている。
This preset receiver addresses the memory using the outputs of the band select switch and channel select switch, reads out the band and channel signals preset at the addressed memory address, and sets them in the up/down counter for manual setting. , and is configured to receive radio waves of a preset desired band and channel by converting the output into an analog signal and supplying the analog signal to a variable capacitance diode constituting a tuning circuit.

そしてこの場合、上述したチャンネルセレクトスイッチ
は、例えばノンロックタイプのスイッチによって構成さ
れており、バンドセレクトスイッチはロータリースイッ
チによって構成されており、このチャンネルセレクトス
イッチから出力されるチャンネルセレクト信号およびバ
ンドセレクトスイッチから出力されるバンドセレクト信
号を検出する毎に前記メモリ出力をアップ・ダウンカウ
ンタに読み込み制御するように構成されている。
In this case, the above-mentioned channel select switch is configured by a non-lock type switch, for example, and the band select switch is configured by a rotary switch, and the channel select signal output from this channel select switch and the band select switch The memory output is read into an up/down counter and controlled every time a band select signal outputted from the up/down counter is detected.

このように構成された電子同調受信機は、プリセットス
イッチを閉じた状態においてチャンネルセレクトスイッ
チを選択して閉じることによりその受信局をプリセット
することができるものであるが、何らかの原因によって
上記各スイッチの押し方が不足して閉じない場合には、
メモリにこの情報が書き込まれなくなり、不完全なプリ
セット動作(メモリ動作)となってしまう。
In the electronically tuned receiver configured in this way, the receiving station can be preset by selecting and closing the channel select switch while the preset switch is closed. If it does not close due to insufficient pressure,
This information is no longer written to the memory, resulting in an incomplete preset operation (memory operation).

この発明は上述した欠点を除去するためになされたもの
であって、メモリにプリセットのデータが書き込まれる
毎に表示素子を点灯表示するものである。
This invention has been made to eliminate the above-mentioned drawbacks, and each time preset data is written into a memory, a display element is turned on to display a display.

以下、図面を用いて詳細に説明する。図はこの発明によ
る電子同調受信機のプリセット表示装置の一実施例を示
すブロック図であって同図において1はマニュアル操作
によってアップパルスUあるいはタウンパルスDとクロ
ックパルスKCを選択的に発生するパルス発生器、2は
パルス発生器1のアップ・ダウンパルスUおよびクロッ
クパルスKCを入力とし、クロックパルスKCをアップ
・ダウンパルスU/Dに基づいてカウントする2進のア
ップ・ダウンカウンタ、3はアップ・ダウンカウンタ2
のカウント出力の上位数ビットを入力としてデジタル表
示を行なう周波数表示器、4は発振信号を分周した各段
の出力信号をアップ・ダウンカウンタ2の出力信号によ
って選択して合成することによりアップ・ダウンカウン
タ2の出力に対応したパルス数のシリアルパルス列ヲ得
るパルスシンセサイザ、5はローパスフィルタであって
、前記パルスシンセサイザ4とによってD−A変換部を
構成している。
Hereinafter, it will be explained in detail using the drawings. The figure is a block diagram showing one embodiment of a preset display device for an electronically tuned receiver according to the present invention. In the figure, reference numeral 1 indicates a pulse that selectively generates an up pulse U or a town pulse D and a clock pulse KC by manual operation. Generator, 2 is a binary up/down counter that receives up/down pulses U and clock pulses KC from pulse generator 1, and counts clock pulses KC based on up/down pulses U/D; 3 is an up/down counter;・Down counter 2
A frequency display 4 performs digital display by inputting the upper few bits of the count output of the oscillation signal. A pulse synthesizer 5 which obtains a serial pulse train of the number of pulses corresponding to the output of the down counter 2 is a low-pass filter, and together with the pulse synthesizer 4 constitutes a DA converter.

6はローパスフィルタ5の直流出力を図示しない同調回
路に切替えて供給することにより、バンドを選択するバ
ンドセレクトスイッチであって、固定接点a〜Cはそれ
ぞれA〜Cバンドを担当している。
Reference numeral 6 denotes a band select switch that selects a band by switching and supplying the direct current output of the low-pass filter 5 to a tuning circuit (not shown), and fixed contacts a to C are in charge of bands A to C, respectively.

7a〜7eはノンロックタイプのスイッチによって構成
されたチャンネルセレクトスイッチ、8はA〜Cバンド
を担当する固定接点a−cを有するバンドセレクトスイ
ッチであり、このバンドセレクトスイッチ8と前記バン
ドセレクトスイッチ6は連動している。
Reference numerals 7a to 7e designate channel select switches constituted by non-locking type switches, 8 a band select switch having fixed contacts a to c in charge of bands A to C, and this band select switch 8 and the band select switch 6 are linked.

9はチャンネルセレクトスイッチ?a〜7eおよびバン
ドセレクトスイッチ8の出力によって指定された番地に
アップ・ダウンカウンタ2の出力を記憶したりあるいは
指定された番地に記憶されている内容を読み出してアッ
プ・ダウンカウンタ2に供給するリード−ライトメモリ
、10はチャンネルセレクトスイッチ1a〜γeの出力
およびバンドセレクトスイッチ8の出力を入力とし、プ
リセットスイッチ11がオフの場合には、チャンネルセ
レクトスイッチγa〜7eの出力発生時にアップ・ダウ
ンカウンタ2にロード信号りを保給し、またプリセット
スィッチ110オン時にはリード・ライトメモリ9にラ
イトパルスWを供給する制御回路、12は各チャンネル
セレクトスイッチ7a〜1eのオア出力を取り出すオア
ゲート、13はDタイプのフリップフロップであって、
このフリップフロップ13はオアゲート12の出力をC
K入力端に供給され、D入力端がアースに接続されると
ともに、制御回路10からリード・ライトメモリ9に供
給されるライトパルスWをセット入力としている。
Is 9 the channel select switch? A lead that stores the output of the up/down counter 2 at the address specified by the output of a to 7e and the band select switch 8, or reads out the contents stored at the specified address and supplies it to the up/down counter 2. - The write memory 10 receives the outputs of the channel select switches 1a to γe and the outputs of the band select switch 8 as inputs, and when the preset switch 11 is off, the up/down counter 2 is activated when the output of the channel select switches γa to 7e occurs. 12 is an OR gate that takes out the OR output of each channel select switch 7a to 1e, and 13 is a D type control circuit. A flip-flop,
This flip-flop 13 converts the output of the OR gate 12 into C
A write pulse W is supplied to the K input terminal, the D input terminal is connected to ground, and the write pulse W supplied from the control circuit 10 to the read/write memory 9 is used as a set input.

14は抵抗15を介して供給されるフリップフロップ1
3のセット出力Qによってオンとなるトランジスタ、1
6は前記トランジスタ14と保護用の抵抗11を介して
電源+Vとアース間に接続されたプリセット完了を表示
する発光ダイオードである。
14 is a flip-flop 1 supplied via a resistor 15.
A transistor that is turned on by the set output Q of 3, 1
Reference numeral 6 denotes a light emitting diode connected between the power supply +V and the ground via the transistor 14 and the protective resistor 11, which indicates the completion of presetting.

このように構成された電子同調受信機においてパルス発
生器1を操作して(回転させて)例えばクロックパルス
KCとアップパルスUを発生させると、これら両パルス
はアップ・ダウンカウンタ2に供給される。
In the electronically tuned receiver configured in this manner, when the pulse generator 1 is operated (rotated) to generate, for example, a clock pulse KC and an up pulse U, these two pulses are supplied to the up/down counter 2. .

アップ・ダウンカウンタ2は、アップパルスUに従って
クロックパルスKCを順次カウントアツプする。
The up/down counter 2 sequentially counts up the clock pulse KC in accordance with the up pulse U.

このアップ・ダウンカウンタ2のパラレル出力は、パル
スシンセサイザ4に供給され、ここにおいてアップ・ダ
ウンカウンタ2の出力に対応して発振信号を分周した各
段の信号が選択合成されて対応するパルス数のシリアル
パルス列に変換される。
The parallel output of the up/down counter 2 is supplied to a pulse synthesizer 4, where the signals of each stage, which are frequency-divided oscillation signals corresponding to the output of the up/down counter 2, are selectively synthesized to produce the corresponding number of pulses. is converted into a serial pulse train.

そして、このパルスシンセサイザ゛4の出力信号は、ロ
ーパスフィルタ5において高周波成分が除去されてアッ
プ・ダウンカウンタ2の出力に対応した直流電圧信号と
なる。
The output signal of the pulse synthesizer 4 has high frequency components removed in a low-pass filter 5, and becomes a DC voltage signal corresponding to the output of the up/down counter 2.

この直流電圧信号は、バンドセレクトスイッチ6におい
て選択された図示しない同調回路の可変容量ダイオード
に印加されて対応する周波数の同調が行なわれる。
This DC voltage signal is applied to a variable capacitance diode of a tuning circuit (not shown) selected by the band select switch 6, and the corresponding frequency is tuned.

また、前記アップ・ダウンカウンタ2の上位ビット信号
は周波数表示器3に供給されており、ここにおいて受信
中の周波数がデジタル表示される。
Further, the upper bit signal of the up/down counter 2 is supplied to a frequency display 3, where the frequency being received is digitally displayed.

以上の説明がマニュアル操作時における動作説明である
The above explanation is an explanation of the operation during manual operation.

次に所望放送局をプリセットする場合について説明する
Next, the case of presetting a desired broadcast station will be explained.

上述した方法によって所望の局を選局した状態において
、まずプリセットスイッチ11をオンにし、次にプリセ
ットしたいチャンネルに対応したチャンネルセレクトス
イッチ7a”−7eのいずれかをオンにすると、制御回
路10からリード・ライトメモリ9にライトパルスWが
供給され、リード・ライトメモリ9のバンドセレクトス
イッチ8およびオンされたチャンネルセレクトスイッチ
7a〜7eによって指定された番地にアップ・ダウンカ
ウンタ2のカウント出力、つまり受信中の同調周波数の
基となっているデジタル信号を記憶させることができる
With the desired station selected by the method described above, first turn on the preset switch 11, then turn on any of the channel select switches 7a'' to 7e corresponding to the channel you want to preset, and then the control circuit 10 sends a read signal. - The write pulse W is supplied to the write memory 9, and the count output of the up/down counter 2, that is, the count output of the up/down counter 2, that is, the reception The digital signal on which the tuning frequency is based can be stored.

このようにして、他のチャンネルにも所望周波数のプリ
セットが行なわれる。
In this way, desired frequencies are preset for other channels as well.

この場合、各チャンネルセレクトスイッチ1a〜7eは
ボタンが押された時に′H″H″となり、またDタイプ
のフリップフロップ13は、各チャンネルセレクトスイ
ッチ7a〜7eの出力を入力としてオア出力を送出する
オアゲート12の出力をクロック入力としており、クロ
ック人力CKの立下りエツジによって0人力の状態を取
り込むようになっていや。
In this case, each channel select switch 1a to 7e becomes ``H'' when the button is pressed, and the D-type flip-flop 13 sends an OR output using the output of each channel select switch 7a to 7e as input. The output of the OR gate 12 is used as a clock input, and the state of zero power is taken in by the falling edge of the clock power CK.

従って、通常状態においては各チャンネルセレクトスイ
ッチ7a〜1eの出力はL″であり、これに伴なってフ
リップフロップ130セツト出力QもttLjjとなっ
ており、このセット出力Qをベース入力とする発光ダイ
オード駆動用のトランジスタ14がオフとなって発光ダ
イオード16は非点灯である。
Therefore, in the normal state, the output of each channel select switch 7a to 1e is L'', and accordingly, the set output Q of the flip-flop 130 is also ttLjj, and the light emitting diode with this set output Q as the base input The driving transistor 14 is turned off and the light emitting diode 16 is not lit.

次にプリセットスイッチ11といずれかのチャンネルセ
レクトスイッチ1a〜1eが確実に操作されて両スイッ
チが閉じられると、制御回路10からリード・ライトメ
モリ9にライトパルスWが送出されてアップ・ダウンカ
ウンタ2のカウント出力がメモられる。
Next, when the preset switch 11 and any of the channel select switches 1a to 1e are reliably operated and both switches are closed, a write pulse W is sent from the control circuit 10 to the read/write memory 9 and the up/down counter 2 The count output is memorized.

この場合、ライトパルスWはフリップフロップ130セ
ツト入力端に供給されるために、これに伴なってノリツ
ブフロップ13はクロックCKの状態に関係なくセット
出力Qが11 H”となる。
In this case, the write pulse W is supplied to the set input terminal of the flip-flop 130, so that the set output Q of the Noribu-flop 13 becomes 11H'' regardless of the state of the clock CK.

この結果、トランジスタ14がオンとなって発光ダイオ
ード16が点灯してプリセットが確実に行なわれたこと
を表示する。
As a result, the transistor 14 is turned on and the light emitting diode 16 lights up, indicating that the preset has been reliably performed.

そして、ノンロックスイッチによって構成されているチ
ャンネルセレクトスイッチ1a〜1eを離すと、オアゲ
ート12を介して供給されるクロックCKが1H′″か
らL となり、この立下り時にフリップフロップ13が
リセットされて発光ダイオード16が消灯する。
When the channel select switches 1a to 1e, which are non-locking switches, are released, the clock CK supplied via the OR gate 12 changes from 1H''' to L, and at this fall, the flip-flop 13 is reset and emits light. Diode 16 turns off.

次に、プリセットスイッチ11またはチャンネルセレク
トスイッチ7a〜7eの操作が不完全であった場合には
、制御回路10からライトパルスWが送出されないため
にノリツブフロップ13はセットされることがなく、こ
れによって発光ダイオード16は点灯しない。
Next, if the operation of the preset switch 11 or the channel select switches 7a to 7e is incomplete, the control circuit 10 does not send out the write pulse W, so the control flop 13 is not set. Therefore, the light emitting diode 16 does not light up.

なお、この場合、チャンネルセレクトスイッチ1a〜7
eの立上り出力によってノリツブフロップ13にクロッ
ク信号が与えられるが、D入力がアースに接続されてL
uLjJとなっているために、セット出力QがH″とな
ることは全くなく、これに伴なって発光ダイオード16
の点灯も生じない。
In this case, channel select switches 1a to 7
A clock signal is given to the Noritsubu flop 13 by the rising output of e, but the D input is connected to ground and the L
uLjJ, the set output Q never becomes H'', and accordingly, the light emitting diode 16
does not light up.

次にプリセット選局を行なう場合には、希望する局に対
応したデジタル信号が記憶されている番地をバンドセレ
クトスイッチ8とチャンネルセレクトスイッチ?a”−
7eとによって選択する。
Next, when performing preset tuning, select the address where the digital signal corresponding to the desired station is stored between the band select switch 8 and the channel select switch. a”-
7e.

このような操作を行なうと、プリセットスイッチ11は
オフであるために制御回路10はアップ・ダウンカウン
タ2にロード信号りを供給する。
When such an operation is performed, since the preset switch 11 is off, the control circuit 10 supplies a load signal to the up/down counter 2.

この結果、バンドセレクトスイッチ8とチャンネルセレ
クトスイッチ1a〜7eの出力をアドレスとして読み出
したリード・ライトメモリ9の読み出し信号は、アップ
・ダウンカウンタ2にパラレルに読み込まれ、その出力
がデジタルシンセサイザ4に供給されてマニュアル操作
の場合と同様な選局動作が行なわれる。
As a result, the readout signals of the read/write memory 9, which read out the outputs of the band select switch 8 and channel select switches 1a to 7e as addresses, are read in parallel to the up/down counter 2, and the output is supplied to the digital synthesizer 4. Then, the same channel selection operation as in manual operation is performed.

以後、同一バンド内のプリセット選局変更は、チャンネ
ルセレクトスイッチ7a〜1eの選択的なオン制御のみ
で良く、またバンドが異なる場合には、バンドセレクト
スイッチ8を切替えた後に、チャンネルセレクトスイッ
チ1a〜1eを操作すれば良い。
From now on, to change the preset selection within the same band, it is only necessary to selectively turn on the channel select switches 7a to 1e, and if the bands are different, after switching the band select switch 8, change the channel select switches 1a to 1e. All you have to do is operate 1e.

この場合、プリセット選局においてもチャンネルセレク
トスイッチ7 a = 7 eが操作されるが、プリセ
ットスイッチ11がオフであるためにライトパルスWは
送出されず、これによってフリップフロップ13もセッ
トされないために発光ダイオード16は非点灯状態を続
ける。
In this case, the channel select switch 7a = 7e is operated during preset tuning as well, but since the preset switch 11 is off, the light pulse W is not sent out, and as a result, the flip-flop 13 is not set, so no light is emitted. The diode 16 continues to remain non-lit.

以上説明したようにこの発明によれば、メモリへのプリ
セット(記憶)が確実に行なわれた場合のみ発光ダイオ
ードを点灯させてプリセット操作が確実に行なわれたか
いなかの確認を行なうことができるために、スイッチ操
作の不完全に伴なうプリセットミスを防止することがで
きる優れた効果を有する。
As explained above, according to the present invention, the light emitting diode can be turned on only when the preset (storage) to the memory has been performed reliably, so that it can be confirmed whether the preset operation has been reliably performed. This has an excellent effect of preventing preset errors caused by incomplete switch operations.

【図面の簡単な説明】[Brief explanation of drawings]

図はこの発明による電子同調受信機のプリセット表示装
置の一実施例を示すブロック図である。 1・・・・・・パルス発生器、2・・・・・・アップ・
ダウンカウンタ、3・・・・・・周波数表示器、4・・
・・・・パルスシンセサイザ、5・・・・・・ローパス
フィルタ、6.8・・・・・・バンドセレクトスイッチ
、9・・・・・・リード・ライトメモ1ハ10・・・・
・・制御部、11・・・・・・プリセットスイッチ、1
2・・・・・・オアゲート、13・・・・・・フリップ
フロップ、14・・・・・・トランジスタ、16・・・
・・・発光ダイオード
The figure is a block diagram showing an embodiment of a preset display device for an electronically tuned receiver according to the present invention. 1...Pulse generator, 2...Up...
Down counter, 3... Frequency display, 4...
...Pulse synthesizer, 5...Low pass filter, 6.8...Band select switch, 9...Read/write memo 1c10...
...Control unit, 11...Preset switch, 1
2...OR gate, 13...Flip-flop, 14...Transistor, 16...
・・・Light emitting diode

Claims (1)

【特許請求の範囲】[Claims] 1 マニアル操作によってアップ・ダウンカウントが制
御されるアップ・ダウンカウンタと、このアップ・ダウ
ンカウンタのカウント出力によって受信機の同調をとる
手段と、バンドセレクトスイッチおよび複数のチャンネ
ルセレクトスイッチによってアドレスされてアップ・ダ
ウンカウンタのカウント出力の記憶およびアップ・ダウ
ンカウンタへの読み出し情報の送出を行なうリード・ラ
イトメモリと、プリセットスイッチとチャンネルセレク
トスイッチとバンドセレクトスイッチの出力によってリ
ード・ライトメモリの読み出し書き込み制御およびアッ
プ・ダウンカウンタに対するリード・ライトメモリ出力
の取り込み制御を行なう制御部とを具備する電子同調受
信機において、上記チャンネルセレクトスイッチの操作
中でかつ上記制御部からリードライトメモリに書き込み
制御信号が送出される時のみ点灯する表示素子が設けら
れたことを特徴とする電子同調受信機のプリセット表示
装置。
1. An up/down counter whose up/down counts are controlled by manual operation, means for tuning the receiver by the count output of this up/down counter, and up/down counters that are addressed by a band select switch and a plurality of channel select switches. - Read/write memory that stores the count output of the down counter and sends read information to the up/down counter, and controls read/write memory and up/down by the outputs of the preset switch, channel select switch, and band select switch. - In an electronic tuning receiver equipped with a control unit that controls the acquisition of read/write memory outputs to a down counter, a write control signal is sent from the control unit to the read/write memory while the channel select switch is being operated. 1. A preset display device for an electronically tuned receiver, characterized by being provided with a display element that lights up only at certain times.
JP7808077A 1977-06-30 1977-06-30 Electronic tuning receiver preset display device Expired JPS593043B2 (en)

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Application Number Priority Date Filing Date Title
JP7808077A JPS593043B2 (en) 1977-06-30 1977-06-30 Electronic tuning receiver preset display device
GB7828173A GB2002188B (en) 1977-06-30 1978-06-28 Preset state indicating unit in an electronic type receiver
DE19782828849 DE2828849A1 (en) 1977-06-30 1978-06-30 RECEIVER WITH ELECTRONIC VOTING
US05/921,155 US4196395A (en) 1977-06-30 1978-06-30 Preset state indicating unit in an electronic tuning type receiver

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JPS5456303A JPS5456303A (en) 1979-05-07
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