JPS6138660B2 - - Google Patents
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- JPS6138660B2 JPS6138660B2 JP14361177A JP14361177A JPS6138660B2 JP S6138660 B2 JPS6138660 B2 JP S6138660B2 JP 14361177 A JP14361177 A JP 14361177A JP 14361177 A JP14361177 A JP 14361177A JP S6138660 B2 JPS6138660 B2 JP S6138660B2
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- circuit
- resistor
- power line
- output end
- relay
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- 239000003990 capacitor Substances 0.000 claims description 23
- 238000001514 detection method Methods 0.000 claims description 16
- 238000004804 winding Methods 0.000 description 3
- 230000005540 biological transmission Effects 0.000 description 2
- 230000003321 amplification Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B3/00—Line transmission systems
- H04B3/54—Systems for transmission via power distribution lines
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B2203/00—Indexing scheme relating to line transmission systems
- H04B2203/54—Aspects of powerline communications not already covered by H04B3/54 and its subgroups
- H04B2203/5462—Systems for power line communications
- H04B2203/5483—Systems for power line communications using coupling circuits
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B2203/00—Indexing scheme relating to line transmission systems
- H04B2203/54—Aspects of powerline communications not already covered by H04B3/54 and its subgroups
- H04B2203/5462—Systems for power line communications
- H04B2203/5491—Systems for power line communications using filtering and bypassing
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Selective Calling Equipment (AREA)
- Remote Monitoring And Control Of Power-Distribution Networks (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Description
【発明の詳細な説明】
本発明は、受信回路に係り、尚詳細には電力線
伝送等による負荷の多重制御に用いられ、電力線
を介して伝送された制御信号により制御される受
信回路に関する。
伝送等による負荷の多重制御に用いられ、電力線
を介して伝送された制御信号により制御される受
信回路に関する。
従来、この種の受信回路においては、第４図に
示すように、電力線４に結合器８′とリミツト回
路９′との直列回路を接続し、前記リミツト回路
９′の出力端をコンデンサC1′とダイオードD1′と
の直列回路を介してエミツタを接地したトランジ
スタQ1′のベースに接続し、前記トランジスタ
Q1′のコレクタを抵抗R1′を介して前記電力線４に
接続した整流回路１４′の出力端に、且つ抵抗
R2′を介してノア回路NOR′の一方の入力端に接続
し、前記ノア回路NOR′の他方の入力端を抵抗
R3′と介して前記電力線４′に接続されたゲートパ
ルス発生回路１１′の出力端に接続しており、加
えて、前記ノア回路NOR′の出力端を２段のフリ
ツプフロツプFF1′，FF2′を介してSCR Q2′のゲ
ートに接続していたので、構成が煩雑であり、延
いては、小型化、経費節減等が困難であつた。本
発明は上述の欠点を除去した受信回路を提供しよ
うとするものである。
示すように、電力線４に結合器８′とリミツト回
路９′との直列回路を接続し、前記リミツト回路
９′の出力端をコンデンサC1′とダイオードD1′と
の直列回路を介してエミツタを接地したトランジ
スタQ1′のベースに接続し、前記トランジスタ
Q1′のコレクタを抵抗R1′を介して前記電力線４に
接続した整流回路１４′の出力端に、且つ抵抗
R2′を介してノア回路NOR′の一方の入力端に接続
し、前記ノア回路NOR′の他方の入力端を抵抗
R3′と介して前記電力線４′に接続されたゲートパ
ルス発生回路１１′の出力端に接続しており、加
えて、前記ノア回路NOR′の出力端を２段のフリ
ツプフロツプFF1′，FF2′を介してSCR Q2′のゲ
ートに接続していたので、構成が煩雑であり、延
いては、小型化、経費節減等が困難であつた。本
発明は上述の欠点を除去した受信回路を提供しよ
うとするものである。
以下本発明の受信回路を図面に沿つて説明す
る。
る。
第１図及び第２図において、１は受信回路で、
ブロツクフイルタ２を介して商用電源３に接続さ
れた電力線４に接続されている。５は前記電力線
４に接続された送信回路で、制御スイツチ６の押
圧に応じて制御信号S3を前記電力線４を介して前
記受信回路１へ送出し、前記受信回路１によりラ
ンプ等の負荷７を駆動せしめる。
ブロツクフイルタ２を介して商用電源３に接続さ
れた電力線４に接続されている。５は前記電力線
４に接続された送信回路で、制御スイツチ６の押
圧に応じて制御信号S3を前記電力線４を介して前
記受信回路１へ送出し、前記受信回路１によりラ
ンプ等の負荷７を駆動せしめる。
８は前記電力線に接続された結合器で、前記電
力線４を介して送信回路５より伝送された所定の
制御信号S3をリミツト回路９を介して受信信号検
出回路１０の一方の入力端に与える。１１は前記
電力線４に接続されたゲートパルス発生回路で、
電源電圧S1の位相Ｏで立ち上がり、位相πで立ち
下がるゲートパルスS2を前記受信信号検出回路１
０の他方の入力端に与える。１２はリレー駆動回
路で、前記受信信号検出回路１０とリレー回路１
３との間に挿入されており、前記制御信号S3の到
来に応じて前記リレー回路１３を駆動し、これに
より前記負荷７を適宜動作せしめる。１４は前記
電力線４に接続された整流回路で、出力端が前記
受信信号検出回路１０、ゲートパルス発生回路１
１、リレー駆動回路１２及びリレー回路１３に接
続されている。
力線４を介して送信回路５より伝送された所定の
制御信号S3をリミツト回路９を介して受信信号検
出回路１０の一方の入力端に与える。１１は前記
電力線４に接続されたゲートパルス発生回路で、
電源電圧S1の位相Ｏで立ち上がり、位相πで立ち
下がるゲートパルスS2を前記受信信号検出回路１
０の他方の入力端に与える。１２はリレー駆動回
路で、前記受信信号検出回路１０とリレー回路１
３との間に挿入されており、前記制御信号S3の到
来に応じて前記リレー回路１３を駆動し、これに
より前記負荷７を適宜動作せしめる。１４は前記
電力線４に接続された整流回路で、出力端が前記
受信信号検出回路１０、ゲートパルス発生回路１
１、リレー駆動回路１２及びリレー回路１３に接
続されている。
更に詳述するにはコンデンサC1を介して電力
線４の両端（２本のうち一方が接地されている）
に接続されており、２次巻線の一端がコンデンサ
C2を介して接地され、他端が直接に接地されて
いる。G1はリミツト回路９のインバータで、入
力端が抵抗R1とコンデンサC3との直列回路を介
して前記トランスIRの２次巻線の中間タツプに
接続され、更に入力端と出力端との間に抵抗R2
が挿入されている。NORは受信信号検出回路１
０のノア回路で、一方の入力端が第１，第２の抵
抗R3，R4とダイオードD1との直列回路を介して
前記リミツト回路９のインバータG1の出力端に
接続されている。R5は前記ゲートパルス発生回
路１１の抵抗で、一端が電力線４の非接地側に接
続され、他端が抵抗R6を介して接地されてい
る。G2はインバータで、入力端が抵抗R7を介し
てて前記低抗R5，R6の接続点に接続され、出力
端がインバータG3の入力端に接続されている。
SW1はスイツチで、一方の固定接点が前記インバ
ータG2の出力端に、他方の固定接点が前記イン
バータG3の出力端に接続されており、可動接点
がコンデンサC4と第３の抵抗R8との直列回路を
介して前記ノア回路NORの他の入力端に接続さ
れている。D2，D3は前記整流回路１４のダイオ
ードで、抵抗R9を介して互いに直列に接続さ
れ、電力線４の非接地側とリレー駆動回路１２の
トランジスタQ1のコレクタとの間に挿入されて
いる。ZDはツエナーダイオードで、前記ダイオ
ードD3と大地との間に挿入されている。C5はコ
ンデンサで、前記ツエナーダイオードZDに並列
に接続されている。R10は抵抗で、一端が前記ダ
イオードD3とツエナーダイオードZDとの接続点
に接続されており、他端がコンデンサC4と第３
の抵抗R8との接続点に接続されている。R11は第
４の抵抗で、一端が前記ダイオードD3とツエナ
ーダイオードZDとの接続点に接続されており、
他端が第１，第２の抵抗R3，R4の接続点に接続
されている。C6は第１のコンデンサで、前記第
４の抵抗R11に並列に接続されている。Q1は前記
リレー駆動回路１２のトランジスタで、コレクタ
が前記整流回路１４のダイオードD3とツエナー
ダイオードZDとの接続点に、ベースが前記受信
信号検出回路１０のノア回路NORの出力端に、
エミツタが第５の抵抗R12と第２のコンデンサC7
との直列回路を介して接地されている。Q2は
SCRで、アノードが前記リレー回路１３のリレ
ーコイルRyを介して前記整流回路１４のダイオ
ードD2と抵抗R9との接続点に、ゲートが第６の
抵抗R13を介して前記第５の抵抗R12と第２のコン
デンサC7と接続点に接続されており、カソード
が接地されている。R14は第７の抵抗で、SCR
Q2のゲート・カソード間に挿入されている。D4
はダイオードで、前記リレーコイルRyに逆並列
に接続されている。SW2は前記リレーコイルRy
によつて駆動されるスイツチで、一端が接地さ
れ、他端が前記負荷７を介して電力線４に接続さ
れている。
線４の両端（２本のうち一方が接地されている）
に接続されており、２次巻線の一端がコンデンサ
C2を介して接地され、他端が直接に接地されて
いる。G1はリミツト回路９のインバータで、入
力端が抵抗R1とコンデンサC3との直列回路を介
して前記トランスIRの２次巻線の中間タツプに
接続され、更に入力端と出力端との間に抵抗R2
が挿入されている。NORは受信信号検出回路１
０のノア回路で、一方の入力端が第１，第２の抵
抗R3，R4とダイオードD1との直列回路を介して
前記リミツト回路９のインバータG1の出力端に
接続されている。R5は前記ゲートパルス発生回
路１１の抵抗で、一端が電力線４の非接地側に接
続され、他端が抵抗R6を介して接地されてい
る。G2はインバータで、入力端が抵抗R7を介し
てて前記低抗R5，R6の接続点に接続され、出力
端がインバータG3の入力端に接続されている。
SW1はスイツチで、一方の固定接点が前記インバ
ータG2の出力端に、他方の固定接点が前記イン
バータG3の出力端に接続されており、可動接点
がコンデンサC4と第３の抵抗R8との直列回路を
介して前記ノア回路NORの他の入力端に接続さ
れている。D2，D3は前記整流回路１４のダイオ
ードで、抵抗R9を介して互いに直列に接続さ
れ、電力線４の非接地側とリレー駆動回路１２の
トランジスタQ1のコレクタとの間に挿入されて
いる。ZDはツエナーダイオードで、前記ダイオ
ードD3と大地との間に挿入されている。C5はコ
ンデンサで、前記ツエナーダイオードZDに並列
に接続されている。R10は抵抗で、一端が前記ダ
イオードD3とツエナーダイオードZDとの接続点
に接続されており、他端がコンデンサC4と第３
の抵抗R8との接続点に接続されている。R11は第
４の抵抗で、一端が前記ダイオードD3とツエナ
ーダイオードZDとの接続点に接続されており、
他端が第１，第２の抵抗R3，R4の接続点に接続
されている。C6は第１のコンデンサで、前記第
４の抵抗R11に並列に接続されている。Q1は前記
リレー駆動回路１２のトランジスタで、コレクタ
が前記整流回路１４のダイオードD3とツエナー
ダイオードZDとの接続点に、ベースが前記受信
信号検出回路１０のノア回路NORの出力端に、
エミツタが第５の抵抗R12と第２のコンデンサC7
との直列回路を介して接地されている。Q2は
SCRで、アノードが前記リレー回路１３のリレ
ーコイルRyを介して前記整流回路１４のダイオ
ードD2と抵抗R9との接続点に、ゲートが第６の
抵抗R13を介して前記第５の抵抗R12と第２のコン
デンサC7と接続点に接続されており、カソード
が接地されている。R14は第７の抵抗で、SCR
Q2のゲート・カソード間に挿入されている。D4
はダイオードで、前記リレーコイルRyに逆並列
に接続されている。SW2は前記リレーコイルRy
によつて駆動されるスイツチで、一端が接地さ
れ、他端が前記負荷７を介して電力線４に接続さ
れている。
更に本発明の受信回路の動作を詳述する。
電力線４に印加された電源電圧S1をゲートパル
ス発生回路１１の抵抗R5，R6で適宜分圧し、前
記分圧した電圧を抵抗R7を介してインバータ
G2，G3の直列回路に与える。ここに、整流回路
１４において、電源電圧S1を整流して略一定の電
圧を出力する。従つて、コンデンサC4の一方の
極がスイツチSW1を介して前記インンバータG2
の出力端に接続されている場合は、ゲートパルス
発生回路１１、即ち前記コンデンサC4と抵抗R10
の接続点にゲートパルスS2が出力される。
ス発生回路１１の抵抗R5，R6で適宜分圧し、前
記分圧した電圧を抵抗R7を介してインバータ
G2，G3の直列回路に与える。ここに、整流回路
１４において、電源電圧S1を整流して略一定の電
圧を出力する。従つて、コンデンサC4の一方の
極がスイツチSW1を介して前記インンバータG2
の出力端に接続されている場合は、ゲートパルス
発生回路１１、即ち前記コンデンサC4と抵抗R10
の接続点にゲートパルスS2が出力される。
一方、結合器８の入力端に送信回路５から電力
線４を介して制御信号S3が入力されると、前記結
合器８により所定の制御信号S3のみが選択的に後
続のリミツト回路９に与えられる。リミツト回路
９においては、前記制御信号S3のＯレベルに対し
Ｖ／２を対応せしめた信号S4を出力する（Ｖは電源電 圧S1のピーク値）。
線４を介して制御信号S3が入力されると、前記結
合器８により所定の制御信号S3のみが選択的に後
続のリミツト回路９に与えられる。リミツト回路
９においては、前記制御信号S3のＯレベルに対し
Ｖ／２を対応せしめた信号S4を出力する（Ｖは電源電 圧S1のピーク値）。
前記信号S4は、逆方向に接続されたダイオード
D1，第２，第１の抵抗R4，R3を介してパルスの
高さがV1（Ｖ／２〓V1＜Ｖ）である信号S5とされ、ノ ア回路NORの一方の入力端に与えられる。ま
た、前記ノア回路NORの他方の入力端には、前
記ゲートパルスS2が第３の抵抗R8を介して与え
られている。これにより前記ノア回路NORの出
力端には信号S6が出力される。
D1，第２，第１の抵抗R4，R3を介してパルスの
高さがV1（Ｖ／２〓V1＜Ｖ）である信号S5とされ、ノ ア回路NORの一方の入力端に与えられる。ま
た、前記ノア回路NORの他方の入力端には、前
記ゲートパルスS2が第３の抵抗R8を介して与え
られている。これにより前記ノア回路NORの出
力端には信号S6が出力される。
前記信号S6のパルス幅t1の期間にトランジスタ
Q1は導通され、第２のコンデンサC7に充電が行
なわれる。前記信号S6のパルス間隔t2の期間に前
記第２のコンデンサC7の充電電荷は放電される
が、後続のパルスにより再度前記トランジスタ
Q1が導通されるので、前記第２のコンデンサC7
は更に充電される。数回この動作を反復すること
により、前記第２のコンデンサC7の充電電圧は
所定電圧V2を超え、第６の抵抗R13を介してSCR
Q2のゲートに制御信号を与える。従つてSCR Q2
が導通しリレー回路１３のリレーコイルRyを付
勢する。前記リレーコイルRyの付勢に伴ない、
スイツチSW2を駆動し、負荷７を動作せしめる。
Q1は導通され、第２のコンデンサC7に充電が行
なわれる。前記信号S6のパルス間隔t2の期間に前
記第２のコンデンサC7の充電電荷は放電される
が、後続のパルスにより再度前記トランジスタ
Q1が導通されるので、前記第２のコンデンサC7
は更に充電される。数回この動作を反復すること
により、前記第２のコンデンサC7の充電電圧は
所定電圧V2を超え、第６の抵抗R13を介してSCR
Q2のゲートに制御信号を与える。従つてSCR Q2
が導通しリレー回路１３のリレーコイルRyを付
勢する。前記リレーコイルRyの付勢に伴ない、
スイツチSW2を駆動し、負荷７を動作せしめる。
尚、スイツチSW1の可動接点をインバータG3
の出力端に接触せしめておけば、信号S2が反転し
た形となり、この場合、電源電圧S1の正の半サイ
クルの開始時にローベルとなる信号S2が得られ
る。よつて、信号S2がローベルとなる期間に送信
回路５から制御信号S3が与えられれば受信信号検
出回路１０の出力にパルス信号S6が得られ、前述
と同様にリレー回路１３が動作し、負荷７への電
力供給が制御される。
の出力端に接触せしめておけば、信号S2が反転し
た形となり、この場合、電源電圧S1の正の半サイ
クルの開始時にローベルとなる信号S2が得られ
る。よつて、信号S2がローベルとなる期間に送信
回路５から制御信号S3が与えられれば受信信号検
出回路１０の出力にパルス信号S6が得られ、前述
と同様にリレー回路１３が動作し、負荷７への電
力供給が制御される。
従つて、複数の受信回路を有する場合、ゲート
パルス発生回路１１のパルスを発生する位相を
夫々異ならせ、送信回路５では各受信回路に割り
当てられた位相で制御信号S3を送出することによ
り、個々の受信回路を選択的に制御することがで
きる。第２図に示した例ではスイツチSW1をイン
バータG2側に設定した受信回路に対しては電源
電圧S1の（π，π＋θ）（θはパルスの発生期間
に対応する電気角）の位相の期間に制御信号S3を
送出するかどうかで制御が行え、同様にスイツチ
SW1をインバータG3側に設定した受信回路路に
対しては電源電圧S1の（Ｏ，Ｏ＋θ）の位相の期
間に制御信号S3を送出するかどうかで制御が行え
る。
パルス発生回路１１のパルスを発生する位相を
夫々異ならせ、送信回路５では各受信回路に割り
当てられた位相で制御信号S3を送出することによ
り、個々の受信回路を選択的に制御することがで
きる。第２図に示した例ではスイツチSW1をイン
バータG2側に設定した受信回路に対しては電源
電圧S1の（π，π＋θ）（θはパルスの発生期間
に対応する電気角）の位相の期間に制御信号S3を
送出するかどうかで制御が行え、同様にスイツチ
SW1をインバータG3側に設定した受信回路路に
対しては電源電圧S1の（Ｏ，Ｏ＋θ）の位相の期
間に制御信号S3を送出するかどうかで制御が行え
る。
上述のように本発明の受信回路にあつては、受
信信号検出回路を、一方の入力端が第１，第２の
抵抗とダイオードの直列回路を介してリミツト回
路の出力端に接続され、かつ他方の入力端が第３
の抵抗を介してゲートパルス発生回路の出力端に
接続されたノア回路と前記第１，第２の抵抗の接
続点と整流回路の出力端との間に挿入された第４
の抵抗と、前記第４の低抗に並列に接続された第
１のコンデンサとにより構成し、リレー駆動回路
を、コレクタが前記整流回路の出力端に接続され
ると共にベースが前記受信信号検出回路の出力端
に接続され、かつエミツタが第５の抵抗と第２の
コンデンサを介して接地されたトランジスタと、
アノードがリレー回路を介して前記整流回路の出
力端に接続されると共にゲートが第６の抵抗を介
して前記第５の抵抗と第２のコンデンサとの接続
点に接続され、かつカソードが接地されたSCR
と、前記SCRのゲートとカソードとの間に挿入
された第７の抵抗とにより構成するようにしたの
で、第４図に示した従来例と比較して (イ) 受信信号検出回路の増幅段を一段除去でき
る。
信信号検出回路を、一方の入力端が第１，第２の
抵抗とダイオードの直列回路を介してリミツト回
路の出力端に接続され、かつ他方の入力端が第３
の抵抗を介してゲートパルス発生回路の出力端に
接続されたノア回路と前記第１，第２の抵抗の接
続点と整流回路の出力端との間に挿入された第４
の抵抗と、前記第４の低抗に並列に接続された第
１のコンデンサとにより構成し、リレー駆動回路
を、コレクタが前記整流回路の出力端に接続され
ると共にベースが前記受信信号検出回路の出力端
に接続され、かつエミツタが第５の抵抗と第２の
コンデンサを介して接地されたトランジスタと、
アノードがリレー回路を介して前記整流回路の出
力端に接続されると共にゲートが第６の抵抗を介
して前記第５の抵抗と第２のコンデンサとの接続
点に接続され、かつカソードが接地されたSCR
と、前記SCRのゲートとカソードとの間に挿入
された第７の抵抗とにより構成するようにしたの
で、第４図に示した従来例と比較して (イ) 受信信号検出回路の増幅段を一段除去でき
る。
(ロ) リレー駆動回路のフリツプフロツプを除去で
きる。
きる。
(ハ) よつて、小型化を達成できる。
(ニ) あわせて、経費節減を達成できる。
等の効果を有する。
第１図及び第２図は本発明の受信回路の実施
例、第３図は同動作説明図、第４図は従来例を示
す。 １…受信回路、２…ブロツクフイルター、３…
商用電源、４…電力線、５…送信回路、６…制御
スイツチ、７…負荷、８…結合器、９…リミツト
回路、１０…受信信号検出回路、１１…ゲートパ
ルス発生回路、１２…リレー駆動回路、１３…リ
レー回路、１４…整流回路、C1〜C7…コンデン
サ、D1〜D4…ダイオード、G1〜G3…インバー
タ、NOR…ノア回路、Q1…トランジスタ、Q2…
SCR、R1〜R14…抵抗、Ry…リレーコイル、
SW1，SW2…スイツチ、TR…トランス、ZD…ツ
エナーダイオード。
例、第３図は同動作説明図、第４図は従来例を示
す。 １…受信回路、２…ブロツクフイルター、３…
商用電源、４…電力線、５…送信回路、６…制御
スイツチ、７…負荷、８…結合器、９…リミツト
回路、１０…受信信号検出回路、１１…ゲートパ
ルス発生回路、１２…リレー駆動回路、１３…リ
レー回路、１４…整流回路、C1〜C7…コンデン
サ、D1〜D4…ダイオード、G1〜G3…インバー
タ、NOR…ノア回路、Q1…トランジスタ、Q2…
SCR、R1〜R14…抵抗、Ry…リレーコイル、
SW1，SW2…スイツチ、TR…トランス、ZD…ツ
エナーダイオード。
Claims (1)
- １ 商用電源にブロツクフイルターを介して接続
された電力線に接続され、前記電力線に接続され
た送信回路から前記電力線を介して伝送された制
御信号によつて駆動される受信回路であつて、前
記電力線に接続され制御信号のみを通過させる結
合器と、前記結合器の出力端に接続され入力する
制御信号を所定の振幅に規制するリミツト回路
と、前記電力線に接続され商用電源の所定の位相
で所定幅のパルスを発生するゲートパルス発生回
路と、前記リミツト回路の出力端と前記ゲートパ
ルス発生回路の出力端とに接続され両信号が同時
に到来したのを検出する受信信号検出回路と、前
記受信信号検出回路の出力端に接続されたリレー
駆動回路と、前記リレー駆動回路により駆動され
るリレー回路と、前記リレー回路により動作され
る負荷と、前記電力線に接続され前記ゲートパル
ス発生回路、前記受信信号検出回路、前記リレー
駆動回路、前記リロー回路に直流電圧を与える整
流回路とを備えてなる受信回路において、前記受
信信号検出回路は一方の入力端が第１，第２の抵
抗とダイオードとの直列回路を介して前記リミツ
ト回路の出力端に接続され、かつ他方の入力端が
第３の抵抗を介して前記ゲートパルス発生回路の
出力端に接続されたノア回路と、前記第１，第２
の抵抗の接続点と前記整流回路の出力端との間に
挿入された第４の抵抗と、前記第４の抵抗に並列
に接続された第１のコンデンサとからなり、前記
リレー駆動回路はコレクタが前記整流回路の出力
端に接続されると共にベースが前記受信信号検出
回路の出力端に接続され、かつエミツタが第５の
抵抗と第２のコンデンサとを介して接地されたト
ランジスタと、アノードが前記リレー回路を介し
て前記整流回路の出力端に接続されると共にゲー
トが第６の抵抗を介して前記第５の抵抗と第２の
コンデンサとの接続点に接続され、かつカソード
が接地されたSCRと、前記SCRのゲートとカソ
ードとの間に挿入された第７の抵抗とを備えてな
ることを特徴とする受信回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14361177A JPS5476004A (en) | 1977-11-30 | 1977-11-30 | Receiving circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14361177A JPS5476004A (en) | 1977-11-30 | 1977-11-30 | Receiving circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5476004A JPS5476004A (en) | 1979-06-18 |
| JPS6138660B2 true JPS6138660B2 (ja) | 1986-08-30 |
Family
ID=15342751
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14361177A Granted JPS5476004A (en) | 1977-11-30 | 1977-11-30 | Receiving circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5476004A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6127233Y2 (ja) * | 1980-11-19 | 1986-08-14 |
-
1977
- 1977-11-30 JP JP14361177A patent/JPS5476004A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5476004A (en) | 1979-06-18 |
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