JPS6229909B2 - - Google Patents
Info
- Publication number
- JPS6229909B2 JPS6229909B2 JP55151259A JP15125980A JPS6229909B2 JP S6229909 B2 JPS6229909 B2 JP S6229909B2 JP 55151259 A JP55151259 A JP 55151259A JP 15125980 A JP15125980 A JP 15125980A JP S6229909 B2 JPS6229909 B2 JP S6229909B2
- Authority
- JP
- Japan
- Prior art keywords
- resin
- semiconductor device
- layer
- semiconductor element
- ceramic
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W42/00—Arrangements for protection of devices
- H10W42/20—Arrangements for protection of devices protecting against electromagnetic or particle radiation, e.g. light, X-rays, gamma-rays or electrons
- H10W42/25—Arrangements for protection of devices protecting against electromagnetic or particle radiation, e.g. light, X-rays, gamma-rays or electrons against alpha rays, e.g. for outer space applications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/67—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their insulating layers or insulating parts
- H10W70/68—Shapes or dispositions thereof
- H10W70/682—Shapes or dispositions thereof comprising holes having chips therein
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/075—Connecting or disconnecting of bond wires
- H10W72/07551—Connecting or disconnecting of bond wires characterised by changes in properties of the bond wires during the connecting
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
- H10W72/932—Plan-view shape, i.e. in top view
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W74/00—Encapsulations, e.g. protective coatings
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Description
【発明の詳細な説明】
本発明は、半導装置の製造方法に係り、特に半
導体素子を放射線から保護する保護膜の形成方法
に関する。
導体素子を放射線から保護する保護膜の形成方法
に関する。
近年、樹脂封止型半導体装置及びセラミツク封
止型半導体装置において、これらの樹脂及びセラ
ミツクの封止材料が放出するα粒子による、半導
体装置の誤動作が問題になつている。
止型半導体装置において、これらの樹脂及びセラ
ミツクの封止材料が放出するα粒子による、半導
体装置の誤動作が問題になつている。
従来、行われている樹脂封止型半導体装置の断
面図を第1図aに、セラミツク封止型半導体装置
の断面図を第1図bに、それぞれ示す。すなわ
ち、樹脂封止型半導体装置は、半導体素子1をリ
ードフレーム6に固定し、半導体素子の電極2,
3は、前記リードフレーム6と異なるリードフレ
ーム7,8に、アルミニウムなどの金属線4,5
によつて接続している。これらを樹脂9によつて
おおい、全体を固定している。また、セラミツク
型半導体装置第1図bは、半導体素子1を、セラ
ミツク容器10の空洞部内の金属薄板12上に固
定し、半導体素子の電極13,14をそれぞれリ
ード13,15に金属線4,5を用いて、接続
し、セラミツク又は金属製の蓋板11で封止して
いる。
面図を第1図aに、セラミツク封止型半導体装置
の断面図を第1図bに、それぞれ示す。すなわ
ち、樹脂封止型半導体装置は、半導体素子1をリ
ードフレーム6に固定し、半導体素子の電極2,
3は、前記リードフレーム6と異なるリードフレ
ーム7,8に、アルミニウムなどの金属線4,5
によつて接続している。これらを樹脂9によつて
おおい、全体を固定している。また、セラミツク
型半導体装置第1図bは、半導体素子1を、セラ
ミツク容器10の空洞部内の金属薄板12上に固
定し、半導体素子の電極13,14をそれぞれリ
ード13,15に金属線4,5を用いて、接続
し、セラミツク又は金属製の蓋板11で封止して
いる。
このような従来の封入方式では樹脂及びセラミ
ツクなどの容器の材料から放出されるα粒子は、
半導体素子内に入射され素子内に電荷を発生させ
ることになる。とくにランダムアクセスメモリー
(RAM)などの電荷を蓄積して情報を保持する半
導体集積回路素子ではα粒子の入射で生じる電荷
によつて情報が破壊されることになる。
ツクなどの容器の材料から放出されるα粒子は、
半導体素子内に入射され素子内に電荷を発生させ
ることになる。とくにランダムアクセスメモリー
(RAM)などの電荷を蓄積して情報を保持する半
導体集積回路素子ではα粒子の入射で生じる電荷
によつて情報が破壊されることになる。
これらの対策としてα粒子に対する阻止能力を
有する樹脂を半導体素子表面に塗布し、保護する
方法が一般的になされている。たとえば樹脂封止
型半導体装置において第2図aに示す様に半導体
基板の表面全体にポリイミド樹脂膜17を形成す
る。しかしながらこの場合はα粒子に対する阻止
能力は充分であるが、半導体素子電極2,3とリ
ードフレーム7,8とを接続している金属線4,
5が断線しやすく、高信頼性の半導体集積回路は
得られにくかつた。一方、従来においては第2図
bに示す様に、ポリイミド樹脂17′を電極を除
いて形成する場合もあるが、樹脂17′の厚さは
30〜100μmとなるように塗布し、フオトレジス
ト技術を用いて形状形成するので、ポリイミド樹
脂膜が厚いためパターン精度が非常に悪く実用的
ではない。
有する樹脂を半導体素子表面に塗布し、保護する
方法が一般的になされている。たとえば樹脂封止
型半導体装置において第2図aに示す様に半導体
基板の表面全体にポリイミド樹脂膜17を形成す
る。しかしながらこの場合はα粒子に対する阻止
能力は充分であるが、半導体素子電極2,3とリ
ードフレーム7,8とを接続している金属線4,
5が断線しやすく、高信頼性の半導体集積回路は
得られにくかつた。一方、従来においては第2図
bに示す様に、ポリイミド樹脂17′を電極を除
いて形成する場合もあるが、樹脂17′の厚さは
30〜100μmとなるように塗布し、フオトレジス
ト技術を用いて形状形成するので、ポリイミド樹
脂膜が厚いためパターン精度が非常に悪く実用的
ではない。
本発明の目的は、従来の半導体装置にみられる
上記の欠点を除去した樹脂封止型半導体装置及び
セラミツク封止型半導体装置の製造方法を提供す
ることにある。
上記の欠点を除去した樹脂封止型半導体装置及び
セラミツク封止型半導体装置の製造方法を提供す
ることにある。
上記の目的を達成するために、本発明ではポリ
イミド及びシリコンなどの樹脂膜を、半導体素子
のα粒子感受性の高い部分の表面に、選択的に2
層以上に形成することを特徴とする。
イミド及びシリコンなどの樹脂膜を、半導体素子
のα粒子感受性の高い部分の表面に、選択的に2
層以上に形成することを特徴とする。
以下に、実施例によつて本発明を説明する。
第3図及び第4図は本発明をMOS型RAMに適
用した場合である。半導体素子1の表面全体に、
ポリイミド樹脂を数μm程度の厚さで塗布したの
ち、フオトレジストを用いて、メモリセル及びセ
ンスアンプなどのα粒子の影響を受けやすい部分
だけに、ポリイミド樹脂膜15を形成する(第3
図a)。その後、滴下方法により形成される前記
ポリイミド樹脂膜16は、表面張力及び、前記ポ
リイミド樹脂膜15表面と半導体素子1表面の密
着性の違いから前記ポリイミド樹脂膜15の外側
へ流れ出さない。その後、熱処理でポリイミドを
硬化させる。この時、1層目の樹脂15と2層目
の樹脂16は異種の樹脂でもよい。これをエポキ
シ樹脂9を用いて全体を固定すれば、第4図に示
す樹脂封止型半導体装置が形成される。尚第5図
は第3図aの平面図である。又、第3図乃至第5
図で第1図aと同じ機能のところは同一符号で示
している。
用した場合である。半導体素子1の表面全体に、
ポリイミド樹脂を数μm程度の厚さで塗布したの
ち、フオトレジストを用いて、メモリセル及びセ
ンスアンプなどのα粒子の影響を受けやすい部分
だけに、ポリイミド樹脂膜15を形成する(第3
図a)。その後、滴下方法により形成される前記
ポリイミド樹脂膜16は、表面張力及び、前記ポ
リイミド樹脂膜15表面と半導体素子1表面の密
着性の違いから前記ポリイミド樹脂膜15の外側
へ流れ出さない。その後、熱処理でポリイミドを
硬化させる。この時、1層目の樹脂15と2層目
の樹脂16は異種の樹脂でもよい。これをエポキ
シ樹脂9を用いて全体を固定すれば、第4図に示
す樹脂封止型半導体装置が形成される。尚第5図
は第3図aの平面図である。又、第3図乃至第5
図で第1図aと同じ機能のところは同一符号で示
している。
又本発明において、1層目と樹脂と2層目の樹
脂に異種の樹脂を使用することによつて樹脂のエ
ツチング特性の差を利用することが出来る。すな
わち、フオート・レジストをマスクとして2層目
の樹脂をエツチングし、次に2層目の樹脂をマス
クとして1層目の樹脂をエツチングすることが出
来る。このようにすることによつて精度の良いパ
ターンを形成することが可能となる。
脂に異種の樹脂を使用することによつて樹脂のエ
ツチング特性の差を利用することが出来る。すな
わち、フオート・レジストをマスクとして2層目
の樹脂をエツチングし、次に2層目の樹脂をマス
クとして1層目の樹脂をエツチングすることが出
来る。このようにすることによつて精度の良いパ
ターンを形成することが可能となる。
第6図は本発明の他の実施例を示すもので、セ
ラミツク封止型半導体装置の半導体素子1の表面
に部分的に第1層目の樹脂15および第2層目の
樹脂16を設けたものである。尚、第6図におい
て第1図bと同じ機能のところは同一の符号で示
している。
ラミツク封止型半導体装置の半導体素子1の表面
に部分的に第1層目の樹脂15および第2層目の
樹脂16を設けたものである。尚、第6図におい
て第1図bと同じ機能のところは同一の符号で示
している。
このような、本発明によれば素子内のメモリセ
ル及びセンスアンプなどのα粒子の影響を受けや
すい部分の表面のみ2層目の樹脂膜を形成するこ
とにより、製造が容易で、充分に高い信頼性を特
つた半導体集積回路が実現できる。
ル及びセンスアンプなどのα粒子の影響を受けや
すい部分の表面のみ2層目の樹脂膜を形成するこ
とにより、製造が容易で、充分に高い信頼性を特
つた半導体集積回路が実現できる。
第1図a及び第1図bは、それぞれ従来の樹脂
封止型半導体装置及びセラミツク封止型半導体装
置の断面図である。第2図aおよび第2図bは第
1図aの半導体装置を従来技術により、放射線か
ら保護した構造を示す断面図である。第3図a及
び第3図bは本発明の一実施例の各工程を示す断
面図であり、第4図は一実施例の断面図であり、
第5図は第3図aの平面図である。第6図は本発
明の他の実施例を示す断面図である。 図中、1……半導体素子、2,3……半導体素
子のボンデイングパツド、4,5……金属線、
6,7,8……リードフレーム、9……封止樹
脂、10……セラミツク容器、11……蓋板、1
2……金属薄板、13,14……リード、15…
…第1層の樹脂、16……第2層の樹脂、17,
17′……樹脂である。
封止型半導体装置及びセラミツク封止型半導体装
置の断面図である。第2図aおよび第2図bは第
1図aの半導体装置を従来技術により、放射線か
ら保護した構造を示す断面図である。第3図a及
び第3図bは本発明の一実施例の各工程を示す断
面図であり、第4図は一実施例の断面図であり、
第5図は第3図aの平面図である。第6図は本発
明の他の実施例を示す断面図である。 図中、1……半導体素子、2,3……半導体素
子のボンデイングパツド、4,5……金属線、
6,7,8……リードフレーム、9……封止樹
脂、10……セラミツク容器、11……蓋板、1
2……金属薄板、13,14……リード、15…
…第1層の樹脂、16……第2層の樹脂、17,
17′……樹脂である。
Claims (1)
- 1 半導体素子の表面を放射線に対する阻止能力
を有する第1の樹脂で部分的に被覆し、該第1の
樹脂上に第2の樹脂を滴下し、しかる後滴下した
第2の樹脂を熱硬化せしめるか、もしくは前記第
1の樹脂上に該第1の樹脂とはエツチング特性の
異なる第2の樹脂を重ねて被覆することを特徴と
する半導体装置の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55151259A JPS5775447A (en) | 1980-10-28 | 1980-10-28 | Semiconductor device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55151259A JPS5775447A (en) | 1980-10-28 | 1980-10-28 | Semiconductor device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5775447A JPS5775447A (en) | 1982-05-12 |
| JPS6229909B2 true JPS6229909B2 (ja) | 1987-06-29 |
Family
ID=15514747
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55151259A Granted JPS5775447A (en) | 1980-10-28 | 1980-10-28 | Semiconductor device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5775447A (ja) |
-
1980
- 1980-10-28 JP JP55151259A patent/JPS5775447A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5775447A (en) | 1982-05-12 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US4712129A (en) | Integrated circuit device with textured bar cover | |
| US5622873A (en) | Process for manufacturing a resin molded image pick-up semiconductor chip having a window | |
| JPH0770562B2 (ja) | 半導体パッケージ及びその製造方法 | |
| JPS6249741B2 (ja) | ||
| JP2003309228A (ja) | 半導体装置及びその製造方法 | |
| JPH1092865A (ja) | 半導体装置およびその製造方法 | |
| US5264726A (en) | Chip-carrier | |
| JPS6229909B2 (ja) | ||
| CN218632047U (zh) | 集成电路封装件 | |
| JP3336859B2 (ja) | 半導体装置およびその製造方法 | |
| JP2576496B2 (ja) | 半導体記憶装置 | |
| JPS6137787B2 (ja) | ||
| JP2535890B2 (ja) | 半導体装置の製造方法 | |
| CN223452340U (zh) | 芯片结构 | |
| JP2837488B2 (ja) | 半導体装置 | |
| JPS5891662A (ja) | 半導体装置の製造方法 | |
| CA2021682C (en) | Chip-carrier with alpha ray shield | |
| JPS5893359A (ja) | 半導体装置 | |
| KR19990060346A (ko) | 반도체 장치의 보호막 제조방법 | |
| JP3468406B2 (ja) | 半導体装置の実装方法 | |
| JPS60160626A (ja) | 半導体装置 | |
| JPH0745755A (ja) | 樹脂封止型半導体装置とその製造方法 | |
| JP2694779B2 (ja) | 半導体集積回路装置 | |
| JPS5817642A (ja) | 半導体デバイス用保護装置 | |
| JPS5963752A (ja) | 樹脂封止形半導体装置 |