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JPS6314567B2 - - Google Patents
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JPS6314567B2 - - Google Patents

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JPS6314567B2
JPS6314567B2 JP13769381A JP13769381A JPS6314567B2 JP S6314567 B2 JPS6314567 B2 JP S6314567B2 JP 13769381 A JP13769381 A JP 13769381A JP 13769381 A JP13769381 A JP 13769381A JP S6314567 B2 JPS6314567 B2 JP S6314567B2
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JP
Japan
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voltage detection
thyristor
circuit
thyristors
microprocessor
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Application number
JP13769381A
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Japanese (ja)
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JPS5843134A (en
Inventor
Hidetoshi Ino
Tadashi Takahashi
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Toshiba Corp
Original Assignee
Tokyo Shibaura Electric Co Ltd
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Publication date
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Description

【発明の詳細な説明】 (a) 技術分野の説明 本発明は高電圧サイリスタ変換器のサイリスタ
素子故障診断装置に係り、特にマイクロプロセツ
サを用いてすべてのサイリスタ素子を監視し適切
な論理判断により故障診断するマイクロプロセツ
サによる高電圧サイリスタ変換器の素子故障診断
装置に関する。
[Detailed Description of the Invention] (a) Description of the Technical Field The present invention relates to a thyristor element failure diagnosis device for a high-voltage thyristor converter, and in particular uses a microprocessor to monitor all thyristor elements and make appropriate logical judgments. The present invention relates to an element failure diagnosis device for a high voltage thyristor converter that uses a microprocessor to diagnose failures.

(b) 従来技術の説明 直流送電、周波数変換等の高電圧サイリスタバ
ルブには多数の直列又は直並列接続されたサイリ
スタが使用されている。サイリスタはサイリスタ
自身又はゲート回路等の故障により破損につなが
るため一般に所定の数のサイリスタをマージンと
して直列に接続している。従つてサイリスタが故
障し故障サイリスタの数がこのマージンサイリス
タの数に達した場合はサイリスタバルブを運転不
能として停止し故障サイリスタを交換する必要が
ある。このためサイリスタの故障をモニターしそ
の故障数を常時知ることが重要となる。
(b) Description of the Prior Art A large number of thyristors connected in series or in series and parallel are used in high voltage thyristor valves for DC power transmission, frequency conversion, etc. Thyristors can be damaged due to failure of the thyristor itself or its gate circuit, so generally a predetermined number of thyristors are connected in series with a margin. Therefore, if a thyristor fails and the number of failed thyristors reaches this number of margin thyristors, it is necessary to stop the thyristor valve as inoperable and replace the failed thyristor. Therefore, it is important to monitor thyristor failures and know the number of failures at all times.

第1図は従来のサイリスタ素子故障(以下素子
故障と称す)診断装置の高電圧部の検出回路の構
成図である。第1図はサイリスタバルブ内の直列
接続した複数個のサイリスタのうち例えば直列接
続したサイリスタ1を6個単位で1モジユールと
した例で各サイリスタ1にはコンデンサ、抵抗か
らなる分圧回路2が、また6個の直列接続したサ
イリスタには並列に2個の検出用抵抗3が接続さ
れている。6個の直列接続したサイリスタの中間
点Pと検出用抵抗3の中間点Qには検出回路4が
接続されている。中間点PでA,Bの2グループ
に分割された分圧回路2と中間点Qで分割された
検出用抵抗3によりブリツジ回路を形成してい
る。6個のサイリスが全て正常な時はブリツジ回
路は平衡しているので電圧vは発生しない。しか
し1個のサイリスタが破損した時はブリツジ回路
は不平衡となり電圧vが発生する。検出回路4は
電圧vが所定値以上で発光素子5に電流を流し素
子故障信号をライトガイド6により低電位部の素
子故障判別回路7へ伝送する。素子故障判別回路
7ではサイリスタバルブ内の6個単位のサイリス
タで構成したモジユールでどのモジユール内で素
子が故障しているか、いくつのモジユールが故障
しているかを判別する。
FIG. 1 is a configuration diagram of a detection circuit of a high voltage section of a conventional thyristor element failure (hereinafter referred to as element failure) diagnostic device. FIG. 1 shows an example in which one module consists of six thyristors 1 connected in series among a plurality of thyristors connected in series in a thyristor valve. Furthermore, two detection resistors 3 are connected in parallel to the six series-connected thyristors. A detection circuit 4 is connected to an intermediate point P between the six thyristors connected in series and an intermediate point Q between the detection resistor 3. A bridge circuit is formed by a voltage dividing circuit 2 divided into two groups A and B at an intermediate point P and a detection resistor 3 divided at an intermediate point Q. When all six thyristors are normal, the bridge circuit is balanced and no voltage v is generated. However, when one thyristor is damaged, the bridge circuit becomes unbalanced and a voltage v is generated. The detection circuit 4 causes a current to flow through the light emitting element 5 when the voltage v is equal to or higher than a predetermined value, and transmits an element failure signal to the element failure determination circuit 7 in the low potential section through the light guide 6. The element failure determination circuit 7 determines in which module an element is malfunctioning and in how many modules the element is malfunctioning in a module composed of six thyristors in a thyristor valve.

しかしこの従来の素子故障診断ではブリツジ回
路が不平衡になる様な素子故障の場合、例えば1
個の破損又はA側のみの2個のサイリスタの故障
等は検出可能であるがA側、B側6個全ての故障
又はA,B側が同数故障した場合は、ブリツジ回
路は平衡しているので素子故障を検出することは
不可能である。またサイリスタが正常な場合でも
分圧回路及びサイリスタの特性等のアンバランス
により各サイリスタにかかる電圧にアンバランス
を生じる。また3相ブリツジ接続されたサイリス
タ変換器でサイリスタバルブに電圧が加わつてゲ
ートブロツクしているフローテイング中とサイリ
スタバルブの運転中とではサイリスタにかかる電
圧のピーク値は運転中の方が√3倍大きい。この
ため6個のサイリスタのうち1個破損した時に生
じる電圧vも運転中の方がフローテイング中より
もほぼ√3倍大きい。従つて各サイリスタの電圧
アンバランスにより誤検出することなくかつフロ
ーテイング中、運転中とも確実に検出できる様に
検出回路4の検出レベルを設定することは非常に
むづかしい。またモジユール内のサイリスタ数が
多い構成になる程、1個故障時に生じる電圧vも
小さくなり検出することが不可能な場合がある。
また素子故障を検出できた場合でも例えばA側の
サイリスタが1個から3個の故障に対し低圧側の
素子故障判別回路7では何個故障しているのかが
全く不明である。従つて、モジユール内の正確な
素子故障数が不明のため、バルブ全体での全故障
素子数を知ることはできない。このためその時点
における正確なサイリスタのマージン数を知るこ
とも不可能である。
However, with this conventional device failure diagnosis, in the case of an element failure that causes the bridge circuit to become unbalanced, for example, 1
It is possible to detect damage to one thyristor or failure of two thyristors only on the A side, but if all six thyristors on the A and B sides fail or the same number of thyristors fail on the A and B sides, the bridge circuit is balanced. It is impossible to detect element failure. Further, even when the thyristors are normal, an imbalance occurs in the voltage applied to each thyristor due to an imbalance in the characteristics of the voltage dividing circuit and the thyristor. In addition, the peak value of the voltage applied to the thyristor during floating and when the thyristor valve is in operation is √3 times the peak value during operation, when voltage is applied to the thyristor valve in a thyristor converter connected to a three-phase bridge to block the gate. big. Therefore, the voltage v generated when one of the six thyristors is damaged is approximately √3 times larger during operation than during floating. Therefore, it is very difficult to set the detection level of the detection circuit 4 so as to avoid erroneous detection due to voltage imbalance of each thyristor and to ensure reliable detection both during floating and during operation. Furthermore, as the number of thyristors in the module increases, the voltage v generated when one thyristor fails becomes smaller and may be impossible to detect.
Furthermore, even if an element failure can be detected, it is completely unclear how many thyristors on the low voltage side have failed compared to one to three thyristors on the A side. Therefore, since the exact number of failed elements within the module is unknown, the total number of failed elements for the entire valve cannot be known. Therefore, it is also impossible to know the exact number of thyristor margins at that point in time.

以上の様に従来の素子故障診断装置では確実に
素子故障を判別することが不可能でありこのため
故障サイリスタ数がマージンサイリスタ数をオー
バーし他のサイリスタをも破損する恐れがある。
以上のことはサイリスタ変換器の運用上保守の欠
点となる。
As described above, it is impossible for the conventional element failure diagnosis apparatus to reliably determine element failure, and as a result, the number of failed thyristors may exceed the number of margin thyristors, and other thyristors may also be damaged.
The above is a disadvantage in the operation and maintenance of thyristor converters.

(c) 発明の目的 本発明の目的は前述の欠点に鑑みサイリスタの
故障を確実に検出しさらにはその故障数をも判別
することができサイリスタ変換器の運用又は保守
上からも極めて有効なマイクロプロセツサによる
高電圧サイリスタ変換器の素子故障診断装置を提
供することにある。
(c) Purpose of the Invention In view of the above-mentioned drawbacks, the purpose of the present invention is to provide a microcontroller which is capable of reliably detecting thyristor failures and further determining the number of failures, and which is extremely effective from the viewpoint of operation and maintenance of thyristor converters. An object of the present invention is to provide an element failure diagnosis device for a high voltage thyristor converter using a processor.

(d) 発明の構成 以下本発明を図面を用いて説明する。(d) Structure of the invention The present invention will be explained below using the drawings.

第2図は本発面の一実施例を示す構成図であ
る。各サイリスタ1にはコンデンサと抵抗から成
る分圧回路2を並列接続し、各サイリスタ1の印
加電圧(第2図の例では順方向電圧)を検出する
ための発光素子11、電流制限用の抵抗12、逆
電圧防止用のダイオード13を夫々接続してい
る。各発光素子11の光信号は各ライトガイド1
4により各受光素子15へ伝送し、各受光素子1
5の各電圧検出信号b1,b2…はOR回路16
とマイクロプロセツサ17へ入力する。OR回路
16の出力信号である電圧検出OR信号Cもマイ
クロプロセツサ17へ入力する。マイクロプロセ
ツサ17は入出力のインターフエイスを行なう
I/O回路21、データを読み込む為にデータを
保持するラツチ回路22そのデータを記憶する
RAM回路23、データの読み込みや素子故障を
判別する故障判別論理関数のプログラムを収納し
ているPROM回路24、これらのマイクロプロ
セツサ17の各回路間の制御を行なうCPU回路
25から構成される。
FIG. 2 is a configuration diagram showing an embodiment of the present invention. A voltage dividing circuit 2 consisting of a capacitor and a resistor is connected in parallel to each thyristor 1, and a light emitting element 11 for detecting the voltage applied to each thyristor 1 (forward voltage in the example shown in Fig. 2) and a resistor for current limiting. 12, diodes 13 for preventing reverse voltage are connected respectively. The optical signal of each light emitting element 11 is transmitted to each light guide 1.
4 to each light receiving element 15, and each light receiving element 1
5, each voltage detection signal b1, b2... is an OR circuit 16
is input to the microprocessor 17. A voltage detection OR signal C, which is an output signal of the OR circuit 16, is also input to the microprocessor 17. The microprocessor 17 includes an I/O circuit 21 that performs an input/output interface, a latch circuit 22 that holds data for reading data, and a latch circuit 22 that stores the data.
It is composed of a RAM circuit 23, a PROM circuit 24 storing a program for reading data and a failure discrimination logic function for determining element failure, and a CPU circuit 25 for controlling each circuit of the microprocessor 17.

(e) 発明の作用 上述の構成に於て、マイクロプロセツサ17内
の各回路はCPU回路25により信号の授受を行
なうことができI/O回路21は電圧検出OR信
号Cを入力するとCPU回路25を介してラツチ
回路22へ指令が出されラツチ回路22はデータ
となる各電圧検出信号b1,b2…を読み込む。
(e) Effect of the invention In the above configuration, each circuit in the microprocessor 17 can send and receive signals to and from the CPU circuit 25, and when the I/O circuit 21 receives the voltage detection OR signal C, the CPU circuit 25, a command is issued to the latch circuit 22, and the latch circuit 22 reads each voltage detection signal b1, b2, . . . as data.

いま、サイリスタバルブに第3図aに示す電圧
波形aが加わつており、サイリスタT1が正常で
あれば順電圧期間中は発光素子11は光信号を発
するので、電圧検出信号b1も順電圧期間中、出
力“1”を発生する。しかしサイリスタT2が故
障している場合には電圧検出信号b2の出力は
“0”である。また、正常なサイリスタにより電
圧検出OR信号Cは出力“1”が出るのでI/O
回路21はこの電圧検出OR信号Cを入力すると
ともにラツチ回路22へデータ読み込み信号dを
発生する。ラツチ回路22はデータ読み込み信号
dの発生された時点の各電圧検出信号b1,b2
…の出力を記憶する。従つて、電圧検出信号b1
は“1”電圧検出信号b2は“0”が記憶され
る。記憶された各電圧検出信号b1,b2…はプ
ログラム制御によりRAM回路23へメモリされ
る。
Now, a voltage waveform a shown in FIG. 3a is applied to the thyristor valve, and if the thyristor T1 is normal, the light emitting element 11 emits a light signal during the forward voltage period, so the voltage detection signal b1 also remains during the forward voltage period. , generates an output "1". However, if the thyristor T2 is out of order, the output of the voltage detection signal b2 is "0". In addition, since the voltage detection OR signal C outputs “1” due to a normal thyristor, the I/O
The circuit 21 inputs this voltage detection OR signal C and generates a data read signal d to the latch circuit 22. The latch circuit 22 receives voltage detection signals b1 and b2 at the time when the data read signal d is generated.
Store the output of... Therefore, the voltage detection signal b1
is stored as “1” and voltage detection signal b2 is stored as “0”. The stored voltage detection signals b1, b2, . . . are stored in the RAM circuit 23 under program control.

いまRAM回路23をnビツトとする。RAM
回路23の電圧検出信号データのメモリには種々
の方法がありその一例につき第3図を用いて説明
する。第3図aは本発明の動作を説明するための
タイムチヤート、第3図b,cはRAM回路23
のメモリーブロツク図である。
Now assume that the RAM circuit 23 has n bits. RAM
There are various methods for storing voltage detection signal data in the circuit 23, and one example will be explained with reference to FIG. FIG. 3a is a time chart for explaining the operation of the present invention, and FIGS. 3b and 3c are RAM circuit 23.
FIG.

第3図aの例は、順電圧期間では全サイリス
タが正常で、順電圧期間ではサイリスタT
2のみ故障している場合である。
In the example of FIG. 3a, all thyristors are normal during the forward voltage period, and thyristor T is normal during the forward voltage period.
This is a case where only 2 is out of order.

第3図bはRAM回路23の各ビツトに夫々の
サイリスタの電圧検出論理信号であるデータを対
応させてメモリした例である。RAM回路23の
1つのメモリ番地にはn個単位でデータがメモリ
されたサイリスタの数がn個より多いときは複数
のメモリ番地にデータがメモリされる。ここでは
説明を簡単にするためサイリスタ数をn個とす
る。従つてRAM回路23の1つのメモリ番地
(RAM(i))の1ビツト目にはサイリスタT1の
電圧検出信号のデータをメモリし順次nビツト目
迄サイリスタn個のデーータをメモリする。
FIG. 3b shows an example in which each bit of the RAM circuit 23 is stored in correspondence with data, which is a voltage detection logic signal of each thyristor. Data is stored in units of n in one memory address of the RAM circuit 23. When the number of thyristors is greater than n, data is stored in a plurality of memory addresses. Here, in order to simplify the explanation, the number of thyristors is assumed to be n. Therefore, the data of the voltage detection signal of the thyristor T1 is stored in the first bit of one memory address (RAM(i)) of the RAM circuit 23, and data of n thyristors are sequentially stored up to the nth bit.

第3図aのの順電圧期間の各サイリスタのデ
ータは第3図bのに示す様に全サイリスタT1
〜Tnが正常なのでRAM(i)のすべてのビツトに
“1”がメモリされる。次にの順電圧期間では
サイリスタT2が故障しているのでT2に対応す
る2ビツト目には“0”が他の健全なサイリスタ
に対応するビツトにはすべて“1”がメモリされ
る。
The data of each thyristor during the forward voltage period of Fig. 3a is as shown in Fig. 3b.
~Tn is normal, so "1" is stored in all bits of RAM(i). In the next forward voltage period, since thyristor T2 is out of order, "0" is stored in the second bit corresponding to T2, and "1" is stored in all the bits corresponding to other healthy thyristors.

これ等のメモリされたデータから素子故障であ
るか否かの判別をするのも種々の方法がある。例
えばPROM24にメモリしている故障判別論理
関数とその制御プログラムによりRAM(i)にメモ
リされている各ビツトのデータが“1”か“0”
かを判別し、“1”のときには正常、“0”の場合
は、そのビツトに対応するサイリスタは故障と判
断する。
There are various methods for determining whether or not there is an element failure based on the stored data. For example, the data of each bit stored in RAM (i) is determined to be “1” or “0” by the failure judgment logic function stored in PROM 24 and its control program.
If it is "1", it is determined that the bit is normal, and if it is "0", it is determined that the thyristor corresponding to that bit is out of order.

またCPU内のレジスタ2個を第1、第2のカ
ウンタとして使用し、第1のカウンタは上記正常
か故障かの判断の結果が故障のとき1ずつカウン
トすることによりサイリスタバルブ内の故障サイ
リスタの合計数を記憶することができ、第2のカ
ウンタにはRAM(i)の各ビツトに対し上記故障判
別動作を行う毎に1ずつカウントすることにより
サイリスタTiに対応した番号を記憶することが
できる。従つて故障判別の結果が故障のとき、カ
ウンタ2の内容を呼び出し故障サイリスタの番号
を知ることができ、またカウンタ1の内容を呼び
出せばサイリスタバルブ内の故障サイリスタの合
計数を知ることができる。尚、第1、第2のカウ
ンタは、RAM(i)の新しいデータに対する故障判
別動作に先だち0に初期設定する。
In addition, two registers in the CPU are used as the first and second counters, and the first counter counts by 1 when the result of the judgment of normality or failure is a failure. The total number can be stored, and the number corresponding to the thyristor Ti can be stored in the second counter by counting by 1 each time the above fault determination operation is performed for each bit of RAM (i). . Therefore, when the result of failure determination is failure, the contents of counter 2 can be called to know the number of the failed thyristor, and the contents of counter 1 can be called to know the total number of failed thyristors in the thyristor valve. Note that the first and second counters are initialized to 0 prior to the failure determination operation for new data in RAM(i).

また、マージンサイリスタ数がm個でこの数の
サイリスタが故障したときサイリスタ変換器の運
転を停止したい場合には、第1のカウンタの内容
をmと比較し、この数mに達した時にI/O回路
21より外部へ停止信号eを出力する。尚、本実
施例では電圧検出OR信号cを用いて電圧検出論
理信号のデータを読み込んでおり順電圧期間以外
でのデータを読み込むことなく確実に素子故障を
判断することができる。
In addition, if the number of margin thyristors is m and you want to stop the operation of the thyristor converter when this number of thyristors fail, compare the contents of the first counter with m, and when this number m is reached, the I/O A stop signal e is output from the O circuit 21 to the outside. In this embodiment, the data of the voltage detection logic signal is read using the voltage detection OR signal c, and element failure can be reliably determined without reading data outside the forward voltage period.

以上の説明は、電圧検出論理信号のデータの1
回の読み込みにより素子故障と判別する場合であ
る。
The above explanation is based on one part of the data of the voltage detection logic signal.
This is a case where an element failure is determined by reading the number of times.

サイリスタ変換器がインバータ運転を行なうモ
ードでは、直列接続した全サイリスタの内一部の
サイリスタがターンオフしない場合がある。(以
下この現象を部分転流失敗と称す。)この部分転
流失敗したサイリスタには順電圧はかからないの
で1回のデータの読み込みで素子故障を判別する
と誤判別することになる。
In the mode in which the thyristor converter performs inverter operation, some of the thyristors connected in series may not turn off. (Hereinafter, this phenomenon will be referred to as a partial commutation failure.) Since no forward voltage is applied to the thyristor in which partial commutation has failed, if an element failure is determined by reading data once, it will be erroneously determined.

この様な部分転流失敗の現象が考えられる場合
には連続する数回のデータにより素子故障を判別
する方法が適している。例えば、第3図aで連続
する3回のデータを用いて、サイリスタT2につ
いては2ビツト目が3回とも“0”であれば素子
故障と判別する。一般に部分転流失敗する状況は
数サイクル継続することはないので上記の方法で
部分転流失敗と素子故障を区別できる。なお、数
回のデータにより素子故障を判別する場合にはデ
ータをメモリするRAMの番地もそれに応じて第
3図cに示した様に確保しておくことが必要であ
る。
If such a phenomenon of partial commutation failure is possible, a method of determining element failure based on data from several consecutive times is suitable. For example, using the data of three successive times in FIG. 3a, if the second bit of thyristor T2 is "0" all three times, it is determined that the element has failed. Generally, a situation where partial commutation fails does not continue for several cycles, so the above method can distinguish between partial commutation failure and element failure. In addition, when determining element failure based on data obtained several times, it is necessary to secure RAM addresses for storing data accordingly, as shown in FIG. 3c.

即ち、RAM回路23のメモリ番地RAM(i),
RAM(i+1),RAM(i+2)に,,で
検出した3回分のデータを保持し4回目のデータ
はRAM(i)の内容を書きかえて常に最新の3回
分のデータを保持する様に構成する。
That is, the memory address RAM(i) of the RAM circuit 23,
RAM (i+1) and RAM (i+2) hold the data for the three times detected in , and the fourth data is configured to rewrite the contents of RAM (i) so that the latest three times' worth of data is always retained. do.

そしてPROM回路24に収納している故障判
別論理関数とその制御プログラムによつて、例え
ば次の様に動作させる。
For example, the following operation is performed using the fault discrimination logic function stored in the PROM circuit 24 and its control program.

上述RAM回路23に保持した最新の3回分の
データ,,の各サイリスタTiに対応した
ビツトの和を演算してその結果が“0”のとき故
障と判断する。また演算の結果が“1”〜“3”
の場合には正常と判断し、次のサイクルのサンプ
リングデータを採取してデータ,,の各
ビツトの和を演算し同様に故障判別動作を繰返
し、以下順次連続して採取するデータに対し監視
する。
The sum of the bits corresponding to each thyristor Ti of the latest three times of data held in the RAM circuit 23 is calculated, and when the result is "0", it is determined that there is a failure. Also, the result of the operation is “1” to “3”
In the case of , it is judged as normal, and the sampling data of the next cycle is collected, the sum of each bit of data, , is calculated, and the same failure determination operation is repeated, and the data that is subsequently collected in succession is monitored. .

第3図cに示した実施例の場合、データ,
,に対して故障判別動作を行いサイリスタT
2に対応するビツトの和を演算したとき“0”と
なり故障と判断する。
In the case of the embodiment shown in FIG. 3c, the data,
, performs failure determination operation on thyristor T
When the sum of the bits corresponding to 2 is calculated, it becomes "0", which is determined to be a failure.

またデータの信頼性を高める場合には多数決を
とる方法がある。この場合も例えばデータのサン
プリング回数が3回の場合はその3回の和の演算
結果が“2”又は“3”の場合は正常と判別する
ことができる。このデータのサンプリング回数が
10回以上で従つてデータ数も10個以上となつた場
合には従来の論理素子による回路では非常に複雑
なものとなるがマイクロプロセツサを用いればデ
ータのサンプリング回数が増加してもデータを収
納するRAM回路を確保しておくだけでよい。
In addition, when increasing the reliability of data, there is a method of taking majority vote. In this case as well, for example, if the number of times data is sampled is three times, if the calculation result of the sum of the three times is "2" or "3", it can be determined to be normal. The number of times this data is sampled is
If the number of data samples exceeds 10, and therefore the number of data samples exceeds 10, the circuit using conventional logic elements becomes extremely complex, but if a microprocessor is used, the data can be processed even if the number of data sampling increases. All you need to do is secure a RAM circuit to store it.

(f) 発明の効果 以上の説明の様に本発明によれば複数個の直列
接続されたサイリスタからなるサイリスタバルブ
内でサイリスタの故障が発生してもサイリスタ
個々にそれを確実に検出することができるのでサ
イリスタバルブ内の合計故障数を絶えず正確に知
ることができる。従つて、従来の様に正確な故障
数を知ることができなく他の健全なサイリスタを
も破損し事故を拡大するという欠点に対し、本発
明はサイリスタに加わる電圧を用いてマイクロプ
ロセツサにより個別にサイリスタの故障を判別す
るので正確に故障数を知ることができる。このた
め故障サイリスタ数がマージンサイリスタ数に達
した時点でサイリスタ変換器の運転を停止して保
護することができるので健全なサイリスタ迄破損
してしまう等という不具合もなくサイリスタ変換
器の運用又は保守上からも有効な素子故障診断装
置である。
(f) Effects of the Invention As described above, according to the present invention, even if a thyristor failure occurs in a thyristor valve consisting of a plurality of thyristors connected in series, it can be reliably detected for each thyristor. This allows the total number of failures within the thyristor valve to be accurately known at all times. Therefore, unlike the conventional method, it is not possible to know the exact number of failures, and other healthy thyristors are also damaged, leading to an increase in accidents. Since thyristor failures are determined immediately, the number of failures can be accurately determined. Therefore, when the number of faulty thyristors reaches the number of margin thyristors, the operation of the thyristor converter can be stopped and protected, so there is no problem such as damage to healthy thyristors, and the operation or maintenance of the thyristor converter can be improved. It is also an effective device failure diagnosis device.

また、1個のマイクロプロセツサにより複数の
サイリスタバルブの素子故障診断を行なうことが
できる。例えば、ブリツジ接続した6個のサイリ
スタバルブの全サイリスタの素子故障診断を行な
う場合、RAM回路のメモリ番地も6個のサイリ
スタバルブの分を確保しておき、各サイリスタバ
ルブは通常夫々の点弧に電気角で60゜の位相差を
保つて運転するので、1個のサイリスタバルブに
対する素子故障診断を電気角60゜内で実施すれば
6個のサイリスタバルブの全サイリスタに対して
1サイクルで素子故障診断を行うことができる。
Further, a single microprocessor can perform element failure diagnosis for a plurality of thyristor valves. For example, when performing element failure diagnosis for all thyristors of six bridge-connected thyristor valves, memory addresses in the RAM circuit are reserved for the six thyristor valves, and each thyristor valve is usually Since it operates while maintaining a phase difference of 60 degrees in electrical angle, if element failure diagnosis for one thyristor valve is performed within 60 degrees in electrical angle, element failure will occur for all thyristors of six thyristor valves in one cycle. Diagnosis can be made.

上述の様に多数のサイリスタにもかゝわらず1
サイクルの時間内で全サイリスタを診断すること
が可能であり、更に従来の素子故障診断装置に比
較して小型化したマイクロプロセツサによる高電
圧サイリスタ変換器の素子故障診断装置を提供す
ることができる。
As mentioned above, despite the large number of thyristors, 1
It is possible to diagnose all thyristors within the cycle time, and furthermore, it is possible to provide an element failure diagnosis device for a high voltage thyristor converter using a microprocessor that is more compact than conventional element failure diagnosis devices. .

(g) 変形例 本発明の実施例では各サイリスタの順電圧を検
出して素子故障診断を行なつているが逆電圧また
は順逆電圧を検出する様に構成しても全く同じ効
果を得ることができる。
(g) Modification In the embodiment of the present invention, the forward voltage of each thyristor is detected to perform element failure diagnosis, but the same effect can be obtained by configuring the device to detect reverse voltage or forward/reverse voltage. can.

また本発明の実施例のタイムチヤート第3図a
では、毎サイクルの順電圧期間内に1回のデータ
読み込みの例で説明したが必要に応じて複数回の
データを読み込み前述と同様にして故障判別を行
うことができる。
Also, the time chart of the embodiment of the present invention is shown in Fig. 3a.
Although the explanation has been given using an example in which data is read once within the forward voltage period of each cycle, if necessary, data can be read a plurality of times and failure determination can be performed in the same manner as described above.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来の素子故障診断装置の構成図、第
2図は本発明による素子故障診断装置の構成図、
第3図aは本発明を説明するための各信号のタイ
ムチヤート、第3図b,cはRAM回路のメモリ
ブロツク図である。 1……サイリスタ、2……分圧回路、3……検
出用抵抗、4……検出回路、5,11……発光素
子、6,14……ライトガイド、7……素子故障
判別回路、12……抵抗、13……ダイオード、
15……受光素子、16……OR回路、17……
マイクロプロセツサ、21……I/O回路、22
……ラツチ回路、23……RAM回路、24……
PROM回路、25……CPU回路。
FIG. 1 is a block diagram of a conventional device failure diagnosis device, FIG. 2 is a block diagram of a device failure diagnosis device according to the present invention,
FIG. 3a is a time chart of each signal for explaining the present invention, and FIGS. 3b and 3c are memory block diagrams of the RAM circuit. 1... Thyristor, 2... Voltage dividing circuit, 3... Detection resistor, 4... Detection circuit, 5, 11... Light emitting element, 6, 14... Light guide, 7... Element failure determination circuit, 12 ...Resistance, 13...Diode,
15... Light receiving element, 16... OR circuit, 17...
Microprocessor, 21...I/O circuit, 22
...Latch circuit, 23...RAM circuit, 24...
PROM circuit, 25...CPU circuit.

Claims (1)

【特許請求の範囲】 1 複数個のサイリスタを直列接続したサイリス
タバルブで構成した高電圧サイリスタ変換器の素
子故障診断装置に於て、前記複数個のサイリスタ
の夫々のサイリスタ毎に該サイリスタの電圧を検
出する電圧検出回路を夫々設け、前記素子故障診
断装置の内部に夫々の前記電圧検出回路によつて
検出した夫々の電圧検出論理信号を保持する第1
のメモリ回路とこの第1のメモリ回路に保持した
夫々の電圧検出論理データから故障判別を行なう
制御プログラムを保持する第2のメモリ回路と、
前記故障判別の論理動作を行なうマイクロプロセ
ツサと、前記夫々の電圧検出論理信号の論理和を
とる論理和回路を設け、この論理和回路の出力信
号を前記マイクロプロセツサへの入力信号として
与え、所定のタイミングで前記マイクロプロセツ
サから出力するデータ読み込み信号により前記
夫々の電圧検出論理信号を前記夫々の電圧検出論
理データとして前記第1のメモリ回路に読み込
み、夫々のサイリスタに対応した前記夫々の電圧
検出論理データを前記第2のメモリ回路に保持し
た制御プログラムと前記マイクロプロセツサによ
り順次論理判別し、所定の論理状態のとき故障と
判断し、この故障と判断した前記夫々の電圧検出
論理データの数が所定の数に達したとき、素子故
障の信号を出力することを特徴としたマイクロプ
ロセツサによる高電圧サイリスタ変換器の素子故
障診断装置。 2 複数個のサイリスタを直列接続したサイリス
タバルブで構成した高電圧サイリスタ変換器の素
子故障診断装置に於て、前記複数個のサイリスタ
の夫々のサイリスタ毎に該サイリスタの電圧を検
出する電圧検出回路を夫々設け、前記素子故障診
断装置の内部に夫々の前記電圧検出回路によつて
検出した夫々の電圧検出論理信号を保持する第1
のメモリ回路と、この第1のメモリ回路に保持し
た夫々の電圧検出論理データから故障判別を行な
う制御プログラムを保持する第2のメモリ回路
と、前記故障判別の論理動作を行なうマイクロプ
ロセツサと、前記夫々の電圧検出論理信号の論理
和をとる論理和回路を設け、この論理和回路の出
力信号を前記マイクロプロセツサへの入力信号と
して与え、所定のタイミングで前記マイクロプロ
セツサから出力するデータ読み込み信号により少
なくとも1回以上前記夫々の電圧検出論理信号を
前記夫々の電圧検出論理データとして前記第1の
メモリ回路に読み込み、夫々のサイリスタに対応
した前記少なくとも1回以上の前記夫々の電圧検
出論理データを前記第2のメモリ回路に保持した
制御プログラムと前記マイクロプロセツサにより
順次論理判別し、所定のサイリスタに対応した前
記少なくとも1回以上の電圧検出論理データの所
定の数が所定の論理状態のとき故障と判断しこの
故障と判断したサイリスタの数が所定の数に達し
たとき、素子故障の信号を出力することを特徴と
したマイクロプロセツサによる高電圧サイリスタ
変換器の素子故障診断装置。
[Claims] 1. In an element failure diagnosis device for a high voltage thyristor converter configured with a thyristor valve in which a plurality of thyristors are connected in series, the voltage of the thyristor is determined for each thyristor of the plurality of thyristors. A first voltage detection circuit is provided with a voltage detection circuit for detecting the voltage, and the voltage detection logic signal detected by each of the voltage detection circuits is held inside the element failure diagnosis device.
a second memory circuit holding a control program for determining a failure from the respective voltage detection logic data held in the memory circuit and the first memory circuit;
a microprocessor that performs a logic operation for fault determination; and an OR circuit that ORs the respective voltage detection logic signals, and provides an output signal of the OR circuit as an input signal to the microprocessor; The respective voltage detection logic signals are read into the first memory circuit as the respective voltage detection logic data by a data read signal outputted from the microprocessor at a predetermined timing, and the respective voltages corresponding to the respective thyristors are read. The logic of the detection logic data is sequentially determined by the control program held in the second memory circuit and the microprocessor, and a failure is determined when a predetermined logic state is found. An element failure diagnosis device for a high voltage thyristor converter using a microprocessor, which outputs an element failure signal when the number reaches a predetermined number. 2. In an element failure diagnosis device for a high voltage thyristor converter configured with a thyristor valve in which a plurality of thyristors are connected in series, a voltage detection circuit for detecting the voltage of each thyristor of the plurality of thyristors is provided. a first voltage detection logic signal detected by each voltage detection circuit;
a second memory circuit that holds a control program that performs failure determination from the respective voltage detection logic data held in the first memory circuit, and a microprocessor that performs the logical operation of the failure determination; An OR circuit is provided to OR the respective voltage detection logic signals, and the output signal of this OR circuit is provided as an input signal to the microprocessor, and the data is read to be output from the microprocessor at a predetermined timing. The respective voltage detection logic signals are read into the first memory circuit as the respective voltage detection logic data at least once or more by a signal, and the respective voltage detection logic data are read at least once or more corresponding to the respective thyristors. is sequentially determined by the control program held in the second memory circuit and the microprocessor, and when a predetermined number of the at least one voltage detection logic data corresponding to a predetermined thyristor is in a predetermined logic state. An element failure diagnosis device for a high voltage thyristor converter using a microprocessor, which outputs an element failure signal when the number of thyristors determined to be failure reaches a predetermined number.
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