JPS631614B2 - - Google Patents
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- JPS631614B2 JPS631614B2 JP57113478A JP11347882A JPS631614B2 JP S631614 B2 JPS631614 B2 JP S631614B2 JP 57113478 A JP57113478 A JP 57113478A JP 11347882 A JP11347882 A JP 11347882A JP S631614 B2 JPS631614 B2 JP S631614B2
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- image memory
- dot pattern
- dot
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- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
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- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Record Information Processing For Printing (AREA)
Description
【発明の詳細な説明】
発明の技術分野
本発明は、プリンタ制御に使用されるビツトマ
ツプ形式のイメージメモリにおいて、次ページ分
データの早期バツフアリングとイメージメモリの
展開を可能にするための、エンプテイ(空きスペ
ース)確認制御方式に関する。DETAILED DESCRIPTION OF THE INVENTION Technical Field of the Invention The present invention provides an empty storage system for enabling early buffering of data for the next page and development of the image memory in a bit map format image memory used for printer control. Space) Concerning confirmation control method.
技術の背景
一般にカツト用紙に印字を行なうドキユメン
ト・プリンタにおいては、イメージメモリに1ペ
ージ分の出力データを展開し、そのメモリ上の1
ページ分の全領域について、ラスタ形式による読
出レスキヤンニングを行なつてから、次ページ分
の出力データを展開していた。Technical background In general, document printers that print on cut paper develop one page's worth of output data in the image memory, and
After performing read-less scanning in raster format for the entire area for a page, the output data for the next page is developed.
たとえば第1図に示すように、実際の印字デー
タ領域Aが、用紙の上方向に偏つている場合に
は、イメージメモリ上においても印字進行方向の
一定領域Bがエンプテイとなる。しかし、上述し
たように、従来は、このエンプテイ領域Bに対し
ても、無効の読出し動作が行なわれ、その終了
後、同図で示すように次ページのデータ展開に
入つていた。 For example, as shown in FIG. 1, if the actual print data area A is biased toward the top of the paper, a certain area B in the printing progress direction on the image memory will also be empty. However, as described above, conventionally, an invalid read operation is also performed on this empty area B, and after the read operation is completed, data development for the next page begins as shown in the figure.
他方、印字データの処理は、グラフイツク、イ
メージ、キヤラクタ、オーバレイ等のイメージ処
理上では独立したデータ属性のカテゴリーに分割
して実行し、結果をイメージメモリ上で合成して
出力することが行なわれる。したがつて、イメー
ジメモリにおけるエンプテイ領域の確認は簡単で
はなかつた。 On the other hand, when printing data is processed for graphics, images, characters, overlays, etc., it is divided into categories of independent data attributes, and the results are combined on an image memory and output. Therefore, it is not easy to check the empty area in the image memory.
発明の目的および構成
本発明は、イメージメモリ上のイメージデータ
存在領域とエンプテイ領域との境界を換出するこ
とにより、イメージメモリの読出しスキヤニング
が該境界に達したとき、第1図で示すように、
直ちに次ページのイメージデータの展開動作に移
行することにより、出力処理時間の短縮を図るこ
とを目的とするものである。OBJECTS AND CONFIGURATION OF THE INVENTION The present invention provides a method for converting the boundary between an image data existing area and an empty area on an image memory, so that when reading scanning of the image memory reaches the boundary, as shown in FIG. ,
The purpose of this is to reduce the output processing time by immediately moving to the operation of developing the image data of the next page.
本発明は、そのための構成として、イメージ、
グラフイツク、キヤラクタ、オーバレイ等のデー
タ属性別に出力データを格納するデータバツフア
と、該データバツフア内の出力データを印字面に
対応させてドツトパターンに展開する手段と、該
展開手段により展開されたドツトパターンデータ
を記憶するビツトマツプ形式のイメージメモリ
と、該「ビツトマツプ形式のイメージメモリ」に
記憶されたドツトパターンデータをドツト行ごと
に読出すためのアクセス手段と、該アクセス手段
によりドツト行ごとにイメージメモリから読出さ
れたドツトパターンデータを印字する手段とを有
するドキユメントプリンタにおいて、上記展開手
段がイメージメモリにドツトパターンデータを展
開する際に該ドツトパターンデータの最大アドレ
ス値を検出する手段と、上記アクセス手段がイメ
ージメモリからドツトパターンデータをドツト行
ごとに読出す際に、該ドツト行アドレスと上記最
大アドレス値検出手段により検出されたドツトパ
ターンデータの最大アドレス値とを比較する手段
とをそなえ、該比較手段が一致を検出したとき、
直ちに上記展開手段に対して、イメージメモリへ
の次ページ分のドツトパターンデータの展開処理
を実行させることを特徴とするものである。 The present invention has an image,
A data buffer for storing output data according to data attributes such as graphics, characters, overlays, etc., a means for developing the output data in the data buffer into a dot pattern corresponding to a printing surface, and a dot pattern data developed by the developing means. an image memory in a bitmap format for storing, an access means for reading out the dot pattern data stored in the "image memory in the bitmap format" for each dot row, and an access means for reading out the dot pattern data row by dot from the image memory by the access means. means for printing the dot pattern data, the access means detecting a maximum address value of the dot pattern data when the development means develops the dot pattern data in the image memory; means for comparing the dot row address with the maximum address value of the dot pattern data detected by the maximum address value detection means when reading the dot pattern data from the image memory for each dot row; finds a match,
The present invention is characterized in that the developing means immediately executes a process of developing the next page's worth of dot pattern data into the image memory.
発明の実施例 以下に本発明を実施例にしたがつて説明する。Examples of the invention The present invention will be explained below using examples.
第2図は、本発明実施例のドキユメントプリン
タの構成図である。同図において、1はインタフ
エイス部、2はページバツフア、3は展開制御
部、4はキヤラクタゼネレータCG、5はビツト
マツプ形式のイメージメモリ、6は主制御部、7
は印字制御部、8は印字機構、9はマルチプレク
サMPX、10は最大アドレス検出部、11は比
較器、2a乃至2dはそれぞれイメージ、グラフ
イツク、キヤラクタ、オーバレイのデータ属性の
出力データを格納するバツフアブロツク、3a乃
至3dはそれぞれバツフアブロツク2a乃至2d
の内容をドツトパターンに展開する処理部を示
す。 FIG. 2 is a block diagram of a document printer according to an embodiment of the present invention. In the figure, 1 is an interface section, 2 is a page buffer, 3 is an expansion control section, 4 is a character generator CG, 5 is an image memory in bitmap format, 6 is a main control section, and 7
8 is a printing control unit, 8 is a printing mechanism, 9 is a multiplexer MPX, 10 is a maximum address detection unit, 11 is a comparator, 2a to 2d are buffer blocks that store output data of image, graphics, character, and overlay data attributes, respectively; 3a to 3d are buffer blocks 2a to 2d, respectively.
This figure shows a processing unit that develops the contents of a dot pattern.
インタフエイス部1は、CPUあるいはチヤネ
ルとの間で、制御信号の送受および印字出力デー
タの受信を行なう。 The interface unit 1 sends and receives control signals and print output data to and from the CPU or channel.
データバツフア2は、CPUから送られた印字
すべき1ページ分のコード形式のデータを、上記
したデータ属性の種別に応じて、2a乃至2dの
ブロツク別に一時的に記憶する。 The data buffer 2 temporarily stores code format data for one page to be printed sent from the CPU into blocks 2a to 2d, depending on the type of data attributes described above.
展開制御部3は、ページバツフア2中に格納さ
れているコード形式のデータを、ドツトパターン
形式に変換して、イメージメモリ5上に展開す
る。展開制御部3は、上記したページバツフア内
の4つのブロツクに対応して、それぞれの変換処
理を実行する4つの機能ブロツク、すなわちイメ
ージ処理3a、グラフイツク処理3b、キヤラク
タ処理3c、オーバレイ処理3dを含む。キヤラ
クタゼネレータCG4は、キヤラクタ処理機能ブ
ロツク3Cと共働して、キヤラクタデータの展開
処理を行なうとき、文字のドツトパターンを供給
する。 The expansion control section 3 converts the code format data stored in the page buffer 2 into a dot pattern format and expands it onto the image memory 5. The development control section 3 includes four functional blocks that execute respective conversion processes corresponding to the four blocks in the page buffer described above, namely, an image processing 3a, a graphics processing 3b, a character processing 3c, and an overlay processing 3d. The character generator CG4 cooperates with the character processing function block 3C to supply a character dot pattern when character data is expanded.
イメージメモリ5は、出力印字面のサイズに対
応したメモリ容量をもち、展開制御部3がドツト
パターンに順次展開したイメージ、グラフイツ
ク、キヤラクタ、オーバレイの各データを、1ペ
ージ分の出力印字データとしてまとめて保持す
る。 The image memory 5 has a memory capacity corresponding to the size of the output printing surface, and compiles the image, graphics, character, and overlay data sequentially developed into a dot pattern by the development control section 3 as output print data for one page. and hold it.
主制御部6は、インタフエイス部1を介して、
CPUあるいはチヤネルとの間でのデータ転送を
制御し、またプリンタ内構成要素に対する主制御
的機能を果す。 The main control unit 6, via the interface unit 1,
It controls data transfer to and from the CPU or channel, and also serves as the main control function for components within the printer.
印字機構8は、ワイヤドツトあるいはインクジ
エツト等の任意のドツトプリンタ形式のものでよ
い。 Printing mechanism 8 may be of any dot printer type, such as a wire dot or inkjet printer.
MPX9は、イメージメモリ5へのデータ展開
の際に、展開制御部3から出力されるライトアド
レスを選択し、また印字実行時には印字制御部7
から出力されるリードアドレスを選択して、イメ
ージメモリ5に対するアクセスアドレスとして供
給する。印字制御部7は、イメージメモリ5中の
ドツトパターンデータを1ドツト行ずつ読出し、
既知の方法により印字を実行させる。 The MPX9 selects the write address output from the development control section 3 when data is developed into the image memory 5, and selects the write address output from the development control section 3 when performing printing.
The read address outputted from the memory 5 is selected and supplied as an access address to the image memory 5. The print control unit 7 reads out the dot pattern data in the image memory 5 one dot line at a time, and
Printing is performed using a known method.
最大アドレス検出部10は、イメージ、グラフ
イツク、キヤラクタ、オーバレイの各データにつ
いて、イメージメモリ上にドツトパターン展開さ
れたときの最大アドレスを検出する。比較部11
は、この最大アドレスを、印字実行時に印字制御
部へ1ラインずつ転送されるときのリードアドレ
スとを比較し、一致した時点で、次ページのデー
タ展開処理を要求する信号を、展開制御部3に送
出する。なお、この詳細については後述される。 The maximum address detection section 10 detects the maximum address of each image, graphic, character, and overlay data when a dot pattern is developed on the image memory. Comparison section 11
compares this maximum address with the read address that is transferred line by line to the print control unit during printing, and when they match, sends a signal requesting data expansion processing for the next page to the expansion control unit 3. Send to. Note that the details will be described later.
展開制御部3は、イメージメモリ5へのデータ
展開処理を終了したとき、常に主制御部6に対し
て、次ページのデータ転送すなわちページバツフ
アへのバツフアリングを要求する。主制御部6は
CPUあるいはチヤネルと交信し、印字すべきペ
ージが残つていれば、そのデータ転送を要求し
て、ページバツフア2の内容を更新する。したが
つて、展開制御部8が比較部11からの次ページ
展開要求信号を受けたときには、直ちに次ページ
分のデータの展開処理を開始することができる。
第3図は、この様子を図示したものであり、第2
ページ分の展開開始が、従来方式ではの時点で
あつたものが、本発明では、データ存在領域の読
出し終了と同時に次ページ分の展開処理が行なわ
れるための時点となり、その差tだけ、処理時
間の短縮が図られることがわかる。 When the expansion control section 3 finishes the data expansion process to the image memory 5, it always requests the main control section 6 to transfer the data of the next page, that is, to buffer the data to the page buffer. The main control unit 6
It communicates with the CPU or channel, and if there are pages left to be printed, requests the data transfer and updates the contents of the page buffer 2. Therefore, when the expansion control section 8 receives the next page expansion request signal from the comparison section 11, it can immediately start the expansion process of the data for the next page.
Figure 3 illustrates this situation, and the second
In the conventional method, the start of development for a page was at the time , but in the present invention, the development for the next page is started at the same time as the reading of the data existing area is completed, and the processing time is reduced by the difference t. It can be seen that the time can be shortened.
第4図および第5図は、最大アドレス検出部1
0および比較部11の説明図である。 4 and 5 show the maximum address detection section 1
0 and a comparison section 11. FIG.
第4図において、3は展開制御部、5はビツト
マツプ形式のイメージメモリ、12a乃至12d
はドツトパターンの具体例であつて、12aはイ
メージパターン、12bはグラフイツクパター
ン、12cはキヤラクタパターン、12dはオー
バレイパターンを表わしている。また13a乃至
13dは、上記イメージ、グラフイツク、キヤラ
クタ、オーバレイの各パターンの上限アドレスを
保持する上限アドレスレジスタであつて、第2図
の最大アドレス検出部10のの構成要素の一部と
なつている。 In FIG. 4, 3 is an expansion control unit, 5 is a bitmap format image memory, and 12a to 12d.
are specific examples of dot patterns, 12a is an image pattern, 12b is a graphic pattern, 12c is a character pattern, and 12d is an overlay pattern. Further, 13a to 13d are upper limit address registers that hold the upper limit addresses of each of the image, graphic, character, and overlay patterns, and are part of the components of the maximum address detection section 10 in FIG. .
展開制御部3は、図示されている各異なるカテ
ゴリーのデータ属性をもつパターンデータをイメ
ージメモリ5上に展開する際、それぞれの上限ア
ドレス(図示の例では、116,90,26,1
40)を識別して、レジスタ13a乃至13dに
設定する。 When the expansion control unit 3 expands the pattern data having the data attributes of the different categories shown on the image memory 5, the expansion control unit 3 uses the respective upper limit addresses (in the example shown, 116, 90, 26, 1).
40) and set it in the registers 13a to 13d.
第5図は、最大限アドレス検出部10および比
較部11の実施例構成図であり、図中、13a乃
至13dは上限アドレスレジスタ、14は最大値
選択回路を示す。 FIG. 5 is a block diagram of an embodiment of the maximum address detection section 10 and the comparison section 11. In the figure, 13a to 13d are upper limit address registers, and 14 is a maximum value selection circuit.
最大値選択回路14は、上限アドレスレジスタ
13a乃至13dの内容を比較し、その中の最大
値を示すアドレス(図示の例では、140)を選
択する。この選択された最大アドレスは、比較部
11に送られる。比較部11は、通常の任意の減
算器を使用して構成することができ、一致した時
点で、次ページ展開要求信号を展開制御部3に出
力する。たとえば比較部11は、マイクロプログ
ラム制御によるカウンタ機構を用いて構成するこ
とができる。この場合には、最大アドレスをベー
スにして、印字制御部7がイメージメモリ5から
データを1ドツト行分読出すごとにそれから1ず
つ減算カウントし、零となつたときに一致出力を
出すようにすればよい。 The maximum value selection circuit 14 compares the contents of the upper limit address registers 13a to 13d and selects the address (140 in the illustrated example) indicating the maximum value among them. This selected maximum address is sent to the comparator 11. The comparison unit 11 can be configured using any ordinary subtracter, and outputs a next page expansion request signal to the expansion control unit 3 when a match is found. For example, the comparator 11 can be configured using a counter mechanism controlled by a microprogram. In this case, each time the print control unit 7 reads data from the image memory 5 for one line of dots, it subtracts one from the maximum address, and when the count reaches zero, a match output is output. do it.
なお本実施例における展開制御部3、主制御部
6、行印字制御部7、最大アドレス検出部10、
比較部10等は、ハード的に独立して構成されて
いる必要はなく、それぞれ、マイクロプログラム
により制御される機能ブロツクとして実現するこ
とができる。 Note that in this embodiment, the expansion control section 3, the main control section 6, the line printing control section 7, the maximum address detection section 10,
The comparator 10 and the like do not need to be configured independently in terms of hardware, and can be realized as functional blocks controlled by microprograms.
発明の効果
以上述べたように、本発明によれば、次ページ
の展開動作を、従来方式にくらべて早期に開始で
きるため、複数ページの連続出力を行なう場合
に、用紙出力時間を短縮することができる。Effects of the Invention As described above, according to the present invention, the unfolding operation for the next page can be started earlier than in the conventional method, so that the paper output time can be shortened when consecutively outputting multiple pages. Can be done.
第1図は従来方式におけるイメージメモリのデ
ータ展開タイミング説明図、第2図は本発明実施
例の構成図、第3図は本発明方式によるイメージ
メモリのデータ展開タイミング図、第4図はイメ
ージメモリにおけるドツトパターンの最大アドレ
ス説明図、第5図は最大アドレス検出部および比
較部の構成図である。
図中、3は展開制御部、5はイメージメモリ、
10は最大アドレス検出部、11は比較部、12
a乃至12dは印字すべきドツトパターン、13
a乃至13dは上限アドレスレジスタ、14は最
大値選択回路を示す。
FIG. 1 is an explanatory diagram of the data development timing of the image memory in the conventional method, FIG. 2 is a configuration diagram of the embodiment of the present invention, FIG. 3 is a data development timing diagram of the image memory according to the method of the present invention, and FIG. 4 is the image memory FIG. 5 is a diagram illustrating the maximum address of the dot pattern in FIG. In the figure, 3 is an expansion control unit, 5 is an image memory,
10 is a maximum address detection section, 11 is a comparison section, 12
a to 12d are dot patterns to be printed, 13
A to 13d are upper limit address registers, and 14 is a maximum value selection circuit.
Claims (1)
バレイ等のデータ属性別に出力データを格納する
データバツフアと該データバツフア内の出力デー
タを印字面に対応させてドツトパターンに展開す
る手段と、該展開手段により展開されたドツトパ
ターンデータを記憶するビツトマツプ形式のイメ
ージメモリと、該イメージメモリに記憶されたド
ツトパターンデータをドツト行ごとに読出すため
のアクセス手段と、該アクセス手段によりドツト
行ごとにイメージメモリから読出されたドツトパ
ターンデータを印字する手段とを有するドキユメ
ントプリンタにおいて、上記展開手段がイメージ
メモリにドツトパターンデータを展開する際に該
ドツトパターンデータの最大アドレス値を検出す
る手段と、上記アクセス手段がイメージメモリか
らドツトパターンデータをドツト行ごとに読出す
際に、該ドツト行アドレスと上記最大アドレス値
検出手段により検出されたドツトパターンデータ
の最大アドレス値とを比較する手段とをそなえ、
該比較手段が一致を検出したとき、直ちに上記展
開手段に対して、イメージメモリへの次ページ分
のドツトパターンデータの展開処理を実行させる
ことを特徴とするプリンタのイメージメモリにお
けるエンプテイ確認制御方式。1. A data buffer for storing output data according to data attributes such as images, graphics, characters, overlays, etc., a means for developing the output data in the data buffer into a dot pattern corresponding to the printing surface, and a dot pattern developed by the developing means. an image memory in a bit map format for storing data; an access means for reading dot pattern data stored in the image memory for each dot row; and a dot pattern read out from the image memory for each dot row by the access means. means for detecting the maximum address value of the dot pattern data when the development means develops the dot pattern data in the image memory; means for comparing the dot row address and the maximum address value of the dot pattern data detected by the maximum address value detection means when reading the dot pattern data for each dot row;
An empty confirmation control method in an image memory of a printer, characterized in that when the comparison means detects a match, the expansion means immediately executes expansion processing of the next page's worth of dot pattern data into the image memory.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57113478A JPS593625A (en) | 1982-06-30 | 1982-06-30 | Empty confirmation control system of image buffer of printer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57113478A JPS593625A (en) | 1982-06-30 | 1982-06-30 | Empty confirmation control system of image buffer of printer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS593625A JPS593625A (en) | 1984-01-10 |
| JPS631614B2 true JPS631614B2 (en) | 1988-01-13 |
Family
ID=14613287
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57113478A Granted JPS593625A (en) | 1982-06-30 | 1982-06-30 | Empty confirmation control system of image buffer of printer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS593625A (en) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2715475B2 (en) * | 1988-09-29 | 1998-02-18 | 富士ゼロックス株式会社 | Graphic output device |
| JPH04187463A (en) * | 1990-11-21 | 1992-07-06 | Matsushita Graphic Commun Syst Inc | Picture print processing method |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5395525A (en) * | 1977-02-02 | 1978-08-21 | Hitachi Ltd | Page print processor |
| JPS5720063A (en) * | 1980-07-10 | 1982-02-02 | Ricoh Co Ltd | Buffer memory control circuit of facsimile receiver |
-
1982
- 1982-06-30 JP JP57113478A patent/JPS593625A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS593625A (en) | 1984-01-10 |
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