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JPS6322480B2 - - Google Patents
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JPS6322480B2 - - Google Patents

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Publication number
JPS6322480B2
JPS6322480B2 JP56062151A JP6215181A JPS6322480B2 JP S6322480 B2 JPS6322480 B2 JP S6322480B2 JP 56062151 A JP56062151 A JP 56062151A JP 6215181 A JP6215181 A JP 6215181A JP S6322480 B2 JPS6322480 B2 JP S6322480B2
Authority
JP
Japan
Prior art keywords
back panel
printed board
printed
shelf
tested
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP56062151A
Other languages
English (en)
Other versions
JPS57177600A (en
Inventor
Fujio Yamada
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP6215181A priority Critical patent/JPS57177600A/ja
Publication of JPS57177600A publication Critical patent/JPS57177600A/ja
Publication of JPS6322480B2 publication Critical patent/JPS6322480B2/ja
Granted legal-status Critical Current

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  • Testing Electric Properties And Detecting Electric Faults (AREA)
  • Mounting Of Printed Circuit Boards And The Like (AREA)

Description

【発明の詳細な説明】 本発明はシエルフに実装されたプリント板を該
シエルフに実装された状態で動作させてテストす
る方法に関する。
第1図はシエルフに実装された状態のプリント
板を示す断面図であり、1はプリント板、2はバ
ツクパネル、3はシエルフ(シエルフのガイドレ
ール)、4はバツクパネルに植設された端子ピン
であり、バツクパネル2の両面にスルーホールの
中を貫通しているもの、11はプリント板のコネ
クタであり、上記ピン4を雄コンタクトとしてそ
れと嵌合する雌コンタクトを含んで成るものであ
る。
このような電子装置を動作させて各プリント板
1上の任意の点をプロービングし、電圧値や波形
を観測するとき、従来は第2図のようにしてい
た。即ち被テストプリント板1の代りにいわゆる
エクステンシヨンカード5をバツクパネル2に接
続し、その先のコネクタ52に対して被テストプ
リント板1を接続することにより、被テストプリ
ント板をシエルフ外部に引出した状態で装置全体
を動作させ、被テストプリント板のテストを行な
う。しかしこのような従来方法では、エクステン
シヨンカード5におけるコネクタ51と52との
間の配線長lによりデイレイを生じ、今日のよう
に高速動作する装置においては充分なテストがで
きないという問題を生じていた。
そこで本発明では、一般にバツクパネル2に植
設されている端子ピン4が略表裏対称に形成され
ている(裏面側のピンはデイスクリート配線をラ
ツピングするために利用されているが、バツクパ
ネル自体の多層化がすすむにつれて、デイスクリ
ート配線の量は非常に少なくなつてきている)こ
とに注目し、バツクパネルの背面に被テストプリ
ント板を実装することを提案するものである。
但し、一般にコネクタ11は複数列のコンタク
トを有しており、単にバツクパネルの背面に挿入
したとするとコンタクト列が左右逆になつてしま
う。よつて、第3図aに示す如くアダプタコネク
タ6を介して接続することが必要である。このア
ダプタ6は第3図bに示す如く、バツクパネル側
の雌コンタクト61と被テストプリント板側の雄
コンタクト62とが左右逆になるように内部で配
線されている。
尚上記の例ではバツクパネル2に植設されてい
る端子は表裏貫通したピン状の端子を仮定したが
これ以外の端子でもよいことはいうまでもない。
以上の如く本発明によればほとんど配線長を付
加することなく所望の被テストプリント板をシエ
ルフ外へ引き出して実装試験が可能であり、高速
な装置でも充分なテストが行なえる。
【図面の簡単な説明】
第1図は一般的シエルフの断面図、第2図は従
来のエクステンシヨンカードを用いたテスト方法
を示す断面図、第3図aは本発明の一実施例テス
ト方法を示す断面図、第3図bはアダプタの断面
図である。 図中1はプリント板、2はバツクパネル、6が
アダプタである。

Claims (1)

  1. 【特許請求の範囲】 1 端子が略表裏対称に配列されたバツクパネル
    の片面に複数のプリント板が実装されてなる電子
    装置におけるプリント板の試験方法において、 試験時には、被試験対象のプリント板をバツク
    パネルの背面に端子配列を入れ換えたアダプタコ
    ネクタを介して接続することにより試験を行なう
    ことを特徴とするプリント板の試験方法。
JP6215181A 1981-04-24 1981-04-24 Printed board testing system Granted JPS57177600A (en)

Priority Applications (1)

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JP6215181A JPS57177600A (en) 1981-04-24 1981-04-24 Printed board testing system

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Publications (2)

Publication Number Publication Date
JPS57177600A JPS57177600A (en) 1982-11-01
JPS6322480B2 true JPS6322480B2 (ja) 1988-05-12

Family

ID=13191812

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Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5145468Y2 (ja) * 1971-11-30 1976-11-04
JPS50129967A (ja) * 1974-03-30 1975-10-14
JPS55141989U (ja) * 1979-03-30 1980-10-11

Also Published As

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JPS57177600A (en) 1982-11-01

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