JPS6348075B2 - - Google Patents
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- Publication number
- JPS6348075B2 JPS6348075B2 JP59154217A JP15421784A JPS6348075B2 JP S6348075 B2 JPS6348075 B2 JP S6348075B2 JP 59154217 A JP59154217 A JP 59154217A JP 15421784 A JP15421784 A JP 15421784A JP S6348075 B2 JPS6348075 B2 JP S6348075B2
- Authority
- JP
- Japan
- Prior art keywords
- display
- display section
- storage means
- analog
- scale
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【発明の詳細な説明】
本発明は、アナログ入力信号の大きさをデイジ
タル量に変換し、複数の表示素子を駆動して棒グ
ラフ表示をするようにした表示装置に関するもの
であつて、詳しくは、比較的少数の表示素子で高
精度のアナログ指示を行なう表示装置を提供する
ものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a display device that converts the magnitude of an analog input signal into a digital quantity and drives a plurality of display elements to display a bar graph. The present invention provides a display device that provides analog instructions with high accuracy using a relatively small number of display elements.
第1図は、従来のこの種の表示装置の表示ブロ
ツクの一例を示す構成図であつて、Bは基板、
D1〜D10は表示素子、SLは目盛線、SNは目盛数
字であり、表示素子D1〜D10は基板B上に長手方
向に沿つて一次元的に棒グラフに配列され、目盛
線SLおよび目盛数字SNは表示素子D1〜D10に対
応するように基板B上に長手方向に沿つてたとえ
ば印刷により形成されている。 FIG. 1 is a block diagram showing an example of a display block of a conventional display device of this type, in which B is a substrate;
D 1 to D 10 are display elements, SL is a scale line, and SN is a scale number. and scale numbers SN are formed, for example, by printing, along the longitudinal direction on the substrate B so as to correspond to the display elements D 1 to D 10 .
このような構成において、表示素子Dは、アナ
ログ入力信号の大きさを変換したパルス数に応じ
て駆動される。たとえば、第1図に示すように、
表示素子D1〜D4が駆動されている状態では、入
力信号Xの大きさは、40≦X≦50の範囲にあるこ
とを表わすことになり、1の桁の大きさについて
は知ることができない。すなわち、第1図の構成
では、表示素子Dの数が10個であるために、10%
の精度でしかアナログ指示を行なうことができな
い。 In such a configuration, the display element D is driven according to the number of pulses obtained by converting the magnitude of the analog input signal. For example, as shown in Figure 1,
When the display elements D 1 to D 4 are being driven, the magnitude of the input signal X is in the range of 40≦X≦50, and the magnitude of the 1 digit cannot be known. Can not. That is, in the configuration shown in FIG. 1, since the number of display elements D is 10, 10%
Analog instructions can only be given with an accuracy of .
本発明は、このような欠点を解決したものであ
り、従来と同様な構成を有するアナログ表示部を
用いてより精度の高いアナログ指示を行なう表示
装置を実現したものであつて、以下、図面を用い
て詳細に説明する。 The present invention solves these drawbacks and realizes a display device that provides analog instructions with higher precision using an analog display section having the same configuration as the conventional one. This will be explained in detail using
第2図は、本発明に用いる表示ブロツクの一例
を示す構成図であつて、第1図と同等部分には同
一符号を付している。第2図において、SLDは
目盛線を表示する表示素子、SND1〜SND7は目
盛数字を表示する7セグメントの表示素子であ
り、これら表示素子SLD,SND1〜SND7は表示
素子D1〜D10で構成されるアナログ表示部に対応
した目盛表示部を構成している。なお、これら表
示ブロツクを構成する表示素子としては、たとえ
ば液晶を用いる。 FIG. 2 is a block diagram showing an example of a display block used in the present invention, and the same parts as in FIG. 1 are given the same reference numerals. In FIG. 2, SLD is a display element that displays scale lines, SND 1 to SND 7 are 7-segment display elements that display scale numbers, and these display elements SLD and SND 1 to SND 7 are display elements D 1 to SND 7. It constitutes a scale display section corresponding to the analog display section composed of D10 . Note that, for example, a liquid crystal is used as a display element constituting these display blocks.
このような構成において、アナログ表示部を構
成する表示素子D1〜D10は入力信号の大きさに対
応したパルスにより駆動され、目盛表示部を構成
する表示素子SLD,SND1〜SND7は外部からの
信号で制御される。 In such a configuration, the display elements D 1 to D 10 that make up the analog display section are driven by pulses corresponding to the magnitude of the input signal, and the display elements SLD and SND 1 to SND 7 that make up the scale display section are driven by external pulses. controlled by signals from
第3図は、これらの関係を概念的に示すブロツ
ク図であつて、INは入力信号が印加される入力
端子、DISP.Bは第2図に示した構成を有する表
示ブロツク、CNTL.Bは表示ブロツクDISP.Bの
表示状態を制御する機能を有する制御ブロツクで
ある。制御ブロツクCNTL.Bは、表示ブロツク
DISP.Bを構成するアナログ表示部Aと目盛表示
部Bの表示状態を連動して変化させるための信号
を発生するように構成されている。 FIG. 3 is a block diagram conceptually showing these relationships, where IN is an input terminal to which an input signal is applied, DISP.B is a display block having the configuration shown in FIG. 2, and CNTL.B is a display block having the configuration shown in FIG. This is a control block that has the function of controlling the display state of display block DISP.B. The control block CNTL.B is the display block
It is configured to generate a signal for interlockingly changing the display states of the analog display section A and the scale display section B that constitute DISP.B.
第4図は、第3図の具体的な回路の一例を示す
ブロツク図であつて、INは被測定信号の入力端
子、A/Dは入力信号の大きさをデイジタル量た
とえばパルス数に変換する信号変換器、SR1,
SR2は信号変換器A/Dの出力パルスを格納する
格納手段として用いるシフトレジスタであり、第
1のシフトレジスタSR1の最上位ビツト出力は第
2のシフトレジスタSR2のクロツク端子に接続さ
れている。SWは“粗”測定(COARSE)と
“密”測定(FINE)とを切り換える切換スイツ
チ、REGは粗測定時の目盛表示部Bの目盛数字
情報を格納する格納手段として用いるレジスタ、
SWC1は切換スイツチSWにしたがつてシフトレ
ジスタSR1,SR2のいずれか一方の内容をアナロ
グ表示部Aに送出する第1の切換回路、SWC2は
切換スイツチSWにしたがつて第2のシフトレジ
スタSR2あるいはレジスタREGのいずれかの内容
を目盛表示部Bに接続されたデコーダDEC1に送
出する第2の切換回路である。デコーダDEC1は、
第2の切換回路SWC2の出力にしたがつて目盛表
示部Bを構成する表示素子SLD,SND1〜SND7
を駆動するための信号を発生する。DV1は第1の
切換回路SWC1の出力にしたがつてアナログ表示
部Aを構成する表示素子D1〜D10を駆動する第1
の駆動回路、DV2はデコーダDEC1の出力にした
がつて目盛表示部Bを構成するSLD,SND1〜
SND7を駆動する第2の駆動回路である。 FIG. 4 is a block diagram showing an example of the specific circuit shown in FIG. 3, where IN is an input terminal for the signal under test, and A/D converts the magnitude of the input signal into a digital quantity, such as the number of pulses. Signal converter, SR 1 ,
SR2 is a shift register used as a storage means for storing output pulses of the signal converter A/D, and the most significant bit output of the first shift register SR1 is connected to the clock terminal of the second shift register SR2 . ing. SW is a changeover switch that switches between "coarse" measurement (COARSE) and "fine" measurement (FINE), and REG is a register used as a storage means to store the scale number information of scale display section B during coarse measurement.
SWC 1 is a first switching circuit that sends the contents of either shift register SR 1 or SR 2 to analog display section A according to the changeover switch SW, and SWC 2 is a first switching circuit that sends the contents of either shift register SR 1 or SR 2 to the analog display section A according to the changeover switch SW. This is a second switching circuit that sends the contents of either the shift register SR2 or the register REG to the decoder DEC1 connected to the scale display section B. The decoder DEC 1 is
Display elements SLD, SND 1 to SND 7 forming scale display section B according to the output of the second switching circuit SWC 2
Generates a signal to drive. DV 1 is a first switching circuit that drives display elements D 1 to D 10 constituting the analog display section A according to the output of the first switching circuit SWC 1 .
The drive circuit, DV 2 , connects SLD, SND 1 to
This is the second drive circuit that drives SND 7 .
第5図a,bは、第4図の動作状態の一例を示
す表示ブロツクの動作図である。たとえば、第4
図において、測定範囲を0〜100とし、入力信号
の大きさを“47”とする。このとき、第1のシフ
トレジスタSR1には下位桁の“7”の情報が格納
され、第2のシフトレジスタSR2には上位桁の
“4”の情報が格納されている。そして、切換ス
イツチSWを“粗”に設定すると、アナログ表示
部Aには第2のシフトレジスタSR2の内容“4”
が送出され、目盛表示部BにはレジスタREGの
内容が送出される。これにより、表示ブロツクの
表示状態は第5図aのようになり、第1図の装置
と同様に10%の精度でアナログ表示を行なう。次
に、切換スイツチSWを“密”に切り換えると、
アナログ表示部Aには第1のシフトレジスタSR1
の内容“7”が送出され、目盛表示部Bには第2
のシフトレジスタSR2の内容“4”が送出され
る。そして、アナログ表示部Aは入力信号の下位
桁“7”をアナログ指示し、目盛表示部Bは入力
信号の上位桁“4”の範囲である“40〜45〜50”
をデイジタル表示することになる。これにより、
表示ブロツクの表示状態は第5図bのようにな
り、1%の精度でアナログ指示を行なうことがで
きる。なお、密測定時における表示ブロツクの表
示状態は、入力信号の変化に応じて自動的に切り
換わり、オートレンジの表示装置が実現できる。 5a and 5b are operation diagrams of the display block showing an example of the operating state of FIG. 4. FIG. For example, the fourth
In the figure, the measurement range is 0 to 100, and the magnitude of the input signal is "47". At this time, the first shift register SR 1 stores information on the lower digit "7", and the second shift register SR 2 stores information on the upper digit "4". Then, when the changeover switch SW is set to "coarse", the analog display section A shows the contents of the second shift register SR2 as "4".
is sent out, and the contents of the register REG are sent out to the scale display section B. As a result, the display state of the display block becomes as shown in FIG. 5a, and similar to the device shown in FIG. 1, analog display is performed with an accuracy of 10%. Next, if you switch the selector switch SW to "close",
The analog display section A has the first shift register SR1.
The content “7” is sent out, and the scale display section B shows the second
The content "4" of shift register SR2 is sent out. The analog display section A indicates the lower digit "7" of the input signal in an analog manner, and the scale display section B indicates "40-45-50" which is the range of the upper digit "4" of the input signal.
will be displayed digitally. This results in
The display state of the display block is as shown in FIG. 5b, and analog instructions can be given with an accuracy of 1%. Note that the display state of the display block during precision measurement is automatically switched in accordance with changes in the input signal, making it possible to realize an auto-ranging display device.
以上説明したように、本発明によれば、比較的
少数の表示素子で高精度のアナログ指示を行なう
表示装置が実現でき、テスターや工業計器用の指
示計等に好適である。 As described above, according to the present invention, a display device that provides highly accurate analog instructions using a relatively small number of display elements can be realized, and is suitable for use in testers, indicators for industrial instruments, and the like.
第1図は従来の表示装置の表示ブロツクの一例
を示す構成図、第2図は本発明に用いる表示ブロ
ツクの一例を示す構成図、第3図は本発明の概念
を示すブロツク図、第4図は第3図の具体的な回
路の一例を示すブロツク図、第5図は第4図の動
作状態の一例を示す表示ブロツクの動作図であ
る。
IN……入力端子、DISP.B……表示ブロツク、
CNTL.B……制御ブロツク、A……アナログ表
示部、B……目盛表示部。
Fig. 1 is a block diagram showing an example of a display block of a conventional display device, Fig. 2 is a block diagram showing an example of a display block used in the present invention, Fig. 3 is a block diagram showing the concept of the present invention, and Fig. 4 is a block diagram showing an example of a display block used in the present invention. This figure is a block diagram showing an example of the specific circuit of FIG. 3, and FIG. 5 is an operation diagram of a display block showing an example of the operating state of FIG. 4. IN...Input terminal, DISP.B...Display block,
CNTL.B...Control block, A...Analog display section, B...Scale display section.
Claims (1)
され入力信号の大きさをアナログ的に表示するア
ナログ表示部およびこのアナログ表示部の配列方
向に沿つて配置された複数の表示素子で構成され
アナログ表示部の目盛を表示する目盛表示部を含
む表示ブロツクと、入力信号の大きさに対応した
デイジタル信号および表示ブロツクのアナログ表
示部および目盛表示部の動作を制御する制御信号
を表示ブロツクに送出する制御ブロツクとを具備
し、これら制御ブロツクから送出されるデイジタ
ル信号および制御信号により表示ブロツクのアナ
ログ表示部および目盛表示部の表示状態を連動し
て変化させるように構成された表示装置におい
て、 前記制御ブロツクとして、 入力信号の大きさをデイジタル量に変換する信
号変換器と、 この信号変換器の出力信号の下位桁情報を格納
する第1の格納手段と、 前記信号変換器の出力信号の上位桁情報を格納
する第2の格納手段と、 粗測定モードと密測定モードとを切り換える切
換スイツチと、 粗測定時の目盛数字情報を格納する第3の格納
手段と、 前記切換スイツチの切り換えに従つて前記第1
の格納手段または第2の格納手段の内容をアナロ
グ表示部に送出する第1の切換回路と、 前記切換スイツチの切り換えに従つて前記第2
の格納手段または第3の格納手段の内容を目盛表
示部に送出する第2の切換回路を含むものを用
い、 粗測定時にはアナログ表示部に第2の格納手段
の内容を送出して目盛表示部に第3の格納手段の
内容を送出し、密測定時にはアナログ表示部およ
び目盛表示部にそれぞれ第1の格納手段の内容を
送出することにより、前記切換スイツチの切り換
えに従つてアナログ表示部および目盛表示部の表
示状態を連動して変化させるようにしたことを特
徴とする表示装置。[Claims] 1. An analog display section that is composed of a plurality of display elements arranged one-dimensionally and displays the magnitude of an input signal in an analog manner, and a plurality of display elements arranged along the arrangement direction of the analog display section. A display block including a scale display section that is composed of display elements and displays the scale of the analog display section, and a control that controls the digital signal corresponding to the magnitude of the input signal and the operation of the analog display section and scale display section of the display block. The display block is equipped with a control block that sends signals to the display block, and is configured to change the display states of the analog display section and the scale display section of the display block in conjunction with the digital signals and control signals sent from these control blocks. In the display device, the control block includes a signal converter that converts the magnitude of an input signal into a digital quantity, a first storage means that stores lower digit information of an output signal of the signal converter, and the signal converter. a second storage means for storing upper digit information of the output signal of the instrument; a changeover switch for switching between coarse measurement mode and fine measurement mode; and third storage means for storing scale number information during coarse measurement; According to the switching of the changeover switch, the first
a first switching circuit that sends the contents of the storage means or the second storage means to an analog display section;
or a second switching circuit that sends the contents of the storage means or the third storage means to the scale display section.During rough measurements, the contents of the second storage means are sent to the analog display section and the contents of the third storage means are sent to the scale display section. By sending the contents of the third storage means to the analog display section and the scale display section respectively during precision measurement, the analog display section and the scale display are displayed according to the switching of the changeover switch. A display device characterized in that a display state of a display section is changed in conjunction with each other.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15421784A JPS6045292A (en) | 1984-07-25 | 1984-07-25 | Display unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15421784A JPS6045292A (en) | 1984-07-25 | 1984-07-25 | Display unit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6045292A JPS6045292A (en) | 1985-03-11 |
| JPS6348075B2 true JPS6348075B2 (en) | 1988-09-27 |
Family
ID=15579401
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15421784A Granted JPS6045292A (en) | 1984-07-25 | 1984-07-25 | Display unit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6045292A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6348596A (en) * | 1986-08-18 | 1988-03-01 | カルロ・ガバッツイ・ホ−ルディング・アクチエンゲゼルシャフト | Bar graph display |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS541257Y2 (en) * | 1975-08-29 | 1979-01-20 |
-
1984
- 1984-07-25 JP JP15421784A patent/JPS6045292A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6045292A (en) | 1985-03-11 |
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