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JPS6412195B2 - - Google Patents
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JPS6412195B2 - - Google Patents

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JPS6412195B2
JPS6412195B2 JP58092047A JP9204783A JPS6412195B2 JP S6412195 B2 JPS6412195 B2 JP S6412195B2 JP 58092047 A JP58092047 A JP 58092047A JP 9204783 A JP9204783 A JP 9204783A JP S6412195 B2 JPS6412195 B2 JP S6412195B2
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JP
Japan
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transistor
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drive
circuit
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Application number
JP58092047A
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JPS59218038A (en
Inventor
Shoichi Furuhata
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Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
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Publication date
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K17/00Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/51Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
    • H03K17/56Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
    • H03K17/60Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors

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  • Control Of Ac Motors In General (AREA)
  • Control Of Direct Current Motors (AREA)
  • Electronic Switches (AREA)

Description

【発明の詳細な説明】 〔発明の属する技術分野〕 本発明は負荷に電流を繰返し開閉して供給する
パワートランジスタのベース(ゲーート)を駆動
するための、簡単、安価に構成された駆動回路に
関する。
[Detailed description of the invention] [Technical field to which the invention pertains] The present invention relates to a drive circuit that is simply and inexpensively configured to drive the base (gate) of a power transistor that repeatedly opens and closes current to a load. .

〔従来技術とその問題点〕[Prior art and its problems]

以下各図の説明において同一の符号は同一また
は相当部分を示す。
In the following description of each figure, the same reference numerals indicate the same or corresponding parts.

第1図は一例としていわゆるDCチヨツパー回
路内における従来のパワートランジスタの駆動回
路の例を示す。図中1は直流の主電源、2はパワ
ートランジスタとしての主トランジスタ6にベー
ス電流Ib1を供給する駆動電源、3は該ベース電
流Ib1を制限する抵抗、4は駆動トランジスタ、
7は負荷でこの場合はモータの例を示す。8は該
モータの電流の断続時に、該モータのインダクタ
ンスにもとづく誘起電圧を吸収するフリーホイー
リングダイオードである。
FIG. 1 shows, as an example, a conventional power transistor drive circuit in a so-called DC chopper circuit. In the figure, 1 is a DC main power supply, 2 is a drive power supply that supplies base current Ib1 to the main transistor 6 as a power transistor, 3 is a resistor that limits the base current Ib1, 4 is a drive transistor,
7 is a load, in this case a motor. Reference numeral 8 denotes a freewheeling diode that absorbs the induced voltage based on the inductance of the motor when the current of the motor is interrupted.

次に本回路の動作を述べると、図外の制御回路
から駆動トランジスタ4のベースに、傍の波形で
示されるような、繰返して断続される、制御信号
CSとしてのベース電流Ib2を与えて駆動トラン
ジスタ4を繰返し開閉させると、駆動トランジス
タ4がONのときは、主トランジスタ6の前記ベ
ース電流Ib1は駆動トランジスタ4のコレクタ・
エミツタにより短絡されて、主トランジスタ6は
OFFとなり、駆動トランジスタ4がOFFのとき
は前記ベース電流Ib1が主トランジスタ6に供給
されて主トランジスタ6はONし、モータ7に主
電源1の電圧が加えられる。このようにして前記
ベース電流Ib2の断続の時間比を可変することに
より、主電源1から負荷7に与えられる平均電圧
が可変できモータの制御ができる。
Next, to describe the operation of this circuit, a control signal, as shown in the adjacent waveform, is repeatedly applied to the base of the drive transistor 4 from a control circuit (not shown).
When the drive transistor 4 is repeatedly opened and closed by applying the base current Ib2 as CS, when the drive transistor 4 is ON, the base current Ib1 of the main transistor 6 is applied to the collector of the drive transistor 4.
Short-circuited by the emitter, the main transistor 6
When the driving transistor 4 is OFF, the base current Ib1 is supplied to the main transistor 6, the main transistor 6 is turned ON, and the voltage of the main power supply 1 is applied to the motor 7. By varying the time ratio of on/off of the base current Ib2 in this manner, the average voltage applied from the main power source 1 to the load 7 can be varied and the motor can be controlled.

上記の例のように主トランジスタ6を駆動する
ための駆動電源2は、従来は主電源1とは独立し
て設けられており、第2図に示すようないわゆる
三相インバータの主回路構成のように多くの主ト
ランジスタ6−1,〜,6−6を必要とする回路
では、主トランジスタと同数の独立した駆動電源
が必要となり、駆動回路が複雑、高価となる欠点
がある。
As in the above example, the drive power supply 2 for driving the main transistor 6 has conventionally been provided independently of the main power supply 1, and the main circuit configuration of a so-called three-phase inverter as shown in FIG. In a circuit that requires such a large number of main transistors 6-1, .

この欠点を排除する方法の一つとして、主トラ
ンジスタのベース駆動を主電源の電圧を利用して
行う方法があり、第3図にその回路の一例を示
す。この回路では駆動トランジスタ4のOFFの
とき、主トランジスタ6のベース電流Ib1を主電
源1より抵抗3を介して供給して主トランジスタ
6をONさせ、また駆動トランジスタ4のONの
とき前記ベース電流Ib1を駆動トランジスタ4の
コレクタ・エミツタにより短絡して主トランジス
タをOFFする。しかしながらこの回路は図のよ
うに主トランジスタ6のコレクタ側に負荷を置か
ねばならぬと言つた回路構成上の制約があり、各
種の回路構成に適用できない欠点がある。
One method for eliminating this drawback is to drive the base of the main transistor using the voltage of the main power supply, and an example of this circuit is shown in FIG. In this circuit, when the drive transistor 4 is OFF, the base current Ib1 of the main transistor 6 is supplied from the main power supply 1 through the resistor 3 to turn the main transistor 6 ON, and when the drive transistor 4 is ON, the base current Ib1 are short-circuited by the collector and emitter of drive transistor 4 to turn off the main transistor. However, as shown in the figure, this circuit has a limitation in circuit configuration, such as the need to place a load on the collector side of the main transistor 6, and has the disadvantage that it cannot be applied to various circuit configurations.

〔発明の目的〕[Purpose of the invention]

本発明の目的は上述の欠点を除き、主電源の電
圧を利用し、かつ多種類の主回路構成にも適用可
能な主トランジスタの駆動回路を提供しようとす
るもので、これにより駆動回路の構成を簡単かつ
低価格となるようにし、駆動回路を通称パワート
ランジスタモジユールと呼ばれる個別半導体製品
にも容易に内蔵できるようにすることである。
SUMMARY OF THE INVENTION An object of the present invention is to eliminate the above-mentioned drawbacks and provide a main transistor drive circuit that utilizes the voltage of the main power supply and is applicable to many types of main circuit configurations. The object of the present invention is to make the drive circuit simple and low-cost, and to enable the drive circuit to be easily built into an individual semiconductor product commonly called a power transistor module.

〔発明の要点〕[Key points of the invention]

本発明の要点は、それぞれ第1、第2の主端子
と1つの制御用端子を少なくとも有する主半導体
素子と駆動半導体素子とを備え、前記主半導体素
子の第1または第2の主端子と制御用端子との間
に前記駆動半導体素子の第1、第2主端子を接続
し、前記主半導体素子の第1、第2主端子を直流
電源と負荷との間に直列に接続し、前記駆動半導
体素子の制御用端子への制御信号により前記駆動
半導体素子と前記主半導体素子を作動させて負荷
に供給する電流を開閉する回路において、前記主
半導体素子がオフの状態時に前記主半導体素子に
印加される前記直流電源の電圧によりダイオード
と第1の抵抗との直列接続を介して充電されるコ
ンデンサを前記主半導体素子と並列に接続し、前
記主半導体素子がオンの状態時に前記主半導体素
子の制御用端子に前記コンデンサの電圧または電
流を印加させる第2の抵抗を前記主半導体素子の
制御用端子と前記コンデンサの一端に接続するよ
うにした点にある。
The gist of the present invention is to include a main semiconductor element and a drive semiconductor element each having at least a first and a second main terminal and one control terminal, and a first or second main terminal of the main semiconductor element and a control terminal. The first and second main terminals of the drive semiconductor element are connected between the drive semiconductor element and the drive semiconductor element, and the first and second main terminals of the main semiconductor element are connected in series between the DC power source and the load. In a circuit that operates the driving semiconductor element and the main semiconductor element in response to a control signal to a control terminal of a semiconductor element to open and close a current supplied to a load, the voltage is applied to the main semiconductor element when the main semiconductor element is in an OFF state. A capacitor that is charged by the voltage of the DC power source through a series connection of a diode and a first resistor is connected in parallel with the main semiconductor element, and when the main semiconductor element is in an on state, the capacitor is charged by the voltage of the DC power supply. The second resistor for applying the voltage or current of the capacitor to the control terminal is connected to the control terminal of the main semiconductor element and one end of the capacitor.

〔発明の実施例〕[Embodiments of the invention]

以下第4〜9図にもとづいて本発明を説明す
る。第4図は本発明の一実施例として第1図に対
応する回路構成図である。第4図Aにおいて第1
図との相異は主トランジスタ6のベース電流Ib1
を供給する駆動電源2に代りコンデンサ9、抵抗
10、ツエナーダイオード11、ダイオード12
が付加されている点である。第4図Aの動作を第
8図の波形と対応しつ説明すると、駆動トランジ
スタ4に制御信号CSとしてのベース電流Ib2が
印加され、駆動トランジスタ4がONの状態(第
8図期間T1)では主トランジスタ6のベース・
エミツタは駆動トランジスタ4により短絡されて
主トランジスタ6はOFF従つて主トランジスタ
6のコレクタ・エミツタ間には主電源1の電圧が
印加されており、コンデンサ9は主電源1→ダイ
オード12→抵抗10→コンデンサ9→負荷7の
閉回路で急速に充電される。なお抵抗10を通る
電流の一部は抵抗3→駆動トランジスタ4のコレ
クタ・エミツタに分流したのち再び合流する。こ
のときツエナダイオード11はコンデンサ9の充
電電圧ecが過大とならぬように制限するが、回路
条件によつては省略することができる。
The present invention will be explained below based on FIGS. 4 to 9. FIG. 4 is a circuit configuration diagram corresponding to FIG. 1 as an embodiment of the present invention. In Figure 4A, the first
The difference from the figure is the base current Ib1 of the main transistor 6.
A capacitor 9, a resistor 10, a Zener diode 11, and a diode 12 are used instead of the drive power supply 2 that supplies
is added. To explain the operation in FIG. 4A in correspondence with the waveforms in FIG. 8, when the base current Ib2 as the control signal CS is applied to the drive transistor 4 and the drive transistor 4 is ON (period T1 in FIG. 8), Base of main transistor 6
The emitter is short-circuited by the drive transistor 4, and the main transistor 6 is OFF.Therefore, the voltage of the main power supply 1 is applied between the collector and emitter of the main transistor 6, and the capacitor 9 is connected to the main power supply 1 → diode 12 → resistor 10 → The capacitor 9 is rapidly charged in the closed circuit of the load 7. Note that a part of the current passing through the resistor 10 is shunted from the resistor 3 to the collector/emitter of the drive transistor 4, and then joins again. At this time, the Zener diode 11 limits the charging voltage ec of the capacitor 9 from becoming excessive, but it can be omitted depending on the circuit conditions.

次に前記ベース電流Ib2の流入を止め駆動トラ
ンジスタ4をOFFとした状態(第8図期間T2)
では主トランジスタ6にはコンデンサ9から抵抗
3を介してベース電流Ib1が供給され主トランジ
スタ6はONする。このとき主トランジスタ6の
コレクタ・エミツタ電圧はコレクタ飽和電圧まで
低下するが、主トランジスタ6のコレクタ・エミ
ツタへのコンデンサ9の放電はダイオード12に
より阻止されて、コンデンサ9の充電電圧ecはゆ
るやかに下降する。
Next, the inflow of the base current Ib2 is stopped and the drive transistor 4 is turned off (period T2 in Fig. 8).
Then, the base current Ib1 is supplied from the capacitor 9 to the main transistor 6 via the resistor 3, and the main transistor 6 is turned on. At this time, the collector-emitter voltage of the main transistor 6 drops to the collector saturation voltage, but the discharge of the capacitor 9 to the collector-emitter of the main transistor 6 is blocked by the diode 12, and the charging voltage ec of the capacitor 9 gradually drops. do.

現在この種のパワートランジスタの応用では主
トランジスタ6を高周波で開閉スイツチングする
ことが一般化しており、このスイツチングの周期
と主トランジスタの特性などに対応して抵抗1
0,3やコンデンサ9などの値を選定することが
できる。
Currently, in the application of this type of power transistor, it is common to switch the main transistor 6 on and off at high frequencies, and the resistance 1
Values such as 0, 3 and capacitor 9 can be selected.

第4図Bは第4図Aの駆動トランジスタ4に代
りホトカプラPC内のホトトランジスタ41を接
続したもので、この場合ホトトランジスタ41の
開,閉は、ホトカプラPC内のホトダイオードPD
に流れる、制御信号CSとしての順電流IFの断続
によつて行われ、制御信号CSを出力する制御回
路と絶縁された極めて簡単な回路が実現できる。
In FIG. 4B, a phototransistor 41 in a photocoupler PC is connected in place of the drive transistor 4 in FIG.
This is achieved by switching on and off the forward current IF as the control signal CS flowing through the control signal CS, making it possible to realize an extremely simple circuit that is isolated from the control circuit that outputs the control signal CS.

第5図Aは本発明の他の実施例としての回路構
成を示したもので、第4図との差は主トランジス
タ6にはダーリントン接続で補助トランジスタ6
Aが付加されている点である。
FIG. 5A shows a circuit configuration as another embodiment of the present invention. The difference from FIG. 4 is that the main transistor 6 is connected to Darlington, and the auxiliary transistor 6 is
This is the point where A is added.

この回路では主トランジスタ6をONするとき
コンデンサ9から抵抗3を介して補助トランジス
タ6Aにベース電流IbAを供給することにより、
増巾されたエミツタ電流としてのベース電流Ib1
が補助トランジスタ6Aのコレクタ・エミツタを
介して主電源1側から、主トランジスタ6に供給
される。このため前記ベース電流IbAは第4図の
場合のベース電流Ib1より小さくできるのでコン
デンサ9の容量を小さく、また抵抗10,3の値
を大きく、すなわち主トランジスタ6の駆動回路
を小形化することができる。
In this circuit, when the main transistor 6 is turned on, by supplying the base current IbA from the capacitor 9 to the auxiliary transistor 6A via the resistor 3,
Base current Ib1 as amplified emitter current
is supplied to the main transistor 6 from the main power supply 1 side via the collector and emitter of the auxiliary transistor 6A. Therefore, since the base current IbA can be made smaller than the base current Ib1 in the case of FIG. 4, it is possible to reduce the capacitance of the capacitor 9 and increase the values of the resistors 10 and 3, that is, to downsize the drive circuit of the main transistor 6. can.

第5図Bは補助トランジスタ6Aとして、バイ
ポーラ形のトランジスタに代り電界効果トランジ
スタ(以後FETと略す)を用い、また駆動トラ
ンジスタ4としてホトカプラPC内のホトトラン
ジスタ41を用いた点が主な相異点である。この
場合補助トランジスタ6AのゲートG1とソース
S1との間は極めて高インピーダンスであり、従
つて抵抗3,10の値も第5図Aの場合に比し、
さらに高い値に、またコンデンサ9の容量もさら
に小さい値とすることができる。この場合の回路
動作は第4図Bと同様、ホトカプラPC内のホト
ダイオードPDに順電流IFを流してホトランジス
タ41をONさせると主トランジスタ6のベー
ス・エミツタはスピードアツプダイオードSDを
介して急速に短絡されOFFとなる。このとき補
助トランジスタ6AのゲートG1・ソースS1間
も逆バイアスされ補助トランジスタ6Aのドレイ
ンD1・ソースS1間はOFFとなる。なおスピ
ードアツプダイオードSDは、主トランジスタ6
内の接合部の電荷を急速にホトトランジスタ41
に放電させて、主トランジスタ6のONからOFF
へのスイツチング時間を短縮する役割を持つが、
回路条件によつては省略することもできる。また
PRはホトランジスタ41のベース・エミツタ間
に付加された抵抗で、ホトトランジスタ41の特
性や耐圧を安定化する役割を持つが回路条件によ
つては省略することもできる。
The main difference in FIG. 5B is that a field effect transistor (hereinafter abbreviated as FET) is used instead of a bipolar transistor as the auxiliary transistor 6A, and a phototransistor 41 in the photocoupler PC is used as the drive transistor 4. It is. In this case, there is an extremely high impedance between the gate G1 and the source S1 of the auxiliary transistor 6A, and therefore the values of the resistors 3 and 10 are also smaller than in the case of FIG. 5A.
It is possible to make the value even higher, and the capacitance of the capacitor 9 can be made even smaller. The circuit operation in this case is similar to that shown in Fig. 4B. When the forward current IF is passed through the photodiode PD in the photocoupler PC to turn on the phototransistor 41, the base and emitter of the main transistor 6 are rapidly changed through the speed-up diode SD. Short-circuited and turned OFF. At this time, the gate G1 and source S1 of the auxiliary transistor 6A are also reverse biased, and the drain D1 and source S1 of the auxiliary transistor 6A are turned OFF. Note that the speed up diode SD is connected to the main transistor 6.
The charge at the junction within the phototransistor 41 is rapidly
to turn main transistor 6 from ON to OFF.
It has the role of shortening the switching time to
It may be omitted depending on the circuit conditions. Also
PR is a resistor added between the base and emitter of the phototransistor 41, and has the role of stabilizing the characteristics and breakdown voltage of the phototransistor 41, but can be omitted depending on the circuit conditions.

次に前記順電流IFを断ち、ホトトランジスタ
41をOFFとすると補助トランジスタ6Aのソ
ースS1に対するゲートG1の電圧は上昇し、補
助トランジスタ6AのドレインD1・ソースS1
間はON状態となつて主トランジスタ6はONす
る。
Next, when the forward current IF is cut off and the phototransistor 41 is turned off, the voltage of the gate G1 with respect to the source S1 of the auxiliary transistor 6A increases, and the voltage between the drain D1 and the source S1 of the auxiliary transistor 6A increases.
During this period, the main transistor 6 is turned on.

第6図,第7図も本発明の異つた実施例を示
し、図では簡単のために主電源1と負荷7は省略
されている。第6図は第5図Bの変形回路で駆動
トランジスタ4、新に付加された駆動補助トラン
ジスタ4A、補助トランジスタ6Aとしてそれぞ
れFETが用いられている。第6図の動作は制御
信号CSの入力により駆動トランジスタ4のソー
スS2に対するゲートG2の電位を駆動トランジ
スタ4の導通可能な電位以上に高めると、駆動ト
ランジスタ4のドレインD2,ソースS2間が
ONして補助トランジスタ6AのゲートG1,ソ
ースS1間の電位を下げ補助トランジスタ6Aの
ドレインD1,ソースS1間をOFFにすると同
時に、同じ制御信号CSを受けて駆動補助トラン
ジスタ4AのドレインD3,ソースS3間もON
し主トランジスタ6のベース、エミツタが短絡さ
れる。この回路では第5図Bのようにトランジス
タ6のベース、エミツタがスピードアツプダイオ
ードSDを介してホトトランジスタ41で短絡さ
れる代りに、直接駆動補助トランジスタ4Aで短
絡されるため、主トランジスタ6のターンオフ時
間をさらに短縮でき、ON/OFF動作の周波数や
耐圧従つて主電源1の電圧を高めることができ
る。しかし前記駆動補助トランジスタ4Aは第5
図BのスピードアツプダイオードSDと同様、回
路条件によつては省略することができる。
6 and 7 also show different embodiments of the present invention, in which the main power source 1 and load 7 are omitted for simplicity. FIG. 6 shows a modified circuit of FIG. 5B, in which FETs are used as the drive transistor 4, the newly added drive auxiliary transistor 4A, and the auxiliary transistor 6A. The operation shown in FIG. 6 is such that when the potential of the gate G2 of the drive transistor 4 with respect to the source S2 is raised to a potential higher than the potential at which the drive transistor 4 can conduct by inputting the control signal CS, the voltage between the drain D2 and the source S2 of the drive transistor 4 is increased.
ON, lowering the potential between the gate G1 and source S1 of the auxiliary transistor 6A, and turning OFF the voltage between the drain D1 and source S1 of the auxiliary transistor 6A, and at the same time receiving the same control signal CS, the drain D3 and source S3 of the drive auxiliary transistor 4A. Pause ON
The base and emitter of the main transistor 6 are then short-circuited. In this circuit, instead of the base and emitter of the transistor 6 being short-circuited by the phototransistor 41 via the speed-up diode SD as shown in FIG. 5B, they are short-circuited by the direct drive auxiliary transistor 4A, which turns off the main transistor The time can be further shortened, and the frequency and withstand voltage of ON/OFF operation, as well as the voltage of the main power supply 1, can be increased. However, the drive auxiliary transistor 4A is the fifth transistor.
Similar to the speed-up diode SD in Figure B, it can be omitted depending on the circuit conditions.

次に第7図では第4図Bにおける主トランジス
タ6がFETに置き換わり、また抵抗3とホトカ
プラPCのホトトランジスタ41の位置が互に入
れ換つている。この回路では制御信号CSによつ
てホトカプラPCのホトダイオードPDに順電流IF
が流れホトトランジスタ41がONすると、主ト
ランジスタ6のゲートGO、ソースSO間の電位上
昇によつて主トランジスタのドレインDO、ソー
スSO間がONし、他方順電流IFが0となるとホ
トトランジスタ41はOFF、従つて主トランジ
スタ6のゲートGO、ソースSO間は短絡抵抗GR
により短絡されて、主トランジスタ6のドレイン
DO、ソースSO間はOFFとなる。この場合順電
流IFの断、続と主トランジスタ6のON/OFFと
の関係が第4図Bの場合と逆になる。
Next, in FIG. 7, the main transistor 6 in FIG. 4B is replaced with an FET, and the positions of the resistor 3 and the phototransistor 41 of the photocoupler PC are exchanged. In this circuit, the forward current IF is applied to the photodiode PD of the photocoupler PC by the control signal CS.
When current flows and the phototransistor 41 turns on, the voltage between the gate GO and the source SO of the main transistor 6 rises, turning on the drain DO and source SO of the main transistor 6. On the other hand, when the forward current IF becomes 0, the phototransistor 41 turns on. OFF, therefore, there is a short-circuit resistor GR between the gate GO and source SO of the main transistor 6.
The drain of the main transistor 6 is short-circuited by
The connection between DO and source SO is OFF. In this case, the relationship between the interruption/continuation of the forward current IF and the ON/OFF of the main transistor 6 is opposite to that shown in FIG. 4B.

第9図は第5図Bにおけるパワートランジスタ
モジユールTMの部分を、第2図の3相インバー
タの主回路構成にパワートランジスタモジユール
TM−1,〜,TM−6として適用した例を示
す。この場合例えばパワートランジスタモジユー
ル(以後単にモジユールと略す)TM−1につい
て見ると、当初全てのモジユールTM−1〜TM
−6がOFFの状態では、モジユールTM−1内の
主トランジスタ6のコレクタ・エミツタ間には、
モジユールTM−4内の主トランジスタ6と主電
源1の電圧を分圧する形で電圧が印加され、モジ
ユールTM−1内のコンデンサ9に充電が行われ
る。次に各モジユールがON/OFFの動作に入つ
た場合にはモジユールTM−1の主トランジスタ
6がOFFのとき、モジユールTM−4の主トラン
ジスタ6はONとなるような制御動作が行われ、
モジユールTM−1の主トランジスタ6には主電
源1の全電圧が印加され、前記と同様モジユール
TM−1内のコンデンサ9への充電が行われる。
Figure 9 shows how the power transistor module TM in Figure 5B is replaced with the power transistor module TM in the main circuit configuration of the three-phase inverter in Figure 2.
An example of application as TM-1, ~, and TM-6 is shown below. In this case, for example, if we look at the power transistor module (hereinafter simply referred to as module) TM-1, initially all modules TM-1 to TM
-6 is OFF, between the collector and emitter of the main transistor 6 in module TM-1,
A voltage is applied in the form of dividing the voltage between the main transistor 6 in the module TM-4 and the main power supply 1, and the capacitor 9 in the module TM-1 is charged. Next, when each module enters ON/OFF operation, a control operation is performed such that when the main transistor 6 of module TM-1 is OFF, the main transistor 6 of module TM-4 is turned ON.
The full voltage of the main power supply 1 is applied to the main transistor 6 of the module TM-1, and the module
The capacitor 9 in TM-1 is charged.

〔発明の効果〕〔Effect of the invention〕

以上詳述したように本発明によれば、主トラン
ジスタがOFFの状態で、そのコレクタ・エミツ
タ間に印加される主電源の電圧により充電される
コンデンサの電圧を用いて主トランジスタのベー
ス駆動を行うこととしたため、高速で主トランジ
スタの開閉スイツチングを行う応用回路におい
て、主トランジスタの駆動回路を極めて簡単化す
ることができ、また駆動回路を主トランジスタの
モジユールに内蔵することが容易となり、かつ大
巾なコストダウンが達成できる。
As detailed above, according to the present invention, when the main transistor is in an OFF state, the base of the main transistor is driven using the voltage of the capacitor that is charged by the voltage of the main power supply applied between the collector and emitter of the main transistor. As a result, in application circuits that open and close the main transistor at high speed, the main transistor drive circuit can be extremely simplified, and the drive circuit can be easily built into the main transistor module, and cost reduction can be achieved.

本発明はトランジスタインバータ、トランジス
タDCチヨツパーなどいわゆるパワーエレクトロ
ニクス回路用のトランジスタモジユールに広く適
用することができる。
The present invention can be widely applied to transistor modules for so-called power electronics circuits such as transistor inverters and transistor DC choppers.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のパワートランジスタ駆動回路の
構成例を示す図、第2図はパワートランジスタの
多用される主回路構成の一例を示す図、第3図は
従来のパワートランジスタ駆動回路の他の構成例
を示す図、第4図乃至第7図は本発明のパワート
ランジスタ駆動回路の構成例を示す図、第8図は
第4図、第5図に対応する動作波形の例を示す
図、第9図は本発明を利用した、第2図に対応す
る主回路構成例を示す図である。 1……主電源、3……抵抗、4……駆動トラン
ジスタ、6……主トランジスタ、6A……補助ト
ランジスタ、9……コンデンサ、10……抵抗、
12……ダイオード、41……ホトトランジス
タ。
Figure 1 is a diagram showing an example of the configuration of a conventional power transistor drive circuit, Figure 2 is a diagram showing an example of the main circuit configuration in which power transistors are often used, and Figure 3 is another configuration of a conventional power transistor drive circuit. 4 to 7 are diagrams showing configuration examples of the power transistor drive circuit of the present invention. FIG. 8 is a diagram showing examples of operating waveforms corresponding to FIGS. 4 and 5. FIG. 9 is a diagram showing an example of the main circuit configuration corresponding to FIG. 2, using the present invention. 1... Main power supply, 3... Resistor, 4... Drive transistor, 6... Main transistor, 6A... Auxiliary transistor, 9... Capacitor, 10... Resistor,
12...Diode, 41...Phototransistor.

Claims (1)

【特許請求の範囲】 1 それぞれ第1、第2の主端子と1つの制御用
端子を少なくとも有する主半導体素子と駆動半導
体素子とを備え、前記主半導体素子の第1または
第2の主端子と制御用端子との間に前記駆動半導
体素子の第1、第2主端子を接続し、前記主半導
体素子の第1、第2主端子を直流電源と負荷との
間に直列に接続し、前記駆動半導体素子の制御用
端子への制御信号により前記駆動半導体素子と前
記主半導体素子を作動させて負荷に供給する電流
を開閉する回路において、前記主半導体素子がオ
フの状態時に前記主半導体素子に印加される前記
直流電源の電圧によりダイオードと第1の抵抗と
の直列接続を介して充電されるコンデンサを前記
主半導体素子と並列に接続し、前記主半導体素子
がオンの状態時に前記主半導体素子の制御用端子
に前記コンデンサの電圧または電流を印加させる
第2の抵抗を前記主半導体素子の制御用端子と前
記コンデンサの一端に接続したことを特徴とする
トランジスタ駆動回路。 2 特許請求の範囲第1項に記載のトランジスタ
駆動回路において、前記主半導体素子は1または
ダーリントン接続された複数のトランジスタから
なることを特徴とするトランジスタ駆動回路。
[Scope of Claims] 1. A main semiconductor element and a drive semiconductor element each having at least a first and a second main terminal and one control terminal, the first or second main terminal of the main semiconductor element and The first and second main terminals of the drive semiconductor element are connected between the control terminal and the main semiconductor element, the first and second main terminals of the main semiconductor element are connected in series between a DC power supply and a load, and the In a circuit that operates the drive semiconductor element and the main semiconductor element by a control signal to a control terminal of the drive semiconductor element to open and close the current supplied to the load, when the main semiconductor element is in an OFF state, the main semiconductor element A capacitor that is charged by the applied DC power voltage through a series connection of a diode and a first resistor is connected in parallel with the main semiconductor element, and when the main semiconductor element is in an on state, the main semiconductor element A transistor drive circuit characterized in that a second resistor for applying a voltage or current of the capacitor to a control terminal of the main semiconductor element is connected to a control terminal of the main semiconductor element and one end of the capacitor. 2. The transistor drive circuit according to claim 1, wherein the main semiconductor element comprises one or a plurality of Darlington-connected transistors.
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