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JPH0336478B2 - - Google Patents
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JPH0336478B2 - - Google Patents

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JPH0336478B2
JPH0336478B2 JP12056985A JP12056985A JPH0336478B2 JP H0336478 B2 JPH0336478 B2 JP H0336478B2 JP 12056985 A JP12056985 A JP 12056985A JP 12056985 A JP12056985 A JP 12056985A JP H0336478 B2 JPH0336478 B2 JP H0336478B2
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calls
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Shunji Abe
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  • Data Exchanges In Wide-Area Networks (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)

Description

【発明の詳細な説明】 〔目次〕 概 要 産業上の利用分野 従来の技術 発明が解決しようとする問題点 問題点を解決するための手段(第1図) 作 用 実施例 発明の効果 〔概要〕 時分割交換システムにおいて、高速通話路網の
両端に低速時間スイツチを設け、低速時間スイツ
チにより低速呼のデータを高速フレームの各々の
同一位相上に並べ換えることにより、高速通話路
網内での各高速フレームの同一チヤネルを異なる
N種の低速呼のデータで共用するようにして呼損
率の増大および処理効果の低下を軽減したもの。
[Detailed Description of the Invention] [Table of Contents] Overview Industrial Application Fields Conventional Technology Problems to be Solved by the Invention Means for Solving the Problems (Fig. 1) Function Examples Effects of the Invention [Summary ] In a time-division switching system, a low-speed time switch is provided at both ends of the high-speed communication network, and by rearranging the data of the low-speed call on the same phase of each high-speed frame, the low-speed time switch is used to arrange data on the same phase of each high-speed frame. The same channel of each high-speed frame is shared by N different types of low-speed call data, thereby reducing the increase in call loss probability and the decrease in processing efficiency.

〔産業上の利用分野〕[Industrial application field]

本発明は低速呼と、そのN倍の転送速度を要す
る高速呼とを対象とする多元交換方式に係り、特
に高速フレーム単位に動作する高速通話路と低速
フレーム単位に動作する低速時間スイツチを組合
せて構成する交換方式に関する。
The present invention relates to a multiple switching system that targets low-speed calls and high-speed calls that require N times the transfer speed, and in particular combines a high-speed communication path that operates in units of high-speed frames and a low-speed time switch that operates in units of low-speed frames. The present invention relates to an exchange system configured with

以下の記述において、FHは高速フレーム、FL
はその時間長がFHのN倍(Nは正の整数)の低
速フレーム、TLは低速時間スイツチ、SLは低速
空間スイツチ、THは高速時間スイツチ、SHは高
速空間スイツチを表わす。
In the following description, F H is a fast frame, F L
is a slow frame whose time length is N times F H (N is a positive integer), T L is a slow time switch, S L is a slow space switch, T H is a fast time switch, and S H is a fast space switch. .

〔従来の技術〕[Conventional technology]

低速呼と高速呼を共に扱う多元交換方式とし
て、従来はFL単位でデータを交換するTL−SL
TL構成の低速通話路と、FH単位でデータを交換
するTH−SH−TH構成の高速通話路のいずれかを
用いていた。
Conventionally, as a multiple switching system that handles both low-speed calls and high-speed calls, T L −S L − exchanges data in F L units.
Either a low-speed communication path with a T L configuration or a high-speed communication path with a T H -S H -TH configuration in which data was exchanged in FH units was used.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

上記従来構成の問題点を第6図および第7図に
よつて説明する。
Problems with the above conventional structure will be explained with reference to FIGS. 6 and 7.

第6図は従来のTL−SL−TL構成の問題点を示
す図である。第6図aにおいて、ハイウエイ上の
各タイムスロツトTSのデータはFL単位にスイツ
チングされ、各フレームFLには多数のタイムス
ロツトTSが含まれる。低速呼のデータA,B,
Cはそれぞれ各低速フレームFL内の1つのタイ
ムスロツトを用いて伝送される。これに対し、高
速呼のデータはFL内の複数のタイムスロツト
(図においては斜線で示す4個)を用いて伝送さ
れる。こうして、高速呼(図においては低速呼の
4倍の速度)のデータでも低速通話路にて転送可
能である。
FIG. 6 is a diagram showing problems with the conventional T L -S L -T L configuration. In FIG. 6a, the data in each time slot TS on the highway is switched in FL units, and each frame FL includes a large number of time slots TS. Low speed call data A, B,
C are each transmitted using one time slot in each slow frame F L. On the other hand, high-speed call data is transmitted using a plurality of time slots (four indicated by diagonal lines in the figure) within the FL . In this way, even data from a high-speed call (in the figure, the speed is four times that of a low-speed call) can be transferred over the low-speed communication path.

しかしながら、第6図bに示すように、TL
SL−TL構成ではSLで異なるハイウエイ上の情報
を交換する際に、SLへ情報を入力する1次リンク
と、SLから情報を出力する2次リンク上に同一位
相の空きを見つける必要がある。低速呼は、FL
内に1つの同一位相空きタイムスロツトが存在す
れば接続可能となるが、高速呼は複数の同一位相
空きタイムスロツト(第6図aの例では4つ)が
存在しなければ接続できず通話路内呼損となる。
第6図bでは3つの同一位相空きタイムスロツト
が存在するが1FL内に4以上のタイムスロツトを
要する高速呼は呼損となる。このように、TL
SL−TL構成では、高速呼の内部呼損率が低速呼
に比べ大きく、両呼の接続品質が著しくばらつ
く。
However, as shown in Figure 6b, T L
In the S L -T L configuration, when exchanging information on different highways in S L , the same phase is created on the primary link that inputs information to S L and the secondary link that outputs information from S L. need to find it. For low speed calls, F L
Connection is possible if there is one free time slot of the same phase within the same phase, but a high-speed call cannot be connected unless there are multiple free time slots of the same phase (four in the example of Figure 6a). The internal call will be lost.
In FIG. 6b, there are three vacant time slots of the same phase, but high-speed calls that require four or more time slots within 1 FL will be lost. In this way, T L
In the S L -T L configuration, the internal call loss probability of high-speed calls is greater than that of low-speed calls, and the connection quality of both calls varies significantly.

さらに、高速呼のデータが各FL内の複数のタ
イムスロツトを用いて伝送されるが、交換機内で
タイムスロツトの位相変換を行う場合、高速呼の
データについては、タイムスロツトの順序を保持
しなければならないので制御が複雑になるという
問題点もある。
Furthermore, although high-speed call data is transmitted using multiple time slots in each FL , when time slot phase conversion is performed within the switch, the order of the time slots is maintained for the high-speed call data. There is also the problem that control becomes complicated because the

第7図は従来のTH−SH−TH構成の問題点を示
す図である。第7図において、ハイウエイ上の各
タイムスロツトTSのデータは高速フレームFH
位にスイツチングされる。この場合、複数(図に
おいては4個)の高速フレームFHで1低速フレ
ームFLが構成される。各高速フレームFHの同一
タイムスロツト(同一位相)には斜線で示す高速
呼のデータが挿入されている。高速フレームFH
単位でスイツチングされる場合、低速データが入
力される周期FL期間中に交換処理される呼数を
考えると、THの内容はFH周期で更新される為、
データAの情報は同じ内容をFL期間中にくり返
し交換処理されることになる。つまり、図に示す
低速呼データAと同一位相のタイムスロツトTS
1,TS2,TS3はデータAに占有されデータA
以外は使用できず、低速呼の呼量が多くなるにつ
れてFL期間中に処理可能な呼数が急激に少なく
なるという問題点がある。
FIG. 7 is a diagram showing problems with the conventional T H -S H -T H configuration. In FIG. 7, data in each time slot TS on the highway is switched in units of high-speed frames FH . In this case, one low-speed frame FL is composed of a plurality of (four in the figure) high-speed frames FH . High-speed call data indicated by diagonal lines is inserted into the same time slot (same phase) of each high-speed frame FH . High speed frame F H
When switching is performed in units, considering the number of calls that are switched during the F L period in which low-speed data is input, the contents of T H are updated in the F H period.
The same information on data A will be exchanged repeatedly during the FL period. In other words, the time slot TS has the same phase as the low-speed call data A shown in the figure.
1, TS2, TS3 are occupied by data A.
There is a problem in that as the volume of low-speed calls increases, the number of calls that can be processed during the FL period decreases rapidly.

〔問題点を解決するための手段〕[Means for solving problems]

第1図に本発明の原理ブロツク図を示す。同図
において、本発明による多元交換方式は低速呼
と、そのN倍の転送速度を要する高速呼とを対象
としており、高速フレームFH単位に動作するTH
−SH−TH構成の高速通話路の両端に、FHの時間
長のN倍のFL単位に動作するTLを設けてTL−TH
−SH−TH−TL構成の交換機としている。それぞ
れのスイツチは対応する制御メモリSCML
SCMH,HCML,SCMH,SCMLにより制御される
ようになつている。入力側のTLによつて、各FL
に含まれるFHのN倍の時間内にある低速呼の異
なるN個のタイムスロツトをFH長の間隔ごとに
周期的に存在するように位相変換する。
FIG. 1 shows a block diagram of the principle of the present invention. In the figure, the multiple switching system according to the present invention targets low-speed calls and high-speed calls that require N times the transfer speed, and T H operates in units of high-speed frames F H .
-S H -T H A high - speed communication path with T
The switch has a -S H -T H -T L configuration. Each switch has a corresponding control memory SCM L ,
It is designed to be controlled by SCM H , HCML , SCM H , and SCML . Depending on T L on the input side, each F L
N different time slots of the low-speed call within a time period N times F H included in the call are phase-converted so that they exist periodically at intervals of F H length.

TH−SH−TH構成の高速通話路によつて、対応
する制御メモリSCMH,HCMH,SCMHからの接
続要求に応じて高速フレームFH単位にタイムス
ロツトの位相交換を行う。出力側のTLによつて、
対応する制御メモリSCMLからの接続要求に応じ
てFL単位に低速呼のタイムスロツトを位相交換
する。
Using the high-speed communication path with the T H -S H -TH configuration, time slot phases are exchanged in units of high-speed frames F H in response to connection requests from the corresponding control memories SCM H , HC H , and SCM H . Depending on T L on the output side,
In response to a connection request from the corresponding control memory SCML , the phase of the time slot of the low-speed call is exchanged in units of FL .

〔作用〕[Effect]

TL−TH−SH−TH−TL構成の交換機としたこと
により、入力側のTLにて低速呼のデータをFL
位に同一位相上に位相交換して高速呼データと同
等に扱うことが可能となり高速フレーム中の1つ
のタイムスロツトを複数の異なる低速呼や1つの
高速呼で共用できる。
By using an exchange with T L −T H −S H −T H −T L configuration, low-speed call data is phase-switched on the same phase in units of F L at the input side T L and converted into high-speed call data. They can be treated equally, and one time slot in a high-speed frame can be shared by multiple different low-speed calls or one high-speed call.

〔実施例〕〔Example〕

第2図は本発明の実施例による多元交換方式を
示すブロツク図である。第2図において、
TDSWは本発明の実施例による多元時分割交換
機であり、空間スイツチSH3の入力側には2組の
時間スイツチTL1−TH2構成とTL4−TH5構成
とが接続されており、出力側には同じく2組の時
間スイツチTH6−TL7構成とTH8−TL9構成と
が接続されている。各時間スイツチTHおよび空
間スイツチSHは対応する制御メモリSCM,HCM
により制御される。制御メモリSCM,HCMは
SPバス10を介して制御装置(CC)11に接続
されている。制御装置(CC)11には加入者情
報を蓄積する共通メモリ12が接続されている。
FIG. 2 is a block diagram illustrating a multiple switching system according to an embodiment of the present invention. In Figure 2,
TDSW is a multidimensional time division switch according to an embodiment of the present invention, and two sets of time switches T L 1-T H 2 configuration and T L 4-T H 5 configuration are connected to the input side of the spatial switch S H 3. Similarly, two sets of time switches T H 6-T L 7 configuration and T H 8-T L 9 configuration are connected to the output side. Each time switch T H and space switch S H has a corresponding control memory SCM, HCM
controlled by Control memory SCM, HCM is
It is connected to a control device (CC) 11 via an SP bus 10. A common memory 12 for storing subscriber information is connected to the control device (CC) 11.

動画を扱う高速端末T1および低速端末T2か
らのデータは、集線スイツチLCSW1により時分
割多重化されてハイウエイHW1に送出される。
端末T2は高速フアクシミリ端末であつてもよ
い。同様に端末T3およびT4からのデータは集
線スイツチLCSW2により時分割多重化されてハ
イウエイHW2に送出される。低速端末としては
通常の電話端末やパソコン等がある。
Data from the high-speed terminal T1 and the low-speed terminal T2 that handle moving images are time-division multiplexed by the concentrator switch LCSW1 and sent to the highway HW1.
Terminal T2 may be a high speed facsimile terminal. Similarly, data from terminals T3 and T4 is time-division multiplexed by concentrator switch LCSW2 and sent to highway HW2. Examples of low-speed terminals include ordinary telephone terminals and personal computers.

空間スイツチSH3はTL1−TH2構成およびTL
4−TH5構成の時間スイツチの出力のいずれか
をTH6−TL7構成およびTH8−TL9構成の時間
スイツチの入力のいずれかに接続されるものであ
る。第2図に示した多元時分割交換機TDSWの
基本構成は第1図の原理ブロツク図と実質的に同
等なので、以下の動作説明では第1図の原理ブロ
ツク図について行なう。
Spatial switch S H 3 has T L 1-T H 2 configuration and T L
One of the outputs of the time switch having the 4-T H 5 configuration is connected to any of the inputs of the time switch having the TH 6-T L 7 configuration and the T H 8-T L 9 configuration. The basic configuration of the multi-dimensional time division switch TDSW shown in FIG. 2 is substantially the same as the principle block diagram of FIG. 1, so the following explanation of the operation will be based on the principle block diagram of FIG. 1.

第3図は本発明の一実施例の説明のためのタイ
ムチヤートである。第3図aは第1図に示した入
力ハイウエイHWi上のフレームフオーマツト、
第3図bは入力側TLの出力データ(1次)のフ
レームフオーマツト、第3図cは入力側THの出
力側THの出力データ(2次)のフレームフオー
マツト、第3図dはSHの出力データ(3次)のフ
レームフオーマツト、第3図eは出力側THの出
力データ(4次)のフレームフオーマツト、第3
図fは出力側TLの出力データのフレームフオー
マツトをそれぞれ示す。
FIG. 3 is a time chart for explaining one embodiment of the present invention. Figure 3a shows the frame format on the input highway HWi shown in Figure 1,
Fig. 3b shows the frame format of the output data (primary) of the input side TL , Fig. 3c shows the frame format of the output data (secondary) of the output side TH of the input side TH , Fig. 3 d is the frame format of the output data (3rd order) of S H , Figure 3 e is the frame format of the output data (4th order) of the output side T H ,
Figure f shows the frame format of the output data on the output side T L , respectively.

FHの時間長のN倍(Nは正の整数)がFLとな
つている。
F L is N times the time length of F H (N is a positive integer).

第3図aに示すように、入力ハイウエイHWi
上で、高速呼は斜線のタイムスロツトで示す如
く、FH単位に周期的に同一位相上に現われ、低
速呼はA〜Dで示す如く、FL単位に周期的に同
一位相上に現われる。すなわち、低速呼のデータ
A〜Dの各々はFL内の任意の1タイムスロツト
を用いて伝送され、連続するFL内の同一タイム
スロツト上に現われる。
As shown in Figure 3a, the input highway HWi
In the above, high-speed calls appear on the same phase periodically in F H units, as shown by the diagonally shaded time slots, and low-speed calls appear on the same phase periodically in F L units, as shown by A to D. That is, each of the low-speed call data A to D is transmitted using any one time slot in FL , and appears on the same time slot in consecutive FL .

第3図bに示す如く、入力側のTLによつて、
これらの低速呼のデータはFH内の同一位相上に
存在するように位相交換される。図においては、
低速呼のデータA〜Dは異なるFH内で同一位相
上に配置されている。低速呼のデータがN個(図
においては4個)より多い場合は、異なるFH
の他の空いているタイムスロツトに位相交換すれ
ばよい。こうして、1つのFL内におけるすべて
のFHの同一位相上に異なる低速呼データを配置
することができる。
As shown in Figure 3b, by T L on the input side,
The data of these low speed calls are phase swapped so that they are on the same phase within FH . In the figure,
Low-speed call data A to D are arranged on the same phase within different FHs . If there are more than N pieces of low-speed call data (four pieces in the figure), the phase can be exchanged to another vacant time slot in a different FH . In this way, different low-speed call data can be placed on the same phase of all FHs within one FL .

次いで、第3図c〜eに示す如く、低速呼のデ
ータの存在を意識することなく、通常の高速呼の
スイツチングがFH単位で行われる。すなわち、
2次リンクのFHの同一タイムスロツトが、ある
FHでは低速呼データA用に、次のFHでは低速呼
データB用に、更に次のFHではC用に、といつ
た具合に共用されることになる。こうして、対応
する制御メモリSCMH,HCMH,SCMHからの接
続要求に応じて高速呼のスイツチングが行われ、
例えば第3図eに示す如く、低速呼のデータA〜
DはFHの最後のタイムスロツトに、高速呼のデ
ータはFHの先頭タイムスロツトに配置される。
Next, as shown in FIGS. 3c to 3e, normal high-speed call switching is performed in units of FH without being aware of the existence of low-speed call data. That is,
There is an identical time slot of F H of the secondary link.
FH is used for low-speed call data A, the next FH is used for low-speed call data B, the next FH is used for C, and so on. In this way, high-speed call switching is performed in response to connection requests from the corresponding control memories SCM H , HCM H , and SCM H.
For example, as shown in Figure 3e, low-speed call data A~
D is placed in the last time slot of FH , and high-speed call data is placed in the first time slot of FH .

次いで、出力側TLによつて、対応する制御メ
モリSCMLからの接続要求に応じて、低速フレー
ムFL単位に低速呼のタイムスロツトを位相交換
し、例えば第3図fに示す如く、低速呼の各デー
タを要求されたタイムスロツト上に配置させる。
Next, the output side T L exchanges the phase of the time slot of the low-speed call in units of low-speed frames F L in response to the connection request from the corresponding control memory SCML, and, for example, as shown in FIG. Place each piece of data in the call on the requested time slot.

第4図は本発明の一実施例の効果を示す図であ
る。第4図において、FH間に高速呼が16多重さ
れるTH−SH−TH構成に、FL間に低速呼が256多重
されるTLを増設した場合の実施例で扱える呼量
を低速呼換算で示してある。この場合、高速呼と
低速呼の速度比NはN=16である。図から明らか
なように、本実施例ではFL内における低速呼の
全タイムスロツトに対する呼量比が増大しても処
理呼量は256と一定であるが、従来例の如くTL
増設しない場合には低速呼の呼量比が大きくなる
につれて扱える呼量は低下する。従つて、TL
増設したことによる効果は極めて大である。
FIG. 4 is a diagram showing the effect of one embodiment of the present invention. In Fig. 4, the number of calls that can be handled in the example is when TL, in which 256 low-speed calls are multiplexed between F L , is added to the T H - S H - T H configuration, in which 16 high-speed calls are multiplexed between F H. The amounts are shown in slow call terms. In this case, the speed ratio N between the high speed call and the low speed call is N=16. As is clear from the figure, in this embodiment, even if the call volume ratio of low-speed calls to all time slots within FL increases, the processing call volume remains constant at 256, but unlike the conventional example, no additional T L is added. In this case, as the traffic ratio of low-speed calls increases, the amount of calls that can be handled decreases. Therefore, the effect of adding T L is extremely large.

以上の説明ではFLを固定長としたが、制御メ
モリSCMLによつてFLを可変にしても本発明の範
囲に含まれる。この場合、第2図に示した制御装
置(CC)1は共通メモリ2に蓄積されている。
加入者数等の交換機の負荷の状況に応じてSCML
を制御することにより、FL時間長をFL=FH×n
(n=2、4、…、N)と可変制御する。これに
より低速呼を可変速度として処理することが可能
になる。
In the above description, F L is assumed to have a fixed length, but it is within the scope of the present invention even if F L is made variable by the control memory SCML . In this case, the control device (CC) 1 shown in FIG. 2 is stored in a common memory 2.
SCM L depending on the load situation of the exchange, such as the number of subscribers.
By controlling F L time length, F L =F H ×n
(n=2, 4, . . . , N). This allows low speed calls to be handled as variable speeds.

例えば、交換機の負荷が軽いときは、第5図a
に示すように、bを小さくして(図においてはn
=2)低速呼の速度を高速呼の速度とほぼ同じに
して交換動作を行わせる。また、交換機の負荷が
重い時は、第5図bに示すように、nを大きくし
て(図においてはn=6)低速呼の多重度を上げ
てより多くの呼を処理できるようにする。
For example, when the load on the exchange is light,
As shown in the figure, b is made smaller (in the figure, n
=2) Make the speed of low-speed calls almost the same as the speed of high-speed calls and perform the switching operation. Also, when the load on the exchange is heavy, as shown in Figure 5b, increase n (n = 6 in the figure) to increase the multiplicity of low-speed calls so that more calls can be processed. .

〔発明の効果〕〔Effect of the invention〕

以上の説明から明らかなように、本発明によれ
ば、TH−SH−TH構成の高速通話路の両端にTL
増設したことにより、多元時分割交換方式におい
て、制御の複雑化をもたらすことなく呼損率の低
下を実現でき、かつ低速呼の呼数が増大しても処
理可能な呼数が減少することはなくなる。更に交
換機の負荷の状況に応じて低速フレーム長を可変
にできるので、低速呼と高速呼を効率よくスイツ
チングできる。
As is clear from the above description, according to the present invention, by adding T L at both ends of the high-speed communication path with the T H - S H - T H configuration, control becomes complicated in the multi-source time division switching system. It is possible to reduce the call loss rate without causing any problems, and even if the number of low-speed calls increases, the number of calls that can be processed does not decrease. Furthermore, since the low-speed frame length can be made variable depending on the load condition of the exchange, it is possible to efficiently switch between low-speed calls and high-speed calls.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の原理ブロツク図、第2図は本
発明の一実施例による多元交換方式を示すブロツ
ク図、第3図は本発明の一実施例の説明のための
タイムチヤート、第4図は本発明の一実施例の効
果を示す図、第5図は本発明の他の実施例の説明
のためのタイムチヤート、そして第6図および第
7図は従来の構成の問題点を説明するための図で
ある。 FL……低速フレーム、FH……高速フレーム、
TH……高速時間スイツチ、SH……高速空間スイ
ツチ、TL……低速時間スイツチ、TDSW……多
元時分割交換機。
FIG. 1 is a block diagram of the principle of the present invention, FIG. 2 is a block diagram showing a multiple exchange system according to an embodiment of the present invention, FIG. 3 is a time chart for explaining an embodiment of the present invention, and FIG. The figure shows the effects of one embodiment of the present invention, Figure 5 is a time chart for explaining another embodiment of the present invention, and Figures 6 and 7 explain problems with the conventional configuration. This is a diagram for F L ...Low speed frame, F H ...High speed frame,
T H ...Fast time switch, S H ...Fast space switch, T L ...Slow time switch, TDSW...Multi-dimensional time division switch.

Claims (1)

【特許請求の範囲】 1 低速呼と、そのN倍の転送速度を要する高速
呼とを対象とし、高速呼フレーム単位に動作する
高速時間スイツチ−高速空間スイツチ−高速時間
スイツチ構成の高速通話路に、該高速フレームの
時間長のN倍の低速フレーム単位に動作する低速
時間スイツチを該高速通話路の両端に設けて低速
時間スイツチ−高速時間スイツチ−高速空間スイ
ツチ−高速時間スイツチ−低速時間スイツチ構成
の交換機とし、 各スイツチは対応する制御メモリにより制御さ
れるようになつており、入力側の低速時間スイツ
チによつて、各低速フレームに含まれる高速フレ
ームのN倍の時間内にある低速呼の異なるN個の
タイムスロツトを高速フレーム長の間隔ごとに周
期的に存在するように位相変換し 該高速通話によつて、対応する制御メモリから
の接続要求に応じて高速フレーム単位にタイムス
ロツトの位相変換を行い、 出力側の低速時間スイツチによつて、対応する
制御メモリからの接続要求に応じて低速フレーム
単位に低速呼のタイムスロツトを位相変換するこ
とを特徴とする多元交換方式。 2 前記低速時間スイツチに対応する制御メモリ
は、前記低速フレームの時間長を前記交換機の負
荷に応じて可変にする手段を具備する特許請求の
範囲第1項記載の多元交換方式。
[Claims] 1. A high-speed communication path with a high-speed time switch-high-speed spatial switch-high speed time switch configuration that operates in units of high-speed call frames, targeting low-speed calls and high-speed calls that require N times the transfer speed. , low-speed time switches that operate in units of low-speed frames with a time length N times the time length of the high-speed frame are provided at both ends of the high-speed communication path to form a low-speed time switch, a high-speed time switch, a high-speed space switch, a high-speed time switch, and a low-speed time switch. Each switch is controlled by a corresponding control memory, and a low-speed time switch on the input side determines whether the low-speed calls within a time period N times the high-speed frame included in each low-speed frame are controlled by the corresponding control memory. The phase of N different time slots is changed so that they exist periodically at intervals of high-speed frame length, and the phase of the time slots is changed in high-speed frame units according to the connection request from the corresponding control memory by the high-speed call. A multiple switching method characterized by converting the time slot of a low-speed call in units of low-speed frames in response to a connection request from the corresponding control memory using a low-speed time switch on the output side. 2. The multiple switching system according to claim 1, wherein the control memory corresponding to the low-speed time switch includes means for making the time length of the low-speed frame variable in accordance with the load of the exchange.
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