JPH07101973B2 - 電圧変動抑制装置 - Google Patents
電圧変動抑制装置Info
- Publication number
- JPH07101973B2 JPH07101973B2 JP58059582A JP5958283A JPH07101973B2 JP H07101973 B2 JPH07101973 B2 JP H07101973B2 JP 58059582 A JP58059582 A JP 58059582A JP 5958283 A JP5958283 A JP 5958283A JP H07101973 B2 JPH07101973 B2 JP H07101973B2
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- 230000001629 suppression Effects 0.000 title description 2
- 238000010586 diagram Methods 0.000 description 4
- 239000003990 capacitor Substances 0.000 description 3
- 238000001514 detection method Methods 0.000 description 3
- 238000009434 installation Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000002452 interceptive effect Effects 0.000 description 1
Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02E—REDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
- Y02E40/00—Technologies for an efficient electrical power generation, transmission or distribution
- Y02E40/30—Reactive power compensation
-
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- Y02E40/00—Technologies for an efficient electrical power generation, transmission or distribution
- Y02E40/50—Arrangements for eliminating or reducing asymmetry in polyphase networks
Landscapes
- Supply And Distribution Of Alternating Current (AREA)
- Control Of Electrical Variables (AREA)
Description
【発明の詳細な説明】 〔技術分野〕 本発明は電力系統の母線電圧が不平衡かつ急峻に変動し
ている場合にも母線電圧変動抑制のできる、サイリスタ
制御リアクトルと並列コンデンサよりなる電圧変動抑制
装置に関する。
ている場合にも母線電圧変動抑制のできる、サイリスタ
制御リアクトルと並列コンデンサよりなる電圧変動抑制
装置に関する。
第１図に電圧変動抑制装置の一例を示す。図において４
は直列リアクトルであり、５はサイリスタスイッチであ
り、直列リアクトル４とサイリスタスイッチ５は直列に
接続され、これに並列にコンデンサ６が接続される。
は直列リアクトルであり、５はサイリスタスイッチであ
り、直列リアクトル４とサイリスタスイッチ５は直列に
接続され、これに並列にコンデンサ６が接続される。
１は無限大母線を示し、２は電源インピーダンスを示
し、３は設置母線を示す。設置母線３に対し、PT7およ
び前記PT7の出力信号をうけるサイリスタ制御装置８が
接続される。81は電圧検出器であり、その出力は減算器
82において、基準電圧Vrefと比較され、信号△Vu−ｖは
調節器83に入力され、パルス発生器84より点弧制御パル
スを発生し、サイリスタスイッチ５を制御し、直列リア
クトル４の通電制御を行って消費無効電力を調節し、電
圧変動を抑制する。
し、３は設置母線を示す。設置母線３に対し、PT7およ
び前記PT7の出力信号をうけるサイリスタ制御装置８が
接続される。81は電圧検出器であり、その出力は減算器
82において、基準電圧Vrefと比較され、信号△Vu−ｖは
調節器83に入力され、パルス発生器84より点弧制御パル
スを発生し、サイリスタスイッチ５を制御し、直列リア
クトル４の通電制御を行って消費無効電力を調節し、電
圧変動を抑制する。
このようにサイリスタスイッチで制御される直列リアク
トル回路は、詳細には第２図のような３相構成となって
おり、実際には前記第１図の電圧検出器81は母線３の線
間電圧を検出し、各相のリアクトルを制御し、各相の線
間電圧を一定とするように制御している。
トル回路は、詳細には第２図のような３相構成となって
おり、実際には前記第１図の電圧検出器81は母線３の線
間電圧を検出し、各相のリアクトルを制御し、各相の線
間電圧を一定とするように制御している。
しかし、不平衡負荷による電圧変化は、関係のない他の
相にも影響し、各線間電圧の変化を検出しただけでは次
のような問題がある。
相にも影響し、各線間電圧の変化を検出しただけでは次
のような問題がある。
第３図Ａは無限大母線電圧系統に単相のリアクトルXLが
負荷された場合の回路図を示す。ただし系統の電源イン
ピーダンスの抵抗分は無視している。このときの各相電
圧の関係を同Ｂ図に示す。電圧検出器81では線間電圧を
検出しており、ｕ−ｖ間ではVsu−ｖからVu−ｖまで変
動することになり、ｖ−w,w−ｕ間についても同様に変
化する。
負荷された場合の回路図を示す。ただし系統の電源イン
ピーダンスの抵抗分は無視している。このときの各相電
圧の関係を同Ｂ図に示す。電圧検出器81では線間電圧を
検出しており、ｕ−ｖ間ではVsu−ｖからVu−ｖまで変
動することになり、ｖ−w,w−ｕ間についても同様に変
化する。
ところが、このような単相リアクトル負荷が突発的に生
じ、それによる変動を可及的すみやかに抑制する場合を
考えると、ｕ−ｖ間,v−ｗ間、ｗ−ｕ間ともに電圧が降
下しているため、各相制御回路はリアクトル電流をしぼ
り込み、電圧を上昇させようと機能する。現実にはｕ−
ｖ間リアクトルのみ動作すればよいところが、各相全て
動作し、互に干渉しながら変動抑制することになるた
め、目標値に到達するには時間がかかってしまう。
じ、それによる変動を可及的すみやかに抑制する場合を
考えると、ｕ−ｖ間,v−ｗ間、ｗ−ｕ間ともに電圧が降
下しているため、各相制御回路はリアクトル電流をしぼ
り込み、電圧を上昇させようと機能する。現実にはｕ−
ｖ間リアクトルのみ動作すればよいところが、各相全て
動作し、互に干渉しながら変動抑制することになるた
め、目標値に到達するには時間がかかってしまう。
もちろん従来の回路構成によっても最終的には変動を抑
制した状態に落着くのであるが、突発的な変動に対して
速応することは困難である。
制した状態に落着くのであるが、突発的な変動に対して
速応することは困難である。
本発明は前記突発的に不平衡且つ急峻に負荷が変動した
場合に速応して電圧変動を抑制できるように、不平衡負
荷による電圧の不平衡を検出し、消費する無効電力を変
化させて不平衡を抑制する回路において、一つの線間電
圧変動を形成する２つの相電圧変動の和に、残る一つの
相電圧変動の差をとった値を、対応する線間の制御信号
とし、各相間で互に干渉を受けずに独立に電圧変動抑制
のできる情報に変換し、各線間無効電力の制御に利用す
ることのできる不平衡電圧検出装置を備える電圧変動抑
制装置にある。
場合に速応して電圧変動を抑制できるように、不平衡負
荷による電圧の不平衡を検出し、消費する無効電力を変
化させて不平衡を抑制する回路において、一つの線間電
圧変動を形成する２つの相電圧変動の和に、残る一つの
相電圧変動の差をとった値を、対応する線間の制御信号
とし、各相間で互に干渉を受けずに独立に電圧変動抑制
のできる情報に変換し、各線間無効電力の制御に利用す
ることのできる不平衡電圧検出装置を備える電圧変動抑
制装置にある。
以下、本発明において使用されるサイリスタ制御装置を
第４図により説明する。
第４図により説明する。
まず母線３より、PTにて各相電圧を計測し、各電圧検出
器81にて直流に変換し、Vu,Vv,Vwを得る。
器81にて直流に変換し、Vu,Vv,Vwを得る。
次に設定値Vrefと減算器82において比較し、各相電圧変
動△Vu,△Vv,△Vwを求め、次の（１）式で示すように各
加減算器85に入力して演算を行う。
動△Vu,△Vv,△Vwを求め、次の（１）式で示すように各
加減算器85に入力して演算を行う。
このΔVU−v,ΔVV−w,ΔVW−ｕは、それぞれ電圧変動の
和をとった相の線間の無効電力の制御信号として第１図
のそれぞれの調節器83から入力して、サイリスタスイッ
チ５を制御し、各リアクトル４の通電電流を個々に制御
し、消費無効電力を制御する。
和をとった相の線間の無効電力の制御信号として第１図
のそれぞれの調節器83から入力して、サイリスタスイッ
チ５を制御し、各リアクトル４の通電電流を個々に制御
し、消費無効電力を制御する。
上記（１）式は３相不平衡時における各相間における干
渉分を除去した変動検出値に当るから、後述のようにこ
の検出値により、各相相互干渉せず、各相独立に目標値
に到達させるものであり、極めて迅速に目標値に到達さ
せることができる。
渉分を除去した変動検出値に当るから、後述のようにこ
の検出値により、各相相互干渉せず、各相独立に目標値
に到達させるものであり、極めて迅速に目標値に到達さ
せることができる。
第３図の例について考察してみると、 △Vw＝０ ただし|Vs|＝|Vsu|＝|Vsv|＝|Vsw| 従って すなわち、ｕ−ｖ間にのみ電圧変動が検出され、ｖ−ｗ
間,w−ｕ間には電圧変動は検出されない。この信号によ
り、ｕ−ｖ間のみ電圧を上昇させるように、リアクトル
に制御が加えられ、ｖ−w,w−ｕ間リアクトルには制御
動作を必要としないことになり、単相負荷に対して、他
相からの干渉を受けず、適確かつ高速の制御を行うこと
ができる。以上は変動負荷が単相のリアクトルの例で述
べたが、いかなる不平衡負荷においても、同様の対応が
できることはいうまでもない。
間,w−ｕ間には電圧変動は検出されない。この信号によ
り、ｕ−ｖ間のみ電圧を上昇させるように、リアクトル
に制御が加えられ、ｖ−w,w−ｕ間リアクトルには制御
動作を必要としないことになり、単相負荷に対して、他
相からの干渉を受けず、適確かつ高速の制御を行うこと
ができる。以上は変動負荷が単相のリアクトルの例で述
べたが、いかなる不平衡負荷においても、同様の対応が
できることはいうまでもない。
もし電圧変動を発生させている負荷の電流が計測できる
ならば、負荷の無効電力を検出し、その出力信号を第１
図の調節器83の出力に加算してリアクトルを制御すれ
ば、上記無効電力検出制御の残留電圧変動分が本発明の
制御系で修正されるような方向に動く。
ならば、負荷の無効電力を検出し、その出力信号を第１
図の調節器83の出力に加算してリアクトルを制御すれ
ば、上記無効電力検出制御の残留電圧変動分が本発明の
制御系で修正されるような方向に動く。
以上説明したように、突発的に生じた電圧変動を迅速に
抑制することができる。
抑制することができる。
第１図は本発明が適用される電圧抑制装置の一例を示
す。 第２図は直列リアクトルとサイリスタスイッチによる無
効電流回路の詳細図である。 第３図Ａは単相負荷が接続された場合の回路説明図であ
り、同Ｂは前記の負荷接続があった場合の各相、各相間
の電圧関係の説明図である。 第４図は本発明に使用されるサイリスタ制御装置の例を
示す。 １……無限大母線、２……電源インピーダンス、３……
母線、４……直列リアクトル、５……サイリスタスイッ
チ、６……並列コンデンサ、７……PT、８……制御装
置、81……電圧検出器、82……減算器、83……調節器、
84……パルス発生器、85……加減算器。
す。 第２図は直列リアクトルとサイリスタスイッチによる無
効電流回路の詳細図である。 第３図Ａは単相負荷が接続された場合の回路説明図であ
り、同Ｂは前記の負荷接続があった場合の各相、各相間
の電圧関係の説明図である。 第４図は本発明に使用されるサイリスタ制御装置の例を
示す。 １……無限大母線、２……電源インピーダンス、３……
母線、４……直列リアクトル、５……サイリスタスイッ
チ、６……並列コンデンサ、７……PT、８……制御装
置、81……電圧検出器、82……減算器、83……調節器、
84……パルス発生器、85……加減算器。
Claims (1)
- 【請求項１】不平衡負荷による電圧の不平衡を検出し、
消費する無効電力を変化させて、前記不平衡を制御する
回路において、一つの線間電圧の変動を形成する２つの
相電圧変動の和に、残る一つの相電圧変動の差をとった
値を前記和をとった相の線間の無効電力の制御信号とし
て用いることを特徴とする電圧変動抑制装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58059582A JPH07101973B2 (ja) | 1983-04-04 | 1983-04-04 | 電圧変動抑制装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58059582A JPH07101973B2 (ja) | 1983-04-04 | 1983-04-04 | 電圧変動抑制装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59185124A JPS59185124A (ja) | 1984-10-20 |
| JPH07101973B2 true JPH07101973B2 (ja) | 1995-11-01 |
Family
ID=13117358
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58059582A Expired - Lifetime JPH07101973B2 (ja) | 1983-04-04 | 1983-04-04 | 電圧変動抑制装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07101973B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5532104A (en) * | 1978-08-29 | 1980-03-06 | Toshiba Corp | Method and apparatus for speed control in intermittent load operation |
-
1983
- 1983-04-04 JP JP58059582A patent/JPH07101973B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59185124A (ja) | 1984-10-20 |
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