JPH0727144B2 - 液晶表示パネル用電極基板の製造方法 - Google Patents
液晶表示パネル用電極基板の製造方法Info
- Publication number
- JPH0727144B2 JPH0727144B2 JP29495187A JP29495187A JPH0727144B2 JP H0727144 B2 JPH0727144 B2 JP H0727144B2 JP 29495187 A JP29495187 A JP 29495187A JP 29495187 A JP29495187 A JP 29495187A JP H0727144 B2 JPH0727144 B2 JP H0727144B2
- Authority
- JP
- Japan
- Prior art keywords
- film
- insulating film
- insulating
- liquid crystal
- resist
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 239000000758 substrate Substances 0.000 title claims description 18
- 239000004973 liquid crystal related substance Substances 0.000 title claims description 16
- 238000004519 manufacturing process Methods 0.000 title claims description 12
- 238000000034 method Methods 0.000 title description 13
- 229910052751 metal Inorganic materials 0.000 claims description 32
- 239000002184 metal Substances 0.000 claims description 32
- 238000000059 patterning Methods 0.000 claims description 11
- 239000010408 film Substances 0.000 description 157
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 18
- 229910052581 Si3N4 Inorganic materials 0.000 description 17
- 229910021417 amorphous silicon Inorganic materials 0.000 description 14
- 229910004298 SiO 2 Inorganic materials 0.000 description 12
- 239000010409 thin film Substances 0.000 description 9
- 238000005530 etching Methods 0.000 description 6
- 239000000463 material Substances 0.000 description 6
- 239000011651 chromium Substances 0.000 description 5
- 238000002161 passivation Methods 0.000 description 4
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 3
- 229910052804 chromium Inorganic materials 0.000 description 3
- 230000007547 defect Effects 0.000 description 3
- 229910052814 silicon oxide Inorganic materials 0.000 description 3
- 239000010936 titanium Substances 0.000 description 3
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 description 2
- NBIIXXVUZAFLBC-UHFFFAOYSA-N Phosphoric acid Chemical compound OP(O)(O)=O NBIIXXVUZAFLBC-UHFFFAOYSA-N 0.000 description 2
- 229910006404 SnO 2 Inorganic materials 0.000 description 2
- 239000011521 glass Substances 0.000 description 2
- 239000010931 gold Substances 0.000 description 2
- 239000011159 matrix material Substances 0.000 description 2
- 229910052719 titanium Inorganic materials 0.000 description 2
- PXGOKWXKJXAPGV-UHFFFAOYSA-N Fluorine Chemical compound FF PXGOKWXKJXAPGV-UHFFFAOYSA-N 0.000 description 1
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- 229910000147 aluminium phosphate Inorganic materials 0.000 description 1
- 238000005336 cracking Methods 0.000 description 1
- 229910021419 crystalline silicon Inorganic materials 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000011737 fluorine Substances 0.000 description 1
- 229910052731 fluorine Inorganic materials 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- AMGQUBHHOARCQH-UHFFFAOYSA-N indium;oxotin Chemical compound [In].[Sn]=O AMGQUBHHOARCQH-UHFFFAOYSA-N 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 238000010030 laminating Methods 0.000 description 1
- 229910052750 molybdenum Inorganic materials 0.000 description 1
- 239000011733 molybdenum Substances 0.000 description 1
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 1
- 239000012495 reaction gas Substances 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- XOLBLPGZBRYERU-UHFFFAOYSA-N tin dioxide Chemical compound O=[Sn]=O XOLBLPGZBRYERU-UHFFFAOYSA-N 0.000 description 1
- 229910001887 tin oxide Inorganic materials 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
Landscapes
- Liquid Crystal (AREA)
- Thin Film Transistor (AREA)
Description
【発明の詳細な説明】 (イ)産業上の利用分野 液晶表示パネル用電極基板の製造方法に関する。
(ロ)従来の技術 近年非晶質半導体材料、特にアモルフアス・シリコン
(以下a−Siと略記する)膜等の非晶質材料は、その物
件上の特徴及びプラズマCVD法という形成法の利点をい
かしてこれまでの単結晶シリコン(c−Si)では実現不
可能であつた分野への応用を開拓している。特にa−Si
膜はプラズマ反応という形成法で成膜できるため、太陽
電池や大面積液晶TV用のスイッチング素子などに応用さ
れている。
(以下a−Siと略記する)膜等の非晶質材料は、その物
件上の特徴及びプラズマCVD法という形成法の利点をい
かしてこれまでの単結晶シリコン(c−Si)では実現不
可能であつた分野への応用を開拓している。特にa−Si
膜はプラズマ反応という形成法で成膜できるため、太陽
電池や大面積液晶TV用のスイッチング素子などに応用さ
れている。
アクテイブマトリクス型の液晶テレビへのa−SiTFTス
イッチング素子の応用は、プラズマ反応の大面積化の容
易さといつたメリットをいかしたものであるが、同時に
同反応法によつてTFTを構成するゲート絶縁膜やパッシ
ベーシヨン膜となる窒化シリコン(以下SiN)膜や酸化
シリコン(以下SiO2)膜を反応ガスを変えるだけで形成
できるという長所も利用している。
イッチング素子の応用は、プラズマ反応の大面積化の容
易さといつたメリットをいかしたものであるが、同時に
同反応法によつてTFTを構成するゲート絶縁膜やパッシ
ベーシヨン膜となる窒化シリコン(以下SiN)膜や酸化
シリコン(以下SiO2)膜を反応ガスを変えるだけで形成
できるという長所も利用している。
しかしながら、数ミクロン以下の薄膜は、膜厚およびそ
の形成条件によつて膜内に内部応力を潜在しやすい。こ
の内部応力を無視した場合、多層構造の薄膜を形成する
際に膜剥がれや膜割れが発生するなどの問題が生じる。
さらにこの内部応力は、TFTなどのアクテイブデバイス
の駆動特性にも影響を与える。また、膜剥がれなどは膜
中の応力のほかに下層薄膜の材料にも依存する。そのた
め多層構造の薄膜デイバイスでは、その内部応力を素子
設計の際に十分考慮に入れなければならない。
の形成条件によつて膜内に内部応力を潜在しやすい。こ
の内部応力を無視した場合、多層構造の薄膜を形成する
際に膜剥がれや膜割れが発生するなどの問題が生じる。
さらにこの内部応力は、TFTなどのアクテイブデバイス
の駆動特性にも影響を与える。また、膜剥がれなどは膜
中の応力のほかに下層薄膜の材料にも依存する。そのた
め多層構造の薄膜デイバイスでは、その内部応力を素子
設計の際に十分考慮に入れなければならない。
したがつて、例えば液晶テレビの表示電極に用いられる
導電性のITO膜のような多孔質の膜上に薄膜を形成する
際応力を比較的制御しやすい膜をあらかじめバッフア層
として形成した後に所望の薄膜を順次形成している。し
かしながらバッフア層として簡便に用いられる膜は少な
く、良好な絶縁性でかつ膜内応力を緩和しやすいものと
しては酸化シリコン(SiO2)膜に限られてしまう。また
Si3N4膜とSiO2膜の2層構造では、膜エッジにおいて応
力が緩和されLSI製造プロセスにおいても膜下地材料の
転位発生抑制に使用されている。この事はSiO2膜の粘性
に起因する応力緩和があるためである。
導電性のITO膜のような多孔質の膜上に薄膜を形成する
際応力を比較的制御しやすい膜をあらかじめバッフア層
として形成した後に所望の薄膜を順次形成している。し
かしながらバッフア層として簡便に用いられる膜は少な
く、良好な絶縁性でかつ膜内応力を緩和しやすいものと
しては酸化シリコン(SiO2)膜に限られてしまう。また
Si3N4膜とSiO2膜の2層構造では、膜エッジにおいて応
力が緩和されLSI製造プロセスにおいても膜下地材料の
転位発生抑制に使用されている。この事はSiO2膜の粘性
に起因する応力緩和があるためである。
従来の液晶パネル用電極基板に形成される画素電極と薄
膜トランジスタ(TFT)の素子断面図を第3図に示す。
同図に於いて素子形成はガラスなどの透光絶縁性基板
(1)上にクロム(Cr)膜などのゲート電極用金属膜
(10)を形成した後ITO膜やSnO2膜などの透明導電膜
(2)を形成、パターニングし次にSiO2膜(3)を被着
形成した後少なくとも前記透明伝導膜(2)をおおうよ
うにSiO2膜(3)をパターニングし、次にゲートSiN
(5)膜、a−Si膜(6)、パッシベーシヨン用SiN膜
(7)を順次積層形成する。パッシベーシヨン用SiN膜
(7)をパターニングし、その後n+a-Si膜(8)を全面
に形成した後n+a-Si膜(8)a−Si膜(6)を同一のレ
ジストパターンでエッチングする。次にゲートSiN膜
(5)を所望の位置にコンタクトホール用にエッチング
を行う。この際従来の素子構造ではSiN膜(5)とSiO2
膜(3)とが直接接触しているためSiN膜のエッチング
の際にSiO2膜が弗素(F)のエッチヤントによつてエッ
チングされてしまう。これは一般にSiO2膜(3)はSiN
膜(5)よりもエッチングレートが大きいためでありこ
のため図中Oのコンタクトホール位置のホールサイド部
分がオーバーエッチングされ空洞ができてしまう。即ち
SiN膜のエッチヤントとしては熱リン酸なども用いられ
るが条件制御が困難であることが多い。さらにSiN膜は
形成条件によつて膜質が微妙に変化しそのエッチンググ
レートにも変化が生じる。そのためSiO2膜とSiN膜との
2層構造の薄膜デバイスでは前述したようにSiO2膜形成
後に上層と下層とを電気的につなぐコンタクトホールを
形成するためにSiC2膜の形成後にコンタクトホールをパ
ターニングし次にSiN膜を形成し同じようにその後コン
タクトホールを形成していた。このため工程数が多くな
りホールの形状が変形してコンタクトの信頼性の低下を
招く惧れがあつた。
膜トランジスタ(TFT)の素子断面図を第3図に示す。
同図に於いて素子形成はガラスなどの透光絶縁性基板
(1)上にクロム(Cr)膜などのゲート電極用金属膜
(10)を形成した後ITO膜やSnO2膜などの透明導電膜
(2)を形成、パターニングし次にSiO2膜(3)を被着
形成した後少なくとも前記透明伝導膜(2)をおおうよ
うにSiO2膜(3)をパターニングし、次にゲートSiN
(5)膜、a−Si膜(6)、パッシベーシヨン用SiN膜
(7)を順次積層形成する。パッシベーシヨン用SiN膜
(7)をパターニングし、その後n+a-Si膜(8)を全面
に形成した後n+a-Si膜(8)a−Si膜(6)を同一のレ
ジストパターンでエッチングする。次にゲートSiN膜
(5)を所望の位置にコンタクトホール用にエッチング
を行う。この際従来の素子構造ではSiN膜(5)とSiO2
膜(3)とが直接接触しているためSiN膜のエッチング
の際にSiO2膜が弗素(F)のエッチヤントによつてエッ
チングされてしまう。これは一般にSiO2膜(3)はSiN
膜(5)よりもエッチングレートが大きいためでありこ
のため図中Oのコンタクトホール位置のホールサイド部
分がオーバーエッチングされ空洞ができてしまう。即ち
SiN膜のエッチヤントとしては熱リン酸なども用いられ
るが条件制御が困難であることが多い。さらにSiN膜は
形成条件によつて膜質が微妙に変化しそのエッチンググ
レートにも変化が生じる。そのためSiO2膜とSiN膜との
2層構造の薄膜デバイスでは前述したようにSiO2膜形成
後に上層と下層とを電気的につなぐコンタクトホールを
形成するためにSiC2膜の形成後にコンタクトホールをパ
ターニングし次にSiN膜を形成し同じようにその後コン
タクトホールを形成していた。このため工程数が多くな
りホールの形状が変形してコンタクトの信頼性の低下を
招く惧れがあつた。
(ハ)解決しようとする問題点 本発明は上述のような事情に鑑み、同系列のエッチヤン
トに対してエッチングレートの異なる複数の物質を積層
しても、夫々のパターニングが簡単に精度よく実現でき
る液晶表示パネル用電極基板の製造方法を提供するもの
である。
トに対してエッチングレートの異なる複数の物質を積層
しても、夫々のパターニングが簡単に精度よく実現でき
る液晶表示パネル用電極基板の製造方法を提供するもの
である。
(ニ)問題を解決するための手段 本発明の液晶表示パネル用電極基板の製造方法は、絶縁
性基板上に導電膜をパターン形成する第1工程と、前記
導電膜上にレジストを塗布した後パターニングして導電
膜上の特定位置にレジストを残存せしめる第2工程と、
前記導電膜上並びに前記レジスト上に第1の絶縁膜を形
成した後、該レジストを剥離することに因り、前記特定
位置の導電膜が露出する露出部を形成する第3工程と、
露出した該導電膜を覆うと共に、前記露出部周辺の前記
第1の絶縁膜の表面にまで延出するように、金属膜パッ
ドをパターン形成する第4工程と、前記金属膜パッド並
びに前記第1の絶縁膜の、表面を覆うように第2の絶縁
膜を形成した後、金属膜パッド上の第2の絶縁膜に、コ
ンタクトホールをパターン形成する第5工程と、前記第
2の絶縁膜に形成したコンタクトホールから露出した金
属膜パッドに配線用金属を接続する第6工程よりなるも
のであって、前記第1の絶縁膜は前記第2の絶縁膜と同
種のエッチヤントによってエッチングされる材料からな
ることを特徴とする。
性基板上に導電膜をパターン形成する第1工程と、前記
導電膜上にレジストを塗布した後パターニングして導電
膜上の特定位置にレジストを残存せしめる第2工程と、
前記導電膜上並びに前記レジスト上に第1の絶縁膜を形
成した後、該レジストを剥離することに因り、前記特定
位置の導電膜が露出する露出部を形成する第3工程と、
露出した該導電膜を覆うと共に、前記露出部周辺の前記
第1の絶縁膜の表面にまで延出するように、金属膜パッ
ドをパターン形成する第4工程と、前記金属膜パッド並
びに前記第1の絶縁膜の、表面を覆うように第2の絶縁
膜を形成した後、金属膜パッド上の第2の絶縁膜に、コ
ンタクトホールをパターン形成する第5工程と、前記第
2の絶縁膜に形成したコンタクトホールから露出した金
属膜パッドに配線用金属を接続する第6工程よりなるも
のであって、前記第1の絶縁膜は前記第2の絶縁膜と同
種のエッチヤントによってエッチングされる材料からな
ることを特徴とする。
(ホ)作用 本発明の液晶表示用電極基板の製造方法は、第1の絶縁
膜から導電膜を露出せしめるべく、レジストによるリフ
ト・オフ法により上記第1の絶縁膜に上記導電膜のため
の露出部を設けるものであることから、斯る導電膜の露
出部を精度良く形成することが可能になり、またその露
出部の導電膜を覆うと共に、該露出部周辺の第1絶縁膜
にまで延出するように、金属膜パッドをパターン形成す
ることに因り、後で形成する第2の絶縁膜にコンタクト
ホールを設けるためのエッチヤントとして、たとえ上記
第1の絶縁膜にも作用し得るエッチヤントを使用して
も、上記金属膜パッドにより上記エッチヤントが上記第
1の絶縁膜及び透明導電膜に浸透することがなく、第2
の絶縁膜に良好なコンタクトホールを形成することがで
き、然るに、コンタクトホールから露出した金属膜パッ
ドに良好な状態で配線用金属を接続することができるこ
ととなる。
膜から導電膜を露出せしめるべく、レジストによるリフ
ト・オフ法により上記第1の絶縁膜に上記導電膜のため
の露出部を設けるものであることから、斯る導電膜の露
出部を精度良く形成することが可能になり、またその露
出部の導電膜を覆うと共に、該露出部周辺の第1絶縁膜
にまで延出するように、金属膜パッドをパターン形成す
ることに因り、後で形成する第2の絶縁膜にコンタクト
ホールを設けるためのエッチヤントとして、たとえ上記
第1の絶縁膜にも作用し得るエッチヤントを使用して
も、上記金属膜パッドにより上記エッチヤントが上記第
1の絶縁膜及び透明導電膜に浸透することがなく、第2
の絶縁膜に良好なコンタクトホールを形成することがで
き、然るに、コンタクトホールから露出した金属膜パッ
ドに良好な状態で配線用金属を接続することができるこ
ととなる。
(ヘ)実施例 本発明の液晶表示ピネル用電極基板の製造方法を、薄膜
トランジスタ(TFT)に画素電極が結合したアクアイブ
マトリクス型の液晶表示パネルに採用した場合の一実施
例について第1図並びに第2図に示す。
トランジスタ(TFT)に画素電極が結合したアクアイブ
マトリクス型の液晶表示パネルに採用した場合の一実施
例について第1図並びに第2図に示す。
第1図(b)は一対のTFTと画素電極とからなる一画素
単位を示した電極基板平面図、同図(a)は同図(b)
のA−A′線断面図、第2図(a)乃至(g)は本発明
方法を示す工程断面図である。
単位を示した電極基板平面図、同図(a)は同図(b)
のA−A′線断面図、第2図(a)乃至(g)は本発明
方法を示す工程断面図である。
以下、第2図に基づき本発明方法を詳述する。
まず、ガラス等の透光絶縁性基板(1)上に酸化スズ
(SnO2)、酸化インジウムスズ(ITO)等の透明導電膜
(2)を例えば400Å〜1500Åの膜厚に被着形成しパタ
ーニングする〔同図(a)〕。
(SnO2)、酸化インジウムスズ(ITO)等の透明導電膜
(2)を例えば400Å〜1500Åの膜厚に被着形成しパタ
ーニングする〔同図(a)〕。
次にこの透明導電膜(2)と後工程〔同図(g)〕で設
けられる配線用金属(9)との接続位置にレジスト
(B)を例えば4000Å〜15000Åの膜厚にパターン形成
し、その後酸化シリコン(SiO2)等からなる応力緩和用
の第1の絶縁膜(3)を例えば150Å〜3000Åの膜厚に
形成する〔同図(b)〕。
けられる配線用金属(9)との接続位置にレジスト
(B)を例えば4000Å〜15000Åの膜厚にパターン形成
し、その後酸化シリコン(SiO2)等からなる応力緩和用
の第1の絶縁膜(3)を例えば150Å〜3000Åの膜厚に
形成する〔同図(b)〕。
次にレジスト(B)を所定の剥離液に浸せきすることに
より、前記接続位置の透明導電膜(2)を露出させ露出
部を形成する。そして、この露出部より露出した透明導
電膜(2)を覆うと共に、この露出部周辺の第1の絶縁
膜(3)にまで延出するように、クロム(Cr)、モリブ
デン(Mo)、チタン(Ti)、タングステン(W)膜等か
らなる金属膜パッド(4)をパターン形成する[同図
(c)]。
より、前記接続位置の透明導電膜(2)を露出させ露出
部を形成する。そして、この露出部より露出した透明導
電膜(2)を覆うと共に、この露出部周辺の第1の絶縁
膜(3)にまで延出するように、クロム(Cr)、モリブ
デン(Mo)、チタン(Ti)、タングステン(W)膜等か
らなる金属膜パッド(4)をパターン形成する[同図
(c)]。
その後Cr、Ti、金(Au)膜等からなるゲート電極用金属
膜(10)をパターン形成し〔同図(d)〕、さらに、窒
化シリコン(SiN)等からなる第2の絶縁膜(5)、ア
モルフアスシリコン(a−Si)膜(6)、SiN膜等より
なるパンシベーション膜(7)をそれぞれ例えば2000Å
〜5000Å、100Å〜2000Å、200Å〜3000Åの膜厚に順次
積層した後、前記パンシベーション膜(7)をTFT箇所
の所定位置にパターン形成する〔同図(e)〕。
膜(10)をパターン形成し〔同図(d)〕、さらに、窒
化シリコン(SiN)等からなる第2の絶縁膜(5)、ア
モルフアスシリコン(a−Si)膜(6)、SiN膜等より
なるパンシベーション膜(7)をそれぞれ例えば2000Å
〜5000Å、100Å〜2000Å、200Å〜3000Åの膜厚に順次
積層した後、前記パンシベーション膜(7)をTFT箇所
の所定位置にパターン形成する〔同図(e)〕。
次に燐ドープされたアモルフアスシリコン(n+a-Si)膜
(8)を100Å〜2000Åの膜厚に形成した後、n+a−Si膜
(8)、a−Si膜(6)、第2の絶縁膜(5)を順次パ
ターニングする。尚、前記第2の絶縁膜(5)は金属膜
パッド(4)並びに第1の絶縁膜(3)の表面を覆うよ
うに形成されており、またこの第2の絶縁膜(5)のエ
ッチングに於ては、前記金属膜パッド(4)上にコンタ
クトホール(P)をパターン形成する[同図(f)]。
(8)を100Å〜2000Åの膜厚に形成した後、n+a−Si膜
(8)、a−Si膜(6)、第2の絶縁膜(5)を順次パ
ターニングする。尚、前記第2の絶縁膜(5)は金属膜
パッド(4)並びに第1の絶縁膜(3)の表面を覆うよ
うに形成されており、またこの第2の絶縁膜(5)のエ
ッチングに於ては、前記金属膜パッド(4)上にコンタ
クトホール(P)をパターン形成する[同図(f)]。
その後配線用金属膜(9)をパターン形成してコンタク
トホール(P)から露出した金属膜パッド(4)と前記
配線用金属膜(9)を接続する〔同図(g)〕。
トホール(P)から露出した金属膜パッド(4)と前記
配線用金属膜(9)を接続する〔同図(g)〕。
上述の如き本発明実施例では第2図(b)の工程に於
て、第1の絶縁膜(3)をリフト・オフ法によりエッチ
ングをするので、エッチング部を精密に形成でき、これ
によつてその後の同図(d)の工程に於て該エッチング
部に形成する金属膜パッド(4)に穴、段差などの欠陥
の発生を抑制している。従つて、同図(f)の工程に於
て、該金属膜パッド(4)上の第2の絶縁膜(5)を第
1の絶縁膜(3)にも作用するエッチヤントで第2の絶
縁膜(5)をエッチングしても該エッチヤントにより、
第1の絶縁膜(3)や透明導電膜(2)が影響されるこ
とはない。
て、第1の絶縁膜(3)をリフト・オフ法によりエッチ
ングをするので、エッチング部を精密に形成でき、これ
によつてその後の同図(d)の工程に於て該エッチング
部に形成する金属膜パッド(4)に穴、段差などの欠陥
の発生を抑制している。従つて、同図(f)の工程に於
て、該金属膜パッド(4)上の第2の絶縁膜(5)を第
1の絶縁膜(3)にも作用するエッチヤントで第2の絶
縁膜(5)をエッチングしても該エッチヤントにより、
第1の絶縁膜(3)や透明導電膜(2)が影響されるこ
とはない。
即ち、本発明方法によれば、第2図(b)の工程で従来
第1の絶縁膜(3)をエッチヤントによりエッチングす
るとエッチング部に段差、不整等のエッチング不良が発
生し、その後同図(c)の工程で形成される金属膜
(4)に段差、穴等の欠陥が生じ、同図(f)の工程に
於て第2の絶縁膜(5)をエッチングした時にエッチヤ
ントが前記第1の絶縁膜(3)を浸食したり、透明導電
膜(2)に浸透したりして悪影響をおよぼすと云う従来
の不都合を解消できる事となる。
第1の絶縁膜(3)をエッチヤントによりエッチングす
るとエッチング部に段差、不整等のエッチング不良が発
生し、その後同図(c)の工程で形成される金属膜
(4)に段差、穴等の欠陥が生じ、同図(f)の工程に
於て第2の絶縁膜(5)をエッチングした時にエッチヤ
ントが前記第1の絶縁膜(3)を浸食したり、透明導電
膜(2)に浸透したりして悪影響をおよぼすと云う従来
の不都合を解消できる事となる。
尚、上記実施例に於いて、第1の絶縁膜(3)としてSi
O2膜を使用する場合にはレジストとしてシイプレ社の商
品名「AZ1350」を使用し、剥離液には同社の商品名〔J
−100〕を使用するとよい。
O2膜を使用する場合にはレジストとしてシイプレ社の商
品名「AZ1350」を使用し、剥離液には同社の商品名〔J
−100〕を使用するとよい。
(ト)発明の効果 本発明の液晶表示用電極基板の製造方法は、第1の絶縁
膜から導電膜を露出せしめるべく、レジストによるリフ
ト・オフ法により上記第1の絶縁膜に上記導電膜を露出
せしめるための露出部を設けるものであることから、斯
る導電膜に露出部を精度良く形成することが可能にな
り、またその露出部の導電膜を覆うと共に、該露出部周
辺の第1絶縁膜にまで延出するように、金属膜パッドを
パターン形成することに因り、後で形成する第2の絶縁
膜にコンタクトホールを設けるためのエッチヤントとし
て、たとえ上記第1の絶縁膜にも作用し得るエッチヤン
トを使用しても、上記金属膜パッドにより上記エッチヤ
ントが上記第1の絶縁膜及び透明導電膜に浸透すること
がなく、第2の絶縁膜に良好なコンタクトホールを形成
することができ、然るに、コンタクトホールから露出し
た金属膜パッドに良好な状態で配線用金属を接続するこ
とができることとなる。
膜から導電膜を露出せしめるべく、レジストによるリフ
ト・オフ法により上記第1の絶縁膜に上記導電膜を露出
せしめるための露出部を設けるものであることから、斯
る導電膜に露出部を精度良く形成することが可能にな
り、またその露出部の導電膜を覆うと共に、該露出部周
辺の第1絶縁膜にまで延出するように、金属膜パッドを
パターン形成することに因り、後で形成する第2の絶縁
膜にコンタクトホールを設けるためのエッチヤントとし
て、たとえ上記第1の絶縁膜にも作用し得るエッチヤン
トを使用しても、上記金属膜パッドにより上記エッチヤ
ントが上記第1の絶縁膜及び透明導電膜に浸透すること
がなく、第2の絶縁膜に良好なコンタクトホールを形成
することができ、然るに、コンタクトホールから露出し
た金属膜パッドに良好な状態で配線用金属を接続するこ
とができることとなる。
従って、本発明製造方法によれば、第1の絶縁膜と第2
の絶縁膜とが、同種のエッチヤントによってエッチング
される材料であっても、良好なパターンを形成すること
ができることとなり、エッチヤントの選択の自由度を増
すことができる。
の絶縁膜とが、同種のエッチヤントによってエッチング
される材料であっても、良好なパターンを形成すること
ができることとなり、エッチヤントの選択の自由度を増
すことができる。
第1図(a)及び(b)は本発明に係る液晶表示パネル
用電極基板の1画素分の断面図及び平面図、第2図
(a)乃至(g)は第1図の製造工程断面図、第3図は
従来の液晶表示パネル用電極基板の1画素分の構造断面
図である。 (1)……絶縁性基板、(2)……透明導電膜、(3)
……第1の絶縁膜、(4)……金属膜パッド、(5)…
…第2の絶縁膜、(9)……配線用金属膜、(B)……
レジスト、(P)……コンタクトホール。
用電極基板の1画素分の断面図及び平面図、第2図
(a)乃至(g)は第1図の製造工程断面図、第3図は
従来の液晶表示パネル用電極基板の1画素分の構造断面
図である。 (1)……絶縁性基板、(2)……透明導電膜、(3)
……第1の絶縁膜、(4)……金属膜パッド、(5)…
…第2の絶縁膜、(9)……配線用金属膜、(B)……
レジスト、(P)……コンタクトホール。
Claims (1)
- 【請求項1】絶縁性基板上に導電膜をパターン形成する
第1工程と、 前記導電膜上にレジストを塗布した後パターニングして
導電膜上の特定位置にレジストを残存せしめる第2工程
と、 前記導電膜上並びに前記レジスト上に第1の絶縁膜を形
成した後、該レジストを剥離することに因り、前記特定
位置の導電膜が露出する露出部を形成する第3工程と、 露出した該導電膜を覆うと共に、前記露出部周辺の前記
第1の絶縁膜の表面にまで延出するように、金属膜パッ
ドをパターン形成する第4工程と、 前記金属膜パッド並びに前記第1の絶縁膜の、表面を覆
うように第2の絶縁膜を形成した後、金属膜パッド上の
第2の絶縁膜に、コンタクトホールをパターン形成する
第5工程と、 前記第2の絶縁膜に形成したコンタクトホールから露出
した金属膜パッドに配線用金属を接続する第6工程より
なる液晶表示パネル用電極基板の製造方法であって、前
記第1の絶縁膜は前記第2の絶縁膜と同種のエッチヤン
トによってエッチングされる材料からなることを特徴と
する液晶表示パネル用電極基板の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29495187A JPH0727144B2 (ja) | 1987-11-20 | 1987-11-20 | 液晶表示パネル用電極基板の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29495187A JPH0727144B2 (ja) | 1987-11-20 | 1987-11-20 | 液晶表示パネル用電極基板の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01136124A JPH01136124A (ja) | 1989-05-29 |
| JPH0727144B2 true JPH0727144B2 (ja) | 1995-03-29 |
Family
ID=17814401
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29495187A Expired - Lifetime JPH0727144B2 (ja) | 1987-11-20 | 1987-11-20 | 液晶表示パネル用電極基板の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0727144B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2620240B2 (ja) | 1987-06-10 | 1997-06-11 | 株式会社日立製作所 | 液晶表示装置 |
| JPH06208132A (ja) * | 1990-03-24 | 1994-07-26 | Sony Corp | 液晶表示装置 |
| KR100560401B1 (ko) * | 2003-11-04 | 2006-03-14 | 엘지.필립스 엘시디 주식회사 | 수평 전계 인가형 박막 트랜지스터 기판 및 그 제조 방법 |
-
1987
- 1987-11-20 JP JP29495187A patent/JPH0727144B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01136124A (ja) | 1989-05-29 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| KR19990023185A (ko) | 게이트 구조 및 그의 제조 방법, 박막 트랜지스터 구조 및 그의 제조 방법, 인버티드 트랜지스터 구조 | |
| JPH055898A (ja) | 薄膜素子形成パネル | |
| GB2185622A (en) | Thin film transistor array | |
| JP3053848B2 (ja) | アクティブマトリクス基板 | |
| KR950008931B1 (ko) | 표시패널의 제조방법 | |
| JPH1117188A (ja) | アクティブマトリクス基板 | |
| JP3239504B2 (ja) | 薄膜トランジスタマトリクスの製造方法 | |
| JP4166300B2 (ja) | 液晶表示装置の製造方法 | |
| JPH04253342A (ja) | 薄膜トランジスタアレイ基板 | |
| JPH0580650B2 (ja) | ||
| JPH0727144B2 (ja) | 液晶表示パネル用電極基板の製造方法 | |
| JP2594114B2 (ja) | 液晶表示パネル用電極基板の製造方法 | |
| JP2990815B2 (ja) | 液晶表示装置及びその製造方法 | |
| JPH0815733A (ja) | 薄膜トランジスタパネルとその製造方法 | |
| JPH06332008A (ja) | アクティブマトリクス基板とその製造方法 | |
| JP3287070B2 (ja) | 液晶表示パネルと配線パターンの修復方法 | |
| JP3200638B2 (ja) | 配線形成方法 | |
| JPH0651350A (ja) | 表示装置 | |
| JP3151209B2 (ja) | マトリクス型表示装置の製造方法 | |
| US5523187A (en) | Method for the fabrication of liquid crystal display device | |
| JPH0685255A (ja) | 薄膜トランジスタ及びその製造方法 | |
| JP2770807B2 (ja) | 端子構造 | |
| JP2002314088A (ja) | 薄膜トランジスタアレイ基板の製造方法及び当該方法により製造された薄膜トランジスタアレイ基板を用いた液晶表示装置 | |
| JPH069220B2 (ja) | 多層配線 | |
| JPH04313266A (ja) | 薄膜半導体装置 |