JPH0773615B2 - Exercise form checker - Google Patents
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- Video Image Reproduction Devices For Color Tv Systems (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明はあらゆるスポーツの競技者自身がそのプレイ
直後に運動フォームをチェックすることが可能な運動フ
ォームチェッカに関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to an exercise form checker that allows an athlete of any sport to check the exercise form immediately after playing.
各種スポーツの練習の際には、鏡やビデオカメラとビデ
オテープレコーダ等を使用して、その運動フォーム(例
えばゴルフスウィング等)をそのプレイと同時に又はし
ばらく時間を置いて映像的にチェックする練習方法が採
用されることがある。When practicing various sports, use a mirror, video camera, video tape recorder, etc. to visually check the exercise form (eg, golf swing) at the same time as it is played or after a while. May be adopted.
しかし、鏡を見てそのフォームをチェックする場合、目
線は常に鏡に向けている必要があり、実際の練習にあっ
ては、例えばゴルフボールを打つ様なことが難しくなっ
たり、逆にフォームが崩れる原因となることもある。又
ビデオカメラとビデオテープレコーダを使用する場合
も、巻き戻しや頭出し等の操作を行なった後に始めて確
認できるため、プレイ直後には体が覚えていた一連の動
きの記憶も消失してしまってから、漸く視覚的にチェッ
クできるようになり、運動フォームのチェックにあまり
有効な手段とは言えない等の問題がある。However, when looking at the mirror and checking the form, it is necessary to always keep the eyes on the mirror, and in practice, it is difficult to hit a golf ball, for example. It may cause collapse. Also, when using a video camera and a video tape recorder, it can be confirmed only after rewinding or cueing, so immediately after play, the memory of the series of movements remembered by the body is also lost. Therefore, it becomes possible to visually check it, and there is a problem that it cannot be said that it is a very effective means for checking the exercise form.
本発明は従来技術の以上の様な問題に鑑み創案されたも
ので、競技者自身がプレイ直後であって、その運動フォ
ームの一連の動きを体が覚えているうちに、該運動フォ
ームをチェックすることが可能な装置を提供せんとする
ものである。The present invention was devised in view of the above problems of the prior art, and the player checks the exercise form immediately after playing and while the body remembers a series of movements of the exercise form. It is intended to provide a device capable of doing so.
そのため本発明の運動フォームチェッカは、スポーツ競
技者の運動フォームを映像的に捉えてビデオ信号として
入力し、A/D変換した後、メモリ上に記憶させ、設定時
間経過後該メモリから取り出してD/A変換し、そのビデ
オ信号を映像的再生する構成を有している。Therefore, the exercise form checker of the present invention captures the exercise form of a sports athlete as a video signal, inputs it as a video signal, stores it in a memory after A / D conversion, and takes it out from the memory after a set time elapses and then D A / A conversion is performed and the video signal is reproduced visually.
前提として、本発明の基本的特徴につき、第1図(a)
(b)を用いて更に具体的に説明すると、次の様にな
る。As a premise, the basic features of the present invention will be described with reference to FIG.
A more specific description using (b) is as follows.
即ち、競技者の運動フォームをビデオカメラ(1)で捉
えてそのビデオ信号をA/Dコンバータ(2)によりデジ
タルデータ信号に変換し、データデマルチプレクサによ
り同図(a)に示すように、該デジタルデータ信号をメ
モリ群X(3a)に記憶させる。そして、同図(b)に示
すように、同じくデータデマルチプレクサによりメモリ
群Y(3b)にそのデジタルデータ信号の入力先が切り換
えられる。一方、前記メモリ群X(3a)に記憶されたデ
ジタルデータ信号は、予め設定されているディレイタイ
ム分遅れてデータマルチプレクサによりD/Aコンバータ
(4)に取り出されてもう一度アナログのビデオ信号に
変換され、TVモニタ(5)で再生される。この時、設定
されるべきディレイタイムに対応させてメモリ群XY(3
a)(3b)の記憶容量を調整しておけば、データデマル
チプレクサによりメモリ群X(3a)が信号を記憶してい
る間に、データマルチプレクサによりメモリ群Y(3b)
から信号を出力し、又データデマルチプレクサによって
メモリ群Y(3b)が記憶している間に、データマルチプ
レクサによりメモリ群X(3a)から出力するというデジ
タルデータ信号の記憶及びその出力作業について、デー
タマルチプレクサとデータデマルチプレクサを使って複
数のメモリ群間で交互に繰り返すことで、連続的な映像
をディレイさせて表示することが可能となる。That is, the athlete's exercise form is captured by the video camera (1), the video signal is converted to a digital data signal by the A / D converter (2), and the data demultiplexer is used to convert the video signal to a digital data signal as shown in FIG. The digital data signal is stored in the memory group X (3a). Then, as shown in FIG. 9B, the input destination of the digital data signal is switched to the memory group Y (3b) by the data demultiplexer. On the other hand, the digital data signal stored in the memory group X (3a) is taken out by the data multiplexer to the D / A converter (4) after being delayed by a preset delay time and converted into an analog video signal again. , Is played on the TV monitor (5). At this time, the memory group XY (3
a) If the storage capacity of (3b) is adjusted, while the memory group X (3a) is storing signals by the data demultiplexer, the memory group Y (3b) is stored by the data multiplexer.
From the memory group X (3a) by the data multiplexer while the memory group Y (3b) is being stored by the data demultiplexer. By alternately repeating a plurality of memory groups using a multiplexer and a data demultiplexer, it is possible to delay and display a continuous image.
以下本発明の具体的実施例につき説明する。 Specific examples of the present invention will be described below.
第2図は本発明のゴルフスウィングチェッカの実施例装
置の回路構成を示す回路図である。FIG. 2 is a circuit diagram showing the circuit configuration of the golf swing checker device of the present invention.
本実施例装置は、大別して、映像を捉えるビデオ信号入
力回路Aと、信号入出力部に特別な回路構成(後述する
データマルチプレクサとデータデマルチプレクサ)を備
えた信号記憶用のメモリ回路Bと、メモリ回路Bから取
り出された信号を映像として再生する再生回路Cと、設
定されたディレイタイムに応じてメモリ回路Bの入力信
号の記憶動作制御命令及び信号の出力制御命令を行なう
制御回路Dとを有している。The apparatus of this embodiment is roughly classified into a video signal input circuit A for capturing an image, a memory circuit B for signal storage having a special circuit configuration (a data multiplexer and a data demultiplexer described later) in a signal input / output unit, A reproduction circuit C for reproducing the signal taken out from the memory circuit B as an image and a control circuit D for executing a storage operation control command of an input signal of the memory circuit B and a signal output control command according to a set delay time. Have
前記ビデオ信号入力回路Aはビデオカメラ(10)と、A/
Dコンバータ(20)とから構成され、ゴルファのゴルフ
スウィングを該ビデオカメラ(10)で捉えて更にA/Dコ
ンバータ(20)でそのビデオ信号をデジタルデータ信号
に変換する。The video signal input circuit A includes a video camera (10), A /
The video camera (10) captures the golf swing of the golfer, and the A / D converter (20) converts the video signal into a digital data signal.
前記メモリ回路Bは、データデマルチプレクサであるデ
ィストリビューションアンプ(30)と、ビデオメモリ群
(31a)乃至(31e)と、データマルチプレクサであるマ
トリックススイッチャ(32)とからなり、該ディストリ
ビューションアンプ(30)は、前記A/Dコンバータ(2
0)で変換されたデジタルデータ信号をビデオメモリ群
(31a)乃至(31e)の数に対応させて分岐し、これらの
ビデオメモリ群(31a)乃至(31e)に対し同一信号を同
時に出力しており、又マトリックススイッチャ(32)は
ビデオメモリ群(31a)乃至(31e)の出力側につながっ
ていて、各メモリ群(31a)乃至(31e)からの信号取り
出しの切替えを行なっている。尚、各ビデオメモリ群
(31a)乃至(31e)は、後述する制御回路Dの制御命令
により、ディストリビューションアンプ(30)側からの
入力信号の記憶動作が制御され、各メモリ群に同時に入
力されてくるデジタル変換されたデータ信号のうち、最
初の一画面目及び二画面目を構成する信号をビデオメモ
リ群(31a)に記憶させ、三画面目及び四画面目の信号
をビデオメモリ群(31b)に記憶させるという様に、連
続的な映像の一瞬一瞬を各ビデオメモリ群(31a)乃至
(31e)毎にデジタル信号として記憶させる。又、同様
にマトリックススイッチャ(32)によるビデオメモリ群
(31a)乃至(31e)からのデジタルデータ信号取り出し
切替えも、制御回路Dの制御命令により制御され、ビデ
オメモリ群(31a)から一画面目及び二画面目の信号を
取り出し、次にビデオメモリ群(31b)に切替えてそこ
から三画面目及び四画面目の信号を取り出すという様に
メモリ群側の信号取り出し切替えを行なう。The memory circuit B includes a distribution amplifier (30) which is a data demultiplexer, video memory groups (31a) to (31e), and a matrix switcher (32) which is a data multiplexer. ) Is the A / D converter (2
The digital data signal converted in (0) is branched according to the number of video memory groups (31a) to (31e), and the same signal is simultaneously output to these video memory groups (31a) to (31e). Further, the matrix switcher (32) is connected to the output side of the video memory groups (31a) to (31e) and switches the signal extraction from each of the memory groups (31a) to (31e). In each of the video memory groups (31a) to (31e), the storage operation of the input signal from the distribution amplifier (30) side is controlled by a control command of the control circuit D described later, and the input signals are simultaneously input to each memory group. Of the incoming digitally converted data signals, the signals that make up the first and second screens are stored in the video memory group (31a), and the signals of the third and fourth screens are stored in the video memory group (31b). ) Is stored in each video memory group (31a) to (31e) as a digital signal. Similarly, switching of digital data signal extraction from the video memory groups (31a) to (31e) by the matrix switcher (32) is also controlled by the control command of the control circuit D, and the first screen from the video memory group (31a) and The signals of the second screen are taken out, then the signals are switched to the video memory group (31b), and then the signals of the third screen and the fourth screen are taken out from the video memory group (31b).
前記再生回路Cは、デジタルデータ信号をアナログ信号
に変換するD/Aコンバータ(40)と、アナログのビデオ
信号を映像として再生するTVモニタ(50)とからなり、
前述のマトリックススイッチャ(32)により順次ビデオ
メモリ(31a)乃至(31e)から取り出されてくるデジタ
ルデータ信号を該D/Aコンバータ(40)によりアナログ
のビデオ信号に変換せしめ、更にTVモニタ(50)により
これを実際の映像として再生することになる。The reproduction circuit C includes a D / A converter (40) for converting a digital data signal into an analog signal, and a TV monitor (50) for reproducing an analog video signal as an image.
The D / A converter (40) converts the digital data signals sequentially output from the video memories (31a) to (31e) by the matrix switcher (32) into analog video signals, and further the TV monitor (50). Will play this as an actual video.
前記制御回路Dは、ディレイタイム設定用インタフェイ
ス(61)を備えたCPU(60)と、該CPU(60)から各ビデ
オメモリ群(31a)乃至(31e)に対し入力信号の記憶動
作制御命令を出すためのビデオメモリ側インタフェイス
(62a)乃至(62e)と、該CPU(60)からマトリックス
スイッチャ(32)に対しビデオメモリ群(31a)乃至(3
1e)からのデジタル信号取り出しの切替えを指令するた
めのマトリックススイッチャ側インタフェイス(63)と
を備えている。そして該CPU(60)は前記ディレイタイ
ム設定用インタフェイス(61)を介してこのCPU(60)
自身に設定されたディレイタイムに基づき自動的にシー
ケンスを組み、各ビデオメモリ群(31a)乃至(31e)の
記憶動作制御命令と、マトリックススイッチャ(32)の
信号取り出し切替え制御命令を出力する。即ち、このCP
U(60)は、前記ディストリビューションアンプ(30)
で分岐された全メモリ群側に同時に入力されるデジタル
データ信号のうち、各ビデオメモリ群(31a)乃至(31
e)に夫々どの時点で記憶させるかを各別に指令する制
御命令を上記インタフェイス(62a)乃至(62e)を介し
て出力している。又同じくCPU(60)は、マトリックス
スイッチャ(32)がビデオメモリ群(31a)乃至(31e)
から各デジタル信号の取り出しを行なう際、設定された
ディレイタイム経過後各ビデオメモリ群(31a)乃至(3
1e)から順次信号取り出しを行なえる様に該マトリック
ススイッチャ(32)に信号取り出しのメモリ間切替え制
御命令を出力する。The control circuit D includes a CPU (60) having a delay time setting interface (61), and a storage operation control command of an input signal from the CPU (60) to each of the video memory groups (31a) to (31e). Video memory side interfaces (62a) to (62e) for outputting the video memory groups and the video memory groups (31a) to (3a) from the CPU (60) to the matrix switcher (32).
And a matrix switcher side interface (63) for instructing switching of digital signal extraction from 1e). The CPU (60) is connected to the CPU (60) via the delay time setting interface (61).
A sequence is automatically formed based on the delay time set in itself, and a storage operation control command for each video memory group (31a) to (31e) and a signal extraction switching control command for the matrix switcher (32) are output. That is, this CP
U (60) is the distribution amplifier (30)
Of the digital data signals that are simultaneously input to all the memory groups that have been branched in step 1, each of the video memory groups (31a) to (31a)
The control commands for individually instructing e) at which time to store are output via the interfaces (62a) to (62e). Similarly, in the CPU (60), the matrix switcher (32) has video memory groups (31a) to (31e).
When each digital signal is extracted from the video memory group (31a) to (3a) after the set delay time elapses.
A memory switching control command for signal extraction is output to the matrix switcher (32) so that signals can be sequentially extracted from 1e).
本実施例では以上の様な構成を備えているので、ビデオ
カメラ(10)で捉えられたゴルファのゴルフスウィング
の映像信号をA/Dコンバータ(20)でデジタルデータ信
号に変換し、更にディストリビューションアンプ(30)
で分岐して全ビデオメモリ群(31a)乃至(31e)に同時
に同一の信号を送る。一方、CPU(60)はディレイタイ
ム設定用インタフェイス(61)により設定されたディレ
イタイムに基づき自動的にシーケンスを組み、各ビデオ
メモリ群(31a)乃至(31e)に対してはデジタル変換さ
れたデータ信号をどの時点で夫々記憶するかを指令し、
又、該ディレイタイム経過後、マトリックススイッチャ
(32)によるビデオメモリ(31a)乃至(31e)の信号取
り出しのメモリ間切替え命令を該マトリックススイッチ
ャ(32)に出力する。そしてこのマトリックススイッチ
ャ(32)により取り出されたデジタルデータ信号はD/A
コンバータ(40)により元のアナログのビデオ信号に変
換され、TVモニタ(50)により映像として再生される。Since the present embodiment has the above configuration, the video signal of the golf swing of the golfer captured by the video camera (10) is converted into a digital data signal by the A / D converter (20) and further distributed. Amplifier (30)
And the same signal is simultaneously sent to all video memory groups (31a) to (31e). On the other hand, the CPU (60) automatically forms a sequence based on the delay time set by the delay time setting interface (61), and digital conversion is performed for each video memory group (31a) to (31e). Command when to store each data signal,
Further, after the delay time has elapsed, a memory switching command for outputting signals from the video memories (31a) to (31e) by the matrix switcher (32) is output to the matrix switcher (32). The digital data signal extracted by this matrix switcher (32) is D / A.
It is converted into an original analog video signal by the converter (40) and reproduced as an image by the TV monitor (50).
尚、ストロボ録画(間欠録画)やスローモーション録画
等の特殊録画を行なう場合、CPU(60)によるメモリ側
の記憶制御やマトリックススイッチャ(32)による信号
取り出し制御のシーケンスを変えて行なうと良い。即
ち、ストロボ録画の場合は各ビデオメモリ群(31a)乃
至(31e)に対し、記憶制御命令の出力タイミングを大
きくとったり、マトリックススイッチャ(32)によるビ
デオメモリ群からの信号取り出しを1つ置き、2つ置き
というように間引きして行なっても良い(この場合ビデ
オメモリ群(31a)乃至(31e)の容量を増やす必要があ
ろう)。又スローモーション録画の場合は、ビデオメモ
リ群(31a)乃至(31e)の容量を増やし、且つCPU(6
0)からの各ビデオメモリ群(31a)乃至(31e)間の記
憶制御命令の出力タイミングを狭くとって映像録画画面
数を多くとるようにすると良い。When performing special recording such as strobe recording (intermittent recording) or slow motion recording, it is advisable to change the sequence of memory side memory control by the CPU (60) and signal extraction control by the matrix switcher (32). That is, in the case of flash recording, the output timing of the storage control command is set large for each of the video memory groups (31a) to (31e), and one signal is taken out from the video memory group by the matrix switcher (32). It may be performed by thinning out every other time (in this case, it is necessary to increase the capacity of the video memory groups (31a) to (31e)). For slow-motion recording, increase the capacity of the video memory groups (31a) to (31e) and add the CPU (6
It is preferable to increase the number of video recording screens by narrowing the output timing of the storage control command between the video memory groups (31a) to (31e) from (0).
更にこのゴルフスウィングチェッカではCPU(60)のシ
ーケンスを必要に応じて変えることでループリピート機
能を持たせ、見たいシーンを何度でもリピート再生させ
ることもできる。In addition, this golf swing checker has a loop repeat function by changing the sequence of the CPU (60) as needed, and you can repeat the scene you want to watch as many times as you want.
以上詳述した本発明の運動フォームチェッカによれば、
データマルチプレクサ及びデータマルチプレクサを使
い、予め設定された時間分ディレイさせて、自動的にそ
の運動フォームがTVモニタ等に映像として再現されて視
覚的なフォームのチェックだけでなく、競技者自身がそ
のフォームをチェックすることができることになり、競
技者自身の体がその一連の動きを覚えている間にフォー
ムのチェックが可能となり、練習効果を飛躍的に高める
ことができる様になる。According to the exercise form checker of the present invention detailed above,
The data multiplexer and data multiplexer are used to delay for a preset time, and the exercise form is automatically reproduced as an image on a TV monitor, etc. Not only the visual form check but also the athlete himself. It becomes possible to check the form, and it becomes possible to check the form while the athlete's body remembers the series of movements, and it is possible to dramatically improve the practice effect.
第1図(a)(b)は本発明の装置構成をより具体化し
た状態により示す説明図、第2図は本発明の一実施例に
係るゴルフスウィングチェッカの回路構成を示す回路図
である。 図中(1)(10)はビデオカメラ、(2)(20)はA/D
コンバータ、(3a)(3b)はメモリ群、(31a)(31b)
(31c)(31d)(31e)はビデオメモリ群、(30)はデ
ィストリビューションアンプ、(32)はマトリックスス
イッチャ、(4)(40)はD/Aコンバータ、(5)(5
0)はTVモニタ、(60)はCPUを各示す。FIGS. 1 (a) and 1 (b) are explanatory views showing the device structure of the present invention in a more specific state, and FIG. 2 is a circuit diagram showing the circuit structure of a golf swing checker according to an embodiment of the present invention. . In the figure, (1) and (10) are video cameras, and (2) and (20) are A / D.
Converter, (3a) (3b) are memory groups, (31a) (31b)
(31c) (31d) (31e) are video memory groups, (30) is a distribution amplifier, (32) is a matrix switcher, (4) and (40) are D / A converters, (5) (5)
0) shows a TV monitor, and (60) shows a CPU.
Claims (1)
捉えてビデオ信号として入力し、A/D変換した後、デジ
タルデータ信号をメモリ上に記憶させ、設定時間経過後
このデジタルデータ信号を該メモリ上から取り出してD/
A変換し、そのビデオ信号を映像的に再生する運動フォ
ームチェッカにおいて、データマルチプレクサとデータ
デマルチプレクサを使って、複数のメモリ群に対し順次
デジタルデータ信号を記憶させ、上記時間経過後このデ
ジタルデータ信号を該メモリ群から順次出力せしめるこ
とを特徴とする運動フォームチェッカ。1. A sports athlete's exercise form is visually captured and input as a video signal, and after A / D conversion, a digital data signal is stored in a memory, and this digital data signal is stored after a lapse of a set time. Remove it from memory and press D /
In the motion form checker that A-converts and reproduces the video signal visually, use a data multiplexer and a data demultiplexer to sequentially store digital data signals in a plurality of memory groups, and after this time has elapsed, this digital data signal is stored. Is sequentially output from the memory group.
Priority Applications (1)
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|---|---|---|---|
| JP2042355A JPH0773615B2 (en) | 1990-02-26 | 1990-02-26 | Exercise form checker |
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| JP2042355A JPH0773615B2 (en) | 1990-02-26 | 1990-02-26 | Exercise form checker |
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| JPH03247366A JPH03247366A (en) | 1991-11-05 |
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Family Applications (1)
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|---|---|---|---|
| JP2042355A Expired - Lifetime JPH0773615B2 (en) | 1990-02-26 | 1990-02-26 | Exercise form checker |
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1990
- 1990-02-26 JP JP2042355A patent/JPH0773615B2/en not_active Expired - Lifetime
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