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TCKとは 意味・読み方・使い方
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「TCK」を含む例文一覧
該当件数 : 28件
The major circuit 122 generates the TCK at its output Q to selectively change the TCK at each edge of the CLK, the dummy circuit 124 generates a dummy signal DTCK at its output Q and selectively changes the DTCK at each edge.例文帳に追加
主要回路122 は出力QにてTCK を生成しCLKの各エッジにて選択的にTCK を変化させ、ダミー回路124 は出力Qにてダミー信号DTCKを生成しCLK の各エッジにて選択的にDTCKを変化させる。 - 特許庁
The analog circuit receives a digital control signal TCK, generates one analog signal or more depending on the received signal TCK, and the digital circuit 120 is provided with a major clocked circuit 122 that generates a clock signal by a clock signal CLK and a dummy clocked circuit 124.例文帳に追加
アナログ回路はデジタル制御信号TCK を受信し受信したTCK に依存して一個以上のアナログ信号を生成し、デジタル回路120 はクロック信号CLK によりクロック化される主要クロック化回路122 とダミー・クロック化回路124 とを備える。 - 特許庁
Control circuits 126-130 connected to the clocked circuits 122, 124 can be acted so as to causes a change at the edge of the CLK when no change is caused in the TCK and prevent occurrence of the change in the DTCK when the TCK has the change.例文帳に追加
クロック化回路122, 124に接続された制御回路 126〜130 はTCK に変化が生じないCLK のエッジにおいては斯かる変化をDTCK中に生じせしめるべく、かつTCK に斯かる変化が有る時点においては斯かる変化がDTCKに生ずるのを防止すべく作用可能である。 - 特許庁
To assure a sufficient tDQSS margin for all of tCK by respectively regulating tDQSS characteristics for the respective tCK depending on change of tCK by using a CAS latency signal.例文帳に追加
CASレイテンシ信号を用いてtCKの変化に従い各tCKに対するtDQSS特性をそれぞれ調節するようにし、全てのtCKに対し十分なtDQSSマージンを確保する。 - 特許庁
The thickness tck of the covering layer 24 is determined according to the radial gap δ determined thereby.例文帳に追加
このようにして求めたラジアルギャップδに従って被覆層24の膜厚tckを決定する。 - 特許庁
A timing generating section 37 changes a frequency of a transfer clock signal TCK on the basis of the compressed image data S3, and an output section 36 externally outputs compressed image data ED on the basis of the transfer clock signal TCK.例文帳に追加
タイミング発生部37は、圧縮画像データS3に基づいて転送用クロック信号TCKの周波数を変更し、出力部36は、転送用クロック信号TCKに基づいて圧縮画像データEDを外部出力する。 - 特許庁
A CCD delay line 103 sequentially transfers the inputted analog signals AS according to the transfer clock signals TCK.例文帳に追加
CCD遅延線103は、入力したアナログ信号ASを転送クロック信号TCKに応じて順次転送する。 - 特許庁
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The analog circuit 14 receives a set of digital signals TCK 1-n and is operative in each processing cycle to generate one or more analog signals OUTA, OUTB in response to the received digital signals TCK 1-n.例文帳に追加
アナログ回路14は、1組のディジタル信号TCK1−nを受信しこの受信したディジタル信号TCK1−nに応じて1またはそれ以上のアナログ信号OUTA,OUTBを生成すべく、各処理サイクル内で動作可能である。 - 特許庁
The step time increment for adjusting Pre/Post-launch time is set to tCK/32 or higher precision.例文帳に追加
Pre/Post−launchの時間調整用のステップ時間刻みをtCK/32またはそれよりも高精細とする。 - 特許庁
This allows counting of frequency in which the master clock signal MCK is "H" at rising time of test clock signal TCK.例文帳に追加
これにより、テストクロック信号TCKの立ち上がり時点でマスタクロック信号MCKが“H”である回数をカウントすることができる。 - 特許庁
In this measuring method, status of master clock signal MCK is maintained by FF38 at rising time of test clock signal TCK, then AND of this FF38 output signal and inversion signal of the test clock signal TCK is taken to be input into clock terminal of a counter 34.例文帳に追加
テストクロック信号TCKの立ち上がり時点において、マスタクロック信号MCKの状態をFF38で保持し、このFF38の出力信号とテストクロック信号TCKを反転した信号のANDを取ってカウンタ34のクロック端子に入力する。 - 特許庁
To provide a synchronous semiconductor memory device wherein RAS active operation time (tRAS) is set according to the cycle (tCK) of a clock signal.例文帳に追加
RASアクティブ動作時間(tRAS)がクロック信号の周期(tCK)に応じて設定される同期型半導体記憶装置を実現する。 - 特許庁
Timing when the switching element 34-j is turned on is made to differ from timing when the level of a clock signal TCK for inspection for specifying an operation of an inspecting circuit 3 is changed.例文帳に追加
検査スイッチング素子34−jをオンするタイミングは、検査用回路3の動作を規定する検査用クロック信号TCKのレベル変化のタイミングとは異なっている。 - 特許庁
The digital circuits 100, 200 are connected to the analog circuit to apply one set of the digital signals TCK 1-n to the analog circuit 14 in each processing cycle.例文帳に追加
ディジタル回路100,200は、各処理サイクルでかかる1組のディジタル信号TCK1−nをアナログ回路14に印加するためこのアナログ回路に接続される。 - 特許庁
The clock signal that is asynchronous with the measured signal M but has a constant period of a clock signal CK is generated, and an interpolation signal fm is generated in the clock period Tck.例文帳に追加
被測定信号Mとは非同期であるが、一定周期のクロック信号CKを発生させるとともに、そのクロック周期Tckで補間信号fmを発生する。 - 特許庁
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