JPS5810910B2 - how to get rid of it - Google Patents
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- JPS5810910B2 JPS5810910B2 JP14116174A JP14116174A JPS5810910B2 JP S5810910 B2 JPS5810910 B2 JP S5810910B2 JP 14116174 A JP14116174 A JP 14116174A JP 14116174 A JP14116174 A JP 14116174A JP S5810910 B2 JPS5810910 B2 JP S5810910B2
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Description
【発明の詳細な説明】 本発明は放送事実自動確認方法に関する。[Detailed description of the invention] The present invention relates to a method for automatically confirming broadcast facts.
放送事実の確認とは、ある特定の放送内容たとえばコマ
ーシャル放送が予め定められた時間に現実に放送された
か否かの放送事実を実信側において確認(モニタ)する
ために、受信側においてその確認しようとする放送内容
の弁別を行ってその放送内容に対応する符号化記録等を
自動的に行い、その記録されたデータを事後的に解析す
ることにより、上記放送事実の有無、その放送の暇疵等
を知ろうとするものであるが、それを人為的でなくして
自動的に行なおうとする場合には、上記確認しようとす
る特定の放送内容が他の放送内容と区別できる識別する
ための情報(テジタル信号)を、確認しようとするその
放送内容の現実の放送中において受信側に伝送しなけれ
ばならない。Confirmation of broadcast fact refers to confirmation on the receiving side in order to confirm (monitor) on the broadcasting side whether or not a particular broadcast content, such as a commercial broadcast, was actually broadcast at a predetermined time. By discriminating the broadcast content to be broadcast, automatically recording the encoded data corresponding to the broadcast content, and analyzing the recorded data after the fact, it is possible to determine whether or not the above-mentioned broadcast has occurred, and the time of the broadcast. If you are trying to find out the defects, etc., but you want to do it automatically without doing it manually, it is necessary to identify the specific broadcast content to be checked as described above so that it can be distinguished from other broadcast content. Information (digital signals) must be transmitted to the receiving side during the actual broadcast of the broadcast content to be verified.
従来、テレビジョン放送において行われている放送事実
の確認としては、識別を行うデジタル電気信号として、
確認しようとする特定の放送内容を記録した映写フィル
ムの1駒のなかに、白、黒の縦縞を施しておき、その縞
の白黒の組み合せをコードとしてそれをテレビジョン受
信機の受信信号中より弁別することにより、その放送内
容を表わす符号情報を取り出せるようにしたものが知ら
れている。Traditionally, the confirmation of broadcast facts in television broadcasts uses digital electrical signals for identification.
White and black vertical stripes are applied to one frame of the projection film that records the specific broadcast content to be confirmed, and the combination of black and white stripes is used as a code to distinguish it from the signal received by the television receiver. There is a known system in which code information representing the content of the broadcast can be extracted by doing so.
ところで、上記白黒の縦縞は、直接映写フィルムに施す
ことは至難であるため、たとえば大きな白紙に描いてお
いてそれを映写フィルムに撮影記録することによりつく
るものであって、その撮影の際の撮影位置のずれで、正
確に白紙に描いておいた白黒の縦縞が映写フィルムに転
写されたとき、規定の記録位置よりずれたり、その読み
出しを行うフィルム送像装置における撮像位置のずれや
倍率の変動によって変形したりして、受信側においてキ
ャッチされたときはその白黒の縦縞は、ラスターにおけ
る規定の位置よりずれていたり、正規の長さおよび巾よ
り大きく変形していたりする。By the way, it is extremely difficult to directly apply the black and white vertical stripes to the projection film, so they can be created by, for example, drawing them on a large piece of blank paper and then photographing and recording them on the projection film. Due to positional deviations, when the black and white vertical stripes accurately drawn on a blank sheet of paper are transferred to the projection film, they may deviate from the specified recording position, or the image pickup position or magnification may vary in the film feeding device that reads the stripes. When the black and white vertical stripes are caught on the receiving side, they may be shifted from the specified position in the raster, or may be deformed to a greater extent than the normal length and width.
そのため、単に白黒の縦縞のみの検知だけをもって放送
事実確認のための情報を得ようとする従来の方法は、受
信側における検知装置の精度をいくら高くしても、かん
じんの識別を行うコード信号(白黒の縦縞)が上記のご
とく変化してしまっているが故に、目的とするコード信
号を確実に検出できなかったり、誤検出してしまうとい
う危険性がきわめて高かった。Therefore, the conventional method of obtaining information for confirming the broadcast fact by simply detecting only black and white vertical stripes is difficult to do, no matter how high the accuracy of the detection device on the receiving side is. Because the black and white vertical stripes) have changed as described above, there is an extremely high risk that the desired code signal cannot be reliably detected or that it will be detected incorrectly.
しかして、本発明は目的とする特定の放送内容の放送事
実のみを的確に行うことができる放送事実自動確認方法
を提供しようとするものである。SUMMARY OF THE INVENTION Therefore, it is an object of the present invention to provide an automatic broadcasting fact checking method that can accurately check only the broadcasting facts of a specific target broadcasting content.
以下には本発明を、図示の実施例を参照して詳細に説明
する。The invention will be explained in more detail below with reference to illustrated embodiments.
第1図に示すように映像情報記録媒体の一例の映写フィ
ルムCFは、公知のごとく走行方向(矢印にて図示)に
沿って中央に映像情報記録トラック1を、またその一側
に音声情報記録トラック2を、さらに他側に、パーホレ
ーション3を等間隔に穿設した帯状の透明部分4を設け
ている。As shown in FIG. 1, a projection film CF, which is an example of a video information recording medium, has a video information recording track 1 in the center along the running direction (indicated by an arrow), and audio information is recorded on one side of the film. On the other side of the track 2, a band-shaped transparent part 4 in which perforations 3 are formed at equal intervals is provided.
そして、この映写フィルムCFは、その映像情報記録ト
ラック1において区画形成された駒5、〜5nのうちの
最初の駒51を除くそのあとの駒52〜5nの中に、放
送事実の確認をすべき特定の映像情報たとえば「A」〜
「Z」のアルファベット文字を光学記録し、また上記最
初の駒5、を利用してその中に、上記特定の映像情報の
放送事実の自動確認を特徴とする特殊なパターンの信号
を同じく光学記録している。Then, this projection film CF has confirmation of the broadcast fact in the frames 52 to 5n after the first frame 51 of the frames 5 to 5n formed into sections on the video information recording track 1. Specific video information to be used, for example "A" ~
The alphabet letter "Z" is optically recorded, and a special pattern signal is also optically recorded therein, which is characterized by automatic confirmation of the broadcast fact of the specific video information, using the first piece 5 mentioned above. are doing.
この最初の駒51に記録された信号は、第2図にくわし
く示すように、この範囲だけは送受信両側においていか
なる悪条件を想定しても必ず撮像送信および受信される
という安全圏SZ内において記録したもので、それは検
索用の複数のクロックパターンxとアドレス(ROW
ADDRES)を指示する複数のアドレスパターンyと
コードを特定するコードパターン2とに分けられる。As shown in detail in Figure 2, the signal recorded on this first frame 51 is recorded within the safe zone SZ in which image transmission and reception are guaranteed in this range even under any adverse conditions on both the transmitting and receiving sides. It consists of multiple clock patterns x and addresses (ROW
ADDRES) and a code pattern 2 that specifies a code.
ここにおいて検索用のクロックパターンxをつくってお
くことが本発明の特徴であって、それは、そのあとに走
査伝送されるアドレスおよびコードパターンy、zを取
り出すためのサンプリング信号たる機能をもち、その送
信側での撮像送信および受信側の検出の如何がそのあと
のパターンy。The feature of the present invention is that a clock pattern x for searching is created here, and it has a function as a sampling signal for extracting the address and code patterns y and z that are then scanned and transmitted. The subsequent pattern y is how the image is captured and transmitted on the transmitting side and detected on the receiving side.
zの検知に重大な影響を及ぼすもので、その検索用のク
ロックパターンxは、後のパターンy、zに比べ特にそ
の撮像および受信側での検出が確実に行えるようにしで
ある。This has a significant influence on the detection of z, and the clock pattern x used for its search is designed to particularly ensure its imaging and detection on the receiving side compared to the subsequent patterns y and z.
すなわち、検索用のクロックパターンxは、駒51 の
左側端から走査速度にして一定長さTs離れたところよ
り、一定巾TAでしかも駒51(すなわち1フイールド
)の上端より一定長さB。That is, the search clock pattern x has a constant width TA from a point a fixed length Ts away from the left edge of the frame 51 at the scanning speed, and a constant length B from the upper edge of the frame 51 (that is, one field).
以上の所要長さB1の縦長の黒帯6をNa本(本実施例
においては16本)だけ一定間隔TBづつ離して記録す
ることにより構成されている。It is constructed by recording the vertically elongated black belts 6 of the above required length B1 at regular intervals TB by Na (16 in this embodiment).
黒帯6の間の間隔78部分は透明あるいは白色になって
いる。The space 78 between the black bands 6 is transparent or white.
また、アドレスパターンyは、上記Na本の黒帯6のう
ち左側のNr本(本実施例では4本)の黒帯の各真下に
おいて、それより一定長さWl離れたところより、横が
黒帯6と同じ巾のTAで縦が一定中B2の方形な区画が
、上下に一定間隔W2離して所定列(本実施例では7列
)あるものと仮想して、その各列ごとのNr個(4個)
の区画につき、黒パターンとするか白パターン(または
透明のまま)とするかの組み合せを変えることによって
、各列をB、C,Dコード化している。In addition, the address pattern y is created by starting from a point a certain length Wl away from the Nr (4 in this embodiment) black belts on the left side among the Na black belts 6, with the horizontal black Assuming that rectangular sections with TA of the same width as the band 6 and a constant length of B2 are arranged in a predetermined row (7 rows in this embodiment) vertically spaced apart by a fixed interval W2, Nr sections are arranged in each row. (4 pieces)
For each section, each column is coded B, C, and D by changing the combination of black pattern or white pattern (or remaining transparent).
因みに、本実施例では、最上列が7で、最下列が1とな
っている。Incidentally, in this embodiment, the top row is 7 and the bottom row is 1.
さらに、コードパターン2は、上記アドレスパターンy
を真下に設けた黒帯6以外の所要の黒帯の真下において
、アドレスパターンyの横列と同じ水平位置にそれと同
じ横列数でしかも1個の区画の横巾は上記TAであるが
縦巾が上記B2より所定長さαだけ下側に長い方形な区
画を仮想して、その区画のうちのどの列の区画を黒パタ
ーンとし、またどの列の区画を白パターン(透明)とす
るかを、当該映写フィルムCFの駒52〜5nに記録の
前述の確認すべき特定の映像情報との関係で決めること
により構成してあって、全体としてその確認すべき特定
の映像情報のコードを表わしている。Furthermore, code pattern 2 is the address pattern y
Immediately below the required black belts other than the black belt 6 provided directly below, there is a block in the same horizontal position as the rows of the address pattern y, the same number of rows, and the width of one section is the above TA, but the vertical width is Imagine a rectangular section that is longer than B2 by a predetermined length α, and decide which row of sections in that section will be the black pattern and which row will be the white pattern (transparent). It is constructed by determining the relationship with the above-mentioned specific video information to be confirmed recorded in the frames 52 to 5n of the projection film CF, and represents the code of the specific video information to be confirmed as a whole. .
検索用のクロックパターンx、アドレスパターンyおよ
びコードパターン2は上述のごとき関係になっているも
ので、これらを映写フィルムの1駒のなかに記録するに
は、たとえば大きな白紙に、黒くすべきところだけに黒
色を着色しておき、その白紙を撮影すればよいものであ
る。The search clock pattern x, address pattern y, and code pattern 2 have the relationship described above, and in order to record them in one frame of projection film, for example, write only the parts that should be black on a large blank sheet of paper. All you have to do is color the blank paper black and take a photograph of the blank paper.
このようにして1駒中(1フイールド)に記録された上
記3種のパターンx、y、zは、送信側における撮像送
信の場合にもまた受信側における受信の場合にも同じ条
件で撮像、送信、受信されるから、その変化率は同じに
なること明らかである
そしてまた、駒51の最初の水平走査による電気信号は
第3図に示すように、水平同期信号7からTs時間離れ
たところより、巾がTAで間隔がTBのクロックパルス
が1水平走査区間HにNa個ある波形となり、これが少
なくともB。The three types of patterns x, y, and z recorded in one frame (one field) in this way are captured and transmitted under the same conditions both in the case of image capture and transmission on the transmitting side and in the case of reception on the receiving side. Since it is transmitted and received, it is clear that the rate of change will be the same. Also, as shown in FIG. Therefore, there is a waveform in which there are Na clock pulses with a width TA and an interval TB in one horizontal scanning section H, which is at least B.
時間帯続くこと明らかである。It is clear that the period will continue.
次に、従来公知なテレビジョン受信機に付設することに
よって、受信側において上述のごとき関係にした検索用
クロックパターンxのみを検出し、またそめ検出を前提
としてアドレスパターンyおよびコードパターンzを検
出し、それによってそれらのあとに送られてくる特定の
映像情報のコードを表わす確認用の符号情報を得るよう
にした放送事実自動確認装置につき第4,5図を参照し
て詳細に説明する。Next, by attaching it to a conventionally known television receiver, only the search clock pattern x having the above-mentioned relationship is detected on the receiving side, and the address pattern y and code pattern z are also detected on the premise of some detection. 4 and 5, a detailed explanation will be given of an automatic broadcasting fact checking apparatus which uses this information to obtain checking code information representing the code of specific video information sent after the broadcasting information.
第4図には、全体として前記検索用のクロックパターン
xを検出してクロックパルスを得るクロックパターン検
出回路xが示してあれ、また第5図には上記クロックパ
ルスにもとづいて前記アドレスパターンyを検出するア
ドレスパターン検出回路Yと、上記クロックパルスにも
とづいて前記コードパターン2を検出するとともにその
検出信号を上記検出回路Yよりの信号によってふり分け
られるコードパターン検出回路2とが示しである。FIG. 4 shows a clock pattern detection circuit x that detects the search clock pattern x to obtain clock pulses, and FIG. An address pattern detection circuit Y for detecting the address pattern and a code pattern detection circuit 2 for detecting the code pattern 2 based on the clock pulse and distributing the detection signal according to the signal from the detection circuit Y are shown.
まず、第4図に示すクロックパターン検出回路Xより説
明すると、テレビジョン受信機TVで受信されたテレビ
ジョンビデオシグナルは、絶縁回路と垂直同期信号分離
回路と水平同期信号分離回路とを含む分離回路10によ
って、ビデオシグナルと垂直同期信号と水平同期信号と
に分離され、ビデオシグナルはレベルクランプ回路を含
む白黒レベル判定回路11に、また水平同期信号はカウ
ンタ12にそれぞれ入力されるようになっている。First, to explain from the clock pattern detection circuit X shown in FIG. 10, the video signal is separated into a vertical synchronization signal and a horizontal synchronization signal, and the video signal is input to a black and white level determination circuit 11 including a level clamp circuit, and the horizontal synchronization signal is input to a counter 12. .
上記白黒レベル判定回路11に入力されたビデオシグナ
ルは、クランプされたのち黒レベル域に入るか白レベル
域に入るかによって第3図に示すように2値電気信号(
黒レベルがHIGH,白レベルがLOW)に整形される
。After being clamped, the video signal input to the black and white level determination circuit 11 is converted into a binary electrical signal (
The black level is HIGH and the white level is LOW).
ここにおいて黒レベルは「H」となり、白レベルは「L
」となるので、以下には説明の便宜上、H部分(黒レベ
ル)をマーク、L部分(白レベル)をスペースと称する
ことにする。Here, the black level is "H" and the white level is "L".
Therefore, for convenience of explanation, the H portion (black level) will be referred to as a mark and the L portion (white level) will be referred to as a space.
判定回路11よりの2値電気信号はマークカウンタ13
Mとスペースカウンタ13sとに入力され、マーク長さ
とスペース長さとがそれぞれ計数され、その長さに応じ
た並列2進電気信号となったのち、前記一定時間TAお
よびTBに少しく冗長度をもたせた規定範囲内の長さの
ものだけ取り出されるとともに、マーク区間中に存在す
る僅少なスペースおよびスペース区間中に存在する僅少
なマークはここにおいて吸収除去されるようになってい
る。The binary electric signal from the judgment circuit 11 is sent to the mark counter 13.
M and a space counter 13s, the mark length and space length are counted respectively, and a parallel binary electric signal corresponding to the length is generated.After that, a little redundancy is given to TA and TB for the certain period of time. Only those having a length within a specified range are taken out, and a small amount of space existing in the mark section and a small amount of mark existing in the space section are absorbed and removed here.
マークカウンタ13Mにおいて並列2進信号となったマ
ークは、奇数、偶数順位選別回路14によって奇数番目
と偶数番目とにふり分けられ、奇数番目は奇数側のラッ
チメモリ15oに、また偶数番目は偶数側のラッチメモ
リ15Eにそれぞれ記憶されるようになっている。The marks that have become parallel binary signals in the mark counter 13M are sorted into odd and even numbers by the odd/even ranking sorting circuit 14. The data are stored in the latch memory 15E, respectively.
このようにしてふり分けられたマークは、コンパレータ
16により比較せられ、奇、偶一致してイタトキコンパ
レータ16より一致を表わスパルスが出力されるように
なっており、またかかる動作は、ラッチメモリ15o、
15Eに新情報が入って旧情報がクリアされるごとに繰
返されるようになっている。The marks sorted in this way are compared by the comparator 16, and if there is an odd or even match, the mark comparator 16 outputs a pulse indicating a match. memory 15o,
This process is repeated every time new information is entered in 15E and old information is cleared.
すなわち、ここにおいて、前記検索用のクロックパター
ンxの要素である黒帯6の横巾TAが、■水平走査の間
において隣り合うもの同士圧いに一致しているかどうか
を検べているものである。That is, here, it is checked whether the width TA of the black belt 6, which is an element of the search clock pattern x, matches the pressure between adjacent ones during horizontal scanning. be.
さらに、マークカウンタ13Mで並列2進信号となった
マークは、水平同期信号が受信されてから最初のマーク
だけを通過させるように関連構成したゲート17にも入
力されるようになっており、これを通過したマークすな
わち水平走査1回ごとの最初のマークは、上記と同じよ
うにして奇数、偶数順位選別回路18によりふり分けら
れ、ラッチメモリ19o、19Eに記憶されてコンパレ
ータ20で比較せられるようになっている。Furthermore, the marks converted into parallel binary signals by the mark counter 13M are also input to the gate 17, which is configured to pass only the first mark after receiving the horizontal synchronization signal. The mark that has passed through, that is, the first mark in each horizontal scan, is sorted by the odd and even rank sorting circuit 18 in the same manner as described above, and is stored in the latch memories 19o and 19E so that it can be compared by the comparator 20. It has become.
なお、奇数、偶数順位選別回路14は、具体的には、デ
ータを一時保持するためのレジスタと、そのデータを特
定の除数(例えば2)で割るための割算器と、その結果
を判定するためのコンパレータとで構成され、入力デー
タを除数にて割った結果に余りがあるときは、その入力
データを奇数と判定し、また余りがないときは偶数と判
定するもので、後述する奇数、偶数順位選別回路もこれ
と同じ構成である。Note that the odd/even rank selection circuit 14 specifically includes a register for temporarily holding data, a divider for dividing the data by a specific divisor (for example, 2), and a divider for determining the result. If there is a remainder after dividing the input data by the divisor, the input data is determined to be an odd number, and if there is no remainder, it is determined to be an even number. The even rank sorting circuit also has the same configuration.
すなわち、ここにおいて、前回の水平走査において最初
に出現した規定範囲内の長さのマークと当該回の水平走
査において最初に出現した同じ規定範囲内の長さのマー
クとが互いに一致しているかどうかを検べるものである
。That is, here, whether the mark with a length within the specified range that first appeared in the previous horizontal scan and the mark with the length within the same specified range that first appeared in the current horizontal scan match each other. It is possible to check.
上記コンパレータ20よりの一致信号はホールド回路2
1によって一定時間ホールドされるようになっている。The match signal from the comparator 20 is sent to the hold circuit 2.
1, it is held for a certain period of time.
前記カウンタ12は、前記分離回路10で分離された水
平同期信号でセントされ、前記白黒レベル判定回路11
より出力されるマーク(黒レベル〕でリセットされるよ
うになっている。The counter 12 is clocked by the horizontal synchronizing signal separated by the separation circuit 10, and
It is now reset at the mark (black level) that is output.
したがってこのカウンタ12は水平同期信号1個ごとに
、それが受信されてから最初のマークが受信されるまで
の時間を計数することになる。Therefore, this counter 12 counts the time from when the horizontal synchronizing signal is received to when the first mark is received for each horizontal synchronizing signal.
水平走査1回ごとにカウンタ12で計数した上記時間値
は、奇数、偶数順位選別回路22によって奇数番目と偶
数番目とにふり分けられ、ラッチメモリ23o、23o
に記憶されてコンパレータ24によって比較せられるよ
うになっている。The above-mentioned time value counted by the counter 12 for each horizontal scan is sorted into odd number and even number by the odd number/even rank sorting circuit 22, and is stored in the latch memories 23o, 23o.
The data are stored in the memory and compared by the comparator 24.
すなわち、ここにおいて、1個面中における1番左側に
位置する黒パターンが同じ水平走査位置において垂直に
連続しているかどうか換言すれば前記Ts時間位置にお
いて連続しているかどうかを検べているものである。That is, here, it is checked whether the black pattern located on the leftmost side in one plane is vertically continuous at the same horizontal scanning position, or in other words, whether it is continuous at the Ts time position. It is.
上記コンパレータ24よりの一致信号はホールド回路2
5によって一定時間ホールドされるようになっている。The match signal from the comparator 24 is sent to the hold circuit 2.
5, it is held for a certain period of time.
前述のように1水平走査区間におけるマーク巾が隣り合
うもの同士互いに一致しているかどうかを検べるために
用いた前記コンパレータ16より一致信号は、カウンタ
26に加えられ、これにより1水平走査区間中に何個の
一致信号かえられたかを計数するようになっている。As mentioned above, the coincidence signal from the comparator 16, which is used to check whether the widths of adjacent marks in one horizontal scanning section match each other, is added to the counter 26. It is designed to count how many matching signals are returned during the test.
そして、その計数値は、奇数、偶数順位選別回路27に
よって奇数番目と偶数番目とにふり分けられ、ラッチメ
モリ280,28Eに記憶されてコンパレータ29によ
り比較せられるようになっている。Then, the counted value is sorted into odd and even numbers by the odd and even rank sorting circuit 27, stored in the latch memories 280 and 28E, and compared by the comparator 29.
すなわち、ここにおいて、前回の水平走査において存在
したマークの数と当該回の水平走査において存在したマ
ークの数とが互いに一致していたかどうか換言すれば前
記黒帯6の数であるNa個のマークが連続しているかど
うかを検べるものである。That is, here, it is determined whether the number of marks present in the previous horizontal scan and the number of marks present in the current horizontal scan match each other. It can be used to check whether or not they are continuous.
上記コンパレータ29よりの一致信号はホールド回路3
0により一定時間ホールドされるようになっている。The match signal from the comparator 29 is sent to the hold circuit 3.
0, it is held for a certain period of time.
上述のようにして水平走査相互間におけるマークの数が
一致しているかどうかを検べる上記コンパレータ29、
最初のマークの巾が一致しているかどうかを検べるコン
パレータ20および最初のマークの位置が一致している
かどうかを検べるコンパレータ24よりのそれぞれの一
致信号は、ホールド回路30,21,25により一旦ホ
ールドされ、その論理積が1水平走査ごとにアンド回路
31によってとられるようになっている。the comparator 29, which can check whether the number of marks between horizontal scans matches as described above;
Match signals from a comparator 20 that can check whether the widths of the first marks match and a comparator 24 that can check whether the positions of the first marks match are sent to hold circuits 30, 21, 25. The logical product is once held by the AND circuit 31 for each horizontal scan.
さらに、図面においては省略したが、前記スペースカウ
ンタ13sよりのスペース(白レベル)は、その巾を前
記選別回路14、ラッチメモリ15o、15E、コンパ
レータ16と同様な機構で判定されたのち、前記ゲート
17、選別回路13、ラッチメモリ190,19E、コ
ンパレータ20と同様な機構で、最初のマーク成立後の
最初のスペース巾を水平走査相互間において比較せられ
、また前記選別回路22、ラッチメモリ23o、23E
、コンパレータ24と同様な機構で連続しているかどう
かを検べられ、さらに前記選別回路27、ラッチメモリ
28o、28E、コンパレータ29と同様の機構によっ
て数を検べられるもので、それも同様にして上記アンド
回路31に加えられ、マークとともに論理積をとられる
ようになっている。Furthermore, although omitted in the drawings, the width of the space (white level) from the space counter 13s is determined by a mechanism similar to the selection circuit 14, latch memories 15o, 15E, and comparator 16, and then the width of the space (white level) is determined by the gate. 17. With a mechanism similar to the sorting circuit 13, latch memories 190, 19E, and comparator 20, the initial space width after the establishment of the first mark can be compared between horizontal scans, and the sorting circuit 22, latch memory 23o, 23E
, the continuation is checked by a mechanism similar to that of the comparator 24, and the number can be checked by a mechanism similar to that of the selection circuit 27, latch memories 28o, 28E, and comparator 29; It is added to the AND circuit 31, and logical product is performed together with the mark.
かくして、水平走査相互間においてマークおよびスペー
スにつき全ての条件が一致満足したとき、アンド回路3
1はその一致を表わすパルスを出力するもので、そのパ
ルスはプリセットカウンタ32によって計数されるよう
になっており、その数が、前記黒帯6が満足すべき長さ
とした前記Boに相当する数似上となったとき、カウン
タ32よりプリセット値を超えたことを表わすパルスが
出力されるようになっている。Thus, when all the conditions for marks and spaces between horizontal scans are satisfied, the AND circuit 3
1 outputs a pulse representing the coincidence, and the pulse is counted by a preset counter 32, and the number corresponds to the Bo that the black belt 6 has a satisfactory length. When the preset value is exceeded, the counter 32 outputs a pulse indicating that the preset value has been exceeded.
すなわち、ここにおいて、上述のマークおよびスペース
についての条件が設定した水平走査回数(前記B。That is, here, the number of horizontal scans set by the above-mentioned conditions for marks and spaces (above B).
に相当)連続して満足しているかどうかを検べるもので
ある。(equivalent to) can be used to check whether or not you are continuously satisfied.
上記のことが満足してプリセットカウンタ32がパルス
を出力したとき、そのパルスによりメモリコントロール
回路33が駆動され、前記ラッチメモリ15o、23o
等に記憶の必要なデータすなわちマーク、スペースの巾
、順列、数、水平同期信号に対する時間等を表わすデー
タがメモリ34に記憶されるようになっている。When the above is satisfied and the preset counter 32 outputs a pulse, the memory control circuit 33 is driven by the pulse, and the latch memories 15o, 23o
Data necessary to be stored, such as marks, widths of spaces, permutations, numbers, times relative to horizontal synchronization signals, etc., are stored in the memory 34.
しかして、第4図に示したクロックパターン検出回路X
は、前述のごとき黒帯6を特定の配列、長さにした検索
用のクロックパターンxと全<同じあるいはそれと酷似
する映像しか検出しないもので、このようなパターンの
像は通常の映像情報においてはまず絶無と考えてよいか
ら、この検出回路Xは上記クロックパターンxが受信さ
れたときのみメモリ34にデータの記憶を行うことにな
る。Therefore, the clock pattern detection circuit X shown in FIG.
detects only images that are the same as or very similar to the search clock pattern x in which the black bands 6 have a specific arrangement and length as described above, and images of such patterns cannot be found in normal video information. Therefore, this detection circuit X stores data in the memory 34 only when the clock pattern x is received.
次に、上記のごときクロックパターンxの検出を前提と
して前記アドレスパターンyの検出を行うアドレスパタ
ーン検出回路Y(第5図)について説明すると、前記白
黒レベル判定回路11よりの2値電気信号はゲート35
に入力されていて、そのゲート35が前記プリセットカ
ウンタ32よりのパルスによって開くことによりそれを
通過するようになっている。Next, the address pattern detection circuit Y (FIG. 5) that detects the address pattern y on the premise of detecting the clock pattern x as described above will be explained. 35
When the gate 35 is opened by a pulse from the preset counter 32, the signal passes through it.
したがって、上記2値電気信号は前記クロックパターン
xが前述のように検出されてからゲート35を通過する
ことになる。Therefore, the binary electrical signal passes through the gate 35 after the clock pattern x is detected as described above.
第2図に示したようにクロックパターンxのあとのW1
範囲は白であって、それを検出するため、上記ゲート3
5を通過した2値電気信号はプリセットカウンタ36に
入力され、これによって1水平走査ごとのスペース(白
レベル)長さを計数し、1水平走査区間中はぼ全体がス
ペースだけとなっていたとき、カウンタ36より1パル
スが出力されるようになっている。W1 after clock pattern x as shown in FIG.
The range is white, and in order to detect it, the above gate 3
The binary electrical signal that has passed through 5 is input to the preset counter 36, which counts the length of the space (white level) for each horizontal scan. , the counter 36 outputs one pulse.
換言すれば、カウンタ36は、全体が白レベルの水平走
査線のみを検出しているといえる。In other words, it can be said that the counter 36 detects only horizontal scanning lines whose entirety is at the white level.
さらに、このカウンタ36よりのパルスはプリセットカ
ウンタ37によって計数され、そのパルス数が前記W1
に相当する数となったとき、カウンタ37よりパルスが
出力され、そのパルスはゲート38を介して前記メモリ
コントロール回路33(第4図)に入力され、これによ
って前記メモリ34に記憶のデータ(クロックパターン
x)が読み出されるようになっている。Furthermore, the pulses from this counter 36 are counted by a preset counter 37, and the number of pulses is
When the number corresponds to pattern x) is read out.
この読み出されたデータはデコーダ39(第4図)によ
って2値電気信号に変換され、第3図に示したようなマ
ーク巾がTA1スペース巾がTBのクロックパルスとな
る。This read data is converted into a binary electric signal by a decoder 39 (FIG. 4), and becomes a clock pulse having a mark width of TA and a space width of TB as shown in FIG.
このクロックパルスは第5図に示すプリセットカウンタ
40によってアドレス指示として用いる前記Nr個(第
2図参照)だけ計数され、またNr個計数したときゲー
ト41がカウンタ40の出力によって閉じられることに
より、そのNr個だけゲート41を通過し、マークコン
パレータ42に順次入力されるようになっている。These clock pulses are counted by the preset counter 40 shown in FIG. 5 by the number Nr (see FIG. 2) used as an address instruction, and when the clock pulses have been counted Nr, the gate 41 is closed by the output of the counter 40. Nr pieces of data pass through the gate 41 and are sequentially input to the mark comparator 42.
一方、前記ゲート35を通過した2値電気信号は、ゲー
ト43を通って上記クロックパルスを入力される上記マ
ークコンパレータ42に入力され、これによって各クロ
ックパルス到来の際にマーク(黒)であるかスペース(
白)であるかの判定を行われ、そのあとシフトレジスタ
44によって1水平走査ごとに黒白をビット単位とする
Nrピット(最初の黒パターンはサインピット)並列2
進電気信号(たとえば第2図において最上列の場合、1
.1.1=7)に変換されるようになっている。On the other hand, the binary electric signal that has passed through the gate 35 is inputted through the gate 43 to the mark comparator 42 which receives the clock pulse, thereby determining whether it is a mark (black) when each clock pulse arrives. space(
After that, the shift register 44 outputs Nr pits (the first black pattern is a sine pit) in parallel 2 in which black and white are bit units for each horizontal scan.
Leading electric signal (for example, in the case of the top row in Fig. 2, 1
.. 1.1=7).
そして、シフトレジスタ44よりの1水平走査ごとの並
列2進電気信号は、奇数、偶数順位選別回路45によっ
て奇数番目の水平走査に係わるものと偶数番目の水平走
査に係わるものとにふり分けられ、ラッチメモリ460
,46Eにそれぞれ記憶されてコンパレータ47によっ
て比較せられるようになっている。Then, the parallel binary electric signals for each horizontal scan from the shift register 44 are sorted by an odd/even rank sorting circuit 45 into those related to odd-numbered horizontal scans and those related to even-numbered horizontal scans, latch memory 460
, 46E, and are compared by a comparator 47.
このコンパレータ47よりの一致信号はプリセットカウ
ンタ49によって計数され、その数が、前記アドレスパ
ターンyを構成する黒パターンの前記縦巾B2(第2図
参照)に相当する数となったときすなわちB2時間同じ
並列2進電気信号が続いたときカウンタ49よりパルス
がえられ、そのパルスによってゲート50が開いて、上
記ラッチメモリ46oに記憶のアドレスを表わす並列2
進電気信号すなわちアドレス指示信号がゲート50を通
過し、コードパターン検出回路Zに含まれるアドレスセ
レクタ51に入って後述するコード信号のアドレスを指
示するようになっている。The coincidence signal from the comparator 47 is counted by a preset counter 49, and when the number corresponds to the vertical width B2 (see FIG. 2) of the black pattern constituting the address pattern y, that is, B2 time When the same parallel binary electric signal continues, a pulse is obtained from the counter 49, which causes the gate 50 to open, and the parallel 2 signal representing the address stored in the latch memory 46o is output.
The forward electric signal, that is, the address instruction signal passes through the gate 50 and enters the address selector 51 included in the code pattern detection circuit Z, so as to specify the address of the code signal, which will be described later.
このようにして1列のアドレスパターンyは検出される
ものであるが、その列の間は第2図に示したようにW2
長さ白となっているもので、これを検出するために前記
ゲート35を通過した2値電気信号のスペース(白)は
、プリセットカウンタ52によって1水平走査ごとにそ
の長さを計数され、前記プリセットカウンタ36と同様
、■水平走査区間中はぼ全体がスペースだけとなってい
たとき、カウンタ52よりパルスが出力され、そのパル
スはプリセットカウンタ53によって計数されてその数
が前記W2長さに相当する数となったとき、カウンタ5
3のパルスはゲート54を通って前記ゲート43を開き
、次の列のアドレスパターンyの検出を可能とするよう
になっている。In this way, one column of address pattern y is detected, but between that column, W2 is detected as shown in FIG.
The length of the space (white) of the binary electric signal passed through the gate 35 to detect this is counted by the preset counter 52 for each horizontal scan, and the length of the space (white) is counted by the preset counter 52 for each horizontal scan. Similar to the preset counter 36, when the entire horizontal scanning section is just a space, the counter 52 outputs a pulse, which is counted by the preset counter 53, and the number corresponds to the length of W2. When the number is reached, counter 5
The third pulse passes through the gate 54 and opens the gate 43, making it possible to detect the address pattern y of the next column.
なお、前記プリセットカウンタ49よりのパルスはゲー
トコントロール回路55に入力され、これによって上記
ゲート54は正規のアドレスパターンyが検出されたあ
と開き、それ以外のときは閉じるようにしである。The pulse from the preset counter 49 is input to the gate control circuit 55, so that the gate 54 opens after the regular address pattern y is detected, and closes otherwise.
上記のようにしてアドレスパターンyは各列ごとに検出
されるものであるが、次にはそれにより検出された信号
および前記クロックパルスによって制御されて前記コー
ドパターンzの検出を行うコードパターン検出回路Zに
ついて説明する。Address pattern y is detected for each column as described above, and next, a code pattern detection circuit detects code pattern z under the control of the detected signal and the clock pulse. Z will be explained.
各列のアドレスパターンyが検出されるごとにパルスを
出力する前記プリセットカウンタ49の上記パルスは、
前記ゲート35を通過した2値電気信号を加えられてい
るゲート56を開くようになっている。The pulse of the preset counter 49, which outputs a pulse every time the address pattern y of each column is detected, is as follows:
A gate 56 to which the binary electric signal passed through the gate 35 is applied is opened.
このゲート56を通過した(すなわち1列のアドレスパ
ターンyの検出後の)上記の2値電気信号は、前記デコ
ーダ39よりのクロックパルスを入力されるマークコン
パレータ57に加えられ、これによって各クロックパル
ス到来の際にマーク(黒)であるかスペース(白)であ
るかの判定が行われ、そのあとシフトレジスタ58によ
って黒白をビット単位とする並列2進電気信号に変換さ
れるようになっている。The above-mentioned binary electrical signal that has passed through this gate 56 (that is, after the detection of one column of address pattern y) is applied to a mark comparator 57 that receives clock pulses from the decoder 39, so that each clock pulse When it arrives, it is determined whether it is a mark (black) or a space (white), and then it is converted by a shift register 58 into a parallel binary electrical signal with black and white as bit units. .
そして、シフトレジスタ58よりの1水平走査ごとの並
列2進電気信号は、奇数、偶数順位選別回路59によっ
て奇数番目と偶数番目とにふり分けられ、ラッチメモリ
600,60Eにそれぞれ記憶されてコンパレータ61
によって比較せられるようになっている。Then, the parallel binary electrical signals from the shift register 58 for each horizontal scan are sorted into odd and even numbers by the odd and even rank sorting circuit 59, and are stored in the latch memories 600 and 60E, respectively, and are sent to the comparator 61.
can be compared by.
このコンパレータ61よりの一致信号はプリセットカウ
ンタ62によって計数され、その数が、第2図に示した
ようにアドレス用の黒パターンとの差である前記α長さ
に相当する数となったときすなわちα時間同じ並列2進
電気信号が続いたときカウンタ62よりパルスかえられ
、そのパルスによってゲート63が開いて、上記ラッチ
メモリ60oに記憶の並列2進電気信号がゲート63を
通って前記アドレスセレクタ51に加えられるようにな
っている。The coincidence signal from the comparator 61 is counted by the preset counter 62, and when the number corresponds to the α length which is the difference from the black pattern for address as shown in FIG. When the same parallel binary electric signal continues for α time, a pulse is changed by the counter 62, the gate 63 is opened by the pulse, and the parallel binary electric signal stored in the latch memory 60o passes through the gate 63 to the address selector 51. can be added to.
なお、上記プリセットカウンタ62よりのパルスは前記
ゲートコントロール回路55にも加えられ、前記ゲート
38を閉じるようになっている。The pulse from the preset counter 62 is also applied to the gate control circuit 55 to close the gate 38.
上記のようにして各列のコードパターンzは検出される
ものであるが、前述のようにアドレスセレクタ51が、
検出したアドレスパターンy(アドレス指示信号)によ
って制御されるにより、各列順次に専用のラッチメモリ
64・・・・・・に指定記憶される。The code pattern z of each column is detected as described above, but as mentioned above, the address selector 51
Under the control of the detected address pattern y (address instruction signal), each column is sequentially designated and stored in the dedicated latch memory 64.
しかして、これらラッチメモリ64・・・・・・に記憶
のデータを適当な時期に読み出し、それを穿孔テープあ
るいは磁気テープ等の外部記録媒体に符号記録しておい
て事後その記録情報を解析することにより、前記映写フ
ィルムCFに記録されていた特定の映像情報が現実に放
送されたか否かを確認できるものである。The data stored in these latch memories 64 is read out at an appropriate time, recorded in code on an external recording medium such as a perforated tape or magnetic tape, and the recorded information is analyzed afterwards. This makes it possible to confirm whether the specific video information recorded on the projection film CF was actually broadcast.
なお、上記実施例において3種のパターンを、1つの駒
に、そのほぼ全域を使って記録したが、その一部分にお
いて記録してもよく、また複数駒に記録してもよい。In the above embodiment, the three types of patterns were recorded on one frame using almost the entire area, but they may be recorded on a portion of the frame, or may be recorded on a plurality of frames.
また、上記のように記録した映写フィルムCFの記録情
報を磁気テープに再生記録すれば、その磁気テープを使
っても上記と同じことが行える。Further, if the information recorded on the projection film CF recorded as described above is reproduced and recorded on a magnetic tape, the same operation as described above can be performed using the magnetic tape.
さらに、黒、白を単位として2進化を行ったが、カラー
放送の場合にはそれ以外の色で2進化を行ってもよい。Furthermore, although the binarization was performed using black and white as units, in the case of color broadcasting, the binarization may be performed using other colors.
以上に述べたところから明らかなとおり、本発明放送事
実自動確認方法は、特定の映像情報を記録した映写フィ
ルムあるいは磁気テープ等の映像情報記録媒体の任意の
1フイールド中に検索用の複数のクロックパターンと、
上記特定の映像情報のコードを特定するコードパターン
とを所定の位置関係にして記録しておき、これら特定の
映像情報、クロックパターン及びコードパターンをテレ
ビジョン送信機にて送信する一方、テレビジョン受信機
が受信した受信信号のなかから上記クロックパターンに
係る信号を検出することによりクロック信号をつくり、
そのクロック信号によって上記コードパターンに係る信
号の索出を行うことにより、上記特定の映像情報のコー
ドを表わす符号情報を得るもので、クロックパターンの
検出を前提としてそれによりコードパターンの索出を行
うとともに、それら両パターンを変動率が同じとなるよ
うに同じ1フイールド中に記録しておくものであるから
、放送事実の確認を正確に行うことができるものである
。As is clear from the above description, the method for automatically confirming broadcasting facts of the present invention uses a plurality of clocks for retrieval in any one field of a video information recording medium such as a projection film or magnetic tape in which specific video information is recorded. pattern and
The code of the specific video information mentioned above is recorded in a predetermined positional relationship with the code pattern that specifies the code, and while the specific video information, clock pattern, and code pattern are transmitted by the television transmitter, the television receiver Create a clock signal by detecting a signal related to the clock pattern from among the received signals received by the machine,
Code information representing the code of the specific video information is obtained by searching the signal related to the code pattern using the clock signal, and the code pattern is searched based on the detection of the clock pattern. In addition, since both of these patterns are recorded in the same field so that the rate of variation is the same, it is possible to accurately confirm the broadcast fact.
また、特許請求の範囲第2項の本発明方法は、上記に加
えさらに、前記コードパターンのアドレス指示を行うア
ドレスパターンを同じフィールド中に記録し、これもま
たクロックパターンの検出を前提として索出を行うとと
もに、それによってコードパターンの索出による符号情
報のアドレス指定を行うようにしたので、受信側の放送
事実確認装置を何ら変更することなく、同じ装置によっ
て多数の放送内容の確認を的確に行うことができるもの
である。Further, in addition to the above, the method of the present invention according to claim 2 further records an address pattern for specifying the address of the code pattern in the same field, and also retrieves it on the premise of detecting a clock pattern. At the same time, the code information can be addressed by searching the code pattern, making it possible to accurately check a large number of broadcast contents using the same device without changing the broadcast fact checking device on the receiving side. It is something that can be done.
図面は本発明の実施例を示すもので、第1図は映写フィ
ルムの一部省略平面図、第2図は上記映写フィルムの駒
のうちの1つを拡大して示すその平面図、第3図は第2
図に示す駒に記録した検索用のクロックパターンを走査
することにより得られる電気信号の波形図、第4,5図
は放送事実自動確認装置のブロックダイヤグラムを示し
、第4図はそのなかのクロックパターン検出回路を、ま
た第5図はアドレスパターン検出回路とコードパターン
検出回路とを示すものである。
CF・・・・・・映写フィルム、x・・・・・・検索用
のクロックパターン、z・・・・・・コードパターン、
y・・・・・・アドレスパターン、TV・・・・・・テ
レビジョン受信機。The drawings show an embodiment of the present invention, and FIG. 1 is a partially omitted plan view of a projection film, FIG. 2 is an enlarged plan view of one of the frames of the projection film, and FIG. 3 is a plan view of the projection film. is the second
The waveform diagram of the electric signal obtained by scanning the search clock pattern recorded on the frame shown in the figure, Figures 4 and 5 show the block diagram of the automatic broadcast fact confirmation device, and Figure 4 shows the clock in it. FIG. 5 shows an address pattern detection circuit and a code pattern detection circuit. CF...Projection film, x...Clock pattern for search, z...Code pattern,
y...address pattern, TV...television receiver.
Claims (1)
気テープ等の映像情報記録媒体の任意の1フイールド中
に、検索用の複数のクロックパターンと、上記特定の映
像情報のコードを特定するコードパターンとを所定の位
置関係にして記録しておき、これら特定の映像情報、ク
ロックパターン及びコードパターンをテレビジョン送信
機にて送信する一方、テレビジョン受信機が受信した受
信信号のなかから上記クロックパターンに係る信号を検
出することによりクロック信号をつくり、そのクロック
信号によって上記コードパターンに係る信号を索出する
ことにより、上記特定の映像情報のコードを表わす符号
情報を得ることを特徴とする放送事実自動確認方法。 2 特定の映像情報を記録した映写フィルムあるいは磁
気テープ等の映像情報記録媒体の任意の1フイールド中
に、検索用の複数のクロックパターンと、上記特定の映
像情報のコードを特定するコードパターンと、このコー
ドパターンのアドレスを指示するアドレスパターンとを
所定の位置関係にして記録しておき、これら特定の映像
情報、クロックパターン、コードパターン及びアドレス
パターンをテレビジョン送信機にて送信する一方、テレ
ビジョン受信機が受信した受信信号のなかから上記クロ
ックパターンに係る信号を検出することによりクロック
信号をつくり、そのクロック信号によって上記コードパ
ターンに係る信号を索出することにより、上記特定の映
像情報のコードを表わす符号情報を得るとともに、同じ
くクロック信号によって上記アドレスパターンに係る信
号を索出することによりアドレス指示信号をえ、このア
ドレス指示信号によって上記符号情報のアドレス指定を
行うことを特徴とする放送事実自動確認方法。[Scope of Claims] 1. A plurality of clock patterns for retrieval and a code of the specific video information are stored in any one field of a video information recording medium such as a projection film or magnetic tape on which specific video information is recorded. The code pattern to be specified is recorded in a predetermined positional relationship, and while the specific video information, clock pattern, and code pattern are transmitted by the television transmitter, the information in the received signal received by the television receiver is A clock signal is generated by detecting a signal related to the clock pattern from the above, and code information representing the code of the specific video information is obtained by searching for a signal related to the code pattern using the clock signal. A method for automatically confirming broadcast facts. 2. In any one field of a video information recording medium such as a projection film or magnetic tape on which specific video information is recorded, a plurality of clock patterns for searching and a code pattern that specifies the code of the specific video information; This code pattern and an address pattern indicating the address are recorded in a predetermined positional relationship, and these specific video information, clock pattern, code pattern, and address pattern are transmitted by a television transmitter. A clock signal is generated by detecting a signal related to the clock pattern from among the received signals received by the receiver, and a code related to the specific video information is detected by searching for a signal related to the code pattern using the clock signal. The broadcasting fact is characterized in that the code information representing the address pattern is obtained, and an address instruction signal is obtained by similarly searching for a signal related to the address pattern using a clock signal, and the address of the code information is specified by this address instruction signal. Automatic confirmation method.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14116174A JPS5810910B2 (en) | 1974-12-10 | 1974-12-10 | how to get rid of it |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14116174A JPS5810910B2 (en) | 1974-12-10 | 1974-12-10 | how to get rid of it |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5168120A JPS5168120A (en) | 1976-06-12 |
| JPS5810910B2 true JPS5810910B2 (en) | 1983-02-28 |
Family
ID=15285540
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14116174A Expired JPS5810910B2 (en) | 1974-12-10 | 1974-12-10 | how to get rid of it |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5810910B2 (en) |
-
1974
- 1974-12-10 JP JP14116174A patent/JPS5810910B2/en not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5168120A (en) | 1976-06-12 |
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