JPS584964B2 - display device - Google Patents
display deviceInfo
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- JPS584964B2 JPS584964B2 JP52098275A JP9827577A JPS584964B2 JP S584964 B2 JPS584964 B2 JP S584964B2 JP 52098275 A JP52098275 A JP 52098275A JP 9827577 A JP9827577 A JP 9827577A JP S584964 B2 JPS584964 B2 JP S584964B2
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Description
【発明の詳細な説明】
この機関は、プラズマ表示器を用いて正負両極性に渡全
範囲のアナログ入力信号の大きさを棒グラフ的に表示す
る表示装置に関する。DETAILED DESCRIPTION OF THE INVENTION This invention relates to a display device that uses a plasma display to display the magnitude of an analog input signal over the entire range of both positive and negative polarities in the form of a bar graph.
この種の表示装置に使用するプラズマ表示器は、アノー
ドとカソードとを放電ガス中に密封し、両電極間に電圧
を加えればその間に放電を起してカソードが点灯するこ
とを利用するもので、表示器のフロントガラス内面に形
成した透明導電膜のアノードに対して表示器のバックシ
ート面に多数のカソードを表示目盛相当位置に対向配列
し、アノードにはアオログ信号レベルに比例した時間幅
のパルス電圧を加え、カソード群には最下位のカソード
から最上位のカソードまで時分割的にローレベル(低い
電圧)を加えることによって点灯するカソードの数をア
ノード信号の時間幅に比例させ、アナログ入力信号の大
きさを棒グラフ的に表示するものである。Plasma displays used in this type of display device utilize the fact that an anode and a cathode are sealed in a discharge gas, and when a voltage is applied between the two electrodes, a discharge is generated between the two electrodes, causing the cathode to light up. , a large number of cathodes are arranged on the back sheet surface of the display device at positions corresponding to the display scale, facing each other to the anode of a transparent conductive film formed on the inner surface of the windshield of the display device, and the anode has a time width proportional to the aolog signal level. By applying a pulse voltage and applying a low level (low voltage) to the cathode group from the lowest cathode to the highest cathode in a time-division manner, the number of cathodes that light up is made proportional to the time width of the anode signal, and analog input This displays the signal magnitude in a bar graph.
このようなプラズマ表示器により正負両極性に渡る範囲
のアナログ入力信号を表示するには、表示面中央を零点
とし、アナログ入力信号の正負に応じて零点から上又は
下のカソード群を入力信号レベルに比例した数だけ点灯
させることで正負も表示するいわゆる零センターの表示
器が考えられる。In order to display an analog input signal with a range of positive and negative polarities using such a plasma display, the center of the display screen is set as the zero point, and the cathode groups above or below the zero point are set to the input signal level depending on the positive or negative polarity of the analog input signal. A so-called zero-center indicator can be considered, which also displays positive and negative values by lighting a number proportional to .
ところで、プラズマ表示器にはカソードの駆動が簡単に
なるセルフスキャン型のものがある。By the way, some plasma display devices are of a self-scan type, which makes it easy to drive the cathode.
このセルフスキャン型プラズマ表示器は、複数のカソー
ドにその点灯のためのパルス電圧を加えるにおいても既
に点灯しているカソードに隣接するカソードのみを点灯
させ得る放電の移行を利用し、隣接するカソードは互い
に異なるグループに属するようにカソード群のグループ
分けをし、同じグループのカソード群は共通カソード端
子として引出し、グループ毎のカソード端子を順次駆動
することでカソード群の下位から上位まで時分割的に点
灯させることができる。This self-scanning plasma display utilizes a discharge transition that allows only the cathodes adjacent to the already lit cathodes to light up even when a pulse voltage is applied to multiple cathodes for lighting. By dividing the cathodes into groups so that they belong to different groups, pulling out the cathodes of the same group as a common cathode terminal, and sequentially driving the cathode terminals of each group, the cathode groups are lit in a time-divisional manner from the lower to the upper. can be done.
これにより、カソードはその外部引出し端子を最小3端
子にでき、その駆動回路も3相のパルス電圧を発生する
簡単な構成になる。As a result, the cathode can have a minimum of three external lead-out terminals, and its drive circuit can also have a simple configuration that generates three-phase pulse voltages.
このようなセルフスキャン型プラズマ表示器で上記の零
センター表示器を構成するには特殊な表示器、駆動回路
を必要とし、コスト高となる問題があった。In order to construct the above-mentioned zero center display using such a self-scan type plasma display, a special display and drive circuit are required, resulting in a problem of high cost.
この発明の目的は、一般的なセルフスキャン型プラズマ
表示器を使用して入力信号の正負極性も表示でき、さら
に後に示す効果も得られる表示装置を提供するにある。An object of the present invention is to provide a display device that can display both the positive and negative polarities of an input signal using a general self-scan type plasma display, and can also obtain the effects described later.
この発明においては、セルフスキャン型プラズマ表示器
にて入力信号の絶対値を表示し、表示器の近傍に備える
極性符号表示器にて入力信号の正。In this invention, a self-scan type plasma display displays the absolute value of the input signal, and a polarity sign display provided near the display indicates the positive value of the input signal.
負を符号表示するようにしたものである。Negative values are displayed as signs.
以下、図面を参照してこの発明の詳細な説明する。Hereinafter, the present invention will be described in detail with reference to the drawings.
第1図はこの発明における表示部の一実施例を示す。FIG. 1 shows an embodiment of the display section in this invention.
プラズマ表示器Dpはセルフスキャン型とし、カソード
の最下位を入力信号レベル0%、最上位を入力信号レベ
ル100%とし、入力信号レベルに比例した数のカソー
ドを点灯させることで入力信号の絶対値を棒グラフ表示
する。The plasma display Dp is a self-scanning type, with the input signal level at 0% at the lowest level of the cathode and 100% at the highest level, and the absolute value of the input signal is determined by lighting the number of cathodes proportional to the input signal level. Display as a bar graph.
極性符号表示器Dpcはプラズマ表示器DP近傍に配置
した正極性表示体Dpc十と負極性表示体DPウーO一
方を発光させることで入力信号の極性表示をする。The polarity code display Dpc displays the polarity of the input signal by causing one of the positive polarity display Dpc and the negative polarity display DP0 disposed near the plasma display DP to emit light.
この極性符号表示器Dpcとしては発光ダイオード等の
発光素子を使用できるが、プラズマ表示器DP自体に極
性符号表示器を備えるものにもできる。A light emitting element such as a light emitting diode can be used as the polarity code display Dpc, but the plasma display DP itself can be provided with a polarity code display.
すなわち、プラズマ表示器には極性符号形状に構成した
カソード及びこのカソードに対向させたアノード(絶対
値表示のアノードと一体)を備え、入力信号の極性に応
じて該カソードを選択駆動することで極性表示できる。That is, the plasma display is equipped with a cathode configured in the shape of a polarity code and an anode (integrated with the anode for absolute value display) opposed to the cathode, and the polarity can be determined by selectively driving the cathode according to the polarity of the input signal. Can be displayed.
また、極性符号を(+)と(−)にする場合は複数のカ
ソードで(+)形状に構成し、カソードの選択駆動で(
+)表示と(−)表示を切換えることもできる。In addition, when setting the polarity sign to (+) and (-), configure the (+) shape with multiple cathodes, and selectively drive the cathodes (
It is also possible to switch between +) display and (-) display.
これは、発光ダイオード等を使用した表示器の場合にも
同等に適用できる。This can equally be applied to a display using a light emitting diode or the like.
第2図はこの発明における駆動部の一実施例を示す。FIG. 2 shows an embodiment of the drive section in this invention.
2重積分型アナログーデジタル変換器ADは、第5図に
示すように、積分器1、コンパレータ2、カウンタ3、
スイッチ駆動回路4を内蔵している。As shown in FIG. 5, the double integration type analog-to-digital converter AD includes an integrator 1, a comparator 2, a counter 3,
It has a built-in switch drive circuit 4.
内蔵のカウンタ3は端子fを通してクロック発生器CL
Kからのクロックを計数する。Built-in counter 3 is connected to clock generator CL through terminal f.
Count the clocks from K.
カウンタ3が変換開始から一定計数値に達するまでの一
定時間TMは内蔵のスイッチ駆動回路40制御出力で端
子すを介してスイッチ素子S。A certain period of time TM from the start of conversion until the counter 3 reaches a certain count value is a control output of a built-in switch drive circuit 40 and is connected to a switch element S via a terminal.
をONさせる。Turn on.
これにより、内蔵の積分器1はTM時間だけアナログ入
力信号Einを抵抗R6および端子aを通して積分する
。As a result, the built-in integrator 1 integrates the analog input signal Ein for the time TM through the resistor R6 and the terminal a.
積分器1の出力にはコンパレータ2を接続しており、コ
ンパレータ2は零電位と積分器1の出力を比較し、アナ
ログ入力信号Einの極性の正、負を判別し、その信号
をスイッチ駆動回路4に導へスイッチ駆動回路4はアナ
ログ入力信号Einの正負判別信号に応じて一定時間T
M時間積分の後に端子d又はeを介してスイッチ素子S
1又はS2をON、端子すを介してスイッチ素子S。A comparator 2 is connected to the output of the integrator 1, and the comparator 2 compares the zero potential with the output of the integrator 1, determines whether the polarity of the analog input signal Ein is positive or negative, and sends the signal to the switch drive circuit. 4. The switch drive circuit 4 operates for a certain period of time T in accordance with the positive/negative determination signal of the analog input signal Ein.
After M time integration, switch element S is connected via terminal d or e.
1 or S2 is turned on, and the switch element S is connected through the terminal.
をOFFにし、アナログ入力信号Einとは逆極性の基
準電圧+Es又は−Esを抵抗R1又はR2および端子
Cを通して積分器1の積分入力にする。is turned OFF, and the reference voltage +Es or -Es, which has the opposite polarity to the analog input signal Ein, is applied to the integration input of the integrator 1 through the resistor R1 or R2 and the terminal C.
これにより、積分器1の出力は、第3図Iに示す如く、
アナログ入力信号EinのTM時間積分値から零点に向
かった減算積分になり、零電位に達したことをコンパレ
ータ2が検出する。As a result, the output of the integrator 1 is as shown in FIG.
The comparator 2 detects that the TM time integral value of the analog input signal Ein is subtracted and integrated toward the zero point, and that the zero potential has been reached.
この検出でスイッチ駆動回路4はスイッチ素子Sl又は
S2をOFFにし、スイッチ素子S。Upon this detection, the switch drive circuit 4 turns off the switch element Sl or S2, and turns off the switch element S.
をONにして再びアナログ入力信号Einの積分を開始
する。is turned ON to start integrating the analog input signal Ein again.
同時に、カウンタ3は一定時間TMの出力を得るための
クロック計数を端子fを介して開始する。At the same time, the counter 3 starts clock counting via the terminal f to obtain the output of TM for a certain period of time.
従って、入力信号EinのTM時間積分終了時点−から
コンパレータ2の零検出までの積分時間Txはアナログ
入力信号Einの大きさに比例する。Therefore, the integration time Tx from the end of the TM time integration of the input signal Ein to the zero detection of the comparator 2 is proportional to the magnitude of the analog input signal Ein.
この時間TxはスイッチS1又はS2がONする時間に
相当し、従ってスイッチ駆動回路4かもアナログ−デジ
タル変換器AD出力として端子gを介して積分時間Tx
の時間幅のパルスが出力され、このパルスがアノードド
ライバDAを通してプラズマ表示器DPのアノード電圧
に加えられる。This time Tx corresponds to the time when the switch S1 or S2 is turned on, and therefore the switch drive circuit 4 also outputs the analog-to-digital converter AD through the terminal g for the integration time Tx.
A pulse having a time width of is output, and this pulse is applied to the anode voltage of the plasma display DP through the anode driver DA.
なな、第3図So、Sl、S2は夫々スイッチ素子S。In Fig. 3, So, Sl, and S2 are switch elements S, respectively.
、Sl。S2のON、OFF状態を示す。, Sl. The ON and OFF states of S2 are shown.
一方、クロック発生器CLKのクロックは変換器Fの入
力にし、変換器Fにおいてプラズマ表示器DPのカソー
ド端子数Nに応じたN相のクロックに変換する。On the other hand, the clock of the clock generator CLK is input to the converter F, and the converter F converts it into an N-phase clock corresponding to the number N of cathode terminals of the plasma display DP.
このN相のクロックはカソードドライバDKを通してプ
ラズマ表示器DPのグループ分けしたカソードを順次ド
ライブする。This N-phase clock sequentially drives the grouped cathodes of the plasma display DP through the cathode driver DK.
従ってプラズマ表示器DPは第3図Kに示す如く、アノ
ード電圧が加えられる時間すなわちTx待時間はアナロ
グ入力信号Einに比例した数のカソードが点灯してE
inの絶対値を棒グラフ表示できる。Therefore, in the plasma display DP, as shown in FIG.
The absolute value of in can be displayed as a bar graph.
極性表示は、アナログ−デジタル変換器ADの端子d又
はeには入力信号Einの極性に応じてスイッチ素子S
1又はS2をONさせるための信号が出力されるので、
この信号を抵抗R3,R4を通して極性表示用の発光素
子(図示の場合は発光ダイオード)Dpc+又はDpc
−を点灯させることでできる。The polarity is indicated by a switch element S at the terminal d or e of the analog-to-digital converter AD depending on the polarity of the input signal Ein.
Since the signal to turn on 1 or S2 is output,
This signal is passed through resistors R3 and R4 to a light emitting element (light emitting diode in the case shown) for polarity display Dpc+ or Dpc.
This can be done by lighting -.
なお、プラズマ表示器DPでの表示を入力信号Einの
極性に応じて指示スパンを変更させるには、基準電圧+
Es又は−Esの値を所望のスパンに応じたものにする
こと、又は抵抗R1又はR2の抵抗値を変えることでで
きる。Note that in order to change the display span on the plasma display DP according to the polarity of the input signal Ein, the reference voltage +
This can be done by changing the value of Es or -Es depending on the desired span, or by changing the resistance value of resistor R1 or R2.
第4図は指示スパンをl:2にする場合を示し、正負極
性に応じたスケールにしている。FIG. 4 shows a case where the instruction span is set to 1:2, and the scale is set according to positive and negative polarities.
以上説明した如く、この発明はセルフスキャン型プラズ
マ表示器で入力信号の絶対値を棒グラフ表示し、極性符
号表示器で入力信号の極性表示をするため、プラズマ表
示器の駆動回路が簡単になるし、通常のプラズマ表示器
を使用できそのコストダウンを図れる。As explained above, the present invention uses a self-scan type plasma display to display the absolute value of an input signal as a bar graph, and uses a polarity code display to display the polarity of the input signal, which simplifies the drive circuit for the plasma display. , an ordinary plasma display can be used, and its cost can be reduced.
また、零センター表示器に比べて入力信号のフルスケー
ルが倍になり、その指示精度(単位長あたりのカソード
数で決まる)を上げることができること、もしくは同じ
指示精度で表示量の読み取りが容易になる効果がある。In addition, the full scale of the input signal is doubled compared to the zero center display, making it possible to increase its indication accuracy (determined by the number of cathodes per unit length), or to make it easier to read the displayed amount with the same indication accuracy. There is a certain effect.
第1図はこの発明における表示部の一実施例を示す図、
第2図はこの発明における駆動部の一実施例を示すブロ
ック図、第3図は第2図の動作を説明するためのタイム
チャート、第4図はこの発明における表示部の他の実施
例を示す図、第5図は本発明の要部の具体例を示す回路
図である。
DP:プラズマ表示器、Dpc:極性符号表示器、AD
:アナログ−デジタル変換器、DAニアノートドライバ
、DK:カソードドライバ、CLK:クロック発生器、
F:変換器。FIG. 1 is a diagram showing an embodiment of the display section in this invention,
FIG. 2 is a block diagram showing one embodiment of the driving section in this invention, FIG. 3 is a time chart for explaining the operation of FIG. 2, and FIG. 4 is a block diagram showing another embodiment of the display section in this invention. The figure shown in FIG. 5 is a circuit diagram showing a specific example of the main part of the present invention. DP: Plasma display, Dpc: Polarity code display, AD
:Analog-digital converter, DA near note driver, DK: cathode driver, CLK: clock generator,
F: Converter.
Claims (1)
置に配列し、アノードにはアナログ入力信号に比例した
時間幅のパルス電圧を加え、カソード群には下位のカソ
ードから上位のカソードまでその点灯のための電圧を順
次印加することでアナログ入力信号の大きさを棒グラフ
的に表示できるセルフスキャン型プラズマ表示器DPと
、このプラズマ表示器の近傍に配置されアナログ入力信
号の極性を表示できる極性符号表示器Dpcと、アナロ
グ入力信号Einおよび正極性の第1基準信号十Esま
たは負極性の第2基準信号−Esがそれぞれスイッチ素
子S。 、Sl、S2を介して与えられて、初めにアナログ入力
信号の積分を行ない、その後それとは逆極性に第1基準
信号または第2基準信号の積分を行なう積分器1と、こ
の積分器出力を零電位と比較してアナログ入力信号の正
負判別信号を出力するコンパレータ2と、このコンパレ
ータ出力に基づき、アナログ入力信号とは逆極性の第1
基準信号または第2基準信号が前記積分器に与えられる
ように前記スイッチ素子を制御するスイッチ駆動回路4
と、前記積分器出力が零電位に達したら前記コンパレー
タ出力に基づいてクロックの計数を開始し、計数値が一
定計数値に達するまでの一定時間TM、前記スイッチ駆
動回路を介して前記積分器にアナログ入力信号が与えら
れるようにするカウンタ3と、前記クロックを多相タロ
ツクに変換して前記プラズマ表示器のカソードに印加す
る変換器Fとを備え、前記積分器に第1基準信号または
第2基準信号が与えられている時間Txに相当する時間
幅のパルスを前記プラズマ表示器のアノードに供給して
前記プラズマ表示器にはアナログ入力信号の絶対値を表
示させ、かつ、前記第1基準信号または第2基準信号を
前記積分器に供給させるための前記スイッチ駆動回路出
力を前記極性符号表示器に与えて前記アナログ入力信号
の極性を表示させるようにしたことを特徴と干る表示装
置。[Claims] 1. A large number of cathodes are arranged at positions corresponding to the display scale, and a pulse voltage with a time width proportional to the analog input signal is applied to the anode. There is a self-scanning plasma display DP that can display the magnitude of an analog input signal in a bar graph by sequentially applying the voltage for lighting up to the cathode, and a self-scanning plasma display DP that can display the polarity of the analog input signal by placing it near the plasma display. A polarity sign indicator Dpc that can be displayed, an analog input signal Ein and a first reference signal 10Es of positive polarity or a second reference signal -Es of negative polarity are respectively connected to the switch element S. , Sl, S2, which first integrates the analog input signal and then integrates the first reference signal or the second reference signal with the opposite polarity thereto; A comparator 2 outputs a signal for determining whether the analog input signal is positive or negative by comparing it with zero potential, and a first comparator whose polarity is opposite to that of the analog input signal based on the comparator output.
a switch drive circuit 4 that controls the switch element so that a reference signal or a second reference signal is provided to the integrator;
When the integrator output reaches zero potential, clock counting is started based on the comparator output, and for a certain time TM until the count value reaches a constant count value, the clock is applied to the integrator via the switch drive circuit. a counter 3 for receiving an analog input signal; and a converter F for converting the clock into a multi-phase clock and applying it to the cathode of the plasma display; A pulse having a time width corresponding to the time Tx during which the reference signal is applied is supplied to the anode of the plasma display to display the absolute value of the analog input signal on the plasma display, and the first reference signal Alternatively, the display device is characterized in that the output of the switch driving circuit for supplying the second reference signal to the integrator is applied to the polarity sign display to display the polarity of the analog input signal.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52098275A JPS584964B2 (en) | 1977-08-18 | 1977-08-18 | display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52098275A JPS584964B2 (en) | 1977-08-18 | 1977-08-18 | display device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5433056A JPS5433056A (en) | 1979-03-10 |
| JPS584964B2 true JPS584964B2 (en) | 1983-01-28 |
Family
ID=14215378
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52098275A Expired JPS584964B2 (en) | 1977-08-18 | 1977-08-18 | display device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS584964B2 (en) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5842957B2 (en) * | 1979-03-12 | 1983-09-22 | 日本碍子株式会社 | Positive characteristic porcelain heating element |
| JPS551075A (en) * | 1979-03-19 | 1980-01-07 | Ngk Insulators Ltd | Positive characteristic porcelain heater |
| JPS61142064U (en) * | 1985-02-22 | 1986-09-02 | ||
| JPH0451816Y2 (en) * | 1986-03-14 | 1992-12-07 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS525555A (en) * | 1975-07-02 | 1977-01-17 | Automob Antipollut & Saf Res Center | Device for indicating temperature |
-
1977
- 1977-08-18 JP JP52098275A patent/JPS584964B2/en not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5433056A (en) | 1979-03-10 |
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