JPS6150243B2 - - Google Patents
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- JPS6150243B2 JPS6150243B2 JP54086268A JP8626879A JPS6150243B2 JP S6150243 B2 JPS6150243 B2 JP S6150243B2 JP 54086268 A JP54086268 A JP 54086268A JP 8626879 A JP8626879 A JP 8626879A JP S6150243 B2 JPS6150243 B2 JP S6150243B2
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- Tests Of Electronic Circuits (AREA)
- Testing Or Calibration Of Command Recording Devices (AREA)
- Testing Of Individual Semiconductor Devices (AREA)
Description
【発明の詳細な説明】
本発明はヒステリシス特性を有する被測定回路
のヒステリシスレベルを測定するヒステリシスレ
ベル測定回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a hysteresis level measuring circuit that measures the hysteresis level of a circuit under test having hysteresis characteristics.
従来のこの種の回路の一例を第1図に示し説明
すると、図において、1はプログラムによる電圧
の発生源であるプログラム電源、2はプログラム
電源1のプログラム値を出力状態により+α、−
αする加減命令回路、3はプログラム電源1に対
し初期値を設定する基準設定回路、4はプログラ
ム電源1の値を記憶する記憶回路、5は記憶回路
4の値を数種計算(主に減算)する演算回路、6
は演算回路5の値を判定するGO/NG判定回路、
7はヒステリシス特性を有する被測定回路(デバ
イス)である。 An example of a conventional circuit of this type is shown in FIG. 1 and will be explained. In the figure, 1 is a program power source which is a source of voltage generated by the program, and 2 is a program value of the program power source 1, which is +α, - depending on the output state.
3 is a reference setting circuit that sets the initial value for the program power source 1, 4 is a memory circuit that stores the value of the program power source 1, and 5 is a memory circuit that calculates several values of the memory circuit 4 (mainly by subtraction). ) arithmetic circuit, 6
is a GO/NG judgment circuit that judges the value of the arithmetic circuit 5;
7 is a circuit (device) to be measured having hysteresis characteristics.
つぎにこの測定回路の動作について説明する。
まず、基準設定回路3よりプログラム電源1に初
期値のデータが送られる。そして、プログラム電
源1では、このデータをアナログ電圧に変換し、
デバイス7に供給する。つぎに、デバイス7の出
力の変化がなければ、加減命令回路2よりプログ
ラム電源1に+αの増加命令が送られる。これに
よりプログラム電源1は、+α増加させたアナロ
グ電圧をデバイス7に供給する。そして、デバイ
ス7の出力の変化があるまで、これを繰返す。 Next, the operation of this measuring circuit will be explained.
First, initial value data is sent from the reference setting circuit 3 to the program power supply 1. Then, the program power supply 1 converts this data into an analog voltage,
Supplied to device 7. Next, if there is no change in the output of the device 7, an increase command of +α is sent from the addition/subtraction command circuit 2 to the program power supply 1. As a result, the program power supply 1 supplies the analog voltage increased by +α to the device 7. This is then repeated until there is a change in the output of the device 7.
つぎに、出力の変化がおこると、そのときのプ
ログラム電源1の出力値を記憶回路4に記憶す
る。(MEMO1)、ここで、この記憶命令は加減命
令回路2より発生する。また、この加減命令回路
2からプログラム電源1に送られる命令が+αか
ら−αに変更される。そして、デバイス7の出力
の変化があるまで前述の+αを−αに変更したも
のを繰り返す。 Next, when a change in the output occurs, the output value of the program power supply 1 at that time is stored in the storage circuit 4. (MEMO1) Here, this storage command is generated from the addition/subtraction command circuit 2. Further, the command sent from the addition/subtraction command circuit 2 to the program power source 1 is changed from +α to -α. Then, the above-described process with +α changed to -α is repeated until there is a change in the output of the device 7.
しかして、出力の変化がおこると、そのときの
プログラム電源1の出力電圧値を再び記憶回路4
に記憶する(MEMO2)。そして、演算回路5で
MEMO1−MEMO2の減算を行ない、ヒステリシ
ス値を出力する。そして、そのヒステリシス値を
判定する場合には、GO/NG判定回路6で行な
う。第2図はその入出力パターン例を示す説明図
で、ΔVはヒステリシス値である。 When a change in the output occurs, the output voltage value of the program power supply 1 at that time is stored again in the memory circuit 4.
(MEMO2). Then, in the arithmetic circuit 5
Subtracts MEMO1 - MEMO2 and outputs the hysteresis value. Then, when determining the hysteresis value, the GO/NG determination circuit 6 performs the determination. FIG. 2 is an explanatory diagram showing an example of the input/output pattern, and ΔV is a hysteresis value.
しかしながら、このような構成の回路において
は、附属回路が複雑になり易く、故障および誤動
作がおこりやすいという欠点があつた。また、入
力を供給した後、出力をみなければならなかつた
ため時間がかかり、ノイズ等にも弱いという欠点
を有している。さらに、加減命令回路により与え
られる+αの値が大きければ、誤差が大きく、ま
た、小さくすれば無用に時間がかかるという欠点
があつた。 However, a circuit with such a configuration has the drawback that the auxiliary circuits tend to be complicated, and failures and malfunctions are likely to occur. Further, it has the disadvantage that it takes time to see the output after supplying the input, and it is susceptible to noise. Furthermore, if the value of +α given by the addition/subtraction command circuit is large, the error will be large, and if it is made small, it will take unnecessary time.
本発明は以上の点に鑑み、このような欠点を除
去すべくなされたもので、その目的は回路を簡略
化すると共に測定の安定化を図り得るヒステリシ
スレベル測定回路を供給することにある。 In view of the above points, the present invention has been made to eliminate such drawbacks, and its purpose is to provide a hysteresis level measuring circuit that can simplify the circuit and stabilize the measurement.
このような目的を達成するために、本発明は、
吹出形定電流源と、吸込形定電流源と、被測定回
路の出力により制御され最初に吹出形定電流源の
出力を選択し被測定回路の出力が増加方向へ変化
したとき吸込形定電流源を選択し被測定回路の出
力が減少方向へ変化したときに吹出形定電流源の
出力を再度選択しこれらの選択動作を反復する出
力切換回路と、この出力切換回路を介する吹出形
定電流源からの定電流により充電されかつ吸込形
定電流源へ通ずる定電流により放電するコンデン
サを備えこのコンデンサの端子電圧を被測定回路
の入力へ与える時定数回路と、被測定回路のヒス
テリシスレベルによつて定まる出力変化周波数を
計測する周波数カウンタとを設け、ヒステリシス
値を周波数に変換して測定するようにしたもの
で、以下、図面に基づき本発明の実施例を詳細に
説明する。 In order to achieve such an objective, the present invention
Controlled by the output of the blow-out type constant current source, the suction type constant current source, and the circuit under test, the output of the blow-out type constant current source is selected first, and when the output of the circuit under test changes in the increasing direction, the suction type constant current an output switching circuit that selects a source, selects the output of the blow-out type constant current source again when the output of the circuit under test changes in a decreasing direction, and repeats these selection operations; It has a capacitor that is charged by a constant current from the source and discharged by a constant current flowing to the sink type constant current source, and a time constant circuit that applies the terminal voltage of this capacitor to the input of the circuit under test, and a hysteresis level of the circuit under test. Embodiments of the present invention will be described in detail below with reference to the drawings.
第3図は本発明によるヒステリシスレベル測定
回路の一実施例を示すブロツク図である。第3図
において第1図と同一符号のものは相当部分を示
し、8はデバイス7に電圧を供給するバツフア電
源、9は三角波を発生するためのコンデンサCお
よび抵抗Rを備える時定数回路、10は出力状態
により吸込形定電流源11または吹出形定電流源
12を時定数回路9に接続する出力切換回路、1
3はデバイス7からのヒステリシスレベルによつ
て定まる出力outの周波数を計数する周波数カウ
ンタで、この計数値がヒステリシス値となる。 FIG. 3 is a block diagram showing an embodiment of a hysteresis level measuring circuit according to the present invention. In FIG. 3, the same symbols as in FIG. 1 indicate corresponding parts, 8 is a buffer power supply that supplies voltage to the device 7, 9 is a time constant circuit including a capacitor C and a resistor R for generating a triangular wave, 10 1 is an output switching circuit that connects the suction type constant current source 11 or the blowout type constant current source 12 to the time constant circuit 9 depending on the output state;
3 is a frequency counter that counts the frequency of the output out determined by the hysteresis level from the device 7, and this counted value becomes the hysteresis value.
第4図は第3図の動作説明に供する入出力パタ
ーン例を示す説明図で、AAは入力例を示し、
BBは入力例を示す。CCはAAに対する出力を
示したものであり、DDはBBに対する出力を示し
たものである。 FIG. 4 is an explanatory diagram showing an example of an input/output pattern for explaining the operation of FIG. 3, where AA indicates an example of input,
BB shows an input example. CC indicates the output for AA, and DD indicates the output for BB.
つぎに第3図に示す実施例の動作を第4図を参
照して説明する。 Next, the operation of the embodiment shown in FIG. 3 will be explained with reference to FIG. 4.
第3図において、出力切換回路10は、最初に
吹出形定電流源12の出力を選択しており、これ
からの定電流を時定数回路9へ与えるため、抵抗
RとコンデンサCとによる時定数に応じてコンデ
ンサCが充電され、コンデンサCの端子電圧が次
第に上昇し、この端子電圧が直流増幅器等を用い
たバツフア電源8を介し、デバイス7の入力IN
へ与えられる。 In FIG. 3, the output switching circuit 10 first selects the output of the blowout type constant current source 12, and in order to supply the constant current from now on to the time constant circuit 9, the output switching circuit 10 selects the output of the constant current source 12. Accordingly, the capacitor C is charged, the terminal voltage of the capacitor C gradually rises, and this terminal voltage is applied to the input IN of the device 7 via the buffer power supply 8 using a DC amplifier or the like.
given to.
入力INの電圧が第4図イのとおり上昇し、ロ
において出力CCが増加方向へ変化すると、これ
に応じて出力切換回路10が今度は吸込形定電流
源11を選択するため、これへ通ずる定電流によ
りコンデンサCや充電々荷の放電を開始し、これ
の端子電圧が次第に低下し、入力INの電圧もハ
のとおり低下する。 When the voltage at the input IN increases as shown in Figure 4 (A) and the output CC changes in the increasing direction in (B), the output switching circuit 10 selects the sink type constant current source 11 in response to this, so this is the case. The constant current starts discharging the capacitor C and the charges, and the terminal voltage of this gradually decreases, and the input IN voltage also decreases as shown in C.
入力INの電圧が低下しニへ達すると、出力CC
が減少方向へ変化するため、これに応じて出力切
換回路10が再度吹出形定電流源12をを選択す
るものとなり、これによつてコンデンサCの充電
が再開され、これの端子電圧が上昇を開始し、入
力INの電圧もホのとおり上昇する。 When the input IN voltage drops and reaches D, the output CC
changes in the decreasing direction, so the output switching circuit 10 selects the blow-out type constant current source 12 again in response to this, and as a result, charging of the capacitor C is restarted, and the terminal voltage of the capacitor C is prevented from rising. The input IN voltage also rises as shown in E.
したがつて、出力OUTの変化に応じて出力切
換回路10が以上の動作を反復するため、入力
INの電圧は三角波状となり、これと対応して出
力OUTの変化はパルス状となることにより、出
力OUTの変化周波数を周波数カウンタ13によ
り計測し、これによつて求めた周波数から周期
1/を求めれば、第4図により明らかなとおり
1/のほゞ1/2がヒステリシス値ΔVとなる。 Therefore, since the output switching circuit 10 repeats the above operation according to the change in the output OUT, the input
The voltage at IN becomes a triangular wave, and correspondingly, the change in the output OUT becomes a pulse. Therefore, the change frequency of the output OUT is measured by the frequency counter 13, and the period 1/ is calculated from the frequency determined by this. If determined, the hysteresis value ΔV will be approximately 1/2, as is clear from FIG.
なお、この演算はGO,NG判定回路6により行
なえばよく、デバイス7の特性に応じ、入力BB
および出力DDのとおりになつた場合も同様とな
る。すなわち、正確には
ΔV=1/2α1/
となる。ここで、αは時定数回路9で決まる値、
は周波数である。 Note that this calculation may be performed by the GO/NG judgment circuit 6, and depending on the characteristics of the device 7, the input BB
The same applies if the output is as shown in DD. That is, to be exact, ΔV=1/2α1/. Here, α is a value determined by the time constant circuit 9,
is the frequency.
このようにして、ヒステリシス特性を持つ被測
定物のヒステリシスレベルを測定することができ
る。 In this way, the hysteresis level of the object to be measured having hysteresis characteristics can be measured.
以上の説明から明らかなように、本発明によれ
ば、一回測定が多回測定になるため、精度は高く
また、ノイズ等にも強くなり、さらに、回路構成
が簡素化されるので経済的に有効である。 As is clear from the above explanation, according to the present invention, since one measurement becomes multiple measurements, the accuracy is high and it is resistant to noise etc. Furthermore, the circuit configuration is simplified, so it is economical. It is effective for
第1図は従来のヒステリシスレベル測定回路の
一例を示すブロツク図、第2図は第1図の動作説
明に供する入出力パターン例を示す説明図、第3
図は本発明によるヒステリシスレベル測定回路の
一実施例を示すブロツク図、第4図は第3図の動
作説明に供する入出力パターン例を示す説明図で
ある。
7……デバイス、8……バツフア電源、9……
時定数回路、10……出力切換回路、11……吸
込形定電流源、12……吹出形定電流源、13…
…周波数カウンタ。
FIG. 1 is a block diagram showing an example of a conventional hysteresis level measuring circuit, FIG. 2 is an explanatory diagram showing an example of an input/output pattern to explain the operation of FIG. 1, and FIG.
FIG. 4 is a block diagram showing an embodiment of the hysteresis level measuring circuit according to the present invention, and FIG. 4 is an explanatory diagram showing an example of an input/output pattern for explaining the operation of FIG. 3. 7...Device, 8...Buffer power supply, 9...
Time constant circuit, 10...Output switching circuit, 11...Suction type constant current source, 12...Blowout type constant current source, 13...
...Frequency counter.
Claims (1)
ヒステリシスレベルを測定する回路において、吹
出形定電流源と、吸込形定電流源と、前記被測定
回路の出力により制御され最初に前記吹出形定電
流源の出力を選択し前記被測定回路の出力が増加
方向へ変化したとき前記吸込形定電流源を選択し
前記被測定回路の出力が減少方向へ変化したとき
に前記吹出形定電流源の出力を再度選択しこれら
の選択動作を反復する出力切換回路と、該出力切
換回路を介する前記吹出形定流電源からの定電流
により充電されかつ前記吸込形定電流源へ通ずる
定電流により放電するコンデンサを備え該コンデ
ンサの端子電圧を前記被測定回路の入力へ与える
時定数回路と、前記被測定回路のヒステリシスレ
ベルによつて定まる出力変化周波数を計測する周
波数カウンタとを設けたことを特徴とするヒステ
リシスレベル測定回路。1. In a circuit for measuring the hysteresis level of a circuit under test having hysteresis characteristics, a blow-out type constant current source, a suction type constant current source, and an output of the blow-out type constant current source controlled by the output of the circuit under test are first set. When the output of the circuit under test changes in the increasing direction, the suction type constant current source is selected, and when the output of the circuit under test changes in the decreasing direction, the output of the blowing type constant current source is changed again. an output switching circuit that selects and repeats these selection operations; and a capacitor that is charged by a constant current from the blow-out type constant current power source via the output switching circuit and discharged by a constant current passed to the suction type constant current source. A hysteresis level measurement characterized by comprising: a time constant circuit that applies the terminal voltage of the capacitor to the input of the circuit under test; and a frequency counter that measures an output change frequency determined by the hysteresis level of the circuit under test. circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8626879A JPS5610207A (en) | 1979-07-06 | 1979-07-06 | Hysteresis level measuring circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8626879A JPS5610207A (en) | 1979-07-06 | 1979-07-06 | Hysteresis level measuring circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5610207A JPS5610207A (en) | 1981-02-02 |
| JPS6150243B2 true JPS6150243B2 (en) | 1986-11-04 |
Family
ID=13882064
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8626879A Granted JPS5610207A (en) | 1979-07-06 | 1979-07-06 | Hysteresis level measuring circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5610207A (en) |
-
1979
- 1979-07-06 JP JP8626879A patent/JPS5610207A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5610207A (en) | 1981-02-02 |
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