JPS6247031B2 - - Google Patents
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- JPS6247031B2 JPS6247031B2 JP53122593A JP12259378A JPS6247031B2 JP S6247031 B2 JPS6247031 B2 JP S6247031B2 JP 53122593 A JP53122593 A JP 53122593A JP 12259378 A JP12259378 A JP 12259378A JP S6247031 B2 JPS6247031 B2 JP S6247031B2
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Description
【発明の詳細な説明】
本発明は、テレビジヨン受信機の水平励振回路
に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a horizontal excitation circuit for a television receiver.
励振トランスを使用しない従来の水平励振回路
を第1図に、その動作電圧電流波形を第3図に示
す。 FIG. 1 shows a conventional horizontal excitation circuit that does not use an excitation transformer, and FIG. 3 shows its operating voltage and current waveforms.
励振トランジスタ1のベースに発振出力電圧a
を印加することにより出力トランジスタ2にベー
ス電流bを流しコレクタ電流cをスイツチングし
水平出力回路を動作させている。この時出力トラ
ンジスタ2のコレクタには、帰線パルスdが発生
している。 The oscillation output voltage a is applied to the base of the excitation transistor 1.
By applying , the base current b flows through the output transistor 2 and the collector current c is switched, thereby operating the horizontal output circuit. At this time, a retrace pulse d is generated at the collector of the output transistor 2.
通常出力トランジスタ2のベースには、コンデ
ンサ3と抵抗4を並列に接続したベース電流波形
成形回路が接続される。これは、出力トランジス
タ2を導通状態に励振する期間(t1〜t2)に、順方
向ベース電流(第3図bのI1で代表される)を充
分大きくとつて出力トランジスタ2の飽和電圧を
低くするためにベース抵抗4があり、また、出力
トランジスタ2を導通状態から遮断状態に励振す
る時に逆方向ベース電流(第3図bの−I2で代表
される)を流し、蓄積時間(t2〜t3)を短かく遮断
特性を改善するとともに、帰線パルス発生期間中
に出力トランジスタ2のベースエミツタ間を逆バ
イアスにするために、ベースコンデンサ3があ
る。 Normally, a base current waveform shaping circuit including a capacitor 3 and a resistor 4 connected in parallel is connected to the base of the output transistor 2. This is achieved by making the forward base current (represented by I 1 in Figure 3b) sufficiently large during the period (t 1 to t 2 ) in which the output transistor 2 is driven into a conductive state so as to reduce the saturation voltage of the output transistor 2. There is a base resistor 4 in order to reduce the storage time ( A base capacitor 3 is provided in order to shorten time (t 2 to t 3 ) and improve the cutoff characteristics, and to reverse bias the base-emitter of the output transistor 2 during the retrace pulse generation period.
ところがベース抵抗4は、I1を大きくするため
には小さくせねばならないが、I2を大きくとるに
はベースコンデンサ3の放電がベース抵抗4を通
して行なわれないように大きくせねばならない。
つまり、I1とI2を同時に大きくとるためにベース
抵抗4に要求される条件は矛盾する。 However, the base resistor 4 must be made small in order to increase I 1 , but it must be made large so that the base capacitor 3 is not discharged through the base resistor 4 in order to increase I 2 .
In other words, the conditions required of the base resistor 4 to simultaneously increase I 1 and I 2 are contradictory.
従つて従来回路では、充分大きいI1とI2を必要
とする大出力の水平出力回路には、導通状態、遮
断状態ともに安定した性能を得るのは困難であつ
た。 Therefore, in the conventional circuit, it has been difficult to obtain stable performance in both the conduction state and the cutoff state for a high-output horizontal output circuit that requires sufficiently large I 1 and I 2 .
本発明の目的は、上記の従来技術の欠点を解決
し、出力トランジスタのコレクタ・エミツタ飽和
電圧を小さくし、遮断特性を良くして水平出力回
路を安定に信類性高く動作させる水平励振回路を
提供するにある。 An object of the present invention is to solve the above-mentioned drawbacks of the prior art, and to provide a horizontal excitation circuit that reduces the collector-emitter saturation voltage of the output transistor, improves the cutoff characteristics, and operates the horizontal output circuit stably and with high reliability. It is on offer.
本発明は出力トランジスタのベースコンデンサ
と並列にスイツチング素子を入れ、順方向ベース
電流時にはスイツチング素子を導通状態にし、逆
方向ベース電流時および帰線パルス発生時にはス
イツチング素子を遮断状態とするようにした。こ
れによりIB1も−IB2も大きくとれ大出力の水平
出力回路でも出力トランジスタのコレクタ・エミ
ツタ飽和電圧を小さくし、かつ、遮断特性を良く
することができる。 In the present invention, a switching element is placed in parallel with the base capacitor of the output transistor, and the switching element is made conductive when a forward base current is applied, and is cut off when a reverse base current is generated or when a retrace pulse is generated. As a result, both I B1 and -I B2 can be made large, and even in a high-output horizontal output circuit, the collector-emitter saturation voltage of the output transistor can be reduced and the cutoff characteristics can be improved.
第2図は本発明による水平励振回路の一実施例
を示す回路図である。 FIG. 2 is a circuit diagram showing an embodiment of the horizontal excitation circuit according to the present invention.
図において、励振トランジスタ1、出力トラン
ジスタ2、およびベースコンデンサ3は、第1図
に示す従来の回路と同様であるが、コンデンサ3
と並列に入る抵抗4に直列に、NPN形のベース
電流制御トランジスタ5のコレクタ・エミツタ径
路が接続される。このトランジスタ5のエミツ
タ、コレクタおよびベースはそれぞれ出力トラン
ジスタ2のベース、励振トランジスタのエミツ
タ、および発振出力パルスと同位相のパルスを発
生する回路に接続される。ベース電流制御トラン
ジスタ5のベースに印加するパルスは、t1〜t2期
間中はベース電流制御トランジスタ5を導通状態
に、t2〜t4期間中は遮断状態になるように設定す
る。 In the figure, an excitation transistor 1, an output transistor 2, and a base capacitor 3 are similar to the conventional circuit shown in FIG.
A collector-emitter path of an NPN type base current control transistor 5 is connected in series with a resistor 4 which is connected in parallel with the resistor 4 . The emitter, collector, and base of this transistor 5 are respectively connected to the base of the output transistor 2, the emitter of the excitation transistor, and a circuit that generates a pulse having the same phase as the oscillation output pulse. The pulse applied to the base of the base current control transistor 5 is set so that the base current control transistor 5 is conductive during the period t 1 to t 2 and cut off during the period t 2 to t 4 .
このようにしたので、出力トランジスタ2の順
方向ベース電流期間(t1〜t2)は、ベース電流制御
トランジスタ5が導通状態となりベース抵抗4を
小さくとればI1を充分大きくとれる。また出力ト
ランジスタ2の逆方向電流期間及び遮断期間(t2
〜t4)はベース電流制御トランジスタ5が遮断状
態となり、ベースコンデンサ3の電荷は、励振ト
ランジスタエミツタ抵抗6、出力トランジスタ2
のベースエミツタ間を通して放電する。従つて、
第1図に示す従来回路はベースコンデンサ3の電
荷が主にベース抵抗4を通して放電していたのに
対して、本回路ではIB2を大きくとれるととも
に、帰線パルス発生期間中も充分に出力トランジ
スタのベース・エミツタ間を、ベースコンデンサ
3の電荷で逆バイアスすることができる。 With this arrangement, during the forward base current period (t 1 to t 2 ) of the output transistor 2, the base current control transistor 5 becomes conductive, and if the base resistance 4 is made small, I 1 can be made sufficiently large. In addition, the reverse current period and cutoff period (t 2
~t 4 ), the base current control transistor 5 is cut off, and the charge in the base capacitor 3 is transferred to the excitation transistor emitter resistor 6 and the output transistor 2.
discharge between the base and emitter of the Therefore,
In the conventional circuit shown in Fig. 1, the charge in the base capacitor 3 was mainly discharged through the base resistor 4, but in this circuit, I B2 can be made large, and the output transistor is sufficiently discharged even during the retrace pulse generation period. It is possible to reverse bias between the base and emitter of the base capacitor 3 by the electric charge of the base capacitor 3.
上記実施例は、ベース電流制御トランジスタ5
としてNPN形を使用したが、PNP形トランジス
タで、出力トランジスタ2のベース側にそのコレ
クタ、励振トランジスタ1のエミツタ側にそのエ
ミツタ、発振出力パルスと逆位相のパルスを発生
する回路にそのベースを接続しても、上記実施例
と同じ動作になる。また、トランジスタでなくと
も、サイリスタ等のスイツチング素子を接続して
も同等の動作になる。 In the above embodiment, the base current control transistor 5
Although an NPN type transistor was used as the oscillation output pulse, it is a PNP type transistor whose collector is connected to the base side of output transistor 2, its emitter is connected to the emitter side of excitation transistor 1, and its base is connected to a circuit that generates a pulse with the opposite phase to the oscillation output pulse. However, the operation is the same as in the above embodiment. Further, even if a switching element such as a thyristor is connected instead of a transistor, the same operation can be achieved.
また、スイツチング素子を駆動するパルスは、
発振出力パルスと完全に同位相又は逆位相でなく
とも、出力トランジスタ2を遮断状態に励振し始
めた時点(t2)の近傍で、スイツチング素子を導
通状態から遮断状態に駆動するものであれば、ほ
ぼ同等の効果を期待できる。 In addition, the pulse that drives the switching element is
Even if it is not completely in phase with the oscillation output pulse or in opposite phase, as long as it drives the switching element from the conductive state to the cut-off state near the time (t 2 ) when the output transistor 2 starts to be excited to the cut-off state. , almost the same effect can be expected.
また、本実施例のような励振トランジスタがな
く、発振出力で直接出力トランジスタを励振する
場合でも同様である。 The same applies even when there is no excitation transistor as in this embodiment and the output transistor is directly excited by the oscillation output.
本発明によれば、出力トランジスタ2のコレク
タ・エミツタ飽和電圧を低く、かつ遮断特性を良
くでき、また帰線パルス発生期間中出力トランジ
スタ2を充分遮断状態に励振できる。 According to the present invention, the collector-emitter saturation voltage of the output transistor 2 can be lowered and the cut-off characteristics can be improved, and the output transistor 2 can be sufficiently excited to the cut-off state during the retrace pulse generation period.
これにより、大出力の水平出力回路にも励振ト
ランスなしの安価な回路で安定に信頼性高く出力
トランジスタ2を励振することができる。 This makes it possible to stably and reliably excite the output transistor 2 even in a high-output horizontal output circuit using an inexpensive circuit without an excitation transformer.
第1図は従来の水平励振回路を示す回路図、第
2図は本発明による水平励振回路の一実施例を示
す回線図、第3図は本発明による水平励振回路主
要部の動作電圧、電流波形を示す図である。
2……水平出力トランジスタ、3……コンデン
サ、4……抵抗、5……トランジスタ。
Fig. 1 is a circuit diagram showing a conventional horizontal excitation circuit, Fig. 2 is a circuit diagram showing an embodiment of the horizontal excitation circuit according to the present invention, and Fig. 3 is an operating voltage and current of the main parts of the horizontal excitation circuit according to the present invention. It is a figure which shows a waveform. 2...Horizontal output transistor, 3...Capacitor, 4...Resistor, 5...Transistor.
Claims (1)
スタをオン、オフする励振信号を発生する励振段
と、水平出力トランジスタのベースと励振段との
間に接続されたコンデンサと、抵抗と開閉素子と
からなり、コンデンサに対して並列接続された直
列回路とから構成され、上記開閉素子は、水平出
力トランジスタが遮断状態に励振され始めた時点
で導通状態から遮断状態となり、その後水平出力
トランジスタの導通開始時点で再び導通状態とな
ることを特徴とする水平励振回路。1 Consists of a horizontal output transistor, an excitation stage that generates an excitation signal to turn on and off the horizontal output transistor, a capacitor connected between the base of the horizontal output transistor and the excitation stage, a resistor, and a switching element. The switching element changes from a conductive state to a cut-off state when the horizontal output transistor starts to be excited to the cut-off state, and then becomes conductive again when the horizontal output transistor starts conducting. A horizontal excitation circuit characterized by being in a state.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12259378A JPS5550778A (en) | 1978-10-06 | 1978-10-06 | Horizontal exciting circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12259378A JPS5550778A (en) | 1978-10-06 | 1978-10-06 | Horizontal exciting circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5550778A JPS5550778A (en) | 1980-04-12 |
| JPS6247031B2 true JPS6247031B2 (en) | 1987-10-06 |
Family
ID=14839760
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12259378A Granted JPS5550778A (en) | 1978-10-06 | 1978-10-06 | Horizontal exciting circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5550778A (en) |
-
1978
- 1978-10-06 JP JP12259378A patent/JPS5550778A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5550778A (en) | 1980-04-12 |
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