JPS6322692B2 - - Google Patents
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- JPS6322692B2 JPS6322692B2 JP56126099A JP12609981A JPS6322692B2 JP S6322692 B2 JPS6322692 B2 JP S6322692B2 JP 56126099 A JP56126099 A JP 56126099A JP 12609981 A JP12609981 A JP 12609981A JP S6322692 B2 JPS6322692 B2 JP S6322692B2
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/02—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas
- H04B7/04—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas
- H04B7/08—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas at the receiving station
- H04B7/0802—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas at the receiving station using antenna selection
- H04B7/0805—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas at the receiving station using antenna selection with single receiver and antenna switching
- H04B7/0814—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas at the receiving station using antenna selection with single receiver and antenna switching based on current reception conditions, e.g. switching to different antenna when signal level is below threshold
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- Signal Processing (AREA)
- Mobile Radio Communication Systems (AREA)
- Radio Transmission System (AREA)
Description
【発明の詳細な説明】
本発明は、ダイバーシテイ受信において、ダイ
バーシテイ用アンテナに優先度をつけて、通常、
優先度の高い主ダイバーシテイ用アンテナで受信
し、優先度の高い主ダイバーシテイ用アンテナの
受信レベルが低下したときに、優先度の低い補助
ダイバーシテイ用アンテナで受信し、その間時分
割的に主ダイバーシテイ用アンテナの受信レベル
を監視し、主ダイバーシテイ用アンテナの受信レ
ベルが回復すれば、直ちに主ダイバーシテイ用ア
ンテナで受信するようにした車載用に好適なダイ
バーシテイ受信装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION In diversity reception, the present invention prioritizes diversity antennas and
Reception is performed using the main diversity antenna with a high priority, and when the reception level of the main diversity antenna with a high priority decreases, reception is performed using the auxiliary diversity antenna with a low priority. The present invention relates to a diversity receiving device suitable for use in a vehicle, which monitors the reception level of a diversity antenna, and when the reception level of the main diversity antenna recovers, immediately receives the signal with the main diversity antenna.
以下、本発明のダイバーシテイ受信装置の実施
例について、図面を参照して説明する。 Embodiments of the diversity receiving apparatus of the present invention will be described below with reference to the drawings.
第1図において、1および2はダイバーシテイ
受信用の主アンテナおよび補助アンテナ、3はそ
れらの主アンテナ1と補助アンテナ2をいずれか
に切換えて受信機24に信号を導くための半導体
スイツチなどからなる切換スイツチ部、17はそ
の切換えのためのコントロール端子、4は受信機
24のチユーナ回路、5は中間周波増幅回路、6
はFM検波回路、7は自動車のイグニツシヨン系
で発生するノイズを除去するためのインパルス雑
音制限回路、10はスピーカである。11は中間
周波増巾回路5より受信レベルに応じた出力を取
出す受信レベル検知用の端子、12は前記端子1
1に接続され、かつ、主アンテナ1に応じた受信
レベル検知出力を得るために、後述の制御回路2
2のクロツク発生回路18からのクロツクパルス
によつて、主アンテナ1のレベルが低下したとき
だけ時分割的に補助アンテナ2より主アンテナ1
に切換えて、主アンテナ1の受信レベルを検知す
るためのサンプルスイツチ、14は上記サンプル
スイツチ12によつて得たアンテナ1の受信レベ
ルを蓄える(記憶する)ためのサンプルホールド
回路、13は主アンテナ1の受信レベルが低下し
たときにスピーカ10に現われる聴感上のノイズ
の検知許容限に設定した基準電圧ESを発生する基
準電圧源、15は主アンテナ1の受信レベルを蓄
えたサンプルホールド回路14の電圧レベルと基
準電圧源13の基準電圧ESとを比較する比較回
路、16は前記比較回路15の出力と、アンテナ
切換パルス回路19の出力を得て主アンテナ1の
受信レベルが高い時は切換スイツチ部3を主アン
テナ1に接続し、主アンテナ1の受信レベルが低
下したときだけ時分割的に補助アンテナ2より主
アンテナ1に切換えるように制御信号を切換スイ
ツチ部3のコントロール端子17に与える駆動回
路、22は上記各部の回路を正常に作動させるた
めに、タイミングを合わせるための制御回路であ
る。この制御回路22において、クロツク発生回
路18のクロツクパルスを受けてアンテナ切換パ
ルス回路19で駆動回路16へアンテナ切換パル
スを与える。 In FIG. 1, 1 and 2 are the main antenna and auxiliary antenna for diversity reception, and 3 is a semiconductor switch for switching between the main antenna 1 and the auxiliary antenna 2 to guide the signal to the receiver 24. 17 is a control terminal for switching, 4 is a tuner circuit of the receiver 24, 5 is an intermediate frequency amplification circuit, and 6
1 is an FM detection circuit, 7 is an impulse noise limiting circuit for removing noise generated in the ignition system of an automobile, and 10 is a speaker. Reference numeral 11 indicates a terminal for detecting a reception level from which an output corresponding to the reception level is output from the intermediate frequency amplification circuit 5; and 12 indicates the terminal 1.
1, and in order to obtain a reception level detection output according to the main antenna 1, a control circuit 2, which will be described later, is connected to the main antenna 1.
Only when the level of the main antenna 1 decreases due to the clock pulse from the clock generation circuit 18 of the second clock generator 18, the main antenna 1 is transferred from the auxiliary antenna 2 in a time-division manner.
14 is a sample hold circuit for storing (memorizing) the reception level of antenna 1 obtained by the sample switch 12; 13 is a main antenna; 15 is a sample hold circuit 14 that stores the reception level of the main antenna 1; 15 is a reference voltage source that generates a reference voltage E S that is set to the permissible detection limit for auditory noise that appears in the speaker 10 when the reception level of the main antenna 1 has decreased; A comparison circuit 16 compares the voltage level of the reference voltage E S of the reference voltage source 13 with the reference voltage E S of the reference voltage source 13. A comparison circuit 16 obtains the output of the comparison circuit 15 and the output of the antenna switching pulse circuit 19, and when the reception level of the main antenna 1 is high, The changeover switch section 3 is connected to the main antenna 1, and a control signal is sent to the control terminal 17 of the changeover switch section 3 so as to switch from the auxiliary antenna 2 to the main antenna 1 in a time-sharing manner only when the reception level of the main antenna 1 decreases. The driving circuit 22 provided is a control circuit for adjusting the timing in order to operate the circuits of the above-mentioned parts normally. In this control circuit 22, an antenna switching pulse circuit 19 applies an antenna switching pulse to the drive circuit 16 in response to a clock pulse from a clock generating circuit 18.
サンプルパルス回路20はアンテナ切換パルス
回路19に接続され、アンテナ切換パルス期間中
に主アンテナ1の受信レベルをサンプルホールド
するためにサンプルスイツチ12へ信号を与え
る。リセツトパルス回路21はサンプルパルス回
路20に接続され、サンプルパルスのスタートと
同期して、サンプルホールド回路14にリセツト
パルスを与える。 Sample pulse circuit 20 is connected to antenna switching pulse circuit 19 and provides a signal to sample switch 12 to sample and hold the reception level of main antenna 1 during the antenna switching pulse period. A reset pulse circuit 21 is connected to the sample pulse circuit 20 and provides a reset pulse to the sample hold circuit 14 in synchronization with the start of the sample pulse.
以上の12〜22でダイバーシテイ受信装置の
制御部23が構成されている。 The above 12 to 22 constitute the control section 23 of the diversity receiving device.
次に、以上のように構成したダイバーシテイ受
信装置の動作について、第1図および第2図の信
号波形図を参照して説明する。なお、第1図中に
付した信号a〜eは第2図a〜eの波形に対応す
る。今、切換スイツチ部3が主アンテナ1に接続
されていて、主アンテナ1で受信を行なつている
と仮定すると、そのアンテナ出力はチユーナ回路
4、中間周波増幅回路5を経てFM検波回路6、
インパルス雑音制限回路7、ステレオ復調回路
8、電力増幅回路9を通つてスピーカ10より発
音せられる。 Next, the operation of the diversity receiver configured as described above will be explained with reference to the signal waveform diagrams of FIGS. 1 and 2. Note that the signals a to e shown in FIG. 1 correspond to the waveforms in FIG. 2 a to e. Now, assuming that the changeover switch section 3 is connected to the main antenna 1 and that the main antenna 1 is receiving data, the antenna output passes through the tuner circuit 4, the intermediate frequency amplification circuit 5, the FM detection circuit 6, and the main antenna 1.
Sound is generated from a speaker 10 through an impulse noise limiting circuit 7, a stereo demodulation circuit 8, and a power amplification circuit 9.
一方、受信レベルに応じた第2図aの信号aが
端子11に出力されている。また、制御回路22
はクロツク発生回路18によつて5〜30msec毎
に第2図bのクロツクパルスbを発生し、これに
より、アンテナ切換パルス回路19、サンプルパ
ルス回路21を連動して動作させる。すなわちク
ロツク発生回路18からのクロツクパルスbによ
つてアンテナ切換パルス回路19がそのクロツク
パルスbの立上りに同期して第2図cに示すごと
き10〜30μsec程度のアンテナ切換パルスcを発生
し、駆動回路16へアンテナ切換えパルスcを与
える。しかし、駆動回路16はもう一方の入力を
比較回路15より得ており、主アンテナ1で受信
機24が受信している場合は比較回路15の情報
により駆動回路16は動作しないようにしてい
る。したがつて時分割的なアンテナの切換え動作
は行なわれない。 On the other hand, a signal a shown in FIG. 2a corresponding to the reception level is output to the terminal 11. In addition, the control circuit 22
The clock pulse b shown in FIG. 2B is generated by the clock generating circuit 18 every 5 to 30 msec, thereby causing the antenna switching pulse circuit 19 and the sample pulse circuit 21 to operate in conjunction. That is, in response to the clock pulse b from the clock generation circuit 18, the antenna switching pulse circuit 19 generates an antenna switching pulse c of about 10 to 30 μsec as shown in FIG. An antenna switching pulse c is applied to the antenna switching pulse c. However, the drive circuit 16 receives the other input from the comparison circuit 15, and when the receiver 24 is receiving signals through the main antenna 1, the information from the comparison circuit 15 prevents the drive circuit 16 from operating. Therefore, no time-division antenna switching operation is performed.
一方、アンテナ切換パルス回路19に接続され
たサンプルパルス回路20は切換スイツチ部3が
切換わつて、チユーナ回路4、中間周波増幅回路
5、端子11に受信レベルが現われるまでの時間
(5〜20μsec)に合わすように第2図dに示すご
ときサンプルパルスdをサンプルスイツチ12に
与える。これと同時にサンプルパルス回路20に
接続されたリセツトパルス回路21で第2図eに
示すごときリセツトパルスeをサンプルホールド
回路14に与えて、あらかじめリセツトしてお
く。このようにすることにより主アンテナ1の受
信レベルは端子11よりサンプルスイツチ12を
介してサンプルホールド回路14へ蓄えられる。
しかし、今の場合、主アンテナ1に切換スイツチ
部3が接続されて、駆動回路16が動作していな
いため、切換スイツチ部3がアンテナ1のまま
で、主アンテナ1の受信レベルが端子11、サン
プルスイツチ12を介してサンプルホールド回路
14へ蓄えられる。そして、サンプルホールド回
路14の出力を比較器15の一方の入力に加え、
他方を受信機24の聴感上のノイズ検知許容限レ
ベルに設定した基準電圧ESを加えて比較し、主ア
ンテナ1の受信レベルが高い時は駆動回路16へ
情報を与えて、そのまま切換スイツチ部3を動か
さず主アンテナ1で受信する。主アンテナ1の受
信レベルが基準電圧ESより高い時はこのまま繰り
返し動作をし、主アンテナ1のみで受信機24は
受信する〔第2図の動作I参照〕。したがつて、
アンテナ切換えの時分割は行なわない。 On the other hand, the sample pulse circuit 20 connected to the antenna switching pulse circuit 19 takes the time (5 to 20 μsec) from when the changeover switch section 3 is switched until the reception level appears at the tuner circuit 4, intermediate frequency amplification circuit 5, and terminal 11. A sample pulse d as shown in FIG. At the same time, a reset pulse circuit 21 connected to the sample pulse circuit 20 applies a reset pulse e as shown in FIG. 2e to the sample hold circuit 14 to reset it in advance. By doing this, the reception level of the main antenna 1 is stored in the sample hold circuit 14 from the terminal 11 via the sample switch 12.
However, in this case, the switch section 3 is connected to the main antenna 1 and the drive circuit 16 is not operating, so the switch section 3 remains at the antenna 1, and the reception level of the main antenna 1 is set to terminal 11, The signal is stored in the sample hold circuit 14 via the sample switch 12. Then, the output of the sample and hold circuit 14 is added to one input of the comparator 15,
The other voltage is compared by adding a reference voltage E S set to the audible noise detection tolerance level of the receiver 24, and when the reception level of the main antenna 1 is high, information is given to the drive circuit 16, and the changeover switch section is directly switched. Receive with main antenna 1 without moving antenna 3. When the reception level of the main antenna 1 is higher than the reference voltage ES , the operation is repeated as it is, and the receiver 24 receives only the main antenna 1 [see operation I in FIG. 2]. Therefore,
Time division of antenna switching is not performed.
しかし、主アンテナ1の受信レベルが基準電圧
ESと比較して低下して来た場合〔第2図動作〕
すなわち端子11、サンプルスイツチ12を介し
てサンプルホールド回路14に蓄えた主アンテナ
1の受信レベルが基準電圧ESと比較して低くなる
と、比較器15は駆動回路16へ情報を与えて駆
動回路16より切換スイツチ部3のコントロール
端子17にアンテナを主アンテナ1から補助アン
テナ2に切換えるように信号を送る。したがつて
補助アンテナ2で受信機24が受信し始める。こ
の時、本発明は主アンテナ1の受信レベルが回復
すれば直に主アンテナ1に戻すように考慮してい
る。すなわち、補助アンテナ2による受信におい
て、アンテナ切換パルス回路19からのアンテナ
切換スイツチ部3のコントロール端子17に与え
られ、時分割的に5〜30μsecの間、主アンテナ1
に切換えられる。このことにより、前記しにタイ
ミングで制御回路23が動作し、主アンテナ1に
切換わつた時のみ主アンテナ1の受信レベルを端
子11、サンプルスイツチ12を介してサンプル
ホールド回路14へ蓄える。ここで前記と同様に
基準電圧ESとサンプルホールド回路14の主アン
テナの受信レベルに相当するレベルを比較回路1
5で比較して、主アンテナ1の受信レベルが低く
なければ、そのまま補助アンテナ2で受信機24
が受信し、主アンテナ1の受信レベルが回復すれ
ば主アンテナ1で受信機24が受信するように動
作する。すなわちサンプルホールド回路14には
常に主アンテナ1の受信レベルが蓄えられてお
り、補助アンテナ2が動作しているときのみ、ア
ンテナ切換パルス回路19、駆動回路16、切換
スイツチ部3が連動して主アンテナ1のレベルを
時分割で取り入れる構成となつている。 However, the reception level of main antenna 1 is at the reference voltage.
If it has decreased compared to E S [Figure 2 operation]
That is, when the reception level of the main antenna 1 stored in the sample and hold circuit 14 via the terminal 11 and the sample switch 12 becomes lower than the reference voltage ES , the comparator 15 gives information to the drive circuit 16. A signal is sent to the control terminal 17 of the changeover switch section 3 to switch the antenna from the main antenna 1 to the auxiliary antenna 2. Therefore, the receiver 24 starts receiving signals using the auxiliary antenna 2. At this time, the present invention takes into consideration that the signal is returned to the main antenna 1 as soon as the reception level of the main antenna 1 recovers. That is, during reception by the auxiliary antenna 2, the signal is applied from the antenna switching pulse circuit 19 to the control terminal 17 of the antenna switching switch section 3, and the main antenna 1 is
can be switched to As a result, the control circuit 23 operates at the timing described above and stores the reception level of the main antenna 1 in the sample hold circuit 14 via the terminal 11 and the sample switch 12 only when switching to the main antenna 1 is performed. Here, as before, the reference voltage E S and the level corresponding to the reception level of the main antenna of the sample and hold circuit 14 are compared to the comparison circuit 1.
5, if the reception level of main antenna 1 is not low, use auxiliary antenna 2 as is to receive receiver 24.
receives the signal, and when the reception level of the main antenna 1 recovers, the receiver 24 operates to receive the signal using the main antenna 1. That is, the sample and hold circuit 14 always stores the reception level of the main antenna 1, and only when the auxiliary antenna 2 is operating, the antenna switching pulse circuit 19, drive circuit 16, and changeover switch section 3 are linked to switch the main antenna 1 to the main antenna 1. The configuration is such that the level of antenna 1 is taken in in a time-division manner.
すなわち、本発明は通常、主アンテナで受信
し、主アンテナの受信レベルが低下したときだ
け、補助アンテナにより受信し、主アンテナの受
信レベルが回復すれば直に主アンテナで受信する
ようにしたもので、特に主アンテナが、車体外に
設置したモノポールアンテナ、補助アンテナが車
のフロントガラスやリヤガラスに装着したウイン
ドシールドアンテナの場合に最も有効に動作す
る。 That is, the present invention normally receives signals using the main antenna, receives signals using the auxiliary antenna only when the receiving level of the main antenna drops, and immediately receives signals using the main antenna when the receiving level of the main antenna recovers. This works most effectively when the main antenna is a monopole antenna installed outside the vehicle body, and the auxiliary antenna is a windshield antenna attached to the car's windshield or rear glass.
第3図に本発明の要部の具体的な構成例を示
す。これは第1図に点線枠で示した制御部23の
部分であり、図中の25は第1図の端子11から
の信号を受けるための入力増幅器である。アナロ
グスイツチ26は第1図のサンプルスイツチ12
に相当する。演算増幅器27および29、ダイオ
ード28、トランジスタ30、コンデンサCは第
1図のサンプルホールド回路14に相当する。演
算増幅器31、ダイオード32、インバータ33
は第1図の比較回路15に相当する。図中、ESは
第1図の基準電圧ESに相当する。NANDゲート
回路34、インバータ35,36および37は第
1図の駆動回路16に相当する。インバータ38
および39は第1図のクロツク発生回路18に相
当する。インバータ40、NANDゲート回路4
1は第1図のアンテナ切換パルス回路19に相当
する。インバータ42および44、NANDゲー
ト回路43は第1図のサンプルパルス回路20に
相当する。NANDゲート回路45、インバータ
46は第1図のリセツトパルス回路21に相当す
る。この場合、受信機の受信レベルと受信レベル
検知用の端子11の電位関係が逆極性であるた
め、すなわち受信レベルが高くなると端子11の
電圧が低下する構成となつているため、サンプル
スイツチ回路からサンプルホールド回路、比較回
路まで逆極性で動作させている。また、この回路
ではサンプルホールド回路にピークホールドを行
なわせており、第1図の基本ブロツク図と全く同
様の作用をする。また、第1図の制御回路22に
相当する部分は、第2図のタイミング関係が保た
れれば、どのように変更してもさしつかえないこ
とはいうまでもない。また、基準電圧ESは半固定
である。さらに電界変動に対して安定性を増すた
め、端子11より積分回路を介して与えることも
できる。 FIG. 3 shows a specific example of the configuration of the main parts of the present invention. This is a part of the control section 23 shown in a dotted frame in FIG. 1, and 25 in the figure is an input amplifier for receiving a signal from the terminal 11 in FIG. The analog switch 26 is the sample switch 12 in FIG.
corresponds to Operational amplifiers 27 and 29, diode 28, transistor 30, and capacitor C correspond to sample and hold circuit 14 in FIG. Operational amplifier 31, diode 32, inverter 33
corresponds to the comparator circuit 15 in FIG. In the figure, E S corresponds to the reference voltage E S in FIG. NAND gate circuit 34 and inverters 35, 36 and 37 correspond to drive circuit 16 in FIG. Inverter 38
and 39 correspond to the clock generation circuit 18 in FIG. Inverter 40, NAND gate circuit 4
1 corresponds to the antenna switching pulse circuit 19 in FIG. Inverters 42 and 44 and NAND gate circuit 43 correspond to sample pulse circuit 20 in FIG. NAND gate circuit 45 and inverter 46 correspond to reset pulse circuit 21 in FIG. In this case, since the potential relationship between the receiving level of the receiver and the terminal 11 for detecting the receiving level is of opposite polarity, that is, the voltage at the terminal 11 decreases as the receiving level increases, so the sample switch circuit Even the sample hold circuit and comparison circuit operate with reverse polarity. Further, in this circuit, a sample and hold circuit performs peak hold, and the operation is exactly the same as that in the basic block diagram of FIG. It goes without saying that the portion corresponding to the control circuit 22 in FIG. 1 may be changed in any way as long as the timing relationship in FIG. 2 is maintained. Further, the reference voltage E S is semi-fixed. Further, in order to increase the stability against electric field fluctuations, it is also possible to apply it from the terminal 11 via an integrating circuit.
もう一つの構成例を第4図に示す。これを説明
すると、演算増幅器47は第3図の25と同様の
入力増幅器である。アアナログスイツチ48は第
1図のサンプルスイツチ12に相当する。演算増
幅器49およびコンデンサCは第1図のサンプル
ホールド回路に相当する。演算増幅器50および
ダイオード51は第1図の比較回路15に相当す
る。図中、ESは第1図の基準電圧ESに相当する。
NANDゲート回路52、インバータ53,54
および55は第1図の駆動回路16に相当する。
インバータ56および57は第1図のクロツク発
生回路18に相当する。インバータ58、
NANDゲート回路59は第1図のアンテナ切換
パルス回路19に相当する。インバータ60およ
び62、NANDゲート回路61は第1図のサン
プルパルス回路20に相当する。この場合の入力
は第3図と同様に逆極性の入力となつている。ま
た、第3図のピークホールドを取り除いて、普通
のサンプルホールドを行なわすことにより、第1
図のリセツトパルス回路21が無くなり、より簡
単なダイバーシテイ受信装置が実現できる。これ
も動作的には第1図の場合と全く同じであり、特
に車載のFMラジオ用のダイバーシテイ受信にお
いて、感度の良好な車体外部に取付けたモノポー
ルアンテナを主アンテナとし、ガラスに装着した
ウインドシールアンテナを補助アンテナとすれば
構成が簡単で動作の確実なダイバーシテイ受信を
行なうことができ、スキツプノイズ、ピケツトフ
エンシング、マルチパスに有効である。 Another configuration example is shown in FIG. To explain this, operational amplifier 47 is an input amplifier similar to 25 in FIG. Analog switch 48 corresponds to sample switch 12 in FIG. Operational amplifier 49 and capacitor C correspond to the sample and hold circuit shown in FIG. Operational amplifier 50 and diode 51 correspond to comparator circuit 15 in FIG. In the figure, E S corresponds to the reference voltage E S in FIG.
NAND gate circuit 52, inverters 53, 54
and 55 correspond to the drive circuit 16 in FIG.
Inverters 56 and 57 correspond to clock generation circuit 18 in FIG. inverter 58,
NAND gate circuit 59 corresponds to antenna switching pulse circuit 19 in FIG. Inverters 60 and 62 and NAND gate circuit 61 correspond to sample pulse circuit 20 in FIG. In this case, the input is of opposite polarity as in FIG. 3. Also, by removing the peak hold in Figure 3 and performing ordinary sample hold, the first
Since the reset pulse circuit 21 shown in the figure is eliminated, a simpler diversity receiving device can be realized. This is also operationally exactly the same as the case shown in Figure 1, and in particular, in diversity reception for car-mounted FM radios, the main antenna is a monopole antenna attached to the outside of the car body, which has good sensitivity, and is attached to the glass. If the wind seal antenna is used as an auxiliary antenna, diversity reception can be performed with a simple configuration and reliable operation, and is effective against skip noise, picket fencing, and multipath.
第1図は本発明の一実施例の要部ブロツク図、
第2図a,b,c,d,eは第1図における各部
の信号波形図、第3図および第4図は本発明で使
用し得る要部の具体回路構成図である。
1…主アンテナ、2…補助アンテナ、3…切換
スイツチ部、11…受信レベル検知用の端子、1
2…サンプルスイツチ、13…基準電圧源、14
…サンプルホールド回路、15…比較回路、16
…駆動回路、18…クロツク発生回路、19…ア
ンテナ切換パルス回路、20…サンプルパルス回
路、21…リセツトパルス回路、22…制御回
路、23…制御部、24…受信機。
FIG. 1 is a block diagram of essential parts of an embodiment of the present invention.
2a, b, c, d, and e are signal waveform diagrams of each part in FIG. 1, and FIGS. 3 and 4 are specific circuit configuration diagrams of main parts that can be used in the present invention. 1... Main antenna, 2... Auxiliary antenna, 3... Selector switch section, 11... Terminal for detecting reception level, 1
2...Sample switch, 13...Reference voltage source, 14
...Sample hold circuit, 15...Comparison circuit, 16
...Drive circuit, 18...Clock generation circuit, 19...Antenna switching pulse circuit, 20...Sample pulse circuit, 21...Reset pulse circuit, 22...Control circuit, 23...Control unit, 24...Receiver.
Claims (1)
助アンテナと、それらの主アンテナと補助アンテ
ナを選択するごとく切換える切換スイツチ部と、
その切換スイツチからのアンテナ出力が与えられ
る受信機と、その受信機に設けた受信レベル検知
端子からの出力に応動して前記切換スイツチ部を
制御するダイバーシテイ受信制御部を具備し、か
つ前記ダイバーシテイ制御部は前記切換スイツチ
部を駆動する駆動回路と、受信レベル検知端子よ
り主アンテナの受信レベルを保持するサンプルホ
ールド回路と、前記受信レベル検知端子の出力を
前記サンプルホールド回路へ主アンテナの受信レ
ベルのみを入力せしめるサンプルスイツチと、前
記サンプルホールド回路の出力レベルと基準電圧
とを比較し、その出力を前記駆動回路に与える比
較回路と、前記サンプルスイツチと前記サンプル
ホールド回路および前記駆動回路を作動せしめる
サンプルパルスとリセツトパルスおよびアンテナ
切換パルスを発生する制御回路を含めて成り、前
記主アンテナの受信レベルの高い時に優先的に主
アンテナにて受信し、主アンテナの受信レベルが
低いときのみ前記補助アンテナで受信し、かつ前
記制御回路により時分割的に主アンテナの受信レ
ベルを監視し主アンテナの受信レベルが回復すれ
ば主アンテナで受信するように自動的に切換える
ごとく構成したことを特徴としたダイバーシテイ
受信装置。1. A main antenna and an auxiliary antenna for diversity reception, and a selector switch section that selectively switches between the main antenna and the auxiliary antenna;
The receiver is provided with an antenna output from the changeover switch, and a diversity reception control section that controls the changeover switch section in response to the output from a reception level detection terminal provided in the receiver, and The city control section includes a drive circuit that drives the changeover switch section, a sample hold circuit that holds the reception level of the main antenna from the reception level detection terminal, and an output of the reception level detection terminal that is sent to the sample and hold circuit to receive the main antenna. a sample switch that inputs only the level; a comparison circuit that compares the output level of the sample and hold circuit with a reference voltage and supplies the output to the drive circuit; and a comparison circuit that operates the sample switch, the sample and hold circuit, and the drive circuit. The control circuit includes a control circuit that generates a sample pulse, a reset pulse, and an antenna switching pulse, so that when the reception level of the main antenna is high, the main antenna receives the signal preferentially, and when the reception level of the main antenna is low, the auxiliary antenna receives the signal preferentially. It is characterized by being configured such that the signal is received by the antenna, and the control circuit monitors the reception level of the main antenna in a time-sharing manner, and when the reception level of the main antenna recovers, the signal is automatically switched to receive by the main antenna. Diversity receiver.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56126099A JPS5827444A (en) | 1981-08-12 | 1981-08-12 | Diversity receiver |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56126099A JPS5827444A (en) | 1981-08-12 | 1981-08-12 | Diversity receiver |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5827444A JPS5827444A (en) | 1983-02-18 |
| JPS6322692B2 true JPS6322692B2 (en) | 1988-05-12 |
Family
ID=14926581
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56126099A Granted JPS5827444A (en) | 1981-08-12 | 1981-08-12 | Diversity receiver |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5827444A (en) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2695414B2 (en) * | 1987-07-10 | 1997-12-24 | アイシン・エィ・ダブリュ株式会社 | Vehicle navigation system |
| JP2698356B2 (en) * | 1987-07-10 | 1998-01-19 | アイシン・エィ・ダブリュ株式会社 | Vehicle navigation system |
| CA1292584C (en) * | 1987-11-30 | 1991-11-26 | Henry Ludwig Kazecki | Antenna selection control circuit |
| CA2052802A1 (en) * | 1990-10-11 | 1993-04-05 | Robert R. Clappier | Fm receiver anti-fading method and system |
-
1981
- 1981-08-12 JP JP56126099A patent/JPS5827444A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5827444A (en) | 1983-02-18 |
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