JPS6326636B2 - - Google Patents
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- Publication number
- JPS6326636B2 JPS6326636B2 JP57098969A JP9896982A JPS6326636B2 JP S6326636 B2 JPS6326636 B2 JP S6326636B2 JP 57098969 A JP57098969 A JP 57098969A JP 9896982 A JP9896982 A JP 9896982A JP S6326636 B2 JPS6326636 B2 JP S6326636B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- motor
- controlled
- edge detection
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000003708 edge detection Methods 0.000 claims description 12
- 238000007493 shaping process Methods 0.000 claims description 9
- 230000001934 delay Effects 0.000 claims description 3
- 230000001360 synchronised effect Effects 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 5
- 239000003990 capacitor Substances 0.000 description 4
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P7/00—Arrangements for regulating or controlling the speed or torque of electric DC motors
- H02P7/06—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual DC dynamo-electric motor by varying field or armature current
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Control Of Direct Current Motors (AREA)
Description
【発明の詳細な説明】
本発明は周波数発電機を装着した直流モータの
可変速制御装置に関する。
可変速制御装置に関する。
従来、周波数発電機〔以下、FGと称す〕を使
用した可変速制御装置は第１図のように構成され
ている。１は被制御直流モータ７に装着された
FGで、波形整形回路２を介して出力波形を整形
し単安定マルチバイブレータ３と混合器４、積分
器５により周波数／電圧変換して、電力増幅器６
により電力増幅して前記被制御直流モータ７を駆
動するものである。かかる従来の構成で１：10以
上の大きな変速範囲を安定に得るには、単安定マ
ルチバイブレータ３の規定時間と積分器５の積分
時間を速度設定値に連動して動かす必要があつ
て、実際の回路構成、精度、安定性に関して問題
の多いものである。
用した可変速制御装置は第１図のように構成され
ている。１は被制御直流モータ７に装着された
FGで、波形整形回路２を介して出力波形を整形
し単安定マルチバイブレータ３と混合器４、積分
器５により周波数／電圧変換して、電力増幅器６
により電力増幅して前記被制御直流モータ７を駆
動するものである。かかる従来の構成で１：10以
上の大きな変速範囲を安定に得るには、単安定マ
ルチバイブレータ３の規定時間と積分器５の積分
時間を速度設定値に連動して動かす必要があつ
て、実際の回路構成、精度、安定性に関して問題
の多いものである。
本発明は、回転に同期した信号を発生するFG
を装着した被制御直流モータと、前記FGの信号
を矩形波の整形する波形整形回路と、前記波形整
形回路の矩形波のエツジを検出して第１の信号を
出力するエツジ検出回路と、前記エツジ検出回路
の第１の信号を遅延させて第２の信号を出力する
遅延回路と、前記被制御直流モータの速度設定信
号を積分し、前記遅延回路の第２の信号によりリ
セツトされる積分器と、前記積分器の出力信号を
前記エツジ検出回路の第１の信号によりサンプル
ホールドするサンプルホールド回路と、前記サン
プルホールド回路の出力信号と前記速度設定信号
を加算する加算器とを設け、この加算器の出力を
前記被制御直流モータへの印加電圧信号としたこ
とを特徴とし、負荷トルクによる速度変動分と速
度設定信号で指示される無負荷回転速度とを分け
て、これを加算器で加算して印加電圧信号とする
ため、速度設定信号を変更するだけで低速から高
速に至る広範囲においても安定した可変速制御を
行うことができる効果がある。
を装着した被制御直流モータと、前記FGの信号
を矩形波の整形する波形整形回路と、前記波形整
形回路の矩形波のエツジを検出して第１の信号を
出力するエツジ検出回路と、前記エツジ検出回路
の第１の信号を遅延させて第２の信号を出力する
遅延回路と、前記被制御直流モータの速度設定信
号を積分し、前記遅延回路の第２の信号によりリ
セツトされる積分器と、前記積分器の出力信号を
前記エツジ検出回路の第１の信号によりサンプル
ホールドするサンプルホールド回路と、前記サン
プルホールド回路の出力信号と前記速度設定信号
を加算する加算器とを設け、この加算器の出力を
前記被制御直流モータへの印加電圧信号としたこ
とを特徴とし、負荷トルクによる速度変動分と速
度設定信号で指示される無負荷回転速度とを分け
て、これを加算器で加算して印加電圧信号とする
ため、速度設定信号を変更するだけで低速から高
速に至る広範囲においても安定した可変速制御を
行うことができる効果がある。
以下本発明の一実施例を第２図と第３図に基づ
いて説明する。なお、第１図と同様のものには同
一符号を付けてその説明を省く。
いて説明する。なお、第１図と同様のものには同
一符号を付けてその説明を省く。
８は波形整形回路２出力信号のエツジを検出す
るエツジ検出回路、９はエツジ検出回路８出力を
遅らせる遅延回路、１０は速度設定信号となる可
変直流電源、１１はリセツト機能を有する積分
器、１２はサンプルホールド回路、１３は加算器
である。FG１の出力を波形整形回路２によつて
矩形波Ａ〔第３図参照〕に整形し、エツジ検出回
路８によつて矩形波Ａの立上がりと立下がりを検
出して信号Ｂを得る。次にこの信号Ｂを遅延回路
９で時間ｔだけ遅延させて信号Ｃを得る。積分器
１１によつて速度設定信号となる可変直流電源１
０の信号Ｄを積分し前述の信号Ｃでリセツトして
積分出力信号Ｅを得る。信号Ｅを前述の信号Ｂに
よつてサンプルしてサンプルホールド回路１２に
よつてホールドして出力信号Ｆを得る。加算器１
３では信号Ｆと信号Ｄとが加算されて信号Ｇが出
力される。被制御直流モータ７は信号Ｇを電力増
幅器６を介して増幅した信号Ｇで駆動される。
るエツジ検出回路、９はエツジ検出回路８出力を
遅らせる遅延回路、１０は速度設定信号となる可
変直流電源、１１はリセツト機能を有する積分
器、１２はサンプルホールド回路、１３は加算器
である。FG１の出力を波形整形回路２によつて
矩形波Ａ〔第３図参照〕に整形し、エツジ検出回
路８によつて矩形波Ａの立上がりと立下がりを検
出して信号Ｂを得る。次にこの信号Ｂを遅延回路
９で時間ｔだけ遅延させて信号Ｃを得る。積分器
１１によつて速度設定信号となる可変直流電源１
０の信号Ｄを積分し前述の信号Ｃでリセツトして
積分出力信号Ｅを得る。信号Ｅを前述の信号Ｂに
よつてサンプルしてサンプルホールド回路１２に
よつてホールドして出力信号Ｆを得る。加算器１
３では信号Ｆと信号Ｄとが加算されて信号Ｇが出
力される。被制御直流モータ７は信号Ｇを電力増
幅器６を介して増幅した信号Ｇで駆動される。
更に前記各部を詳細に説明すると、波形整形回
路２はコンパレータ１４とダイオード１５、抵抗
器１６によつて、エツジ検出回路８は抵抗器１７
とコンデンサ１８とシユミツト回路１９とEx−
OR回路２０によつて、遅延回路９は抵抗器２１
とコンデンサ２２とシユミツト回路２３によつ
て、リセツト機能を有する積分器１は抵抗器２４
とコンデンサ２５とアナログスイツチ２６とオペ
アンプ２７によつて、サンプルホールド回路１２
はバツフアアンプ２８とアナログスイツチ２９と
コンデンサ３０によつて、加算器１３はオペアン
プ３１と抵抗器３２，３３，３４によつてそれぞ
れ構成されている。電力増幅器６は取扱う電力の
大きさによつてアナログ式あるいはPWMによる
デイジタル式等により構成される。
路２はコンパレータ１４とダイオード１５、抵抗
器１６によつて、エツジ検出回路８は抵抗器１７
とコンデンサ１８とシユミツト回路１９とEx−
OR回路２０によつて、遅延回路９は抵抗器２１
とコンデンサ２２とシユミツト回路２３によつ
て、リセツト機能を有する積分器１は抵抗器２４
とコンデンサ２５とアナログスイツチ２６とオペ
アンプ２７によつて、サンプルホールド回路１２
はバツフアアンプ２８とアナログスイツチ２９と
コンデンサ３０によつて、加算器１３はオペアン
プ３１と抵抗器３２，３３，３４によつてそれぞ
れ構成されている。電力増幅器６は取扱う電力の
大きさによつてアナログ式あるいはPWMによる
デイジタル式等により構成される。
第３図に示す第２図の要部波形図は、Ｐ点から
Ｑ点にわたつて速度設定信号である信号Ｄの大き
さを徐々に大きくしたもので、信号Ｇに相当する
信号Ｇが被制御直流モータ７に印加されると、回
転速度が上昇し、それにつれてFG１の整形波形
である信号Ａの周波数も高くなつていることがわ
かる。また、通常、遅延回路９の遅延時間ｔは、
動作に支障のない範囲で出来るだけ小さく設定さ
れる。
Ｑ点にわたつて速度設定信号である信号Ｄの大き
さを徐々に大きくしたもので、信号Ｇに相当する
信号Ｇが被制御直流モータ７に印加されると、回
転速度が上昇し、それにつれてFG１の整形波形
である信号Ａの周波数も高くなつていることがわ
かる。また、通常、遅延回路９の遅延時間ｔは、
動作に支障のない範囲で出来るだけ小さく設定さ
れる。
直流モータの無負荷回転速度が印加電圧にほぼ
比例するところから、被制御直流モータ７の速度
制御を無負荷回転速度と負荷トルクによる速度変
動分を分けて別々の信号処理を行い、最後に加算
器１３により加算して被制御直流モータ７への印
加電圧を得るものであつて、具体的には無負荷時
に被制御直流モータ７の回転が信号Ｄで指示され
る無負荷回転速度となるよう加算器１３の抵抗器
３３と３４の比率を設定してゲインを調節し、こ
れに速度変動分の信号Ｆを加算器１３で加算して
被制御直流モータ７への印加電圧とするため、速
度設定信号を変更するだけで、広範囲にわたつて
しかも安定して被制御直流モータ７の回転速度を
変更できる。
比例するところから、被制御直流モータ７の速度
制御を無負荷回転速度と負荷トルクによる速度変
動分を分けて別々の信号処理を行い、最後に加算
器１３により加算して被制御直流モータ７への印
加電圧を得るものであつて、具体的には無負荷時
に被制御直流モータ７の回転が信号Ｄで指示され
る無負荷回転速度となるよう加算器１３の抵抗器
３３と３４の比率を設定してゲインを調節し、こ
れに速度変動分の信号Ｆを加算器１３で加算して
被制御直流モータ７への印加電圧とするため、速
度設定信号を変更するだけで、広範囲にわたつて
しかも安定して被制御直流モータ７の回転速度を
変更できる。
以上説明のように本発明によると次のような効
果が得られる。
果が得られる。
無負荷回転速度と回転変動分を別々に分けて
制御しているため、特に回転変動分の単位回転
数あたりの信号の大きさを大きくとることがで
き、安定な動作が期待できる。
制御しているため、特に回転変動分の単位回転
数あたりの信号の大きさを大きくとることがで
き、安定な動作が期待できる。
と同じ理由で低速から高速に至る１：10以
上の広範囲な可変速制御を安定に行うことがで
きる。
上の広範囲な可変速制御を安定に行うことがで
きる。
速度設定信号として電圧あるいは電流を直接
に扱うことができ、他の機器よりの信号により
速度設定を行う場合にインターフエースが容易
である。
に扱うことができ、他の機器よりの信号により
速度設定を行う場合にインターフエースが容易
である。
の理由により低電圧電源での回路構成が容
易でTTL回路と同じ５ボルト単一電源での動
作が可能である。
易でTTL回路と同じ５ボルト単一電源での動
作が可能である。
第１図は従来の可変速制御装置の構成図、第２
図は本発明による可変速制御装置の一実施例の構
成図、第３図は第２図の要部波形図である。 １……周波数発電機、２……波形整形回路、７
……被制御直流モータ、８……エツジ検出回路、
９……遅延回路、１０……可変直流電源、１１…
…積分器、１２……サンプルホールド回路、１３
……加算器、Ｄ……速度設定信号。
図は本発明による可変速制御装置の一実施例の構
成図、第３図は第２図の要部波形図である。 １……周波数発電機、２……波形整形回路、７
……被制御直流モータ、８……エツジ検出回路、
９……遅延回路、１０……可変直流電源、１１…
…積分器、１２……サンプルホールド回路、１３
……加算器、Ｄ……速度設定信号。
Claims (1)
- １ 回転に同期した信号を発生する周波数発電機
を装着した被制御直流モータと、前記周波数発電
機の信号を矩形波に整形する波形整形回路と、前
記波形整形回路の矩形波のエツジを検出して第１
の信号を出力するエツジ検出回路と、前記エツジ
検出回路の第１の信号を遅延させて第２の信号を
出力する遅延回路と、前記被制御直流モータの速
度設定信号を積分し、前記遅延回路の第２の信号
によりリセツトされる積分器と、前記積分器の出
力信号を前記エツジ検出回路の第１の信号により
サンプルホールドするサンプルホールド回路と、
前記サンプルホールド回路の出力信号と前記速度
設定信号を加算する加算器とを備え、前記加算器
の出力を前記被制御直流モータへの印加電圧信号
とした可変速制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57098969A JPS58215991A (ja) | 1982-06-08 | 1982-06-08 | 可変速制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57098969A JPS58215991A (ja) | 1982-06-08 | 1982-06-08 | 可変速制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58215991A JPS58215991A (ja) | 1983-12-15 |
| JPS6326636B2 true JPS6326636B2 (ja) | 1988-05-31 |
Family
ID=14233877
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57098969A Granted JPS58215991A (ja) | 1982-06-08 | 1982-06-08 | 可変速制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58215991A (ja) |
-
1982
- 1982-06-08 JP JP57098969A patent/JPS58215991A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58215991A (ja) | 1983-12-15 |
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