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JPH0225305B2 - - Google Patents
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JPH0225305B2 - - Google Patents

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Publication number
JPH0225305B2
JPH0225305B2 JP11658385A JP11658385A JPH0225305B2 JP H0225305 B2 JPH0225305 B2 JP H0225305B2 JP 11658385 A JP11658385 A JP 11658385A JP 11658385 A JP11658385 A JP 11658385A JP H0225305 B2 JPH0225305 B2 JP H0225305B2
Authority
JP
Japan
Prior art keywords
clock pulse
modulation signal
signal
phase modulation
value
Prior art date
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Expired
Application number
JP11658385A
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Japanese (ja)
Other versions
JPS61276453A (en
Inventor
Yojiro Yokoi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kyosan Electric Manufacturing Co Ltd
Original Assignee
Kyosan Electric Manufacturing Co Ltd
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Filing date
Publication date
Application filed by Kyosan Electric Manufacturing Co Ltd filed Critical Kyosan Electric Manufacturing Co Ltd
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Publication of JPH0225305B2 publication Critical patent/JPH0225305B2/ja
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  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Description

【発明の詳細な説明】[Detailed description of the invention]

〔産業上の利用分野〕 本発明は、各種データの伝送に際し、特定周波
数の搬送波に対してデイジタル信号の変調信号に
より位相変調を行なう方法に関するものである。 〔従来の技術〕 デイジタル信号を変調信号として用い、これに
よつて位相変調を行なう場合、従来は、デイジタ
ル・アナログ変換器(以下、DAC)によりデイ
ジタル信号をアナログ信号へ変換してから、アナ
ログ回路の位相変調器へ与え、最終的にはアナロ
グ回路により位相変調信号を得るものとなつてい
る。 〔発明が解決しようとする問題点〕 しかし、アナログ回路の位相変調器は、温度の
変動等に応じて特性が変化し、デイジタル信号の
変調信号により示される値と発生した位相変調信
号の位相角との間に誤差を生じ易く、これを低減
するには、位相変調器の構成が複雑化し、高価に
なる等の問題を招来している。 〔問題点を解決するための手段〕 前述の問題を解決するため、本発明はつぎの手
段により構成するものとなつている。 すなわち、内部に第1および第2のカウンタを
設けたマイクロコンピユータに対し、搬送波の周
波数に対して整数倍の高い周波数を有する第1の
クロツクパルス、および、位相変調信号の位相変
化速度に応じた周波数を有する第2のクロツクパ
ルスを各々第1および第2の割込入力へ与え、か
つ、複数ビツトからなるデイジタル信号の変調信
号をデータとして与えると共に、第1のクロツク
パルスに応じ第1のカウンタに一定値を逐次加算
し、変調信号の示す値と第2のカウンタのカウン
ト値とが一致するまで第2のクロツクパルスに応
じて第2のカウンタを逐次加減算し、第1および
第2のカウンタの各カウント値を加算した値を正
弦波データへ変換して送出する動作をマイクロコ
ンピユータのプロセツサに反復して行なわせ、正
弦波データをアナログ信号へ変換して位相変調信
号を発生するものとしている。 〔作 用〕 したがつて、第1のクロツクパルスに応じて第
1のカウンタが一定値までの加算を反復し、これ
のカウント値が搬送波の各瞬時値を示すものとな
る一方、変調信号の値にしたがつて第2のカウン
タが第2のクロツクパルスに応じて加算または減
算を行ない、これのカウント値が位相変調角を示
すものとなり、第1および第2のカウンタの各カ
ウント値を加算すれば位相変調信号の各瞬時値が
得られるため、これを正弦波データへ変換してか
らアナログ信号へ更に変換すると、位相変調信号
が得られる。 〔実施例〕 以下、実施例を示す図によつて本発明の詳細を
説明する。 第1図は全構成のブロツク図であり、マイクロ
コンピユータ(以下、μCP)1は、プロセツサ
(以下、CPU)11、固定メモリ(以下、ROM)
12、可変メモリ(以下、RAM)13、インタ
ーフエイス(以下、I/F)15,16により構
成され、ROM12中の命令をCPU11が実行
し、必要とするデータをRAM13に対してアク
セスしながら所定の動作を行なうものになつてい
ると共に、CPU11中のレジスタまたはRAM1
3中の特定エリアにより第1および第2のカウン
タが構成されており、これが位相変調信号の発生
に用いられるものとなつている。 なお、ROM12またはRAM13中には、正
弦波信号のデータが少なくとも1/2周期分テー
ブルとして格納されており、これを用いてCPU
11が正弦波データへの変換を行なうものとなつ
ている。 また、μCP1は、第1および第2の割込入力
INT1,INT2を有し、これらには、位相変調信号
の搬送波周波数Tに対し、整数N倍の高い周波数
N・Tを有する第1のクロツクパルスPC1、およ
び位相変調信号の位相変化速度に応じた周波数S
を有する第2のクロツクパルスPC2が各個に与え
られており、これらに応じてCPU11が割込処
理を行なうと共に、複数のaビツトからなるデイ
ジタル信号による変調信号SMがI/F15を介
し、データとして与えられており、これに応じて
所定の動作を反復し、正弦波データDSをI/F
16から送出するものとなつている。 正弦波データDSは、DAC2によりアナログ信
号へ変換されるが、これには、μCP1のデイジタ
ル処理による量子化雑音を含んでおり、低域波
器(以下、LPF)3によりこれを除去したうえ、
位相変調信号SPMとして送出される。 第2図は、CPU11による定常処理のフロー
チヤートであり、上述の第1および第2のカウン
タの各カウント値“n1+n2=n”101を演算し、
上述のテーブルにより、“nに基づきDSへ変換”
102を行ない、これによつて求めた正弦波データ
“DS送出”103を行なつたうえ、ステツプ101以降
を反復する。 ここにおいて、一定値をN−1とし、これが例
えば3桁の2進数〔111〕により示されるものと
すれば、カウント値n1は、後述のとおり〔000〕
〜N−1をクロツクパルスPC1に応じ、一定周期
により反復しており、カウント値n2を3桁の2進
数〔010〕および〔100〕とした場合、各カウント
値n1、n2と加算値nとの関係は次表のとおりにな
る。
[Industrial Application Field] The present invention relates to a method of performing phase modulation on a carrier wave of a specific frequency using a modulation signal of a digital signal when transmitting various data. [Prior Art] When using a digital signal as a modulation signal to perform phase modulation, conventionally, the digital signal is converted to an analog signal by a digital-to-analog converter (hereinafter referred to as DAC), and then the digital signal is converted to an analog signal by an analog circuit. is applied to the phase modulator, and finally a phase modulation signal is obtained by an analog circuit. [Problems to be Solved by the Invention] However, the characteristics of the analog circuit phase modulator change depending on changes in temperature, etc., and the value indicated by the modulation signal of the digital signal and the phase angle of the generated phase modulation signal Errors tend to occur between the two, and in order to reduce this error, the configuration of the phase modulator becomes complicated and expensive, etc., resulting in problems. [Means for Solving the Problems] In order to solve the above-mentioned problems, the present invention is constituted by the following means. That is, a first clock pulse having a high frequency that is an integral multiple of the carrier wave frequency, and a frequency corresponding to the phase change rate of the phase modulation signal, are applied to a microcomputer that has first and second counters inside. A second clock pulse having a value of The second counter is successively added or subtracted in response to the second clock pulse until the value indicated by the modulation signal and the count value of the second counter match, and each count value of the first and second counters is The processor of the microcomputer is made to repeatedly convert the added value into sine wave data and send it out, converting the sine wave data into an analog signal and generating a phase modulation signal. [Function] Therefore, the first counter repeats addition up to a certain value in response to the first clock pulse, and the count value indicates each instantaneous value of the carrier wave, while the value of the modulation signal Accordingly, the second counter performs addition or subtraction according to the second clock pulse, and the count value thereof indicates the phase modulation angle, and if the respective count values of the first and second counters are added, Since each instantaneous value of the phase modulation signal is obtained, if this is converted into sine wave data and then further converted into an analog signal, a phase modulation signal is obtained. [Example] Hereinafter, details of the present invention will be explained with reference to figures showing examples. Figure 1 is a block diagram of the entire configuration. A microcomputer (hereinafter referred to as μCP) 1 includes a processor (hereinafter referred to as CPU) 11 and a fixed memory (hereinafter referred to as ROM).
12, variable memory (hereinafter referred to as RAM) 13, and interfaces (hereinafter referred to as I/F) 15 and 16. The CPU 11 executes instructions in the ROM 12, and the required data is accessed from the RAM 13 while being predetermined. It has become a device that performs the operations of the CPU 11 or the RAM 1.
A first and a second counter are configured by specific areas in 3, which are used to generate a phase modulation signal. In addition, the data of the sine wave signal is stored as a table for at least 1/2 period in the ROM 12 or RAM 13, and this is used to control the CPU.
11 is for converting into sine wave data. In addition, μCP1 has the first and second interrupt inputs.
INT 1 and INT 2 , including a first clock pulse P C1 having a frequency N· T that is an integer N times higher than the carrier frequency T of the phase modulation signal, and a first clock pulse P C1 having a frequency N· T that is an integer N times higher than the carrier frequency T of the phase modulation signal, Frequency S according to
A second clock pulse P C2 having a value of The specified operation is repeated according to this, and the sine wave data D S is
It is set to be sent from 16. The sine wave data D S is converted into an analog signal by the DAC 2, but this includes quantization noise due to the digital processing of the μCP 1, which is removed by the low frequency filter (hereinafter referred to as LPF) 3 and then converted to an analog signal. ,
It is sent out as a phase modulated signal S PM . FIG. 2 is a flowchart of steady processing by the CPU 11, in which each count value "n 1 + n 2 = n" 101 of the above-mentioned first and second counters is calculated,
According to the above table, “convert to D S based on n”
Step 102 is performed, and the sine wave data thus obtained is " Sent out" 103, and then steps 101 and subsequent steps are repeated. Here, if the constant value is N-1 and this is represented by, for example, a 3-digit binary number [111], then the count value n 1 is [000] as described below.
~N-1 is repeated at a constant cycle according to the clock pulse P C1 , and when the count value n 2 is a 3-digit binary number [010] and [100], it is added to each count value n 1 and n 2 . The relationship with the value n is as shown in the following table.

〔発明の効果〕〔Effect of the invention〕

以上の説明により明らかなとおり本発明によれ
ば、デイジタル信号を変調信号とする場合、デイ
ジタル処理により位相変調信号が発生されるた
め、変調信号の値と位相変調信号の位相角との間
に誤差を生ぜず、高忠実度の位相変調が行なわれ
るものとなり、デイジタル信号による位相変調に
おいて顕著な効果が得られる。
As is clear from the above explanation, according to the present invention, when a digital signal is used as a modulation signal, a phase modulation signal is generated by digital processing, so there is an error between the value of the modulation signal and the phase angle of the phase modulation signal. Therefore, high-fidelity phase modulation can be performed without causing any distortion, and a remarkable effect can be obtained in phase modulation using digital signals.

【図面の簡単な説明】[Brief explanation of drawings]

図は本発明の実施例を示し、第1図は全体のブ
ロツク図、第2図乃至第4図はプロセツサの動作
状況を示すフローチヤート、第5図は変調信号の
値と第2のカウンタのカウント値との関係を示す
図、第6図は各値およびデータの変化状況を示す
タイミングチヤートである。 1……μCP(マイクロコンピユータ)、2……
DAC(デイジタル・アナログ変換器)、11……
CPU(プロセツサ)、12……ROM(固定メモ
リ)、13……RAM(可変メモリ)、15,16
……I/F(インターフエイス)、INT1,INT2
…割込入力、PC1,PC2……クロツクパルス、SM
…変調信号、DS……正弦波データ、SPM……位相
変調信号。
The figures show an embodiment of the present invention; FIG. 1 is an overall block diagram, FIGS. 2 to 4 are flowcharts showing the operating status of the processor, and FIG. FIG. 6, which is a diagram showing the relationship with count values, is a timing chart showing changes in each value and data. 1...μCP (microcomputer), 2...
DAC (digital-to-analog converter), 11...
CPU (processor), 12...ROM (fixed memory), 13...RAM (variable memory), 15, 16
...I/F (interface), INT 1 , INT 2 ...
...Interrupt input, P C1 , P C2 ...Clock pulse, S M ...
...Modulation signal, D S ...Sine wave data, S PM ...Phase modulation signal.

Claims (1)

【特許請求の範囲】[Claims] 1 内部に第1および第2のカウンタを設けたマ
イクロコンピユータに対し、搬送波の周波数に対
して整数倍の高い周波数を有する第1のクロツク
パルスおよび位相変調信号の位相変化速度に応じ
た周波数を有する第2のクロツクパルスを各々第
1および第2の割込入力へ与え、かつ、複数ビツ
トからなるデイジタル信号の変調信号をデータと
して与えると共に、前記第1のクロツクパルスに
応じ第1のカウンタに一定値を逐次加算し、前記
変調信号の示す値と第2のカウンタのカウント値
とが一致するまで前記第2のクロツクパルスに応
じて第2のカウンタを逐次加減算し、前記第1お
よび第2のカウンタの各カウント値を加算した値
を正弦波データへ変換して送出する動作を前記マ
イクロコンピユータのプロセツサに反復して行な
わせ、前記正弦波データをアナログ信号へ変換し
て位相変調信号を発生することを特徴としたデイ
ジタル制御位相変調方法。
1 A microcomputer having first and second counters is provided with a first clock pulse having a frequency that is an integral multiple of the frequency of the carrier wave and a second clock pulse having a frequency corresponding to the phase change rate of the phase modulation signal. 2 clock pulses are applied to the first and second interrupt inputs respectively, and a modulated signal of a digital signal consisting of a plurality of bits is applied as data, and a constant value is sequentially input to a first counter in response to the first clock pulse. The second counter is successively added or subtracted in response to the second clock pulse until the value indicated by the modulation signal and the count value of the second counter match, and each count of the first and second counters is A processor of the microcomputer repeatedly performs an operation of converting the added value into sine wave data and sending it out, converting the sine wave data into an analog signal and generating a phase modulation signal. digitally controlled phase modulation method.
JP11658385A 1985-05-31 1985-05-31 Method for modulating digital control phase Granted JPS61276453A (en)

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JP11658385A JPS61276453A (en) 1985-05-31 1985-05-31 Method for modulating digital control phase

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JPS61276453A JPS61276453A (en) 1986-12-06
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