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JPH0137752B2 - - Google Patents
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JPH0137752B2 - - Google Patents

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Publication number
JPH0137752B2
JPH0137752B2 JP60069290A JP6929085A JPH0137752B2 JP H0137752 B2 JPH0137752 B2 JP H0137752B2 JP 60069290 A JP60069290 A JP 60069290A JP 6929085 A JP6929085 A JP 6929085A JP H0137752 B2 JPH0137752 B2 JP H0137752B2
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JP
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line
circuit
switch
switches
output
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JP60069290A
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JPS60258593A (en
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Aaru Gurifuisu Guren
Doichu Rarufu
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Yamaha Corp
Original Assignee
Yamaha Corp
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Filing date
Publication date
Application filed by Yamaha Corp filed Critical Yamaha Corp
Publication of JPS60258593A publication Critical patent/JPS60258593A/en
Publication of JPH0137752B2 publication Critical patent/JPH0137752B2/ja
Granted legal-status Critical Current

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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M11/00Coding in connection with keyboards or like devices, i.e. coding of the position of operated keys
    • H03M11/20Dynamic coding, i.e. by key scanning
    • GPHYSICS
    • G10MUSICAL INSTRUMENTS; ACOUSTICS
    • G10HELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
    • G10H1/00Details of electrophonic musical instruments
    • G10H1/18Selecting circuits
    • G10H1/182Key multiplexing

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Acoustics & Sound (AREA)
  • Multimedia (AREA)
  • Electrophonic Musical Instruments (AREA)
  • Input From Keyboards Or The Like (AREA)

Description

【発明の詳細な説明】 この発明は、複数のキースイツチおよび各種楽
音制御用または機能制御用のスイツチを有する電
子楽器に関し、特に複数のキースイツチおよび複
数の制御用スイツチと所定の利用装置との結線を
簡単化したものに関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an electronic musical instrument having a plurality of key switches and switches for controlling various musical tones or functions, and particularly relates to a method for connecting a plurality of key switches and a plurality of control switches to a predetermined utilization device. Regarding simplifications.

一般に電子オルガンや電子ピアノのような鍵盤
式電子楽器において、重要な問題は鍵盤スイツチ
と音源回路との相互接続にある。典型的な電子オ
ルガンはいくつかの手鍵盤とペダル鍵盤及びスト
ツプ選択スイツチ列とを有している。もし、別々
の接続線で各鍵盤やストツプスイツチを回路に接
続するようにした場合結線が非常に複雑となり、
そのため組立コストが高価で修理点検が困難であ
る。このため、結線の簡単化が望まれていた。
In general, in keyboard-type electronic musical instruments such as electronic organs and electronic pianos, an important problem lies in the interconnection between the keyboard switch and the sound source circuit. A typical electronic organ has several manual keyboards, a pedal keyboard, and a bank of stop selection switches. If you connect each keyboard and stop switch to the circuit using separate connection wires, the wiring will become very complicated.
Therefore, assembly costs are high and repair and inspection are difficult. For this reason, it has been desired to simplify the wiring connections.

ところで、電子オルガンのような電気楽器はキ
ーボードスイツチからの楽音選択情報を時分割多
重技術を使用することによつて適当な回路に転送
する回路を含んでいる。上記回路例は米国特許第
3610799号に示されている。上記米国特許第
3610799号の前置き部分に記載されているように、
多重化の重要な利点はキーボードからオルガンの
楽音選択部分に情報を転送するのに必要な電気配
線の量が相当に減少することである。
Incidentally, electric musical instruments such as electronic organs include circuitry that transfers tone selection information from a keyboard switch to appropriate circuitry by using time division multiplexing techniques. The above circuit example is US Patent No.
No. 3610799. The above U.S. patent no.
As stated in the preface of issue 3610799,
An important advantage of multiplexing is that it significantly reduces the amount of electrical wiring required to transfer information from the keyboard to the tone selection section of the organ.

また、多重化装置は楽音選択情報以外の情報を
転送するのに利用できる。例えば、タブスイツチ
から制御ポイシング回路に情報を転送するための
別の多重化装置が上記米国特許第3610799号の20
欄に記載されている。この多重化装置は、この装
置が利用されない場合に必要とする配線にくらべ
て配線の量を減少させる。しかしながら、この減
少は楽音選択装置は別個の追加の多重化装置によ
つて達成されるから、費用がかかり、かつ複雑と
なる。
Furthermore, the multiplexing device can be used to transfer information other than tone selection information. For example, a separate multiplexing device for transferring information from a tab switch to a control pointing circuit is provided in U.S. Pat.
column. The multiplexing device reduces the amount of wiring that would be required if the device was not utilized. However, this reduction is expensive and complex since the tone selection device is achieved by a separate and additional multiplexing device.

この発明は複数のキースイツチおよび各種楽音
制御用または機能制御用のスイツチとその利用装
置とを結ぶ配線の数を減少させ、回路の簡略化を
図るとともにコストダウンを図つた電子楽器を提
供することを目的とする この発明においては、複数のキースイツチおよ
び複数の楽音/機能制御用のスイツチを有し、該
複数のキースイツチおよび複数の楽音/機能制御
用のスイツチの操作に対応して楽音を発生する電
子楽器において、複数のキースイツチの出力およ
び複数の楽音/機能制御用のスイツチの出力を一
緒に多重化する多重化手段と、この多重化手段に
よつて多重化された信号を入力し、この信号に含
まれるキースイツチに関する情報および制御用ス
イツチに関する情報をそれぞれ所定の回路に分配
する分配手段とを具えることにより、上記目的を
達成している。
An object of the present invention is to provide an electronic musical instrument that reduces the number of wires connecting a plurality of key switches and switches for controlling various musical tones or functions and devices that utilize the same, thereby simplifying the circuit and reducing costs. The present invention provides an electronic device that has a plurality of key switches and a plurality of musical tone/function control switches, and generates a musical tone in response to the operation of the plurality of key switches and the plurality of musical tone/function control switches. In a musical instrument, a multiplexing means for multiplexing together the outputs of a plurality of key switches and the outputs of a plurality of tone/function control switches is inputted, and a signal multiplexed by the multiplexing means is inputted, and a signal multiplexed by the multiplexing means is input. The above object is achieved by including distribution means for distributing information regarding the included key switches and information regarding the control switches to predetermined circuits, respectively.

以下この発明を添附図面の実施例に関して詳細
に説明しよう。
The invention will now be described in detail with reference to the embodiments of the accompanying drawings.

第1図のキーコード化装置10において、エン
コードされるべきキースイツチは夫々N個のスイ
ツチを含むM個のグループからなるスイツチマト
リクス回路11に配列されている。これらのスイ
ツチはN列の出力ライン12に関連しており、グ
ループ選択カウンタ13によつてMグループの1
つが付勢されるとき、付勢されたグループにおい
ては閉成(オン)スイツチに対応すラインのみに
出力(すなわちスイツチオン信号)が供給され
る。
In the key encoding device 10 of FIG. 1, the key switches to be encoded are arranged in a switch matrix circuit 11 consisting of M groups each containing N switches. These switches are associated with N rows of output lines 12 and are selected by group selection counter 13 to select one of M groups.
When one is energized, only the line corresponding to the closed (on) switch in the energized group is provided with an output (ie, a switch-on signal).

スイツチマトリクス回路11からの出力ライン
12は、Nライン選択ゲート回路15と協動する
ライン走査ロジツク14によつて順次走査され
る。ついで各ライン12は母線16を経てコード
マトリクス回路17に接続される。コードマトリ
クス回路17に導通されたライン12がスイツチ
マトリクス回路11における付勢グループの閉成
スイツチに関連しているならば、スイツチオン信
号が送入されており、このスイツチオン信号を受
けてライン12における導通ラインを指定する列
識別コード信号(以下単にコードという)が母線
18に現われる。このコードは、付勢グループを
表わすグループ選択カウンタ13からの母線19
の出力(すなわち選択信号)と相伴つて、マトリ
クス回路11における閉成スイツチを顕著に識別
する。このエンコードされたキーデータは適宜の
利用手段20〜22に供給される。
Output lines 12 from switch matrix circuit 11 are sequentially scanned by line scan logic 14 in cooperation with N line select gate circuit 15. Each line 12 is then connected to a code matrix circuit 17 via a bus 16. If the line 12 conductive to the code matrix circuit 17 is associated with a closing switch of the energizing group in the switch matrix circuit 11, a switch-on signal is being applied, and in response to this switch-on signal, conduction in the line 12 is established. A column identification code signal (hereinafter simply referred to as a code) that designates a line appears on the bus bar 18. This code is the bus 19 from the group selection counter 13 representing the energized group.
(i.e., the selection signal), the closed switch in the matrix circuit 11 is clearly identified. This encoded key data is supplied to appropriate utilization means 20-22.

コードマトリクス回路17へ導通されたライン
が開放された(オフ)スイツチに関連しているな
らば、コードマトリクス回路17はコード出力を
母線18に与えない。このコード出力のない状態
は、ライン走査ロジツク14及ゲート回路15に
よつて直ちにN出力ライン12のうち次のライン
をコードマトリクス回路17に接続させる。コー
ド出力がない状態が終わるまで、無コード検出回
路23は母線18上にコード信号が存在しないこ
とを判別し、これに基づきアンド回路25の条件
を成立させるためにオア回路24を介して信号を
供給する。条件の成立したアンド回路25を介し
てクロツク発生器26から供給される1クロツク
パルスはN進循環シフトレジスタ27を1歩進さ
せる。これによりライン選択ゲート回路15が引
続く次のマトリクス出力ライン12をコードマト
リクス回路17に導通させるようにする。選択さ
れていないキースイツチの走査は高速度で進行す
る。
If the line conducted to code matrix circuit 17 is associated with an open (off) switch, code matrix circuit 17 will not provide a code output to bus 18. When there is no code output, the line scanning logic 14 and gate circuit 15 immediately connect the next line among the N output lines 12 to the code matrix circuit 17. Until the state in which no code is output ends, the no-code detection circuit 23 determines that no code signal is present on the bus 18, and based on this, it outputs a signal via the OR circuit 24 in order to satisfy the condition of the AND circuit 25. supply The one clock pulse supplied from the clock generator 26 via the AND circuit 25 where the condition is met advances the N-ary circular shift register 27 by one step. This causes the line selection gate circuit 15 to conduct the next subsequent matrix output line 12 to the code matrix circuit 17. Scanning of keyswitches that are not selected proceeds at high speed.

N進シフトレジスタ27は単一の2進ビツト1
を含んでいる。各後続段がこの2進信号1を受け
とるとき、対応するライン選択ゲート回路15が
順次動作される。シフトレジスタ27が再循環す
るとき、パルスはライン28を経てグループ選択
カウンタ13の計数入力側に供給される。これは
カウンタ13の内容を増加させ、よつてマトリク
ス回路11における次のスイツチグループを選択
可能にする。走査は、新たに選択されたグループ
の各スイツチに対応せるN個の出力ライン12が
コードマトリクス回路17に対して1つずつ導通
されるように断続されている。グループ選択カウ
ンタ13はM進であり、従つてマトリクス回路1
1の全スイツチグループは順次繰返し選択され
る。
N-ary shift register 27 is a single binary bit 1
Contains. When each subsequent stage receives this binary signal 1, the corresponding line selection gate circuit 15 is operated in sequence. When the shift register 27 recirculates, a pulse is applied via line 28 to the counting input of the group selection counter 13. This increments the contents of counter 13, thus allowing the next switch group in matrix circuit 11 to be selected. The scanning is interrupted such that the N output lines 12 corresponding to each switch of the newly selected group are made conductive to the code matrix circuit 17 one by one. The group selection counter 13 is M-ary, so the matrix circuit 1
One complete switch group is repeatedly selected in sequence.

閉成(オン)スイツチに関連するライン12が
コードマトリクス回路17へ導通される毎に、コ
ード化された出力が母線18に発生される。その
結果、無コード検出回路23から出力は生じず、
シフトレジスタ27はそのままの状態に保持され
る。これにより走査は中断され、コード化された
信号を前記手段20〜22によつて利用しうるよ
うにする。ライン30を経てオア回路24を返答
すなわち“OK”信号が与えられるとき、走査は
断続する。この“OK”信号の受信はクロツクパ
ルスをシフトレジスタ27に与え、これにより次
のマトリクス出力ライン12が走査されるように
する。返答すなわち“OK”信号は、母線18の
コード出力の発生後所定時間後に遅延回路31か
ら供給させるようにしてもよい。また他の実施例
として、エンコードされたキー情報が利用された
後に利用手断21,22によつて返答信号を発生
するようにしてもよい。
A coded output is produced on bus 18 each time line 12 associated with a close (on) switch is conducted to code matrix circuit 17. As a result, no output is generated from the no-code detection circuit 23,
The shift register 27 is maintained as it is. This interrupts the scanning and makes the coded signals available to said means 20-22. Scanning is interrupted when a response or "OK" signal is provided to OR circuit 24 via line 30. Receipt of this "OK" signal provides a clock pulse to shift register 27, which causes the next matrix output line 12 to be scanned. The response or "OK" signal may be supplied from the delay circuit 31 a predetermined time after the generation of the code output of the bus 18. In another embodiment, the response signal may be generated by the use actions 21 and 22 after the encoded key information is used.

キーコード化装置10の一具体例を第2A図、
第2B図に示す。図において、スイツチマトリク
ス回路11は、N(列)×M(行)個接続された複
数スイツチ35−1,35−2,…35−i及び
複数の切換位置をもつスイツチ35−jを有して
いる。スイツチ35−jの各切換位置はマトリク
ス回路11において別個のスイツチと見なす。ダ
イオード36は各スイツチ35に関連している。
例えば、音選択用に使用されるスイツチ35は、
鍵盤やペダル鍵によつて操作される。他のスイツ
チ35は、アタツク及びデイケイ制御用のストツ
プ選択のために使用されるか、あるいは電子楽器
におけるその他の諸機能のために使用される。
A specific example of the key encoding device 10 is shown in FIG. 2A.
It is shown in FIG. 2B. In the figure, the switch matrix circuit 11 includes a plurality of switches 35-1, 35-2, . ing. Each switching position of switch 35-j is considered a separate switch in matrix circuit 11. A diode 36 is associated with each switch 35.
For example, the switch 35 used for sound selection is
Operated by keyboard or pedal keys. Other switches 35 are used for stop selection for attack and decay control, or for other functions in the electronic musical instrument.

第2A図の具体例において、M段循環シフトレ
ジスタ13′はマトリクス回路11におけるM個
のスイツチグループを順次選択するカウンタ13
の代りに使用される。レジスタの各出力段13−
1,13−2,13−Mはグループ選択ライン1
9−1,19−2,…19−Mの各々に夫々接続
される。レジスタ13′のうち1段だけが2進信
号1を有し、これに対応するスイツチグループ3
5が選択される。レジスタ13′の残りの全段は
2進信号0である。ライン28を介してパルスを
受信する毎に該レジスタ13′はシフトされ、唯
一の信号1のビツトを次の段に移行させる。これ
によりマトリクス回路11の次のスイツチグルー
プを選択する。
In the specific example of FIG. 2A, the M-stage circular shift register 13' is a counter 13 that sequentially selects M switch groups in the matrix circuit 11.
used instead of. Each output stage 13- of the register
1, 13-2, 13-M is group selection line 1
9-1, 19-2, . . . 19-M, respectively. Only one stage of the register 13' has a binary signal 1, and the corresponding switch group 3
5 is selected. All remaining stages of register 13' are binary signal 0's. Each time a pulse is received on line 28, the register 13' is shifted, passing the only signal 1 bit to the next stage. This selects the next switch group in the matrix circuit 11.

例えば、レジスタの段13−Mが単一の信号1
のビツトを有するとすると、関連するグループを
選択するライン19−Mは正電圧となり、これに
よりライン19−Mに接続されたスイツチ35−
1乃至35−Nのグループが選択される。ライン
19−Mを除く全ての他のグループ選択ライン1
9は接地電圧となつている。ライン28に次のシ
フトパルスが生じると、レジスタ13′は再循環
し、信号1のビツトを段13−1に移行させ、か
つライン19−1に係るスイツチグループを選択
する。
For example, if stage 13-M of the register is a single signal 1
, the line 19-M selecting the associated group will be at a positive voltage, which causes the switch 35-M connected to line 19-M to
Groups 1 to 35-N are selected. All other group selection lines 1 except line 19-M
9 is the ground voltage. When the next shift pulse occurs on line 28, register 13' recirculates, transferring the signal 1 bit to stage 13-1 and selecting the switch group associated with line 19-1.

マトリクス回路の出力ライン12は抵抗37−
1乃至37−Nを介して通常、接地電圧にバイア
スされている。しかし、選択されたグループにお
いて閉成されたスイツチがあれば、それに対応す
る出力ライン12は高レベルになる。すなわちレ
ジスタ13′の選択段から供給される正電圧レベ
ルになり、これがスイツチオン信号となる。こう
して第2A図に示すように、スイツチ35−2閉
成され、ライン19−Mが選択されるとき、出力
ライン12−2が高レベルになり、他のすべての
出力ライン12は低レベルとなる。勿論、各選択
グループにおいて1以上のスイツチが閉成されて
いてもよく、また、どのスイツチも閉成されてい
なくてもよい。
The output line 12 of the matrix circuit is connected to the resistor 37-
1 to 37-N, typically biased to ground voltage. However, if there is a closed switch in the selected group, the corresponding output line 12 will be high. In other words, it becomes the positive voltage level supplied from the selection stage of the register 13', and this becomes the switch-on signal. Thus, as shown in FIG. 2A, when switch 35-2 is closed and line 19-M is selected, output line 12-2 will be high and all other output lines 12 will be low. . Of course, one or more switches in each selection group may be closed, or none of the switches may be closed.

ライン選択ゲート回路15は、各一方入力側に
各々のマトリクス出力ライン12−1乃至12−
Nが接続されたナンドゲート15−1乃至15−
Nを有する。ナンドゲート15の他の入力側はN
進循環シフトレジスタ27−1乃至27−Nが
夫々接続される。このレジスタも、アンド回路2
5からのパルスの発生によつてシフトされる単一
の2進信号1を含んでいる。この信号1を含むレ
ジスタ27の段は対応するナンドゲート15の条
件を成立させ、他のナンドゲート15の条件は成
立しない。
The line selection gate circuit 15 has one input side connected to each matrix output line 12-1 to 12-.
NAND gates 15-1 to 15- to which N is connected
It has N. The other input side of the NAND gate 15 is N
Leading circular shift registers 27-1 to 27-N are connected, respectively. This register also has AND circuit 2
contains a single binary signal 1 shifted by the occurrence of pulses from 5 to 5. The stage of the register 27 containing this signal 1 satisfies the condition of the corresponding NAND gate 15, and the conditions of the other NAND gates 15 do not hold.

この配列によれば、単一の2進信号1のビツト
がシフトレジスタ27を通して循環されるにした
がつて、各マトリクス出力ライン12はコードマ
トリクス回路17に順次接続される。例えば、ラ
イン走査サイクルの始まりにおいて、レジスタ段
27−1はライン選択ゲート回路15−1を開放
させて、コードマトリクス回路の入力ライン16
−1に出力ライン12−1を接続させる。レジス
タ27の相次ぐシフトによつて、ゲート15−2
乃至15−Nは順次開放され、対応する出力ライ
ン12−2乃至12−Nをコードマトリクス回路
17に順次接続させる。信号1のビツトが段27
−1に帰環されるとき、ライン28を介して供給
される同一のパルスはグループ選択レジスタ1
3′をシフトさせ、これによりマトリクス回路1
1の次のスイツチグループを選択させる。
According to this arrangement, each matrix output line 12 is connected sequentially to the code matrix circuit 17 as the bits of a single binary signal 1 are circulated through the shift register 27. For example, at the beginning of a line scan cycle, register stage 27-1 opens line select gate circuit 15-1 to
-1 to connect the output line 12-1. By successive shifts of register 27, gate 15-2
15-N to 15-N are sequentially opened, and the corresponding output lines 12-2 to 12-N are sequentially connected to the code matrix circuit 17. Bit of signal 1 is in stage 27
-1, the same pulse supplied via line 28 is applied to group select register 1.
3', thereby matrix circuit 1
Select the next switch group after 1.

コードマトリクス回路17は入力ライン16と
出力ライン18とを相互接続するダイオード38
−1乃至38−lからなる。出力ライン18は抵
抗39群を介して正電圧+Vにバイアスされる。
もしコードマトリクス回路17に導通した出力ラ
イン12がマトリクス回路11で選択されかつ閉
じられているスイツチに関連するものであれば、
該マトリクス回路17は出力ライン18−1乃至
18−Qにコード出力を供給する。もし選択され
たライン12がマトリクス回路において開放され
ているスイツチに係るものであれば、ライン18
−1乃至18−Qすべては高レベルのままであ
り、コード出力が存在していない状態を表わす。
Code matrix circuit 17 includes a diode 38 interconnecting input line 16 and output line 18.
-1 to 38-l. Output line 18 is biased to a positive voltage +V through a group of resistors 39.
If the output line 12 conducted to the code matrix circuit 17 is associated with a selected and closed switch in the matrix circuit 11, then
The matrix circuit 17 provides code outputs on output lines 18-1 through 18-Q. If the selected line 12 is associated with an open switch in the matrix circuit, line 18
-1 through 18-Q all remain high, representing the absence of code output.

グループライン19−Mが選択される場合、ラ
イン12−1がコードマトリクス回路17に導通
されるとき、入力ライン16−1は、対応するス
イツチ35−1が開かれているから、高レベルの
ままである。この場合、出力ライン18のすべて
は高レベルのままであり、コード出力は発生され
ない。ゲート15−2が開放すると、ライン16
−2は、対応するスイツチ35−2が閉じられて
いるため、低レベルとなる。従つて、ダイオード
38−5を介してライン16−2に接続されてい
る出力ライン18−2は低レベルにおち、ライン
18−1及び18−Qは高レベルのままであり、
この組合せは選択されたライン16−2を指定す
るコードを形成する。ライン19−M上のグルー
プ識別信号とともに、ライン18上のコードはス
イツチ35−2が閉成されていることを顕著に識
別する。
If group line 19-M is selected, when line 12-1 is conducted to code matrix circuit 17, input line 16-1 remains high since the corresponding switch 35-1 is open. It is. In this case, all of the output lines 18 remain high and no code output is generated. When gate 15-2 opens, line 16
-2 is a low level because the corresponding switch 35-2 is closed. Therefore, output line 18-2, which is connected to line 16-2 through diode 38-5, goes low and lines 18-1 and 18-Q remain high;
This combination forms the code specifying the selected line 16-2. Along with the group identification signal on line 19-M, the code on line 18 significantly identifies that switch 35-2 is closed.

第2A図の具体例において、無コード検出回路
23はライン18が接続されるアンド回路23′
からなる。ライン18−1乃至18−Qのすべて
が高レベルであれば、無コード状態を表わすもの
であり、アンド回路23′の出力もまた高レベル
である。この出力はオア回路24を経てアンド回
路25の条件を成立させ、シフトレジスタ27に
クロツクパルスを供給させる。これは該シフトレ
ジスタ27をシフトさせ、コードマトリクス回路
17に対して次のライン12を導通させる。ライ
ン18上に再びコードが発生されないとすると、
次のクロツクパルスがレジスタ27に対して加え
られる。このようにして、閉じられたスイツチ3
5が検出されるまでクロツクパルス発生器26の
クロツク速度で走査が継続される。検出される
と、ライン18にコード出力が現われ、少くとも
ライン18−1乃至18−Qの1つが低レベルと
なる。その結果、アンド回路23′の出力は低レ
ベルとなる。返答すなわち“OK”信号が利用装
置21,22あるいは遅延回路31からライン3
0を介して送出されるまでは走査は停止される。
In the embodiment of FIG. 2A, the no-code detection circuit 23 is an AND circuit 23' to which line 18 is connected.
Consisting of If lines 18-1 through 18-Q are all high, indicating a no code condition, the output of AND circuit 23' is also high. This output passes through the OR circuit 24, satisfies the condition of the AND circuit 25, and supplies the shift register 27 with a clock pulse. This shifts the shift register 27 and makes the next line 12 conductive to the code matrix circuit 17. Assuming no code is generated again on line 18,
The next clock pulse is applied to register 27. In this way, the closed switch 3
Scanning continues at the clock rate of clock pulse generator 26 until 5 is detected. When detected, a code output appears on line 18 and at least one of lines 18-1 through 18-Q goes low. As a result, the output of the AND circuit 23' becomes low level. A response or "OK" signal is sent from the utilization devices 21, 22 or delay circuit 31 to line 3.
Scanning is halted until sent through 0.

図示の例においては、ライン19−1乃び19
−2によつて選択されるマトリクス回路11のス
イツチグループが第1の利用装置20に関連して
おり、ライン19−3乃至19−5によつて選択
されるスイツチが第2の装置21に利用され、ラ
イン19−6乃至19−Mによつて選択されるス
イツチが第3の利用装置22の制御のために使用
される。第2B図は、各利用装置20〜22にキ
ーコード化装置10からのエンコードされた信号
を供給するためのゲート回路の配置例を示すもの
である。
In the illustrated example, lines 19-1 and 19
The switch group of matrix circuits 11 selected by -2 is associated with the first device 20 used, and the switches selected by lines 19-3 to 19-5 are used with the second device 21. and the switches selected by lines 19-6 to 19-M are used for controlling the third utilization device 22. FIG. 2B shows an example of the arrangement of gate circuits for supplying encoded signals from the key encoding device 10 to each of the utilization devices 20-22.

グループ選択ライン19−1乃び19−2はオ
ア回路40に夫々接続され、マトリクス回路11
において最初の2つのグループのどちらかが走査
されているときライン41上にゲート用信号を発
生させる。このゲート用信号は、アンド回路群4
2を開放させてコード送入ライン18−1乃至1
8−Q及びグループ指定ライン19−1,19−
2を第1の利用装置20に接続される。同様に、
グループ選択ライン19−8乃至19−5のいず
れかが選択されると、このライン19−8乃至1
9−5が接続されたオア回路45を介してライン
44上に供給される信号により出力アンド回路群
43が開放される。このアンド回路群43はライ
ン18のコード信号及びライン19−3乃至19
−5のグループ指定信号を第2の利用装置に供給
する。オア回路48を介して供給されるライン4
7の信号により開放されるアンド回路群46は、
グループ選択ライン19−6乃至19−Mのいず
れかが選択されるとき第3の利用装置22にエン
コード出力を供給する。
Group selection lines 19-1 and 19-2 are connected to OR circuits 40, respectively, and matrix circuit 11
generates a gating signal on line 41 when either of the first two groups is being scanned. This gate signal is applied to the AND circuit group 4.
2 and open the code feed lines 18-1 to 18-1.
8-Q and group designation lines 19-1, 19-
2 is connected to the first usage device 20. Similarly,
When any of the group selection lines 19-8 to 19-5 is selected, this line 19-8 to 19-5 is selected.
The output AND circuit group 43 is opened by a signal supplied on the line 44 via the OR circuit 45 to which 9-5 is connected. This AND circuit group 43 receives the code signal of line 18 and the lines 19-3 to 19-19.
-5 group designation signal is supplied to the second utilization device. Line 4 supplied via OR circuit 48
The AND circuit group 46 opened by the signal No. 7 is
When any of the group selection lines 19-6 to 19-M is selected, an encoded output is supplied to the third utilization device 22.

エンコード出力が第1の利用装置20に供給さ
れるとき、返答すなわち“OK”信号は遅延回路
31によつて送出される。この間中、すなわちグ
ループ選択ライン19−1または19−2のどち
らかが選択されているとき、その結果生じるライ
ン41の信号はまたアンド回路50も開放させ
る。ライン18にコード出力が発生すると、ナン
ド回路51から出力発生される。この出力は、ア
ンド回路50を介して遅延回路31に供給され
る。遅延時間の終わりに、該回路31は“OK”
信号をライン30に送出する。
When the encoded output is provided to the first utilization device 20, a reply or "OK" signal is sent by the delay circuit 31. During this time, ie, when either group select line 19-1 or 19-2 is selected, the resulting signal on line 41 also causes AND circuit 50 to open. When a code output is generated on line 18, an output is generated from NAND circuit 51. This output is supplied to the delay circuit 31 via the AND circuit 50. At the end of the delay time, the circuit 31 is “OK”
A signal is sent out on line 30.

この発明のキーコード化装置10はいかなるタ
イプの利用装置によつて使用されてもよいが、特
に、公開公報特開昭48−90217号「電子楽器」に
おいてドイチユによつて記述されたタイプの鍵盤
式電子楽器によつて有用である。この電子楽器に
おいて、発生される各楽音の基本波周波数は周波
数ナンバ記憶装置から選択された周波数ナンバに
よつて決定される。楽音の音色は予め記憶された
高調波係数の組合せによつて決定され、各係数は
発生された楽音波形を構成しているフーリエ成分
に関連する振幅を決定するものである。このよう
な高調波成分の数種の組合せは個々に記憶され、
ストツプ選択スイツチによる選択により利用に供
されるようになつていることもある。アタツク及
びデイケイは、相次ぐ音発生サイクルのなかで構
成されるフーリエ成分の振幅値を予定通り変える
ことによりデジタル的に実行される。
The key-encoding device 10 of the present invention may be used with any type of utilization device, but in particular with a keyboard of the type described by Deutsch in JP-A-48-90217 ``Electronic Musical Instruments''. Useful with electronic musical instruments. In this electronic musical instrument, the fundamental frequency of each musical tone generated is determined by a frequency number selected from a frequency number storage device. The timbre of a musical tone is determined by a combination of pre-stored harmonic coefficients, each coefficient determining the amplitude associated with the Fourier components making up the generated musical waveform. Several combinations of such harmonic components are individually stored,
It may also be made available for use by selection with a stop selection switch. Attack and decay are performed digitally by systematically varying the amplitude values of the Fourier components that are constructed in successive sound generation cycles.

キーコード化装置10がこのようなコンピユー
タオルガンに使用される場合、第1の利用装置2
0はアタツク、デイケイ制御要素を備え、第2の
利用装置21はストツプ選択回路を具え、第8の
利用装置22は音発生回路からなるものとすれば
よい。このような構成において、ライン19−6
乃至19−Mによつて選択されるスイツチグルー
プは音選択のための手鍵盤及びペダル鍵盤スイツ
チ群である。ゲート回路46を介して音発生回路
22に供給されたエンコード信号は対応する周波
数ナンバをメモリから呼出すために使用される。
この間、ゲート回路46を介して供給されるコー
ド化信号はそのまま選択された音の周波数ナンバ
メモリアドレスとなる。同様に、アタツク、デイ
ケイ制御スイツチ及びストツプ選択スイツチはマ
トリクス回路11の中に含まれており、ライン1
9−1,19−2及び19−8乃至19−5によ
つて個々に選択される。
When the key coding device 10 is used in such a computer towel gun, the first utilization device 2
0 may be provided with attack and decay control elements, the second utilization device 21 may be provided with a stop selection circuit, and the eighth utilization device 22 may be comprised of a sound generation circuit. In such a configuration, line 19-6
The switch groups selected by 19-M are manual keyboard and pedal keyboard switches for tone selection. The encoded signal supplied to the sound generation circuit 22 via the gate circuit 46 is used to recall the corresponding frequency number from memory.
During this time, the coded signal supplied via the gate circuit 46 directly becomes the frequency number memory address of the selected tone. Similarly, attack, decay control switches and stop selection switches are included in matrix circuit 11, and line 1
9-1, 19-2 and 19-8 to 19-5 individually.

以上説明したように、この発明によれば、複数
のキースイツチおよび各種制御用スイツチとその
利用装置との配線を大幅に減少させることがで
き、回路を簡略化するとともにコストダウンを図
ることができる。
As described above, according to the present invention, the wiring between a plurality of key switches and various control switches and devices using the same can be significantly reduced, and the circuit can be simplified and costs can be reduced.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明に係るキースイツチ走査及び
エンコード装置の一実施例を示す電気的ブロツク
図、第2A図及び第2B図は第1図各部回路の具
体例を示す概略電気回路図である。 10……キーコード化装置、11……スイツチ
マトリクス回路、13……グループ選択カウン
タ、14……ライン走査ロジツク、15……ライ
ン選択ゲート回路、17……コードマトリクス回
路、20〜22……利用装置、27……N進シフ
トレジスタ。
FIG. 1 is an electrical block diagram showing one embodiment of a key switch scanning and encoding device according to the present invention, and FIGS. 2A and 2B are schematic electrical circuit diagrams showing specific examples of the circuits of each part in FIG. 1. 10...Key coding device, 11...Switch matrix circuit, 13...Group selection counter, 14...Line scanning logic, 15...Line selection gate circuit, 17...Code matrix circuit, 20-22...Utilization Device, 27...N-ary shift register.

Claims (1)

【特許請求の範囲】 1 複数のキースイツチおよび複数の楽音/機能
制御用のスイツチを有し、該複数のキースイツチ
および複数の楽音/機能制御用のスイツチの操作
に対応して楽音を発生する電子楽器において、 前記複数のキースイツチの出力および前記複数
の楽音/機能制御用のスイツチの出力を一緒に多
重化する多重化手段と、 この多重化手段によつて多重化された信号を入
力し、この信号に含まれるキースイツチに関する
情報および制御用スイツチに関する情報をそれぞ
れ所定の回路に分配する分配手段と を具えた電子楽器。
[Scope of Claims] 1. An electronic musical instrument that has a plurality of key switches and a plurality of musical tone/function control switches, and generates musical tones in response to the operations of the plurality of key switches and the plurality of musical tone/function control switches. a multiplexing means for multiplexing together the outputs of the plurality of key switches and the outputs of the plurality of tone/function control switches; inputting the signal multiplexed by the multiplexing means; and distribution means for distributing information regarding the key switch and information regarding the control switch contained in the electronic musical instrument to respective predetermined circuits.
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