JP4812838B2 - 多孔質絶縁膜の形成方法 - Google Patents
多孔質絶縁膜の形成方法 Download PDFInfo
- Publication number
- JP4812838B2 JP4812838B2 JP2008525919A JP2008525919A JP4812838B2 JP 4812838 B2 JP4812838 B2 JP 4812838B2 JP 2008525919 A JP2008525919 A JP 2008525919A JP 2008525919 A JP2008525919 A JP 2008525919A JP 4812838 B2 JP4812838 B2 JP 4812838B2
- Authority
- JP
- Japan
- Prior art keywords
- raw material
- insulating film
- group
- film
- organic silica
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 0 CCC*(C)N(C)*C(OC)=CC Chemical compound CCC*(C)N(C)*C(OC)=CC 0.000 description 1
- HILVORLFDSOFOE-UHFFFAOYSA-N CN[O](C=C)O[O](C=C)(N)OC Chemical compound CN[O](C=C)O[O](C=C)(N)OC HILVORLFDSOFOE-UHFFFAOYSA-N 0.000 description 1
Images
Classifications
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
- C23C16/22—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the deposition of inorganic material, other than metallic material
- C23C16/30—Deposition of compounds, mixtures or solid solutions, e.g. borides, carbides, nitrides
- C23C16/40—Oxides
- C23C16/401—Oxides containing silicon
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W20/00—Interconnections in chips, wafers or substrates
- H10W20/01—Manufacture or treatment
- H10W20/071—Manufacture or treatment of dielectric parts thereof
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W20/00—Interconnections in chips, wafers or substrates
- H10W20/01—Manufacture or treatment
- H10W20/071—Manufacture or treatment of dielectric parts thereof
- H10W20/072—Manufacture or treatment of dielectric parts thereof of dielectric parts comprising air gaps
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W20/00—Interconnections in chips, wafers or substrates
- H10W20/40—Interconnections external to wafers or substrates, e.g. back-end-of-line [BEOL] metallisations or vias connecting to gate electrodes
- H10W20/45—Interconnections external to wafers or substrates, e.g. back-end-of-line [BEOL] metallisations or vias connecting to gate electrodes characterised by their insulating parts
- H10W20/46—Interconnections external to wafers or substrates, e.g. back-end-of-line [BEOL] metallisations or vias connecting to gate electrodes characterised by their insulating parts comprising air gaps
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/60—Formation of materials, e.g. in the shape of layers or pillars of insulating materials
- H10P14/63—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the formation processes
- H10P14/6326—Deposition processes
- H10P14/6328—Deposition from the gas or vapour phase
- H10P14/6334—Deposition from the gas or vapour phase using decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
- H10P14/6336—Deposition from the gas or vapour phase using decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition in the presence of a plasma [PECVD]
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/60—Formation of materials, e.g. in the shape of layers or pillars of insulating materials
- H10P14/66—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the type of materials
- H10P14/668—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the type of materials the materials being characterised by the deposition precursor materials
- H10P14/6681—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the type of materials the materials being characterised by the deposition precursor materials the precursor containing a compound comprising Si
- H10P14/6684—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the type of materials the materials being characterised by the deposition precursor materials the precursor containing a compound comprising Si the compound comprising silicon and oxygen
- H10P14/6686—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the type of materials the materials being characterised by the deposition precursor materials the precursor containing a compound comprising Si the compound comprising silicon and oxygen the compound being a molecule comprising at least one silicon-oxygen bond and the compound having hydrogen or an organic group attached to the silicon or oxygen, e.g. a siloxane
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/60—Formation of materials, e.g. in the shape of layers or pillars of insulating materials
- H10P14/69—Inorganic materials
- H10P14/692—Inorganic materials composed of oxides, glassy oxides or oxide-based glasses
- H10P14/6921—Inorganic materials composed of oxides, glassy oxides or oxide-based glasses containing silicon
- H10P14/6922—Inorganic materials composed of oxides, glassy oxides or oxide-based glasses containing silicon the material containing Si, O and at least one of H, N, C, F or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T428/00—Stock material or miscellaneous articles
- Y10T428/31504—Composite [nonstructural laminate]
- Y10T428/31652—Of asbestos
- Y10T428/31663—As siloxane, silicone or silane
Landscapes
- Chemical & Material Sciences (AREA)
- Mechanical Engineering (AREA)
- General Chemical & Material Sciences (AREA)
- Chemical Kinetics & Catalysis (AREA)
- Engineering & Computer Science (AREA)
- Materials Engineering (AREA)
- Inorganic Chemistry (AREA)
- Metallurgy (AREA)
- Organic Chemistry (AREA)
- Formation Of Insulating Films (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Chemical Vapour Deposition (AREA)
- Physical Vapour Deposition (AREA)
Description
前記直鎖状有機シリカ構造を持つ原料の直鎖状有機シリカ化合物が、下記式11に示す構造であり、R5は不飽和炭素化合物、R6、R7、R8は飽和炭素化合物であり、R5はビニル基又はアリル基、R6、R7、R8はメチル基、エチル基、プロピル基、イソプロピル基、ブチル基のいずれかであることを特徴とする絶縁膜の形成方法を提供する。
の原料の気体と、直鎖状有機シリカ構造を持つ1種以上の原料の気体とを、プラズマ反応
によって成膜させた有機シリカ膜の形成方法であり、環状有機シリカ構造を持つ原料は主
骨格に3員環SiO環状構造を持ち、かつ直鎖状有機シリカ構造を持つ原料の元素組成比
がH/C≧1.6、C/Si≧5、H/Si≧8であり、かつこれら原料の側鎖に少なく
とも1つの不飽和炭化水素基を持ち、
前記直鎖状有機シリカ構造を持つ原料の直鎖状有機シリカ化合物が、下記式11に示す構造であり、R5は不飽和炭素化合物、R6、R7、R8は飽和炭素化合物であり、R5はビニル基又はアリル基、R6、R7、R8はメチル基、エチル基、プロピル基、イソプロピル基、ブチル基のいずれかであることを特徴とする方法に向けられる。
本発明を用いて、層間絶縁膜として好適な絶縁膜を、少なくとも1種以上の有機シロキサン原料を反応室に供給し、プラズマ気相成長法によって絶縁膜を形成することができる。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR3にビニル基、R4にメチル基からなる式6(式7)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は1:9〜9:1である。
環状構造を持つ原料が3員環SiO環状構造を持つ原料と比較し開環しやすいと考えられる。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にエチル基からなる式1で示される原料を、第二有機シロキサン原料103にはR3にビニル基、R4にメチル基からなる式6(式7)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は8:2である。
成膜には第一有機シロキサン原料101にR1にエチル基、R2にイソプロピル基からなる式1(式4)で示される原料を、第二有機シロキサン原料103にはR3にビニル基、R4にメチル基からなる式6(式7)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は7:3である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にn−ブチル基からなる式1(式5)で示される原料を、第二有機シロキサン原料103にはR3にビニル基、R4にメチル基からなる式6(式7)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は6:4である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR3にビニル基、R4に水素からなる式6(式8)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は5:5である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR3にメチルビニル基、R4に水素からなる式6(式10)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は3:7である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR3にメチルビニル基、R4にメチル基からなる式6(式9)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は1:9である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料のみを使用した。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にメチル基からなる式6(式7)で示される原料のみを使用した。
本実施の形態では気化制御ユニットVU1の原料タンク102内に3員環SiO環状構造を持つ原料、気化制御ユニットVU2の原料タンク102内に直鎖状SiO構造を持つ原料を使い、成膜を行った。それ以外の条件は第1の実施の形態と同じとした。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR5にビニル基、R6にイソプロピル基、R7、R8にメチル基からなる式11(式12)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は1:9〜9:1である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にメチル基からなる式1(式2)で示される原料を、第二有機シロキサン原料103にはR5にビニル基、R6にイソプロピル基、R7、R8にメチル基からなる式11(式12)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は2:8である。
成膜には第一有機シロキサン原料101にR1にエチル基、R2にイソプロピル基からなる式1(式4)で示される原料を、第二有機シロキサン原料103にはR5にビニル基、R6にイソプロピル基、R7、R8にメチル基からなる式11(式12)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は3:7である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にn−ブチル基からなる式1(式5)で示される原料を、第二有機シロキサン原料103にはR5にビニル基、R6にイソプロピル基、R7、R8にメチル基からなる式11(式12)で示される原料を使用した。第一有機シロキサン原料と第二有機シロキサン原料比(モル比)は4:6である。
比較例としてSiOCH膜であるAuroraTM膜を作製し、その膜強度と密着強度を測定した。
比較例としてSiOCH膜であるBlack DiamondTM膜を作製し、その膜強度と密着強度を測定した。
次に本発明における第3の実施の形態について説明する。図1Aに示す従来のデュアルダマシン配線構造は、下層配線201上に、キャップ膜(SiCN)202、ビア層間低誘電率膜203、エッチングストッパー膜204、配線層間低誘電率膜205、ハードマスク206、キャップ膜(SiCN)207が積層されており、ビア層間低誘電率膜203中のビア及び配線層間低誘電率膜205中の配線溝には、周囲にバリア膜209が形成されて、銅208が埋め込まれている。図1Bのデュアルダマシン構造は、図1の構造から実効被誘電率を下げた構造である。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR5にビニル基、R6にイソプロピル基、R7、R8にメチル基からなる式11(式12)で示される原料を使用した。
成膜には第一有機シロキサン原料101にR1にビニル基、R2にイソプロピル基からなる式1(式3)で示される原料を、第二有機シロキサン原料103にはR3にビニル基、R4にメチル基からなる式6(式7)でされる原料を使用した。ビア層間低誘電率膜203成膜のために第一有機シロキサン原料と第二有機シロキサン原料をモル比で3:7に混合しチャンバー内で成膜を行った後、第二有機シロキサン原料の供給を止めるためVU2の110aと118aのバルブをクローズし、第一有機シロキサン原料のみを使い配線層間低誘電率膜205を形成する。次に第一有機シロキサン原料の供給を止めるためVU1の110aと118aのバルブをクローズし、第二有機シロキサン原料のみを使いハードマスク206’を形成した。
比較例5としてビア層間低誘電率膜203にAurora、エッチングストッパー膜204にはSiO2、配線層間低誘電率膜205に第一有機シロキサン原料、ハードマスク206にSiO2を使った(図1A参照)。
Claims (13)
- 環状有機シリカ構造を持つ2種以上の原料の気体をプラズマ反応によって成膜させた有機シリカ膜の形成方法であり、主骨格に3員環SiO環状構造を持つ原料と4員環SiO環状構造をもつ原料からなり、かつこれら原料の少なくとも1種は側鎖に少なくとも1つの不飽和炭化水素基を持つことを特徴とする絶縁膜の形成方法。
- 環状有機シリカ構造を持つ1種以上の原料の気体と、直鎖状有機シリカ構造を持つ1種以上の原料の気体とを、プラズマ反応によって成膜させた有機シリカ膜の形成方法であり、前記環状有機シリカ構造を持つ原料は主骨格に3員環SiO環状構造を持ち、かつ前記直鎖状有機シリカ構造を持つ原料の元素組成比がH/C≧1.6、C/Si≧5、H/Si≧8であり、かつこれら原料の少なくとも1種は、側鎖に少なくとも1つの不飽和炭化水素基を持ち、
前記直鎖状有機シリカ構造を持つ原料の直鎖状有機シリカ化合物が、下記式11に示す構造であり、R5は不飽和炭素化合物、R6、R7、R8は飽和炭素化合物であり、R5はビニル基又はアリル基、R6、R7、R8はメチル基、エチル基、プロピル基、イソプロピル基、ブチル基のいずれかであることを特徴とする絶縁膜の形成方法。
- 前記シリカ構造を持つ原料が、それぞれ異なる気化器により気体化し反応容器に導入されることを特徴とする請求項1又は2に記載の絶縁膜の形成方法。
- 前記シリカ構造を持つ原料が同一の気化器により気体化し反応容器に導入されることを特徴とする請求項1又は2に記載の絶縁膜の形成方法。
- 請求項1乃至9のいずれか一項に記載の絶縁膜の形成方法により形成される絶縁膜であって、
前記絶縁膜において少なくともアモルファスカーボンが含まれることを特徴とする絶縁膜。 - 請求項1乃至9のいずれか一項に記載の絶縁膜の形成方法により形成される絶縁膜を含む半導体デバイスであって、
前記絶縁膜にアモルファスカーボンが含まれ、かつ、前記アモルファスカーボンがSp2構造とSp3構造を兼ね備えることを特徴とする半導体デバイス。 - 請求項10に記載の絶縁膜を含む半導体デバイスであって、
前記絶縁膜に含まれるアモルファスカーボンがSp2構造とSp3構造を兼ね備えることを特徴とする半導体デバイス。 - 請求項11又は12に記載の半導体デバイスであって、
前記絶縁膜において有機シリカ構造を持つ原料の比を変化させて形成された絶縁膜を2層以上持つことを特徴とする半導体デバイス。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2008525919A JP4812838B2 (ja) | 2006-07-21 | 2007-07-23 | 多孔質絶縁膜の形成方法 |
Applications Claiming Priority (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2006199273 | 2006-07-21 | ||
| JP2006199273 | 2006-07-21 | ||
| JP2008525919A JP4812838B2 (ja) | 2006-07-21 | 2007-07-23 | 多孔質絶縁膜の形成方法 |
| PCT/JP2007/064407 WO2008010591A1 (en) | 2006-07-21 | 2007-07-23 | Method for forming porous insulating film |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPWO2008010591A1 JPWO2008010591A1 (ja) | 2009-12-17 |
| JP4812838B2 true JP4812838B2 (ja) | 2011-11-09 |
Family
ID=38956918
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2008525919A Expired - Fee Related JP4812838B2 (ja) | 2006-07-21 | 2007-07-23 | 多孔質絶縁膜の形成方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US8790785B2 (ja) |
| JP (1) | JP4812838B2 (ja) |
| CN (1) | CN101495674B (ja) |
| WO (1) | WO2008010591A1 (ja) |
Families Citing this family (17)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2006101171A1 (ja) * | 2005-03-24 | 2006-09-28 | Ulvac, Inc. | 真空部品の製造方法、樹脂被膜形成装置及び真空成膜システム |
| JP5262144B2 (ja) * | 2008-01-31 | 2013-08-14 | 日本電気株式会社 | 半導体デバイス及びその製造方法 |
| JP5554951B2 (ja) * | 2008-09-11 | 2014-07-23 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
| US8133821B2 (en) | 2008-11-18 | 2012-03-13 | Renesas Electronics Corporation | Method of manufacturing porous insulating film, method of manufacturing semiconductor device, and semiconductor device |
| JP2010278330A (ja) * | 2009-05-29 | 2010-12-09 | Renesas Electronics Corp | 半導体装置及び半導体装置の製造方法 |
| JP2011166106A (ja) * | 2010-01-13 | 2011-08-25 | Renesas Electronics Corp | 半導体装置の製造方法及び半導体装置 |
| JP2011155077A (ja) * | 2010-01-26 | 2011-08-11 | Renesas Electronics Corp | 半導体装置の製造方法 |
| JP5864095B2 (ja) * | 2010-02-18 | 2016-02-17 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
| JP2011199059A (ja) * | 2010-03-19 | 2011-10-06 | Renesas Electronics Corp | 半導体装置およびその製造方法 |
| JP2012074651A (ja) * | 2010-09-30 | 2012-04-12 | Renesas Electronics Corp | 半導体装置、及び、その製造方法 |
| JP6131575B2 (ja) * | 2011-12-22 | 2017-05-24 | 東ソー株式会社 | 環状シロキサン化合物の製造方法およびジシロキサン化合物 |
| TW201348496A (zh) * | 2012-02-15 | 2013-12-01 | 瑞薩電子股份有限公司 | 多孔性絕緣膜的製造方法以及包含該膜的半導體裝置 |
| FR2987626B1 (fr) * | 2012-03-05 | 2015-04-03 | Commissariat Energie Atomique | Procede de collage direct utilisant une couche poreuse compressible |
| JP5904866B2 (ja) | 2012-05-08 | 2016-04-20 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法および半導体装置 |
| JP6109368B2 (ja) * | 2016-03-15 | 2017-04-05 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法および半導体装置 |
| US10170308B1 (en) * | 2017-10-11 | 2019-01-01 | International Business Machines Corporation | Fabricating semiconductor devices by cross-linking and removing portions of deposited HSQ |
| JP7126381B2 (ja) * | 2018-05-21 | 2022-08-26 | 東京エレクトロン株式会社 | 成膜装置および成膜方法 |
Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH1032199A (ja) * | 1996-07-17 | 1998-02-03 | Toshiba Corp | 半導体装置 |
| JPH1187340A (ja) * | 1997-09-05 | 1999-03-30 | Mitsubishi Electric Corp | 半導体装置及びその製造方法 |
| JP2002513203A (ja) * | 1998-04-28 | 2002-05-08 | シリコン ヴァレイ グループ サーマル システムズ リミテッド ライアビリティ カンパニー | 低κ誘電性無機/有機ハイブリッドフィルム及びその製造方法 |
| WO2003019645A1 (en) * | 2001-08-30 | 2003-03-06 | Tokyo Electron Limited | Method and apparatus for forming film |
| JP2004047873A (ja) * | 2002-07-15 | 2004-02-12 | Nec Corp | 有機シロキサン共重合体膜、その製造方法、成長装置、ならびに該共重合体膜を用いた半導体装置 |
| WO2005053009A1 (ja) * | 2003-11-28 | 2005-06-09 | Nec Corporation | 多孔質絶縁膜及びその製造方法並びに多孔質絶縁膜を用いた半導体装置 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6974766B1 (en) | 1998-10-01 | 2005-12-13 | Applied Materials, Inc. | In situ deposition of a low κ dielectric layer, barrier layer, etch stop, and anti-reflective coating for damascene application |
| JP4746829B2 (ja) | 2003-01-31 | 2011-08-10 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
-
2007
- 2007-07-23 WO PCT/JP2007/064407 patent/WO2008010591A1/ja not_active Ceased
- 2007-07-23 CN CN2007800277667A patent/CN101495674B/zh not_active Expired - Fee Related
- 2007-07-23 US US12/374,390 patent/US8790785B2/en active Active
- 2007-07-23 JP JP2008525919A patent/JP4812838B2/ja not_active Expired - Fee Related
Patent Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH1032199A (ja) * | 1996-07-17 | 1998-02-03 | Toshiba Corp | 半導体装置 |
| JPH1187340A (ja) * | 1997-09-05 | 1999-03-30 | Mitsubishi Electric Corp | 半導体装置及びその製造方法 |
| JP2002513203A (ja) * | 1998-04-28 | 2002-05-08 | シリコン ヴァレイ グループ サーマル システムズ リミテッド ライアビリティ カンパニー | 低κ誘電性無機/有機ハイブリッドフィルム及びその製造方法 |
| WO2003019645A1 (en) * | 2001-08-30 | 2003-03-06 | Tokyo Electron Limited | Method and apparatus for forming film |
| JP2004047873A (ja) * | 2002-07-15 | 2004-02-12 | Nec Corp | 有機シロキサン共重合体膜、その製造方法、成長装置、ならびに該共重合体膜を用いた半導体装置 |
| WO2005053009A1 (ja) * | 2003-11-28 | 2005-06-09 | Nec Corporation | 多孔質絶縁膜及びその製造方法並びに多孔質絶縁膜を用いた半導体装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| US20090246538A1 (en) | 2009-10-01 |
| WO2008010591A1 (en) | 2008-01-24 |
| CN101495674A (zh) | 2009-07-29 |
| US8790785B2 (en) | 2014-07-29 |
| JPWO2008010591A1 (ja) | 2009-12-17 |
| CN101495674B (zh) | 2013-07-17 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP4812838B2 (ja) | 多孔質絶縁膜の形成方法 | |
| JP5267130B2 (ja) | 半導体装置およびその製造方法 | |
| US7964442B2 (en) | Methods to obtain low k dielectric barrier with superior etch resistivity | |
| JP4689026B2 (ja) | 極限低誘電率膜のためのキャッピング層 | |
| JP5554951B2 (ja) | 半導体装置の製造方法 | |
| CN100431110C (zh) | 低介电氮化硅膜的形成方法和半导体器件及其制造工艺 | |
| JP4090740B2 (ja) | 集積回路の作製方法および集積回路 | |
| CN102237272B (zh) | 半导体装置和半导体装置制造方法 | |
| US6737747B2 (en) | Advanced BEOL interconnect structures with low-k PE CVD cap layer and method thereof | |
| JP5168142B2 (ja) | 半導体装置 | |
| US7564136B2 (en) | Integration scheme for Cu/low-k interconnects | |
| US20090093100A1 (en) | Method for forming an air gap in multilevel interconnect structure | |
| US20030134499A1 (en) | Bilayer HDP CVD / PE CVD cap in advanced BEOL interconnect structures and method thereof | |
| JP2011166106A (ja) | 半導体装置の製造方法及び半導体装置 | |
| US9059259B2 (en) | Hard mask for back-end-of-line (BEOL) interconnect structure | |
| KR20050020612A (ko) | 저유전율막을 형성하는 방법 | |
| US9870944B2 (en) | Back-end-of-line (BEOL) interconnect structure | |
| JP5093479B2 (ja) | 多孔質絶縁膜の形成方法 | |
| JP4656147B2 (ja) | 多孔質絶縁膜の形成方法および半導体装置 | |
| US7314828B2 (en) | Repairing method for low-k dielectric materials | |
| CN101241857A (zh) | 形成介电结构的方法以及半导体结构 | |
| US7129164B2 (en) | Method for forming a multi-layer low-K dual damascene | |
| JP2010287655A (ja) | 半導体装置の製造方法 | |
| JP2016129259A (ja) | 半導体装置の製造方法および半導体装置 | |
| JP2011181672A (ja) | 低誘電率層間絶縁膜および低誘電率層間絶縁膜の成膜方法 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| RD01 | Notification of change of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7421 Effective date: 20100223 |
|
| A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20100618 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20110426 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110623 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20110719 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110801 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20110823 |
|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20110823 |
|
| R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140902 Year of fee payment: 3 |
|
| S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| LAPS | Cancellation because of no payment of annual fees |